JPH0944117A - 画像表示装置 - Google Patents
画像表示装置Info
- Publication number
- JPH0944117A JPH0944117A JP7193713A JP19371395A JPH0944117A JP H0944117 A JPH0944117 A JP H0944117A JP 7193713 A JP7193713 A JP 7193713A JP 19371395 A JP19371395 A JP 19371395A JP H0944117 A JPH0944117 A JP H0944117A
- Authority
- JP
- Japan
- Prior art keywords
- clock
- circuit
- image data
- display
- display device
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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Landscapes
- Compression Or Coding Systems Of Tv Signals (AREA)
- Controls And Circuits For Display Device (AREA)
- Liquid Crystal (AREA)
- Liquid Crystal Display Device Control (AREA)
- Studio Circuits (AREA)
- Transforming Electric Information Into Light Information (AREA)
Abstract
(57)【要約】
【目的】 画像データを横方向の２倍拡大を簡単に実現
する画像表示装置を提供。 【構成】 設定手段２は水平及び垂直同期信号Ｈ，Ｖよ
り、画像データを１の解像度を判別し、クロック回路３
に制御信号２１を供給し、この制御信号２１により、奇
数画素サンプル回路４１及び偶数画素サンプル回路４２
へ供給する２種類のクロックをドットクロックＤＣＬＫ
と同じ周波数で各々同位相の第２クロックＯＣＬＫ２，
ＥＣＬＫ２か、ドットクロックＤＣＬＫの半分の周波数
で各々逆位相の第１クロックＯＣＬＫ１，ＥＣＬＫ１に
するかを決定する。
する画像表示装置を提供。 【構成】 設定手段２は水平及び垂直同期信号Ｈ，Ｖよ
り、画像データを１の解像度を判別し、クロック回路３
に制御信号２１を供給し、この制御信号２１により、奇
数画素サンプル回路４１及び偶数画素サンプル回路４２
へ供給する２種類のクロックをドットクロックＤＣＬＫ
と同じ周波数で各々同位相の第２クロックＯＣＬＫ２，
ＥＣＬＫ２か、ドットクロックＤＣＬＫの半分の周波数
で各々逆位相の第１クロックＯＣＬＫ１，ＥＣＬＫ１に
するかを決定する。
Description
【０００１】
【産業上利用分野】本発明は、例えば液晶表示装置のよ
うな画像データを複数画素サンプリングして表示を行う
画像表示装置に係り、サンプリングクロックを制御し、
特に横方向へ２倍に画像拡大する画像表示装置に関す
る。
うな画像データを複数画素サンプリングして表示を行う
画像表示装置に係り、サンプリングクロックを制御し、
特に横方向へ２倍に画像拡大する画像表示装置に関す
る。
【０００２】
【従来の技術】従来の画像表示装置（図示せず）、例え
ば液晶表示装置は、１ライン分の画像データをサンプリ
ングする必要があり、横方向がＮ個の画素により構成さ
れる場合、Ｎ画素分の画像データを保持して１ライン毎
にＮ回のサンプリングを行い、液晶表示装置の内部のＩ
Ｃの性能上、実際のドットクロックの数分の１の周波数
にてサンプリングを行うため、サンプル回路が複数のブ
ロックに分けて時分割で行われる。
ば液晶表示装置は、１ライン分の画像データをサンプリ
ングする必要があり、横方向がＮ個の画素により構成さ
れる場合、Ｎ画素分の画像データを保持して１ライン毎
にＮ回のサンプリングを行い、液晶表示装置の内部のＩ
Ｃの性能上、実際のドットクロックの数分の１の周波数
にてサンプリングを行うため、サンプル回路が複数のブ
ロックに分けて時分割で行われる。
【０００３】しかしながら、これらのサンプル回路への
サンプリングクロックの供給方法は、画像の解像度に関
わらず固定され、１ラインに半分、すなわちＮ分の２個
の画素分の画像データのみを表示する場合でもＮ回のサ
ンプリング動作を行わなければならなかった。
サンプリングクロックの供給方法は、画像の解像度に関
わらず固定され、１ラインに半分、すなわちＮ分の２個
の画素分の画像データのみを表示する場合でもＮ回のサ
ンプリング動作を行わなければならなかった。
【０００４】
【発明が解決しようとする課題】上述のように、１画素
の周期にて２画素分の画像データをサンプリングする必
要があり、本来のドットクロックの周波数より、２倍高
速なクロックにてサンプリングを行い、１画素分の２回
のサンプリングデータは、同じ値でなければならないた
め、２倍高速なクロックの１周期の期間中に画像データ
が変動しない点でサンプリングを行わなければならな
い。
の周期にて２画素分の画像データをサンプリングする必
要があり、本来のドットクロックの周波数より、２倍高
速なクロックにてサンプリングを行い、１画素分の２回
のサンプリングデータは、同じ値でなければならないた
め、２倍高速なクロックの１周期の期間中に画像データ
が変動しない点でサンプリングを行わなければならな
い。
【０００５】これは、図３に示すＡ点及びＣ点に相当す
るが、このようなサンプリングポイントは、画像データ
Ｄの変化期間に近いために画像データＤが不安定であ
り、画像データＤを正常にサンプリングできず、安定し
た表示画像が得られないことがある。
るが、このようなサンプリングポイントは、画像データ
Ｄの変化期間に近いために画像データＤが不安定であ
り、画像データＤを正常にサンプリングできず、安定し
た表示画像が得られないことがある。
【０００６】そこで、本発明の目的は、１画素の周期で
２画素分の画像データを安定してサンプリングする画像
表示装置を提供することにある。
２画素分の画像データを安定してサンプリングする画像
表示装置を提供することにある。
【０００７】
【課題を解決するための手段】上述の課題を解決するた
めに、本発明の画像表示装置は、水平同期信号及び垂直
同期信号に基づいて出力される画像データと、この画像
データの水平同期信号及び垂直同期信号によって解像度
を検出し、かつ等倍表示か２倍表示かを設定する設定手
段と、この設定手段で等倍表示と設定された時にドット
クロックの半分の周波数の第１クロック及び、上記設定
手段で２倍表示と設定された時にドットクロックと同じ
周波数の第２クロックを生成するクロック回路と、この
クロック回路で生成された第１クロック及び第２クロッ
クに基づいて上記画像データの奇数画素をサンプリング
する奇数画素サンプル回路と、上記クロック回路で生成
された第１クロック及び第２クロックに基づいて上記画
像データの偶数画素をサンプリングする偶数画素サンプ
ル回路と、この偶数画素サンプル回路及び上記奇数画素
サンプル回路でサンプリングされた上記画像データを表
示する表示手段と、この表示手段に上記画像データを表
示するよう上記奇数画素サンプル回路及び偶数画素サン
プル回路を制御する制御手段とで構成されたことを特徴
とする。
めに、本発明の画像表示装置は、水平同期信号及び垂直
同期信号に基づいて出力される画像データと、この画像
データの水平同期信号及び垂直同期信号によって解像度
を検出し、かつ等倍表示か２倍表示かを設定する設定手
段と、この設定手段で等倍表示と設定された時にドット
クロックの半分の周波数の第１クロック及び、上記設定
手段で２倍表示と設定された時にドットクロックと同じ
周波数の第２クロックを生成するクロック回路と、この
クロック回路で生成された第１クロック及び第２クロッ
クに基づいて上記画像データの奇数画素をサンプリング
する奇数画素サンプル回路と、上記クロック回路で生成
された第１クロック及び第２クロックに基づいて上記画
像データの偶数画素をサンプリングする偶数画素サンプ
ル回路と、この偶数画素サンプル回路及び上記奇数画素
サンプル回路でサンプリングされた上記画像データを表
示する表示手段と、この表示手段に上記画像データを表
示するよう上記奇数画素サンプル回路及び偶数画素サン
プル回路を制御する制御手段とで構成されたことを特徴
とする。
【０００８】また、上述の課題を解決するために、本発
明の画像表示装置は、上記画像データをデジタル変換す
るデジタル回路を備え、このデジタル回路で上記画像デ
ータをデジタル変換後、上記奇数画素サンプル回路及び
偶数画素サンプル回路でサンプリングすることを特徴と
する。
明の画像表示装置は、上記画像データをデジタル変換す
るデジタル回路を備え、このデジタル回路で上記画像デ
ータをデジタル変換後、上記奇数画素サンプル回路及び
偶数画素サンプル回路でサンプリングすることを特徴と
する。
【０００９】
【実施例】次に、本発明の一実施例による画像表示装置
を、図面を参照して説明する。
を、図面を参照して説明する。
【００１０】図１は、本発明の一実施例による画像表示
装置のブロック構成図（Ａ），等倍表示のタイムチャー
ト（Ｂ），２倍表示のタイムチャート（Ｃ）である。
装置のブロック構成図（Ａ），等倍表示のタイムチャー
ト（Ｂ），２倍表示のタイムチャート（Ｃ）である。
【００１１】図２は、本発明の一実施例による画像表示
装置のクロック回路の構成図である。
装置のクロック回路の構成図である。
【００１２】本発明の一実施例による画像表示装置は、
図１の（Ａ）に示すように、水平同期信号Ｈ及び垂直同
期信号Ｖに基づいて出力される画像データ１と、この画
像データ１の水平同期信号Ｈ及び垂直同期信号Ｖによっ
て解像度を検出し、かつ等倍表示か２倍表示かを設定す
る設定手段２と、この設定手段２で等倍表示と設定され
た時にドットクロックＤＣＬＫの半分の周波数の第１ク
ロックＯＣＬＫ１，ＥＣＬＫ１及び、設定手段２で２倍
表示と設定された時にドットクロックＤＣＬＫと同じ周
波数の第２クロックＯＣＬＫ２，ＥＣＬＫ２を生成する
クロック回路３と、このクロック回路３で生成された第
１クロックＯＣＬＫ１，ＥＣＬＫ１及び第２クロックＯ
ＣＬＫ２，ＥＣＬＫ２に基づいて画像データ１の奇数画
素をサンプリングする奇数画素サンプル回路４１と、ク
ロック回路３で生成された第１クロックＯＣＬＫ１，Ｅ
ＣＬＫ１及び第２クロックＯＣＬＫ２，ＥＣＬＫ２に基
づいて画像データ１の偶数画素をサンプリングする偶数
画素サンプル回路４２と、この偶数画素サンプル回路４
２及び奇数画素サンプル回路４１でサンプリングされた
画像データ１を表示する表示手段６と、この表示手段６
に画像データ１を表示するよう奇数画素サンプル回路４
１及び偶数画素サンプル回路４２を制御する制御手段５
とで構成される。
図１の（Ａ）に示すように、水平同期信号Ｈ及び垂直同
期信号Ｖに基づいて出力される画像データ１と、この画
像データ１の水平同期信号Ｈ及び垂直同期信号Ｖによっ
て解像度を検出し、かつ等倍表示か２倍表示かを設定す
る設定手段２と、この設定手段２で等倍表示と設定され
た時にドットクロックＤＣＬＫの半分の周波数の第１ク
ロックＯＣＬＫ１，ＥＣＬＫ１及び、設定手段２で２倍
表示と設定された時にドットクロックＤＣＬＫと同じ周
波数の第２クロックＯＣＬＫ２，ＥＣＬＫ２を生成する
クロック回路３と、このクロック回路３で生成された第
１クロックＯＣＬＫ１，ＥＣＬＫ１及び第２クロックＯ
ＣＬＫ２，ＥＣＬＫ２に基づいて画像データ１の奇数画
素をサンプリングする奇数画素サンプル回路４１と、ク
ロック回路３で生成された第１クロックＯＣＬＫ１，Ｅ
ＣＬＫ１及び第２クロックＯＣＬＫ２，ＥＣＬＫ２に基
づいて画像データ１の偶数画素をサンプリングする偶数
画素サンプル回路４２と、この偶数画素サンプル回路４
２及び奇数画素サンプル回路４１でサンプリングされた
画像データ１を表示する表示手段６と、この表示手段６
に画像データ１を表示するよう奇数画素サンプル回路４
１及び偶数画素サンプル回路４２を制御する制御手段５
とで構成される。
【００１３】本発明の一実施例による画像表示装置の動
作は、図１の（Ａ）に示すように、奇数画素サンプル回
路４１及び偶数画素サンプル回路４２がクロック回路３
のクロックＯＣＬＫ，ＥＣＬＫの立ち上がりエッジにて
画像データ１を保持し、このクロック回路３は、図２に
示すように、ドットクロックＤＣＬＫが分周回路３１
へ、設定手段２から出力される制御信号２１が選択回路
３２及び反転回路３３へ各々入力され、ドットクロック
ＤＣＬＫを半分の周波数に変換し、選択回路３２が制御
信号２１によってドットクロックＤＣＬＫと同じ周波数
の第２クロックＯＣＬＫ２，ＥＣＬＫ２か、ドットクロ
ックＤＣＬＫの半分の周波数の第１クロックＯＣＬＫ
１，ＥＣＬＫ１を出力するかを選択し、反転回路３３が
制御信号２１によって偶数画素サンプル回路４２へのク
ロックＥＣＬＫの反転／非反転を制御する。
作は、図１の（Ａ）に示すように、奇数画素サンプル回
路４１及び偶数画素サンプル回路４２がクロック回路３
のクロックＯＣＬＫ，ＥＣＬＫの立ち上がりエッジにて
画像データ１を保持し、このクロック回路３は、図２に
示すように、ドットクロックＤＣＬＫが分周回路３１
へ、設定手段２から出力される制御信号２１が選択回路
３２及び反転回路３３へ各々入力され、ドットクロック
ＤＣＬＫを半分の周波数に変換し、選択回路３２が制御
信号２１によってドットクロックＤＣＬＫと同じ周波数
の第２クロックＯＣＬＫ２，ＥＣＬＫ２か、ドットクロ
ックＤＣＬＫの半分の周波数の第１クロックＯＣＬＫ
１，ＥＣＬＫ１を出力するかを選択し、反転回路３３が
制御信号２１によって偶数画素サンプル回路４２へのク
ロックＥＣＬＫの反転／非反転を制御する。
【００１４】このクロック回路３から出力されるクロッ
クＯＣＬＫ，ＥＣＬＫは、等倍表示する時にクロック回
路３の出力が”Ｈ”レベルとなって第１クロックＯＣＬ
Ｋ１，ＥＣＬＫ１が送出され、２倍表示する時にクロッ
ク回路３の出力が”Ｌ”レベルとなって第２クロックＯ
ＣＬＫ２，ＥＣＬＫ２を送出する。
クＯＣＬＫ，ＥＣＬＫは、等倍表示する時にクロック回
路３の出力が”Ｈ”レベルとなって第１クロックＯＣＬ
Ｋ１，ＥＣＬＫ１が送出され、２倍表示する時にクロッ
ク回路３の出力が”Ｌ”レベルとなって第２クロックＯ
ＣＬＫ２，ＥＣＬＫ２を送出する。
【００１５】従って、クロック回路３の出力が”Ｈ”レ
ベルとなる等倍表示の場合、第１クロックＥＣＬＫ１
は、図２の（Ｂ）に示すように、ドットクロックＤＣＬ
Ｋの半分の周波数で第１クロックＯＣＬＫ１と逆位相と
なる。
ベルとなる等倍表示の場合、第１クロックＥＣＬＫ１
は、図２の（Ｂ）に示すように、ドットクロックＤＣＬ
Ｋの半分の周波数で第１クロックＯＣＬＫ１と逆位相と
なる。
【００１６】また、クロック回路３の出力が”Ｌ”レベ
ルとなる２倍表示の場合、第２クロックＥＣＬＫ２は、
図２の（Ｃ）に示すように、ドットクロックＤＣＬＫと
同じ周波数で第２クロックＯＣＬＫ２と同位相となり、
隣り合う画素に同じ画像データ１をサンプリングして横
方向に２倍表示する。
ルとなる２倍表示の場合、第２クロックＥＣＬＫ２は、
図２の（Ｃ）に示すように、ドットクロックＤＣＬＫと
同じ周波数で第２クロックＯＣＬＫ２と同位相となり、
隣り合う画素に同じ画像データ１をサンプリングして横
方向に２倍表示する。
【００１７】なお、本発明の一実施例による画像表示装
置は、画像データ１をデジタル変換するデジタル回路を
備え、このデジタル回路で画像データ１をデジタル変換
後、奇数画素サンプル回路４１及び偶数画素サンプル回
路４２でサンプリングしてもよい。
置は、画像データ１をデジタル変換するデジタル回路を
備え、このデジタル回路で画像データ１をデジタル変換
後、奇数画素サンプル回路４１及び偶数画素サンプル回
路４２でサンプリングしてもよい。
【００１８】
【発明の効果】以上説明したように、本発明の画像表示
装置によれば、１画素の周期にて２画素分の画像データ
をサンプリングする場合、１画素の表示期間中の画像デ
ータが変動しない期間でサンプリングを行うことがで
き、安定した画像データを得る効果がある。
装置によれば、１画素の周期にて２画素分の画像データ
をサンプリングする場合、１画素の表示期間中の画像デ
ータが変動しない期間でサンプリングを行うことがで
き、安定した画像データを得る効果がある。
【図１】本発明の一実施例による画像表示装置のブロッ
ク構成図（Ａ），等倍表示のタイムチャート（Ｂ），２
倍表示のタイムチャート（Ｃ）である。
ク構成図（Ａ），等倍表示のタイムチャート（Ｂ），２
倍表示のタイムチャート（Ｃ）である。
【図２】本発明の一実施例による画像表示装置のクロッ
ク回路の構成図である。
ク回路の構成図である。
【図３】従来の画像表示装置による画像データのタイム
チャートである。
チャートである。
１ 画像データ ２ 設定手段 ３ クロック回路 ５ 制御手段 ６ 表示手段 ２１ 設定手段（制御信号） ３１ 分周回路 ３２ 選択回路 ３３ 反転回路 ４１ 奇数画素サンプル回路 ４２ 偶数画素サンプル回路 ＯＣＬＫ１，ＥＣＬＫ１ 第１クロック ＯＣＬＫ２，ＥＣＬＫ２ 第２クロック
───────────────────────────────────────────────────── フロントページの続き (51)Int.Cl.6 識別記号 庁内整理番号 ＦＩ 技術表示箇所 Ｈ０４Ｎ 7/30 Ｈ０４Ｎ 7/133 Ｚ
Claims (2)
- 【請求項１】 水平同期信号及び垂直同期信号に基づい
て出力される画像データと、この画像データの水平同期
信号及び垂直同期信号によって解像度を検出し、かつ等
倍表示か２倍表示かを設定する設定手段と、この設定手
段で等倍表示と設定された時にドットクロックの半分の
周波数の第１クロック及び、上記設定手段で２倍表示と
設定された時にドットクロックと同じ周波数の第２クロ
ックを生成するクロック回路と、このクロック回路で生
成された第１クロック及び第２クロックに基づいて上記
画像データの奇数画素をサンプリングする奇数画素サン
プル回路と、上記クロック回路で生成された第１クロッ
ク及び第２クロックに基づいて上記画像データの偶数画
素をサンプリングする偶数画素サンプル回路と、この偶
数画素サンプル回路及び上記奇数画素サンプル回路でサ
ンプリングされた上記画像データを表示する表示手段
と、この表示手段に上記画像データを表示するよう上記
奇数画素サンプル回路及び偶数画素サンプル回路を制御
する制御手段とで構成されたことを特徴とする画像表示
装置。 - 【請求項２】 上記画像データをデジタル変換するデジ
タル回路を備え、このデジタル回路で上記画像データを
デジタル変換後、上記奇数画素サンプル回路及び偶数画
素サンプル回路でサンプリングすることを特徴とする請
求項１記載の画像表示装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7193713A JPH0944117A (ja) | 1995-07-28 | 1995-07-28 | 画像表示装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7193713A JPH0944117A (ja) | 1995-07-28 | 1995-07-28 | 画像表示装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0944117A true JPH0944117A (ja) | 1997-02-14 |
Family
ID=16312561
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP7193713A Pending JPH0944117A (ja) | 1995-07-28 | 1995-07-28 | 画像表示装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0944117A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR100428930B1 (ko) * | 2000-06-01 | 2004-04-28 | 샤프 가부시키가이샤 | 신호전송 시스템, 신호전송장치, 표시패널 구동장치, 및표시장치 |
-
1995
- 1995-07-28 JP JP7193713A patent/JPH0944117A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR100428930B1 (ko) * | 2000-06-01 | 2004-04-28 | 샤프 가부시키가이샤 | 신호전송 시스템, 신호전송장치, 표시패널 구동장치, 및표시장치 |
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