JPH09116050A - 樹脂封止半導体装置 - Google Patents

樹脂封止半導体装置

Info

Publication number
JPH09116050A
JPH09116050A JP7275818A JP27581895A JPH09116050A JP H09116050 A JPH09116050 A JP H09116050A JP 7275818 A JP7275818 A JP 7275818A JP 27581895 A JP27581895 A JP 27581895A JP H09116050 A JPH09116050 A JP H09116050A
Authority
JP
Japan
Prior art keywords
substrate
resin
semiconductor chip
stress relaxation
sealed
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Withdrawn
Application number
JP7275818A
Other languages
English (en)
Inventor
Noriko Murakami
紀子 村上
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Oki Electric Industry Co Ltd
Original Assignee
Oki Electric Industry Co Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Oki Electric Industry Co Ltd filed Critical Oki Electric Industry Co Ltd
Priority to JP7275818A priority Critical patent/JPH09116050A/ja
Priority to KR1019960047703A priority patent/KR100386061B1/ko
Priority to EP01122146A priority patent/EP1168440A1/en
Priority to EP96117092A priority patent/EP0771029A3/en
Priority to EP00110729A priority patent/EP1039541A1/en
Priority to EP00110727A priority patent/EP1039538A1/en
Priority to US08/736,610 priority patent/US5864174A/en
Priority to EP00110728A priority patent/EP1039540A1/en
Priority to TW085113467A priority patent/TW350106B/zh
Priority to TW087102088A priority patent/TW411533B/zh
Publication of JPH09116050A publication Critical patent/JPH09116050A/ja
Priority to US09/165,295 priority patent/US6177725B1/en
Priority to US09/695,403 priority patent/US6459145B1/en
Priority to US10/223,484 priority patent/US6569755B2/en
Withdrawn legal-status Critical Current

Links

Classifications

    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/44Structure, shape, material or disposition of the wire connectors prior to the connecting process
    • H01L2224/45Structure, shape, material or disposition of the wire connectors prior to the connecting process of an individual wire connector
    • H01L2224/45001Core members of the connector
    • H01L2224/45099Material
    • H01L2224/451Material with a principal constituent of the material being a metal or a metalloid, e.g. boron (B), silicon (Si), germanium (Ge), arsenic (As), antimony (Sb), tellurium (Te) and polonium (Po), and alloys thereof
    • H01L2224/45138Material with a principal constituent of the material being a metal or a metalloid, e.g. boron (B), silicon (Si), germanium (Ge), arsenic (As), antimony (Sb), tellurium (Te) and polonium (Po), and alloys thereof the principal constituent melting at a temperature of greater than or equal to 950°C and less than 1550°C
    • H01L2224/45144Gold (Au) as principal constituent
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/48Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • H01L2224/481Disposition
    • H01L2224/48151Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
    • H01L2224/48221Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
    • H01L2224/48225Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation
    • H01L2224/48227Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation connecting the wire to a bond pad of the item
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/48Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • H01L2224/4899Auxiliary members for wire connectors, e.g. flow-barriers, reinforcing structures, spacers, alignment aids
    • H01L2224/48996Auxiliary members for wire connectors, e.g. flow-barriers, reinforcing structures, spacers, alignment aids being formed on an item to be connected not being a semiconductor or solid-state body
    • H01L2224/48997Reinforcing structures
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/80Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
    • H01L2224/85Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a wire connector
    • H01L2224/85909Post-treatment of the connector or wire bonding area
    • H01L2224/8592Applying permanent coating, e.g. protective coating
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/01Chemical elements
    • H01L2924/01082Lead [Pb]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/013Alloys
    • H01L2924/014Solder alloys
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/15Details of package parts other than the semiconductor or other solid state devices to be connected
    • H01L2924/151Die mounting substrate
    • H01L2924/153Connection portion
    • H01L2924/1531Connection portion the connection portion being formed only on the surface of the substrate opposite to the die mounting surface
    • H01L2924/15311Connection portion the connection portion being formed only on the surface of the substrate opposite to the die mounting surface being a ball array, e.g. BGA
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/15Details of package parts other than the semiconductor or other solid state devices to be connected
    • H01L2924/181Encapsulation

Landscapes

  • Structures Or Materials For Encapsulating Or Coating Semiconductor Devices Or Solid State Devices (AREA)

Abstract

(57)【要約】 【課題】 基板上に半導体チップを搭載し、その基板の
裏面に外部接続用のバンプを設け、前記半導体チップを
樹脂にて封止する半導体装置において、基板の反りを極
力抑えることができる樹脂封止半導体装置を提供する。 【解決手段】 基板11上に半導体チップ12を搭載
し、その基板11の裏面に外部接続用の半田バンプ15
を設け、前記半導体チップを樹脂14にて封止する樹脂
封止半導体装置において、半導体チップ12側の基板1
1面と封止樹脂14の間に応力緩和材を塗布した応力緩
和部16を設ける。

Description

【発明の詳細な説明】
【0001】
【発明の属する技術分野】本発明は、樹脂封止半導体装
置の構造に関するものである。
【0002】
【従来の技術】従来、この種の装置としては、以下に示
すようなものがあった。図3はかかる従来の樹脂封止半
導体装置の断面図である。この図に示すように、基板1
に半導体チップ2をダイスボンドしてからAuワイヤ3
で基板1と半導体チップ2をワイヤボンドし、封止樹脂
4で半導体チップ2とAuワイヤ3を封止し、基板1の
反対側に半田ボール5を付けていた。
【0003】
【発明が解決しようとする課題】しかしながら、上記し
た従来の樹脂封止半導体装置では、封止樹脂4が基板1
の片側だけにあるため、基板の反りが大きく、信頼性に
劣るという問題点があった。本発明は、上記問題点を除
去し、基板上に半導体チップを搭載し、その基板の裏面
に外部接続用バンプを設け、前記半導体チップを樹脂に
て封止する樹脂封止半導体装置において、基板の反りを
極力抑えることができる樹脂封止半導体装置を提供する
ことを目的とする。
【0004】
【課題を解決するための手段】本発明は、上記目的を達
成するために、 (1)基板上に半導体チップを搭載し、この基板の裏面
に外部接続用バンプを設け、前記半導体チップを樹脂に
て封止する樹脂封止半導体装置において、前記半導体チ
ップ側の基板と封止樹脂の間に応力緩和材を塗布した応
力緩和部を設けるようにしたものである。
【0005】このように、半導体チップ側の基板と封止
樹脂の間に応力緩和材を塗布した応力緩和部を設けるよ
うにしたので、封止樹脂と基板の間の応力を緩和するこ
とができ、反りを低減し、信頼性の向上を図ることがで
きる。 (2)基板上に半導体チップを搭載し、この基板の裏面
に外部接続用バンプを設け、前記半導体チップを樹脂に
て封止する樹脂封止半導体装置において、前記半導体チ
ップ側の基板面に応力緩和材を埋め込んだ応力緩和部を
具備する基板上に半導体チップを搭載し、樹脂にて封止
する樹脂封止半導体装置において、基板と封止樹脂の間
に応力緩和材を塗布した応力緩和部を設けるようにした
ものである。
【0006】このように、前記半導体チップ側の基板面
に応力緩和材を埋め込んだ応力緩和部を設けるようにし
たので、封止樹脂と基板の間の応力を緩和することがで
き、反りを低減し、信頼性の向上を図ることができる。
【0007】
【発明の実施の形態】以下、本発明の実施の形態につい
て図を参照しながら詳細に説明する。図1は本発明の第
1実施例を示す樹脂封止半導体装置の断面図である。ま
ず、基板11に半導体チップ12をダイスボンドし、A
uワイヤ13で基板11と半導体チップ12をワイヤボ
ンドする。その後、半導体チップ12の周辺の基板11
上に、応力緩和材としてシリコーンなど応力緩和効果の
高い物質を塗布し、応力緩和部16を設け、必要に応じ
て、加熱、硬化させ、それから封止樹脂14で封止し、
基板11の反対側に半田ボール15を付ける。
【0008】このように構成したので、応力緩和部16
により、線膨張係数の違いから、封止樹脂14と基板1
1の間に生じる応力を緩和することができ、その結果、
反りを低減することが可能となる。次に、本発明の第2
実施例について説明する。図2は本発明の第2実施例を
示す樹脂封止半導体装置の断面図である。
【0009】この実施例では、基板に窪みを形成し、そ
こに応力緩和材を埋め込んだ応力緩和部を設けるように
したものである。この図に示すように、まず、基板21
に、応力緩和材を埋め込むための窪み21aをあけ、こ
こに応力緩和部27を設ける。応力緩和材としては、シ
リコーンなど応力緩和効果の高い物質を用いる。次に、
この応力緩和材を埋め込んだ応力緩和部27を有する基
板21に半導体チップ22をダイスボンドし、Auワイ
ヤ23で基板21と半導体チップ22をワイヤボンドし
た後、封止樹脂24で封止し、基板21の反対側に半田
ボール25を付ける。
【0010】このように構成したので、基板21に形成
された応力緩和部27により、線膨張係数の違いから封
止樹脂24と基板21の間に生じる応力を緩和すること
ができ、その結果、反りを低減することが可能となる。
なお、本発明は上記実施例に限定されるものではなく、
本発明の趣旨に基づいて種々の変形が可能であり、これ
らを本発明の範囲から排除するものではない。
【0011】
【発明の効果】以上、詳細に説明したように、本発明に
よれば、以下のような効果を奏することができる。 (1)請求項1記載の発明によれば、半導体チップ側の
基板と封止樹脂の間に応力緩和材を塗布し、応力緩和部
を形成するようにしたので、封止樹脂と基板の間の応力
を緩和することができ、反りを低減し、信頼性の向上を
図ることができる。
【0012】(2)請求項2記載の発明によれば、半導
体チップ側の基板面に応力緩和材を埋め込んだ応力緩和
部を設けるようにしたので、封止樹脂と基板の間の応力
を緩和することができ、反りを低減し、信頼性の向上を
図ることができる。
【図面の簡単な説明】
【図1】本発明の第1実施例を示す樹脂封止半導体装置
の断面図である。
【図2】本発明の第2実施例を示す樹脂封止半導体装置
の断面図である。
【図3】従来の樹脂封止半導体装置の断面図である。
【符号の説明】
11,21 基板 12,22 半導体チップ 13,23 Auワイヤ 14,24 封止樹脂 15,25 半田ボール 16,27 応力緩和部 21a 窪み

Claims (2)

    【特許請求の範囲】
  1. 【請求項1】 基板上に半導体チップを搭載し、該基板
    の裏面に外部接続用バンプを設け、前記半導体チップを
    樹脂にて封止する樹脂封止半導体装置において、前記半
    導体チップ側の基板と封止樹脂の間に応力緩和材を塗布
    した応力緩和部を具備することを特徴とする樹脂封止半
    導体装置。
  2. 【請求項2】 基板上に半導体チップを搭載し、該基板
    の裏面に外部接続用バンプを設け、前記半導体チップを
    樹脂にて封止する樹脂封止半導体装置において、前記半
    導体チップ側の基板面に応力緩和材を埋め込んだ応力緩
    和部を具備することを特徴とする樹脂封止半導体装置。
JP7275818A 1995-10-24 1995-10-24 樹脂封止半導体装置 Withdrawn JPH09116050A (ja)

Priority Applications (13)

Application Number Priority Date Filing Date Title
JP7275818A JPH09116050A (ja) 1995-10-24 1995-10-24 樹脂封止半導体装置
KR1019960047703A KR100386061B1 (ko) 1995-10-24 1996-10-23 크랙을방지하기위한개량된구조를가지는반도체장치및리이드프레임
EP00110728A EP1039540A1 (en) 1995-10-24 1996-10-24 Semiconductor device having an improved structure for preventing cracks, improved small-sized semiconductor and method of manufacturing the same
EP96117092A EP0771029A3 (en) 1995-10-24 1996-10-24 Semiconductor device with improved structure to avoid cracks and manufacturing process
EP00110729A EP1039541A1 (en) 1995-10-24 1996-10-24 Semiconductor device having an improved structure for preventing cracks, improved small-sized semiconductor and method of manufacturing the same
EP00110727A EP1039538A1 (en) 1995-10-24 1996-10-24 Semiconductor device having an improved structure for preventing cracks, improved small-sized semiconductor and method of manufacturing the same
US08/736,610 US5864174A (en) 1995-10-24 1996-10-24 Semiconductor device having a die pad structure for preventing cracks in a molding resin
EP01122146A EP1168440A1 (en) 1995-10-24 1996-10-24 Semiconductor device having an improved structure for preventing cracks, improved small-sized semiconductor and method of manufacturing the same
TW085113467A TW350106B (en) 1995-10-24 1996-11-04 Semiconductor elements and the manufacturing method
TW087102088A TW411533B (en) 1995-10-24 1996-11-04 Semiconductor device and its manufacturing method
US09/165,295 US6177725B1 (en) 1995-10-24 1998-10-02 Semiconductor device having an improved structure for preventing cracks, improved small-sized semiconductor and method of manufacturing the same
US09/695,403 US6459145B1 (en) 1995-10-24 2000-10-25 Semiconductor device having an improved structure for preventing cracks, and improved small-sized semiconductor
US10/223,484 US6569755B2 (en) 1995-10-24 2002-08-20 Semiconductor device having an improved structure for preventing cracks, improved small sized semiconductor and method of manufacturing the same

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP7275818A JPH09116050A (ja) 1995-10-24 1995-10-24 樹脂封止半導体装置

Publications (1)

Publication Number Publication Date
JPH09116050A true JPH09116050A (ja) 1997-05-02

Family

ID=17560857

Family Applications (1)

Application Number Title Priority Date Filing Date
JP7275818A Withdrawn JPH09116050A (ja) 1995-10-24 1995-10-24 樹脂封止半導体装置

Country Status (1)

Country Link
JP (1) JPH09116050A (ja)

Cited By (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US7122402B2 (en) 2003-09-29 2006-10-17 Fujitsu Limited Method of manufacturing a semiconductor device using a rigid substrate including the vent-end edge portion of the substrate has a thickness smaller than the other portions of the substrate
JP2010141158A (ja) * 2008-12-12 2010-06-24 Denso Corp 電子装置
JP2011142366A (ja) * 2008-10-20 2011-07-21 Denso Corp 電子制御装置
JP2014123606A (ja) * 2012-12-20 2014-07-03 Shindengen Electric Mfg Co Ltd 電源装置およびその製造方法

Cited By (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US7122402B2 (en) 2003-09-29 2006-10-17 Fujitsu Limited Method of manufacturing a semiconductor device using a rigid substrate including the vent-end edge portion of the substrate has a thickness smaller than the other portions of the substrate
US7781259B2 (en) 2003-09-29 2010-08-24 Fujitsu Semiconductor Limited Method of manufacturing a semiconductor using a rigid substrate
JP2011142366A (ja) * 2008-10-20 2011-07-21 Denso Corp 電子制御装置
JP2010141158A (ja) * 2008-12-12 2010-06-24 Denso Corp 電子装置
JP2014123606A (ja) * 2012-12-20 2014-07-03 Shindengen Electric Mfg Co Ltd 電源装置およびその製造方法

Similar Documents

Publication Publication Date Title
TW488053B (en) Semiconductor package having implantable conductive lands and method for manufacturing the same
KR100304681B1 (ko) 몰드bga형반도체장치및그제조방법
JP2936669B2 (ja) 樹脂封止型半導体装置
KR100366111B1 (ko) 수지봉합형 반도체장치의 구조
JPH09116050A (ja) 樹脂封止半導体装置
JPS5810841A (ja) 樹脂封止形半導体装置
JPS6077446A (ja) 封止半導体装置
JP3655338B2 (ja) 樹脂封止型半導体装置及びその製造方法
JPH0345542B2 (ja)
JPH05109976A (ja) 半導体装置
TW200816419A (en) Multi-chip package to optimize mold-flow balance
JPH0526760Y2 (ja)
JPH08115941A (ja) 半導体装置
JPH10223700A (ja) 樹脂封止半導体装置及びその製造方法
JP2004200532A (ja) 半導体装置およびその製造方法
KR20100002868A (ko) 반도체 패키지
KR100308899B1 (ko) 반도체패키지및그제조방법
JPH09326463A (ja) 樹脂封止型半導体装置
JP3145892B2 (ja) 樹脂封止型半導体装置
KR100532947B1 (ko) 회로 형성면에 중앙 패드를 갖는 제1 및 제2 반도체 칩을적층하여 패키징하는 방법
JPH05211268A (ja) 半導体装置
KR0125874Y1 (ko) 반도체 패키지
JPH0250438A (ja) 半導体記憶装置
JPH0669381A (ja) 半導体集積回路装置
JPH0590318A (ja) 半導体装置

Legal Events

Date Code Title Description
A300 Withdrawal of application because of no request for examination

Free format text: JAPANESE INTERMEDIATE CODE: A300

Effective date: 20030107