JPH0783454B2 - 映像信号処理装置 - Google Patents
映像信号処理装置Info
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- JPH0783454B2 JPH0783454B2 JP63276070A JP27607088A JPH0783454B2 JP H0783454 B2 JPH0783454 B2 JP H0783454B2 JP 63276070 A JP63276070 A JP 63276070A JP 27607088 A JP27607088 A JP 27607088A JP H0783454 B2 JPH0783454 B2 JP H0783454B2
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- JP
- Japan
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- bus
- memory
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- video signal
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- 230000015654 memory Effects 0.000 claims description 41
- 238000010586 diagram Methods 0.000 description 10
- 230000005540 biological transmission Effects 0.000 description 9
- 239000013256 coordination polymer Substances 0.000 description 2
- 230000001360 synchronised effect Effects 0.000 description 2
- 230000000694 effects Effects 0.000 description 1
- 238000000034 method Methods 0.000 description 1
- 230000004044 response Effects 0.000 description 1
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-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F3/00—Input arrangements for transferring data to be processed into a form capable of being handled by the computer; Output arrangements for transferring data from processing unit to output unit, e.g. interface arrangements
- G06F3/14—Digital output to display device ; Cooperation and interconnection of the display device with other functional units
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N5/00—Details of television systems
- H04N5/222—Studio circuitry; Studio devices; Studio equipment
- H04N5/262—Studio circuits, e.g. for mixing, switching-over, change of character of image, other special effects ; Cameras specially adapted for the electronic generation of special effects
- H04N5/272—Means for inserting a foreground image in a background image, i.e. inlay, outlay
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N5/00—Details of television systems
- H04N5/44—Receiver circuitry for the reception of television signals according to analogue transmission standards
- H04N5/445—Receiver circuitry for the reception of television signals according to analogue transmission standards for displaying additional information
- H04N5/44504—Circuit details of the additional information generator, e.g. details of the character or graphics signal generator, overlay mixing circuits
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- General Physics & Mathematics (AREA)
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- Controls And Circuits For Display Device (AREA)
Description
【発明の詳細な説明】 〔産業上の利用分野〕 この発明は、連続的なテレビジョン信号等のビデオ画像
に、文字，グラフィック等のディジタル画像をスーパー
インポーズして出力する場合等に用いられる映像信号処
理装置に関するものである。
に、文字，グラフィック等のディジタル画像をスーパー
インポーズして出力する場合等に用いられる映像信号処
理装置に関するものである。
第４図は例えば特開昭60−136828号公報に示された従来
の映像信号処理装置を示すブロック図であり、第４図に
おいて、１は映像信号VIを導く、２は映像信号VIから色
信号を分離するデコーダ、３は色信号をディジタル化す
るA/D変換器、４はA/D変換されたディジタル映像信号を
フィールド又はフレーム単位でビデオ画像データとして
格納する第１のメモリで、メモリへのデータ入出力を制
御する制御回路を含む。５は文字，グラフィック等のデ
ィジタル画像の入力や表示内容，手順，プログラム等の
入力を行うマンマシンインタフェース、６は画像表示の
プログラム等の実行を制御するCPU、７はプログラムを
格納するメモリ、９は文字，グラフィック等のディジタ
ル画像データを格納するディスク、８はディスク９を制
御するディスクコントローラ、10はCPU6のプログラムの
実行に必要な各部のインタフェースが接続されるプログ
ラムコントロールチャンネル用のバス、11はディジタル
画像データの伝送を行うDMAバス、12はディジタル画像
データをフィールド又はフレーム単位で格納する第２の
メモリ、13は第１のメモリ４からのビデオ画像データ又
は第２のメモリ12からのディジタル画像データを選択的
に読み出す第１のバス、14は映像信号VIに基づくタイミ
ングで第１のバス13を制御するバスコントローラ、15は
第１のバス13で読み出されたビデオ画像データ又はディ
ジタル画像データを画像表示信号VOに変換する出力装
置、16は画像表示信号VOが供給されるモニタである。
の映像信号処理装置を示すブロック図であり、第４図に
おいて、１は映像信号VIを導く、２は映像信号VIから色
信号を分離するデコーダ、３は色信号をディジタル化す
るA/D変換器、４はA/D変換されたディジタル映像信号を
フィールド又はフレーム単位でビデオ画像データとして
格納する第１のメモリで、メモリへのデータ入出力を制
御する制御回路を含む。５は文字，グラフィック等のデ
ィジタル画像の入力や表示内容，手順，プログラム等の
入力を行うマンマシンインタフェース、６は画像表示の
プログラム等の実行を制御するCPU、７はプログラムを
格納するメモリ、９は文字，グラフィック等のディジタ
ル画像データを格納するディスク、８はディスク９を制
御するディスクコントローラ、10はCPU6のプログラムの
実行に必要な各部のインタフェースが接続されるプログ
ラムコントロールチャンネル用のバス、11はディジタル
画像データの伝送を行うDMAバス、12はディジタル画像
データをフィールド又はフレーム単位で格納する第２の
メモリ、13は第１のメモリ４からのビデオ画像データ又
は第２のメモリ12からのディジタル画像データを選択的
に読み出す第１のバス、14は映像信号VIに基づくタイミ
ングで第１のバス13を制御するバスコントローラ、15は
第１のバス13で読み出されたビデオ画像データ又はディ
ジタル画像データを画像表示信号VOに変換する出力装
置、16は画像表示信号VOが供給されるモニタである。
次に動作について、第５図及び第６図の概念図および動
作モデル図を参照しながら説明する。
作モデル図を参照しながら説明する。
まず、連続入力される映像信号VIがデコーダ２によりデ
コードされて、各色信号R,G,Bに分離され、続いてA/D変
換器３でディジタル信号に変換される。次にこのディジ
タル信号は第１のメモリ４に記憶される。例えば、第５
図の画面ｄに示すような内容の映像信号VIがリアルタイ
ムで第１のメモリ４に格納される。
コードされて、各色信号R,G,Bに分離され、続いてA/D変
換器３でディジタル信号に変換される。次にこのディジ
タル信号は第１のメモリ４に記憶される。例えば、第５
図の画面ｄに示すような内容の映像信号VIがリアルタイ
ムで第１のメモリ４に格納される。
一方、第５図の画面ｅに示すような内容のディジタル画
像データがマンマシンインタフェース５により作成さ
れ、ディスク９に格納されている。これはCPU6の指令に
より読み出され、ディスクコントローラ８を介してDMA
バス11に送出される。この送出されたディジタル画像デ
ータは、第２のメモリ12にフレーム単位又はフィールド
単位で記憶される。第１のメモリ４と第２のメモリ12と
は同じ走査タイミング（速度）で各データの出力を行
い、その際、第６図の動作モデル図に示すように、第２
のメモリ12が出力するディジタル画像データの画面ｅに
透明色部Ｐがあるか否かを判定部23で判定し、これに応
じて、スイッチ21,22の一方を閉じ、各メモリ4,12のい
ずれかのデータを、選択的に第１のバス13に出力する。
すなわち、走査中において、第２のメモリ12のディジタ
ル画像データに上記透明色部Ｐがあれば、このディジタ
ル画像データの出力をカットして、第１のメモリ４から
のビデオ画像データを第１のバス13に送り、逆に上記透
明色部Ｐがディジタル画像データになければ、第１のメ
モリ４の出力をカットし、第２のメモリ12のディジタル
画像データを、第１のバス13に出力する。この結果、第
５図に示す画面ｆに対応する画像表示信号VOが出力装置
15を通して出力され、この出力によりビデオ画像にディ
ジタル画像がスーパーインポーズされた画面ｆがモニタ
16上に表示される。
像データがマンマシンインタフェース５により作成さ
れ、ディスク９に格納されている。これはCPU6の指令に
より読み出され、ディスクコントローラ８を介してDMA
バス11に送出される。この送出されたディジタル画像デ
ータは、第２のメモリ12にフレーム単位又はフィールド
単位で記憶される。第１のメモリ４と第２のメモリ12と
は同じ走査タイミング（速度）で各データの出力を行
い、その際、第６図の動作モデル図に示すように、第２
のメモリ12が出力するディジタル画像データの画面ｅに
透明色部Ｐがあるか否かを判定部23で判定し、これに応
じて、スイッチ21,22の一方を閉じ、各メモリ4,12のい
ずれかのデータを、選択的に第１のバス13に出力する。
すなわち、走査中において、第２のメモリ12のディジタ
ル画像データに上記透明色部Ｐがあれば、このディジタ
ル画像データの出力をカットして、第１のメモリ４から
のビデオ画像データを第１のバス13に送り、逆に上記透
明色部Ｐがディジタル画像データになければ、第１のメ
モリ４の出力をカットし、第２のメモリ12のディジタル
画像データを、第１のバス13に出力する。この結果、第
５図に示す画面ｆに対応する画像表示信号VOが出力装置
15を通して出力され、この出力によりビデオ画像にディ
ジタル画像がスーパーインポーズされた画面ｆがモニタ
16上に表示される。
一方、この種の装置においては、第７図あるいは第８図
に示すように、映像信号の縮小（又は拡大）処理と組合
わせた多様な表示が必要であるが、この場合、映像信号
の縮小又は拡大処理に必要なデータや制御コマンド信号
（縮小率又は拡大率表示位置等）は、バス10を介してCP
U6から与えられる。
に示すように、映像信号の縮小（又は拡大）処理と組合
わせた多様な表示が必要であるが、この場合、映像信号
の縮小又は拡大処理に必要なデータや制御コマンド信号
（縮小率又は拡大率表示位置等）は、バス10を介してCP
U6から与えられる。
従来の映像信号処理装置は以上のように構成されている
ので、第１および第２のメモリ4,12は、バス10及び第１
のバス13とのインタフェースが夫々必要であり、また第
２のメモリ12はDMAバス11とのインタフェースが必要で
あり、このため、ハードウエアの構成が複雑になる。さ
らに例えば、表示内容を第７図の例から第８図の例へと
切換える場合は、ディジタル画像の切換わりタイミング
はDMAバス11の速度に支配され、一方、ビデオ画像の切
換わりタイミングはCPU6のコマンド伝送速度に依存して
いる。このため、両者の切換わりタイミングの差によ
り、表示内容の切換わり時において、ビデオ画像とディ
ジタル画像との切換わりに時間的なズレが生じ、表示内
容がスムーズに切換えられないという問題点があった。
ので、第１および第２のメモリ4,12は、バス10及び第１
のバス13とのインタフェースが夫々必要であり、また第
２のメモリ12はDMAバス11とのインタフェースが必要で
あり、このため、ハードウエアの構成が複雑になる。さ
らに例えば、表示内容を第７図の例から第８図の例へと
切換える場合は、ディジタル画像の切換わりタイミング
はDMAバス11の速度に支配され、一方、ビデオ画像の切
換わりタイミングはCPU6のコマンド伝送速度に依存して
いる。このため、両者の切換わりタイミングの差によ
り、表示内容の切換わり時において、ビデオ画像とディ
ジタル画像との切換わりに時間的なズレが生じ、表示内
容がスムーズに切換えられないという問題点があった。
この発明は上記のような問題点を解決するためになされ
たもので、単純なハードウエア構成を実現するととも
に、表示内容の円滑な切換え制御を実現することのでき
る映像信号処理装置を得ることを目的とする。
たもので、単純なハードウエア構成を実現するととも
に、表示内容の円滑な切換え制御を実現することのでき
る映像信号処理装置を得ることを目的とする。
この発明に係る映像信号処理装置は、従来、表示内容の
制御に必要であったプログラムコントロールチャンネル
用のバスとDMAバスとを第２のバスとして１本のバスに
まとめるとともに、そのデータの伝送タイミングを映像
信号と同じタイミングとし、その際ディジタル画像デー
タは、映像信号の映像期間に第２のバスを介して伝送
し、映像信号の処理に必要なデータや制御コマンド信号
等は、映像信号の帰線消去期間に同じ第２のバスを介し
て時分割多重伝送するようにしたものである。
制御に必要であったプログラムコントロールチャンネル
用のバスとDMAバスとを第２のバスとして１本のバスに
まとめるとともに、そのデータの伝送タイミングを映像
信号と同じタイミングとし、その際ディジタル画像デー
タは、映像信号の映像期間に第２のバスを介して伝送
し、映像信号の処理に必要なデータや制御コマンド信号
等は、映像信号の帰線消去期間に同じ第２のバスを介し
て時分割多重伝送するようにしたものである。
この発明における映像信号処理装置は、表示内容の制御
に必要であった２つのバスを１つのバスとし、そのデー
タ伝送タイミングを映像信号に準拠したタイミングとす
るとともに、映像信号の処理に必要なデータ制御，コマ
ンド信号等を時分割多重伝送することにより、ハードウ
エア構成が単純化され、表示内容の切換え制御もスムー
ズに行なうことができるようになる。
に必要であった２つのバスを１つのバスとし、そのデー
タ伝送タイミングを映像信号に準拠したタイミングとす
るとともに、映像信号の処理に必要なデータ制御，コマ
ンド信号等を時分割多重伝送することにより、ハードウ
エア構成が単純化され、表示内容の切換え制御もスムー
ズに行なうことができるようになる。
以下、この発明の一実施例を図について説明する。
第１図においては第４図と対応する部分には同一符号を
付して説明を省略する。20はこの発明による第２のバス
であり、前述した第４図におけるバス10及びDMAバス11
は省略され、これらに接続されていた第１のメモリ4,第
２のメモリ12は、何れもこの第２のバス20に接続されて
いる。またこの第２のバス20はCPU6により駆動され、従
って、このCPU6は第２のバス20を駆動する信号発生装置
としても用いられている。
付して説明を省略する。20はこの発明による第２のバス
であり、前述した第４図におけるバス10及びDMAバス11
は省略され、これらに接続されていた第１のメモリ4,第
２のメモリ12は、何れもこの第２のバス20に接続されて
いる。またこの第２のバス20はCPU6により駆動され、従
って、このCPU6は第２のバス20を駆動する信号発生装置
としても用いられている。
次に動作について説明する。第２図に第２のバス20の概
略的なデータ伝送のタイミングを示す。従来DMAバスを
介してCPU6から第２のメモリ12へ伝送されていたディジ
タル画像データは、映像信号VIの映像期間T2に相当する
タイミングで第２のバス20を介して第２のメモリ12へ伝
送される。さらに従来、バス10を介してCPU6から第１の
メモリ４へ伝送されていた映像信号VIの拡大、縮小、あ
るいは表示位置の指定等に必要な各種制御コマンド信号
は、映像信号の垂直帰線消去期間T1に相当するタイミン
グで、ディジタル画像データと同一の信号線、即ち、第
２のバス20上を時分割多重伝送される。このように、第
１のメモリ４及び第２のメモリ12に対して夫々必要なコ
マンド信号を与えたり、あるいは画像データを選択的に
取り出すことによって、１つの第２のバス20で従来と同
等の働きが実現できる。さらに、表示内容の切換えに対
しても、従来CPU6が第１のメモリ４へ制御コマンドを伝
送する際に、CPU6は画像信号と同期していないため、例
えば、１フィールド画面の表示期間中にコマンドが伝送
される場合があり、１フィールド画面の表示中に表示内
容の切換えが行われ、一瞬画面がみだれていた。本願発
明によれば、表示内容の切換えに対しても、切換え制御
コマンド信号を垂直帰線消去期間T1に多重しており、し
かも第２のバス20が映像信号と同じタイミングであり、
従って、フィールド画面の切換わり時に表示内容の切換
えが実行されるため、画面のみだれはなく、スムーズな
画面の切換えが実現できる。
略的なデータ伝送のタイミングを示す。従来DMAバスを
介してCPU6から第２のメモリ12へ伝送されていたディジ
タル画像データは、映像信号VIの映像期間T2に相当する
タイミングで第２のバス20を介して第２のメモリ12へ伝
送される。さらに従来、バス10を介してCPU6から第１の
メモリ４へ伝送されていた映像信号VIの拡大、縮小、あ
るいは表示位置の指定等に必要な各種制御コマンド信号
は、映像信号の垂直帰線消去期間T1に相当するタイミン
グで、ディジタル画像データと同一の信号線、即ち、第
２のバス20上を時分割多重伝送される。このように、第
１のメモリ４及び第２のメモリ12に対して夫々必要なコ
マンド信号を与えたり、あるいは画像データを選択的に
取り出すことによって、１つの第２のバス20で従来と同
等の働きが実現できる。さらに、表示内容の切換えに対
しても、従来CPU6が第１のメモリ４へ制御コマンドを伝
送する際に、CPU6は画像信号と同期していないため、例
えば、１フィールド画面の表示期間中にコマンドが伝送
される場合があり、１フィールド画面の表示中に表示内
容の切換えが行われ、一瞬画面がみだれていた。本願発
明によれば、表示内容の切換えに対しても、切換え制御
コマンド信号を垂直帰線消去期間T1に多重しており、し
かも第２のバス20が映像信号と同じタイミングであり、
従って、フィールド画面の切換わり時に表示内容の切換
えが実行されるため、画面のみだれはなく、スムーズな
画面の切換えが実現できる。
なお、上記実施例では表示制御に関連する第２のバス20
とディジタル画像データの作成、あるいはプログラムの
作成に関連するバス10が、１つのCPU6により制御される
ような説明を行なった。一方、この発明のポイントは、
従来、バス10を介して与えられていた制御コマンド信号
等が第２のバス20を介して与えられるようになり、この
ためバス10が、表示制御部から独立することである。従
って、第３図に示すように、装置全体を表示系40と制御
系50とに機能的にも、また構造的にも分割することがで
きるようになる。ここで両者は、標準的なごく単純なイ
ンタフェース30を介して結びつければよい。
とディジタル画像データの作成、あるいはプログラムの
作成に関連するバス10が、１つのCPU6により制御される
ような説明を行なった。一方、この発明のポイントは、
従来、バス10を介して与えられていた制御コマンド信号
等が第２のバス20を介して与えられるようになり、この
ためバス10が、表示制御部から独立することである。従
って、第３図に示すように、装置全体を表示系40と制御
系50とに機能的にも、また構造的にも分割することがで
きるようになる。ここで両者は、標準的なごく単純なイ
ンタフェース30を介して結びつければよい。
なお、第３図において、61は制御系50に設けられたCP
U、62は表示系40に設けられ第２のバス20を駆動する信
号発生装置であり、複数のディジタル画像データを格納
するメモリを有している。インタフェース30はCPU61と
信号発生装置62とを接続する。また信号発生装置62にデ
ィジタル画像データを格納するディスクを接続してもよ
い。また制御系50は、パーソナルコンピュータ等の汎用
的なハードウエアを利用することができる。表示系40も
従来の３種類のバス構成が２種類のバス構成となるの
で、インタフェースが削減され、ハードウエア構成が単
純化される。
U、62は表示系40に設けられ第２のバス20を駆動する信
号発生装置であり、複数のディジタル画像データを格納
するメモリを有している。インタフェース30はCPU61と
信号発生装置62とを接続する。また信号発生装置62にデ
ィジタル画像データを格納するディスクを接続してもよ
い。また制御系50は、パーソナルコンピュータ等の汎用
的なハードウエアを利用することができる。表示系40も
従来の３種類のバス構成が２種類のバス構成となるの
で、インタフェースが削減され、ハードウエア構成が単
純化される。
以上のように、この発明によれば、ディジタル画像デー
タの伝送と、映像信号の処理に必要な制御コマンド信号
等を１つのバスで多重伝送するとともに、伝送タイミン
グを映像信号と同期させる構成としたので、ハードウエ
ア構成が簡単になるとともに、表示内容の切換えもスム
ーズに行なうことができる効果が得られる。
タの伝送と、映像信号の処理に必要な制御コマンド信号
等を１つのバスで多重伝送するとともに、伝送タイミン
グを映像信号と同期させる構成としたので、ハードウエ
ア構成が簡単になるとともに、表示内容の切換えもスム
ーズに行なうことができる効果が得られる。
第１図はこの発明の一実施例による映像信号処理装置を
示すブロック図、第２図は同装置の第２のバスの動作を
示すタイミングチャート、第３図はこの発明の他の実施
例による映像信号処理装置を示すブロック図、第４図は
従来の映像信号処理装置を示すブロック図、第５図は同
装置によるスーパーインポーズ表示を説明する図、第６
図は同装置の動作モデル図、第７図及び第８図は映像信
号を縮小して表示する場合を説明する図である。 ４は第１のメモリ、６はCPU、12は第２のメモリ、13は
第１のバス、20は第２のバス。 なお、図中、同一符号は同一、又は相当部分を示す。
示すブロック図、第２図は同装置の第２のバスの動作を
示すタイミングチャート、第３図はこの発明の他の実施
例による映像信号処理装置を示すブロック図、第４図は
従来の映像信号処理装置を示すブロック図、第５図は同
装置によるスーパーインポーズ表示を説明する図、第６
図は同装置の動作モデル図、第７図及び第８図は映像信
号を縮小して表示する場合を説明する図である。 ４は第１のメモリ、６はCPU、12は第２のメモリ、13は
第１のバス、20は第２のバス。 なお、図中、同一符号は同一、又は相当部分を示す。
Claims (1)
- 【請求項１】映像信号から得られるビデオ画像データを
格納する第１のメモリと、ディジタル画像データを格納
する第２のメモリと、上記第１のメモリに格納されたビ
デオ画像データ又は上記第２のメモリに格納されたディ
ジタル画像データを選択的に読み出して出力する第１の
バスとを有する映像信号処理装置において、上記第１及
び第２のメモリに接続される第２のバスと、この第２の
バスを駆動する信号発生装置とを設け、この信号発生装
置は上記映像信号と同じタイミングで上記第２のメモリ
に対して上記ディジタル画像データを上記第２のバスを
通じて伝送させると共に、上記映像信号の帰線消去期間
に上記第１のメモリに対して上記ビデオ画像データの処
理に必要な制御コマンド信号を上記第２のバスを通じて
時分割多重伝送させることを特徴とする映像信号処理装
置。
Priority Applications (4)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63276070A JPH0783454B2 (ja) | 1988-11-02 | 1988-11-02 | 映像信号処理装置 |
| US07/381,945 US4996598A (en) | 1988-11-02 | 1989-07-19 | Apparatus for processing video signal |
| DE68925023T DE68925023T2 (de) | 1988-11-02 | 1989-07-21 | Videosignalverarbeitungsgerät. |
| EP89113398A EP0366871B1 (en) | 1988-11-02 | 1989-07-21 | Apparatus for processing video signal |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63276070A JPH0783454B2 (ja) | 1988-11-02 | 1988-11-02 | 映像信号処理装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH02123881A JPH02123881A (ja) | 1990-05-11 |
| JPH0783454B2 true JPH0783454B2 (ja) | 1995-09-06 |
Family
ID=17564383
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP63276070A Expired - Fee Related JPH0783454B2 (ja) | 1988-11-02 | 1988-11-02 | 映像信号処理装置 |
Country Status (4)
| Country | Link |
|---|---|
| US (1) | US4996598A (ja) |
| EP (1) | EP0366871B1 (ja) |
| JP (1) | JPH0783454B2 (ja) |
| DE (1) | DE68925023T2 (ja) |
Families Citing this family (20)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5583566A (en) * | 1989-05-12 | 1996-12-10 | Olympus Optical Co., Ltd. | Combined medical image and data transmission with data storage, in which character/diagram information is transmitted with video data |
| JP2805859B2 (ja) * | 1989-07-06 | 1998-09-30 | キヤノン株式会社 | 静止画像再生装置 |
| US5220312A (en) * | 1989-09-29 | 1993-06-15 | International Business Machines Corporation | Pixel protection mechanism for mixed graphics/video display adaptors |
| JPH0817445B2 (ja) * | 1990-11-06 | 1996-02-21 | 大日本スクリーン製造株式会社 | 画像のカブセ処理方法 |
| JP2560915B2 (ja) * | 1990-11-28 | 1996-12-04 | 三菱電機株式会社 | 液晶表示パネル駆動回路 |
| US5703698A (en) * | 1991-03-04 | 1997-12-30 | Canon Kabushiki Kaisha | Apparatus and method for facsimile transmission of synthesized images |
| JP3347339B2 (ja) * | 1991-04-08 | 2002-11-20 | キヤノン株式会社 | 画像処理装置 |
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