JPH0582496A - レジスト除去方法及びその装置 - Google Patents

レジスト除去方法及びその装置

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JPH0582496A
JPH0582496A JP26842391A JP26842391A JPH0582496A JP H0582496 A JPH0582496 A JP H0582496A JP 26842391 A JP26842391 A JP 26842391A JP 26842391 A JP26842391 A JP 26842391A JP H0582496 A JPH0582496 A JP H0582496A
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JP
Japan
Prior art keywords
resist
substrate
cleaning liquid
etching
liquid
Prior art date
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Pending
Application number
JP26842391A
Other languages
English (en)
Inventor
Junichi Sano
純一 佐野
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Sanyo Electric Co Ltd
Original Assignee
Sanyo Electric Co Ltd
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Publication date
Application filed by Sanyo Electric Co Ltd filed Critical Sanyo Electric Co Ltd
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  • Drying Of Semiconductors (AREA)
  • Exposure Of Semiconductors, Excluding Electron Or Ion Beam Exposure (AREA)
  • Cleaning Or Drying Semiconductors (AREA)

Abstract

(57)【要約】 【目的】 減圧雰囲気下でレジスト残滓を除去すること
により、微細なパタンに生じる気泡を除去してパタンに
入りこんだレジスト残滓を完全に除去する。 【構成】 導入口6から液槽1内に注入された洗浄液7
の中に、ウェハカセット3にセットされた基板4を挿入
し、排気口9から排気して液槽1内を減圧し、減圧下で
基板4を洗浄する。その後、ガス導入口8からガスを導
入して液槽1内を常圧に戻し、基板4をウェハカセット
3ごと取り出す。

Description

【発明の詳細な説明】
【0001】
【産業上の利用分野】本発明は、シリコン基板上に塗布
されたレジストに回路パターンを転写してレジストをマ
スクとしてエッチング加工し、このレジストを大部分除
去した後に残るレジストの残滓を除去する方法及びこれ
に用いる装置に関する。
【0002】
【従来の技術】その高集積化に伴って加工寸法が微細化
している半導体装置の作製プロセスでは、エッチング技
術の向上が重要な課題である。
【0003】シリコン基板上に堆積された絶縁膜,導電
膜上に微細なパターンを形成する方法としては、堆積膜
に塗布したレジストを露光現像してパターンを転写する
ことによって堆積膜上にレジストパターンを形成した
後、レジストパターンをマスクとしてRFプラズマ,μ
波プラズマ等を用いたRIE (Reactive Ion Etching)を行
い、堆積膜上に微細な回路パターンを形成する方法が一
般的である。このような方法では回路パターン形成後に
レジストを除去しなければならない。
【0004】素子の高集積化に伴ってエッチングするパ
ターンも微細化し、例えば、16MDRAMでは 0.5μ
m,64MDRAMでは 0.4μmの微細なパターン形成技
術が必要になっている。このような微細パターンを形成
するには、レジストの微細パターン形成技術,エッチン
グの加工精度の向上,エッチング時に発生するダメージ
の除去技術の確立と同様に、エッチング後のレジストの
完全な除去方法の確立が重要な課題である。
【0005】従来では、オゾン又はμ波を用いたアッシ
ング装置により、基板表面に付着した大部分のレジスト
を剥離除去した後、硫酸・過酸化水素水の混合液及び水
酸化アンモニウム・過酸化水素水の混合液に順次浸して
水洗することによってエッチング後のレジストの残滓及
び異方性エッチング用に形成されたエッチング側壁保護
膜を除去し、レジストの残滓を除去した基板を乾燥する
方法が一般的となっている。
【0006】
【発明が解決しようとする課題】しかし、エッチングパ
ターンの微細化に伴い、従来では問題とならなかったレ
ジスト残滓,エッチング側壁保護膜の除去の不完全性が
その後の工程に不安定をもたらす原因となっている。
【0007】特に、 0.6μm以下のコンタクトホール形
成後のレジスト残滓,異方性確保のために形成される側
壁保護膜の除去が困難になってきており、その後の金属
配線形成時にコンタクト抵抗の高抵抗化及び接触不良を
引き起こす原因となっている。
【0008】図1は、従来のレジスト除去方法により得
られた、酸化膜厚 1.5μmの試料のコンタクトホール径
とコンタクト抵抗との関係を示すグラフである。図から
明らかなように、径 0.6μm以上のコンタクトホールに
関しては抵抗値にばらつきがなく安定したコンタクトが
形成されるが、径が 0.6μm以下になると急激に抵抗値
にばらつきが生ず、特に0.5 μm以下でばらつきが大き
い。
【0009】このような抵抗値のばらつきの原因はエッ
チング速度のエッチング面積への依存性に伴って生じる
マイクロローディング効果等による微細コンタクトホー
ル形成プロセスの不安定性と大いに関係があるが、エッ
チング後のレジスト残滓及びエッチング側壁保護膜の除
去の不完全性にも原因がある。
【0010】しかし、0.6 μm以下のコンタクトホール
形成後、レジスト残滓及び側壁保護膜を硫酸・過酸化水
素水の混合液及び水酸化アンモニウム・過酸化水素水の
混合液中で除去する際、コンタクトホールが微細なため
に脱気が不十分となりコンタクトホールの内部に形成さ
れた気泡に邪魔されて混合液がパターン内へ回り込ま
ず、レジスト残滓及びエッチング側壁保護膜と十分に接
触できないためにこれらの除去が不完全になる。
【0011】本発明はこのような問題点を解決するため
になされたものであって、エッチング後のレジストを大
部分除去した後、液中で基板を洗浄してレジストの残滓
を除去する際に減圧下で行うことにより、微細なパター
ンに付着したレジストの残滓を完全に除去する方法及び
その装置の提供を目的とする。
【0012】
【課題を解決するための手段】本発明に係るレジスト除
去方法は、基板上にパターン形成されたレジストをマス
クとしたエッチング加工後に基板を洗浄液中で洗浄して
レジストの残滓を除去する方法において、基板を洗浄液
中で洗浄してレジストの残滓を除去する工程を減圧下で
行うことを特徴とする。
【0013】また、本発明に係るレジスト除去装置は、
基板上にパターン形成されたレジストをマスクとしたエ
ッチング加工後に基板を洗浄液中で洗浄してレジストの
残滓を除去する装置において、洗浄液を貯留する液槽
と、洗浄液中で基板を保持する保持体と、液槽内を減圧
する減圧手段と、減圧した液槽内を常圧に戻す手段とを
備えたことを特徴とする。
【0014】
【作用】本発明に係るレジスト除去方法は、エッチング
加工した基板を液槽に貯留された洗浄液に挿入して保持
体で保持し、液槽内を減圧して基板を洗浄した後、液槽
内を常圧に戻して基板を取り出す。
【0015】従って、コンタクトホール等の窪んだ微細
なパターンに生じた気泡が除かれて洗浄液が十分に回り
込み、レジスト残滓及びエッチング側壁保護膜をほぼ完
全に除去する。
【0016】
【実施例】以下、本発明をその実施例を示す図に基づい
て説明する。図2は本発明に係るレジスト除去装置の構
成を示す模式的断面図である。図中1は薬液,純水等の
基板の洗浄液7を貯留する液槽であって、液槽1の内部
周壁から底部周縁にかけて、洗浄液7を加熱するヒータ
が内蔵されており、底部中央には洗浄液7を外部へ排水
する排水口5が設けられ、上部は上蓋10によって覆われ
る。
【0017】液槽1の側壁には洗浄液7の導入口6及び
液槽1内部を常圧に戻す窒素ガスのガス導入口8が設け
られ、上蓋10には液槽1の内部を減圧する排気口9が設
けられ、排気口9は図示しないアスピレータに接続され
る。
【0018】また、ウェハカセット3は基板4を保持し
たまま洗浄液7中に挿入され、洗浄液7中で基板4を固
定保持する。
【0019】次に、以上のような構成のレジスト除去装
置を用いた本発明に係るレジスト除去方法(以下、本発
明方法という)について説明する。なお、本発明方法に
は、図2に示す液槽1を洗浄液7の種類別に設けた装置
を用いる。
【0020】シリコン基板上に堆積した酸化膜又は多結
晶シリコン膜をレジストパタニング後エッチングを行
う。エッチングを行った後、オゾンアッシャにより基板
表面に残った大部分のレジストを除去する。オゾンアッ
シングをチャンバ温度 300℃,酸素流量10リットル/mi
n,アッシング時間60sec.の条件で行って 1.2μm厚の
レジストを除去する。
【0021】レジストアッシング後、第1液槽1aに、硫
酸・過酸化水素水(140 :1)の混合液からなる洗浄液
7を導入口6より注ぎ、ヒータ2によって加熱して液温
140℃に保温した中にウェハカセット3にセットした基
板4を挿入する。
【0022】基板4の挿入後、上蓋10を閉じ、アスピレ
ータを作動して排気口9 より液槽1a内を約200mmHg まで
脱気して基板4を12分間洗浄する。
【0023】その後、真空引きを止め、ガス導入口8か
ら第1液槽1a内に窒素ガスを導入して大気圧に戻し、ウ
ェハカセット3ごと基板4を取り出し、基板4を常圧下
の純水中で、10分間流水洗浄する。
【0024】さらに、第2液槽1bに純水を注いでヒータ
2によって50℃に保温した中に基板4をウェハカセット
3ごと挿入して第2液槽1b内の真空引きを行い、基板4
を15分間洗浄する。
【0025】真空引きを止め、ガス導入口8から第1液
槽1a内に窒素ガスを導入して大気圧に戻した後、ウェハ
カセット3ごと基板4を取り出す。基板4を常圧下の純
水中で10分間流水洗浄する。
【0026】次に、第3液槽1cに、水酸化アンモニウム
・過酸化水素水・純水(1:1:5)の混合液を入れ、
ヒータ2によって70℃に液温を保持した中に基板4をウ
ェハカセット3ごと挿入する。アスピレータにより200m
mHg まで真空引きを行い、減圧下で5分間、基板4を洗
浄する。
【0027】その後、ガス導入口8からの窒素導入によ
り第3液槽1c内を常圧に戻して基板4を取り出し、常圧
下の純水中で10分間流水洗浄する。
【0028】さらに、前述の第2液槽1bの純水を排水口
5から排水して槽内を洗浄した後、新たに純水を第2液
槽1b内に入れて常温を保ち、基板4をウェハカセット3
ごと洗浄液7に挿入して減圧下で10分間基板4を洗浄す
る。
【0029】減圧下での水洗終了後、第2液槽1b内を常
圧に戻し、基板4をウェハカセット3ごと取り出して常
圧下の純水中で15分間流水洗浄し、洗浄した基板4を乾
燥させる。
【0030】図3は本発明方法によるレジスト除去後、
金属配線を行った試料のコンタクト径に対するコンタク
ト抵抗を評価した結果を示すグラフである。
【0031】図1に示す従来例と比較すると、 0.6μm
以下のコンタクトホールにおいても抵抗値のばらつきが
減少して抵抗値が安定しており、本発明方法が、微細な
パターン側壁に残ったレジスト残滓及び側壁保護膜の除
去に有効に作用したことを示している。
【0032】なお、本実施例では、減圧下での基板洗浄
に、アスピレータを用いた場合について説明したが、減
圧装置はアスピレータに限るものではなく、より高真空
化が可能な装置を用いればより微細なパターン形成時に
も適応できる。
【0033】
【発明の効果】以上のように、本発明に係るレジスト除
去方法は、大部分のレジストをアッシング等で剥離除去
した後のレジスト残滓を洗浄液で洗浄して除去する際、
減圧下で行うことにより微細なパターンに生じた気泡を
除いて洗浄液をパターンの窪みにまで十分に行き渡らせ
るので、レジスト残滓及びエッチング側壁保護膜をほぼ
完全に除去することができるという優れた効果を奏す
る。
【図面の簡単な説明】
【図1】従来のレジスト除去方法によるコンタクト抵抗
とコンタクトホール径との関係を示すグラフである。
【図2】本発明に係るレジスト除去装置の構成を示す模
式的断面図である。
【図3】本発明方法により得られた試料のコンタクトホ
ール径とコンタクト抵抗との関係を示すグラフである。
【符号の説明】 1 液槽 2 ヒータ 3 ウェハカセット 4 基板 6 導入口 7 洗浄液 9 排気口

Claims (2)

    【特許請求の範囲】
  1. 【請求項1】 基板上にパターン形成されたレジストを
    マスクとしたエッチング加工後に基板を洗浄液中で洗浄
    してレジストの残滓を除去する方法において、基板を洗
    浄液中で洗浄してレジストの残滓を除去する工程を減圧
    下で行うことを特徴とするレジスト除去方法。
  2. 【請求項2】 基板上にパターン形成されたレジストを
    マスクとしたエッチング加工後に基板を洗浄液中で洗浄
    してレジストの残滓を除去する装置において、洗浄液を
    貯留する液槽と、洗浄液中で基板を保持する保持体と、
    液槽内を減圧する減圧手段と、減圧した液槽内を常圧に
    戻す手段とを備えたことを特徴とするレジスト除去装
    置。
JP26842391A 1991-09-18 1991-09-18 レジスト除去方法及びその装置 Pending JPH0582496A (ja)

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Cited By (6)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5419353A (en) * 1994-05-04 1995-05-30 Chen; Hong-Wel Object cleaning and washing device
DE19715368A1 (de) * 1997-04-14 1998-10-15 Iris Bohnet Verfahren und Vorrichtung zur Herstellung einer Multi-Layer-Leiterplatte
US5845663A (en) * 1996-03-13 1998-12-08 Lg Semicon Co., Ltd. Wafer wet processing device
US6105592A (en) * 1997-07-21 2000-08-22 Semitool, Inc. Gas intake assembly for a wafer processing system
JP2015054288A (ja) * 2013-09-12 2015-03-23 三菱電機株式会社 洗浄方法、洗浄装置および洗浄方法を適用した被洗浄物
JPWO2019159969A1 (ja) * 2018-02-14 2021-02-18 Scivax株式会社 両面成型方法および成型品

Cited By (7)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5419353A (en) * 1994-05-04 1995-05-30 Chen; Hong-Wel Object cleaning and washing device
US5845663A (en) * 1996-03-13 1998-12-08 Lg Semicon Co., Ltd. Wafer wet processing device
DE19715368A1 (de) * 1997-04-14 1998-10-15 Iris Bohnet Verfahren und Vorrichtung zur Herstellung einer Multi-Layer-Leiterplatte
DE19715368C2 (de) * 1997-04-14 2000-09-21 Iris Bohnet Verfahren und Vorrichtung zur Herstellung einer Multi-Layer-Leiterplatte
US6105592A (en) * 1997-07-21 2000-08-22 Semitool, Inc. Gas intake assembly for a wafer processing system
JP2015054288A (ja) * 2013-09-12 2015-03-23 三菱電機株式会社 洗浄方法、洗浄装置および洗浄方法を適用した被洗浄物
JPWO2019159969A1 (ja) * 2018-02-14 2021-02-18 Scivax株式会社 両面成型方法および成型品

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