JPH05176178A - ディジタル画像信号の伝送装置 - Google Patents
ディジタル画像信号の伝送装置Info
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- JPH05176178A JPH05176178A JP35782791A JP35782791A JPH05176178A JP H05176178 A JPH05176178 A JP H05176178A JP 35782791 A JP35782791 A JP 35782791A JP 35782791 A JP35782791 A JP 35782791A JP H05176178 A JPH05176178 A JP H05176178A
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- Compression Of Band Width Or Redundancy In Fax (AREA)
- Image Processing (AREA)
- Compression Or Coding Systems Of Tv Signals (AREA)
- Compression, Expansion, Code Conversion, And Decoders (AREA)
- Communication Control (AREA)
Abstract
(57)【要約】
【目的】ＤＣＴで発生した可変長データを簡単な回路お
よび制御で、所定のビット幅のデータにフレーム化す
る。 【構成】（８×８）のブロックのＤＣＴで発生した係数
データが可変長符号化される。このコード（ＤＣ、ＡＣ
０〜ＡＣ６２）が直流分を先頭にして、交流分を低次か
ら高次の順序で前に詰める。また、付加コードＢＡ０〜
ＢＡ３内には、そのシンクブロックのデータエリア内で
最初の直流分ＤＣの位置を示すポインタが挿入される。
よび制御で、所定のビット幅のデータにフレーム化す
る。 【構成】（８×８）のブロックのＤＣＴで発生した係数
データが可変長符号化される。このコード（ＤＣ、ＡＣ
０〜ＡＣ６２）が直流分を先頭にして、交流分を低次か
ら高次の順序で前に詰める。また、付加コードＢＡ０〜
ＢＡ３内には、そのシンクブロックのデータエリア内で
最初の直流分ＤＣの位置を示すポインタが挿入される。
Description
【０００１】
【産業上の利用分野】この発明は、高能率符号化として
ＤＣＴを使用するディジタル画像信号の伝送装置、特
に、伝送データのフレーム化に関する。
ＤＣＴを使用するディジタル画像信号の伝送装置、特
に、伝送データのフレーム化に関する。
【０００２】
【従来の技術】ディジタルビデオ信号を例えば回転ヘッ
ドにより磁気テープに記録するディジタルＶＴＲが知ら
れている。ディジタルビデオ信号の情報量が多いので、
その伝送データ量を圧縮するための高能率符号化が採用
されることが多い。種々の高能率符号化の中でも、ＤＣ
Ｔ（Discrete Cosine Transform)の実用化が進んでい
る。
ドにより磁気テープに記録するディジタルＶＴＲが知ら
れている。ディジタルビデオ信号の情報量が多いので、
その伝送データ量を圧縮するための高能率符号化が採用
されることが多い。種々の高能率符号化の中でも、ＤＣ
Ｔ（Discrete Cosine Transform)の実用化が進んでい
る。
【０００３】ＤＣＴは、１フレームの画像を例えば（８
×８）のブロック構造に変換し、このブロックを直交変
換の一種であるコサイン変換処理するものである。その
結果、（８×８）の係数データが発生する。このような
係数データは、ランレングス符号、ハフマン符号等の可
変長符号化の処理を受けてから伝送される。伝送時に
は、一定長のデータ毎にブロック同期信号が付加された
シンクブロックの構成とされるのが普通である。
×８）のブロック構造に変換し、このブロックを直交変
換の一種であるコサイン変換処理するものである。その
結果、（８×８）の係数データが発生する。このような
係数データは、ランレングス符号、ハフマン符号等の可
変長符号化の処理を受けてから伝送される。伝送時に
は、一定長のデータ毎にブロック同期信号が付加された
シンクブロックの構成とされるのが普通である。
【０００４】受信側では、シンクブロックに含まれるデ
ータを可変長符号の復号を行った後に、画像データに変
換する逆ＤＣＴ変換がなされる。可変長符号の復号の場
合には、受信データから各係数データと対応するコード
を正しく抽出する必要がある。従来では、係数データ間
に存在する重要度の相違を考慮して、重要度が高い直流
分、交流分の低次のデータ、すなわち、重要語をなるべ
く正しく抽出できるように考慮された配列を使用してい
た。
ータを可変長符号の復号を行った後に、画像データに変
換する逆ＤＣＴ変換がなされる。可変長符号の復号の場
合には、受信データから各係数データと対応するコード
を正しく抽出する必要がある。従来では、係数データ間
に存在する重要度の相違を考慮して、重要度が高い直流
分、交流分の低次のデータ、すなわち、重要語をなるべ
く正しく抽出できるように考慮された配列を使用してい
た。
【０００５】図８は、従来の伝送データの一例のシンク
ブロックを示す。シンクブロックの先頭にブロック同期
信号ＳＹＮＣが位置し、その後に、ＩＤ信号および付加
コードＢＡが位置し、付加コードの後に可変長符号化さ
れた係数データが位置する。この係数データの中で重要
度が高い直流分（ＤＣ）と低次の交流分（ＡＣ０〜ＡＣ
２）と座標データＨＶとが付加コードＢＡから一定の間
隔Ｔｘの位置に配される。ＰＴは、シンクブロックのデ
ータ毎に付加されたエラー訂正符号のパリティである。
図８において、斜線領域は、余った隙間に詰められた他
の交流分の係数データを意味している。
ブロックを示す。シンクブロックの先頭にブロック同期
信号ＳＹＮＣが位置し、その後に、ＩＤ信号および付加
コードＢＡが位置し、付加コードの後に可変長符号化さ
れた係数データが位置する。この係数データの中で重要
度が高い直流分（ＤＣ）と低次の交流分（ＡＣ０〜ＡＣ
２）と座標データＨＶとが付加コードＢＡから一定の間
隔Ｔｘの位置に配される。ＰＴは、シンクブロックのデ
ータ毎に付加されたエラー訂正符号のパリティである。
図８において、斜線領域は、余った隙間に詰められた他
の交流分の係数データを意味している。
【０００６】このようなデータ配列を実現するフレーム
化回路の構成の一例を図９に示す。図示せずＤＣＴの変
換器からの係数データＤＴが量子化回路３１および見積
り器３２に供給される。見積り器３２は、所定期間のデ
ータ量を目標値Ａｍ以下とするための量子化ステップを
決定する。この量子化ステップを示す量子化番号ＱＮＯ
がメモリ３３に供給される。メモリ３３からの量子化番
号ＱＮＯが量子化回路３１に供給され、係数データＤＴ
が量子化される。この量子化は、再量子化であって、量
子化回路３１の出力には、ビット数が制御された係数デ
ータが発生する。この発生データ量の制御は、ディジタ
ルＶＴＲに特有の処理で、所定期間（例えば１フレー
ム）のデータを１トラック内に記録するために必要であ
る。但し、直流分は、重要であるため再量子化されな
い。
化回路の構成の一例を図９に示す。図示せずＤＣＴの変
換器からの係数データＤＴが量子化回路３１および見積
り器３２に供給される。見積り器３２は、所定期間のデ
ータ量を目標値Ａｍ以下とするための量子化ステップを
決定する。この量子化ステップを示す量子化番号ＱＮＯ
がメモリ３３に供給される。メモリ３３からの量子化番
号ＱＮＯが量子化回路３１に供給され、係数データＤＴ
が量子化される。この量子化は、再量子化であって、量
子化回路３１の出力には、ビット数が制御された係数デ
ータが発生する。この発生データ量の制御は、ディジタ
ルＶＴＲに特有の処理で、所定期間（例えば１フレー
ム）のデータを１トラック内に記録するために必要であ
る。但し、直流分は、重要であるため再量子化されな
い。
【０００７】量子化回路３１の出力がエリア検出回路３
４およびセレクタＳＷ１の入力端子に供給される。エリ
ア検出回路３４は、量子化された（８×８）のデータ中
で、有意な（零でないという意味）データの存在する範
囲を検出し、この範囲を示す座標データＨＶを発生す
る。この座標データＨＶがメモリ３９に供給される。
４およびセレクタＳＷ１の入力端子に供給される。エリ
ア検出回路３４は、量子化された（８×８）のデータ中
で、有意な（零でないという意味）データの存在する範
囲を検出し、この範囲を示す座標データＨＶを発生す
る。この座標データＨＶがメモリ３９に供給される。
【０００８】セレクタＳＷ１は、直流分のコードを出力
端子ａを通じてメモリ３８に書き込み、その出力端子ｂ
を通じて交流分のコードを可変長符号化回路３５に供給
する。可変長符号化回路３５によって、ランレングス符
号化、ハフマン符号化等の処理をされた交流分のコード
のうちで、低次のものがメモリ４０に供給され、それ以
外のものがＦＩＦＯ３６に供給される。
端子ａを通じてメモリ３８に書き込み、その出力端子ｂ
を通じて交流分のコードを可変長符号化回路３５に供給
する。可変長符号化回路３５によって、ランレングス符
号化、ハフマン符号化等の処理をされた交流分のコード
のうちで、低次のものがメモリ４０に供給され、それ以
外のものがＦＩＦＯ３６に供給される。
【０００９】メモリ３３、３８、３９、４０およびＦＩ
ＦＯ３６には、所定の書き込み／読み出しアドレス、メ
モリ制御信号が供給され、メモリ３８、３９、４０およ
びＦＩＦＯ３６からの読み出しデータがセレクタＳＷ２
の入力端子ａ、ｂ、ｃ、ｄにそれぞれ供給される。セレ
クタＳＷ２の出力データがパッキング回路３７に供給さ
れ、図８のように、付加コードを有し、重要度が高いデ
ータが規則的に配列されたデータが出力される。図８中
には、含まれていないが、この図９の構成の場合には、
メモリ３３から読み出された量子化番号も、重要語の一
つとして、規則的に配列される。
ＦＯ３６には、所定の書き込み／読み出しアドレス、メ
モリ制御信号が供給され、メモリ３８、３９、４０およ
びＦＩＦＯ３６からの読み出しデータがセレクタＳＷ２
の入力端子ａ、ｂ、ｃ、ｄにそれぞれ供給される。セレ
クタＳＷ２の出力データがパッキング回路３７に供給さ
れ、図８のように、付加コードを有し、重要度が高いデ
ータが規則的に配列されたデータが出力される。図８中
には、含まれていないが、この図９の構成の場合には、
メモリ３３から読み出された量子化番号も、重要語の一
つとして、規則的に配列される。
【００１０】
【発明が解決しようとする課題】ディジタルＶＴＲにお
いて、磁気テープの速度が記録時のものに比してより高
速とされる変速再生時には、ヘッドの再生軌跡が複数の
トラックに跨がり、複数のトラックから断片的にデータ
が再生される。通常、１シンクブロックが再生されたデ
ータを有効データとして扱い、変速再生時の再生画像が
構築される。かかる変速再生時では、図８の従来のデー
タ配列では、直流分および低次のデータを得ることがで
きても、そのブロックの交流分のデータは、他のブロッ
クに含まれる場合が殆どであり、得ることができない。
その結果、モザイク状の再生画像しか得られない。直流
分のみを規則的に配する時には、よりこの問題が大き
い。
いて、磁気テープの速度が記録時のものに比してより高
速とされる変速再生時には、ヘッドの再生軌跡が複数の
トラックに跨がり、複数のトラックから断片的にデータ
が再生される。通常、１シンクブロックが再生されたデ
ータを有効データとして扱い、変速再生時の再生画像が
構築される。かかる変速再生時では、図８の従来のデー
タ配列では、直流分および低次のデータを得ることがで
きても、そのブロックの交流分のデータは、他のブロッ
クに含まれる場合が殆どであり、得ることができない。
その結果、モザイク状の再生画像しか得られない。直流
分のみを規則的に配する時には、よりこの問題が大き
い。
【００１１】また、図９に示されるように、重要語を規
則的に配するためのバッファメモリが必要とされ、回路
規模が大きく、処理が複雑化する問題がある。さらに、
重要語以外の可変長コードの区切りの検出を誤った時に
は、このエラーが１シンクブロック内に収まらず、時間
的に前のシンクブロックから後のシンクブロックにま
で、伝搬する問題がある。
則的に配するためのバッファメモリが必要とされ、回路
規模が大きく、処理が複雑化する問題がある。さらに、
重要語以外の可変長コードの区切りの検出を誤った時に
は、このエラーが１シンクブロック内に収まらず、時間
的に前のシンクブロックから後のシンクブロックにま
で、伝搬する問題がある。
【００１２】従って、この発明は、小さい回路規模で、
簡単な制御によって、変速再生時の画質を向上できるデ
ィジタル画像信号の伝送装置を提供することにある。
簡単な制御によって、変速再生時の画質を向上できるデ
ィジタル画像信号の伝送装置を提供することにある。
【００１３】この発明の他の目的は、エラー伝搬を１シ
ンクブロック内に抑えることができるディジタル画像信
号の伝送装置を提供することにある。
ンクブロック内に抑えることができるディジタル画像信
号の伝送装置を提供することにある。
【００１４】
【課題を解決するための手段】この発明は、入力ディジ
タル画像信号をＤＣＴによって圧縮符号化し、上記符号
化されたディジタル画像信号を伝送するようにしたディ
ジタル画像信号の伝送装置において、符号化によって生
じた係数データを直流分、交流分の低次のものから高次
のものに向かう順序で、ビット方向および所定のビット
幅方向に順次詰め込み、また、一定量のデータ毎にシン
クブロック同期信号を付加するための回路と、シンクブ
ロック同期信号が付加された所定のビット幅のデータを
伝送するための手段とからなることを特徴とするディジ
タル画像信号の伝送装置である。また、この発明は、直
流分の係数データのそのシンクブロック内のバイト位置
およびビット位置を示すポインタを付加し、さらに、一
定量のデータ毎にシンクブロック同期信号を付加して伝
送するものである。
タル画像信号をＤＣＴによって圧縮符号化し、上記符号
化されたディジタル画像信号を伝送するようにしたディ
ジタル画像信号の伝送装置において、符号化によって生
じた係数データを直流分、交流分の低次のものから高次
のものに向かう順序で、ビット方向および所定のビット
幅方向に順次詰め込み、また、一定量のデータ毎にシン
クブロック同期信号を付加するための回路と、シンクブ
ロック同期信号が付加された所定のビット幅のデータを
伝送するための手段とからなることを特徴とするディジ
タル画像信号の伝送装置である。また、この発明は、直
流分の係数データのそのシンクブロック内のバイト位置
およびビット位置を示すポインタを付加し、さらに、一
定量のデータ毎にシンクブロック同期信号を付加して伝
送するものである。
【００１５】
【作用】重要度が高い直流分のデータを規則的に並べる
処理が不要であって、回路構成が簡単とできる。また、
直流分および交流分の係数データが同じシンクブロック
内に含まれるので、変速再生時の画質を良好とできる。
さらに、ポインタを付加することで、エラー伝搬をシン
クブロック内に抑えることができる。
処理が不要であって、回路構成が簡単とできる。また、
直流分および交流分の係数データが同じシンクブロック
内に含まれるので、変速再生時の画質を良好とできる。
さらに、ポインタを付加することで、エラー伝搬をシン
クブロック内に抑えることができる。
【００１６】
【実施例】以下、この発明の一実施例について図面を参
照して説明する。図１は、この発明によるフレーム化回
路の構成を示す。１は、図示せぬＤＣＴの変換回路で発
生した（８×８）の係数データＤＴが供給される量子化
回路である。この係数データは、見積り器２にも供給さ
れる。
照して説明する。図１は、この発明によるフレーム化回
路の構成を示す。１は、図示せぬＤＣＴの変換回路で発
生した（８×８）の係数データＤＴが供給される量子化
回路である。この係数データは、見積り器２にも供給さ
れる。
【００１７】図２Ａは、係数データＤＴの（８×８）の
構成を示す。直流分ＤＣは、例えば９ビットであり、交
流分の係数データＡＣ０〜ＡＣ６２は、それぞれ１０ビ
ット（サインビット＋９ビット）である。１ブロックで
６４個の係数データＤＴは、直流分ＤＣを先頭にして、
ＡＣ０、ＡＣ１、ＡＣ２、・・・・のジグザク走査の順
で次数が低いものから高いものに向かって順に配列され
たものである。交流分の次数は、直流分との距離が大き
いほど高いくなる。この交流分の係数データの中で、斜
線を付したＡＣ０〜ＡＣ７を低次の交流分として扱って
いる。
構成を示す。直流分ＤＣは、例えば９ビットであり、交
流分の係数データＡＣ０〜ＡＣ６２は、それぞれ１０ビ
ット（サインビット＋９ビット）である。１ブロックで
６４個の係数データＤＴは、直流分ＤＣを先頭にして、
ＡＣ０、ＡＣ１、ＡＣ２、・・・・のジグザク走査の順
で次数が低いものから高いものに向かって順に配列され
たものである。交流分の次数は、直流分との距離が大き
いほど高いくなる。この交流分の係数データの中で、斜
線を付したＡＣ０〜ＡＣ７を低次の交流分として扱って
いる。
【００１８】量子化回路１では、係数データＤＴ内の直
流分は、再量子化されず、交流分が再量子化される。こ
の量子化ステップが見積り器２によって決定される。デ
ィジタルＶＴＲの場合では、編集等の処理がフレーム単
位でなされるので、１フレーム当りの発生データ量が目
標値Ａｍと等しいか、あるいはそれ以下となる必要があ
る。ＤＣＴおよび可変長符号化で発生するデータ量は、
符号化の対象の絵柄によって変化するので、所定期間当
りの発生データ量を目標値Ａｍ以下とする処理（バッフ
ァリング処理）がなされる。１フレーム毎にバッファリ
ング処理を行っても良いが、この例では、１５マクロブ
ロック単位でバッファリングを行う。
流分は、再量子化されず、交流分が再量子化される。こ
の量子化ステップが見積り器２によって決定される。デ
ィジタルＶＴＲの場合では、編集等の処理がフレーム単
位でなされるので、１フレーム当りの発生データ量が目
標値Ａｍと等しいか、あるいはそれ以下となる必要があ
る。ＤＣＴおよび可変長符号化で発生するデータ量は、
符号化の対象の絵柄によって変化するので、所定期間当
りの発生データ量を目標値Ａｍ以下とする処理（バッフ
ァリング処理）がなされる。１フレーム毎にバッファリ
ング処理を行っても良いが、この例では、１５マクロブ
ロック単位でバッファリングを行う。
【００１９】マクロブロックは、１ブロック当りの（８
×８）の係数データを複数ブロック集めたものである。
例えばコンポーネント方式の（Ｙ：Ｕ：Ｖ＝４：１：
１）のビデオデータの場合には、１フレーム内の同一位
置の、４個のＹブロックと１個のＵブロックと１個のＶ
ブロックとの計６ブロックが１マクロブロックを構成す
る。サンプリング周波数が１３．５ＭHzの場合では、１
フレームの画像が（８５８サンプル×５２５ライン）で
あり、その内の有効データが（７０４サンプル×４８０
ライン）とされる。上述のコンポーネント方式の場合に
は、１フレームの全ブロック数は、（７０４×６／４）
×４８０÷（８×８）＝７９２０として求められる。従
って、７９２０÷６＝１３２０が１フレーム内のマクロ
ブロックの個数である。
×８）の係数データを複数ブロック集めたものである。
例えばコンポーネント方式の（Ｙ：Ｕ：Ｖ＝４：１：
１）のビデオデータの場合には、１フレーム内の同一位
置の、４個のＹブロックと１個のＵブロックと１個のＶ
ブロックとの計６ブロックが１マクロブロックを構成す
る。サンプリング周波数が１３．５ＭHzの場合では、１
フレームの画像が（８５８サンプル×５２５ライン）で
あり、その内の有効データが（７０４サンプル×４８０
ライン）とされる。上述のコンポーネント方式の場合に
は、１フレームの全ブロック数は、（７０４×６／４）
×４８０÷（８×８）＝７９２０として求められる。従
って、７９２０÷６＝１３２０が１フレーム内のマクロ
ブロックの個数である。
【００２０】見積り器２は、バッファリング期間の発生
データ量を目標値以下とすることができ、且つなるべく
小さい値の量子化ステップを決定する。この方法として
は、複数の量子化ステップで係数データの量子化（すな
わち、係数データの各コードを量子化ステップで割算す
る処理）を並列に行い、その結果のデータ量を監視し、
上述の条件を満足する量子化ステップを択一的に決定す
る。この場合、全ての次数の交流分の係数データに対し
て、共通の量子化ステップを適用するのに限らず、その
次数に応じた量子化ステップを使用しても良い。つま
り、交流分の係数データを次数に応じて、複数のグルー
プに分割し、量子化ステップとして、複数のグループの
それぞれに対するものを用意する。そして、量子化ステ
ップを異ならせる場合、複数のグループに対する量子化
ステップの組を複数個準備し、複数の量子化ステップの
組で量子化を行い、その結果を参照して最適な量子化ス
テップが決定される。
データ量を目標値以下とすることができ、且つなるべく
小さい値の量子化ステップを決定する。この方法として
は、複数の量子化ステップで係数データの量子化（すな
わち、係数データの各コードを量子化ステップで割算す
る処理）を並列に行い、その結果のデータ量を監視し、
上述の条件を満足する量子化ステップを択一的に決定す
る。この場合、全ての次数の交流分の係数データに対し
て、共通の量子化ステップを適用するのに限らず、その
次数に応じた量子化ステップを使用しても良い。つま
り、交流分の係数データを次数に応じて、複数のグルー
プに分割し、量子化ステップとして、複数のグループの
それぞれに対するものを用意する。そして、量子化ステ
ップを異ならせる場合、複数のグループに対する量子化
ステップの組を複数個準備し、複数の量子化ステップの
組で量子化を行い、その結果を参照して最適な量子化ス
テップが決定される。
【００２１】見積り器２において決定された量子化ステ
ップは、量子化番号で表現される。この量子化番号がメ
モリ３に書き込まれる。メモリ３（あるいは見積り器
２）からの量子化番号が後段の処理に送られるととも
に、量子化回路１に供給される。この量子化回路１で、
交流分が量子化番号と対応する量子化ステップで再量子
化がなされる。この再量子化は、上述の量子化ステップ
の決定と同様に、次数に適応したものでも良い。
ップは、量子化番号で表現される。この量子化番号がメ
モリ３に書き込まれる。メモリ３（あるいは見積り器
２）からの量子化番号が後段の処理に送られるととも
に、量子化回路１に供給される。この量子化回路１で、
交流分が量子化番号と対応する量子化ステップで再量子
化がなされる。この再量子化は、上述の量子化ステップ
の決定と同様に、次数に適応したものでも良い。
【００２２】量子化回路１の出力がセレクタＳＷの入力
端子ａおよびエリア検出回路４に供給される。セレクタ
ＳＷの入力端子ｂには、エリア検出回路４からの座標デ
ータＨＶが供給される。エリア検出回路４は、量子化回
路１からのコード信号の中で有意な（すなわち、零でな
い）データが存在する範囲を検出する。（８×８）のブ
ロックを２次元座標（Ｈ＝０、１、・・・７、Ｖ＝０、
１、２、・・・７）で表し、図２Ｂに示すように、有意
なコードの存在範囲の２次元座標（Ｈ、Ｖ）をエリア検
出回路４が検出する。
端子ａおよびエリア検出回路４に供給される。セレクタ
ＳＷの入力端子ｂには、エリア検出回路４からの座標デ
ータＨＶが供給される。エリア検出回路４は、量子化回
路１からのコード信号の中で有意な（すなわち、零でな
い）データが存在する範囲を検出する。（８×８）のブ
ロックを２次元座標（Ｈ＝０、１、・・・７、Ｖ＝０、
１、２、・・・７）で表し、図２Ｂに示すように、有意
なコードの存在範囲の２次元座標（Ｈ、Ｖ）をエリア検
出回路４が検出する。
【００２３】セレクタＳＷは、コードの時には、量子化
回路１の出力を選択し、座標データＨＶを挿入するタイ
ミングでエリア検出回路４の出力を選択する。セレクタ
ＳＷの出力が可変長符号化回路５に供給される。可変長
符号化回路５の出力がＦＩＦＯ６に供給され、ＦＩＦＯ
６の出力がパッキング回路７に供給される。パッキング
回路７では、後述するように、アドレス、直流分の位置
を示すポインタ等を含む付加コードＢＡがＤＣＴのコー
ド信号に対して付加される。ＦＩＦＯ６に対する入力デ
ータのレイトは、可変長コードのために変化するが、そ
の出力データのレイトは、一定とされる。パッキング回
路７は、ＦＩＦＯ６の出力データを順に詰めて、所定の
ビット幅例えばバイト幅のデータを発生する。
回路１の出力を選択し、座標データＨＶを挿入するタイ
ミングでエリア検出回路４の出力を選択する。セレクタ
ＳＷの出力が可変長符号化回路５に供給される。可変長
符号化回路５の出力がＦＩＦＯ６に供給され、ＦＩＦＯ
６の出力がパッキング回路７に供給される。パッキング
回路７では、後述するように、アドレス、直流分の位置
を示すポインタ等を含む付加コードＢＡがＤＣＴのコー
ド信号に対して付加される。ＦＩＦＯ６に対する入力デ
ータのレイトは、可変長コードのために変化するが、そ
の出力データのレイトは、一定とされる。パッキング回
路７は、ＦＩＦＯ６の出力データを順に詰めて、所定の
ビット幅例えばバイト幅のデータを発生する。
【００２４】パッキング回路７内あるいはその後には、
図示せずも、ブロック同期信号、ＩＤ信号を付加する回
路が設けられ、これによってシンクブロック構成の記録
データが生成される。記録データは、さらに、シャフリ
ング、エラー訂正符号化、チャンネルコーディング等の
処理を受けてから複数の回転ヘッドに供給され、磁気テ
ープ上に記録される。一例として、２本のトラックが二
つの近接して配された回転ヘッドによって同時に形成
れ、１０本のトラックに１フレームのデータが分割して
記録される。なお、ＰＣＭオーディオ信号は、エラー訂
正符号化され、ビデオデータと混在して記録されるか、
あるいは１トラック内に設けられたオーディオデータ記
録区間に記録される。
図示せずも、ブロック同期信号、ＩＤ信号を付加する回
路が設けられ、これによってシンクブロック構成の記録
データが生成される。記録データは、さらに、シャフリ
ング、エラー訂正符号化、チャンネルコーディング等の
処理を受けてから複数の回転ヘッドに供給され、磁気テ
ープ上に記録される。一例として、２本のトラックが二
つの近接して配された回転ヘッドによって同時に形成
れ、１０本のトラックに１フレームのデータが分割して
記録される。なお、ＰＣＭオーディオ信号は、エラー訂
正符号化され、ビデオデータと混在して記録されるか、
あるいは１トラック内に設けられたオーディオデータ記
録区間に記録される。
【００２５】図３Ａは、この一実施例のシンクブロック
の構成を示す。２バイトのブロック同期信号ＳＹＮＣの
後に、２バイトのＩＤ信号が付加される。ＩＤ信号は、
ビデオデータの方式（ＮＴＳＣ、ＰＡＬ、ＨＤ、Ｓ
Ｄ）、アフレコの有無等の識別と、ＩＤ信号に対するパ
リティとを含む。ＩＤ信号の後に、４バイトの付加コー
ドＢＡ０、ＢＡ１、ＢＡ２、ＢＡ３が付加される。この
付加コードの後のデータエリア区間に、ＤＣＴで発生し
たコードおよび座標データＨＶが配される。最後に、パ
リティＰＴが位置する。
の構成を示す。２バイトのブロック同期信号ＳＹＮＣの
後に、２バイトのＩＤ信号が付加される。ＩＤ信号は、
ビデオデータの方式（ＮＴＳＣ、ＰＡＬ、ＨＤ、Ｓ
Ｄ）、アフレコの有無等の識別と、ＩＤ信号に対するパ
リティとを含む。ＩＤ信号の後に、４バイトの付加コー
ドＢＡ０、ＢＡ１、ＢＡ２、ＢＡ３が付加される。この
付加コードの後のデータエリア区間に、ＤＣＴで発生し
たコードおよび座標データＨＶが配される。最後に、パ
リティＰＴが位置する。
【００２６】エラー訂正符号として、積符号が使用さ
れ、その水平方向および垂直方向のデータに対して、リ
ード・ソロモン符号の符号化がそれぞれされる。水平方
向のエラー訂正符号が内符号と称され、垂直方向のエラ
ー訂正符号が外符号と称される。内符号は、１シンクブ
ロックのデータエリアに含まれるデータに対してなさ
れ、水平パリティＰＴが生成される。垂直パリティのみ
を含むシンクブロックもありうる。変速再生時では、シ
ンクブロックとして切り出されたデータが有効として扱
われ、内符号を使用したエラー訂正がなされる。図３Ｃ
は、エラー訂正符号の構成を示している。１シンクブロ
ックのデータエリアが２次元配列の１行を構成し、水平
パリティＰＴが生成される。各列のデータに対して、垂
直パリティが生成される。
れ、その水平方向および垂直方向のデータに対して、リ
ード・ソロモン符号の符号化がそれぞれされる。水平方
向のエラー訂正符号が内符号と称され、垂直方向のエラ
ー訂正符号が外符号と称される。内符号は、１シンクブ
ロックのデータエリアに含まれるデータに対してなさ
れ、水平パリティＰＴが生成される。垂直パリティのみ
を含むシンクブロックもありうる。変速再生時では、シ
ンクブロックとして切り出されたデータが有効として扱
われ、内符号を使用したエラー訂正がなされる。図３Ｃ
は、エラー訂正符号の構成を示している。１シンクブロ
ックのデータエリアが２次元配列の１行を構成し、水平
パリティＰＴが生成される。各列のデータに対して、垂
直パリティが生成される。
【００２７】ＤＣＴのコード信号は、直流分ＤＣを先頭
に、交流分の有意なものが低次から高次に向かって順に
シンクブロック内に詰め込まれる。座標データＨＶは、
この例では、直流分の後に挿入している。図３の例で
は、付加コードＢＡ３の直後に直流分ＤＣ０が位置して
いるが、直流分ＤＣの位置は、ブロックのコードの長さ
が可変であるので、まちまちである。好ましくは、１シ
ンクブロックのデータエリア内に、少なくとも１ブロッ
クのコードが含まれるように、シンクブロックの長さが
規定される。重要なのは、１ブロックの係数データと対
応するコードがひとかたまりでシンクブロック内に存在
していることである。
に、交流分の有意なものが低次から高次に向かって順に
シンクブロック内に詰め込まれる。座標データＨＶは、
この例では、直流分の後に挿入している。図３の例で
は、付加コードＢＡ３の直後に直流分ＤＣ０が位置して
いるが、直流分ＤＣの位置は、ブロックのコードの長さ
が可変であるので、まちまちである。好ましくは、１シ
ンクブロックのデータエリア内に、少なくとも１ブロッ
クのコードが含まれるように、シンクブロックの長さが
規定される。重要なのは、１ブロックの係数データと対
応するコードがひとかたまりでシンクブロック内に存在
していることである。
【００２８】付加コードＢＡ０〜ＢＡ３のビット構成の
詳細は、図３Ｂに示される。ＢＡ０の先頭の２ビット
（ＴＹＰＥ０、ＴＹＰＥ１）１１は、そのシンクブロッ
クがビデオデータか、オーディオデータか、垂直パリテ
ィデータか、ビデオ／オーディオの混在データの識別等
に使用される。ＢＡ１の８ビットとＢＡ０の６ビット
（ＢＬＫＮ０〜ＢＬＫＮ１３の符号が付されている）の
規定は、下記のものである。
詳細は、図３Ｂに示される。ＢＡ０の先頭の２ビット
（ＴＹＰＥ０、ＴＹＰＥ１）１１は、そのシンクブロッ
クがビデオデータか、オーディオデータか、垂直パリテ
ィデータか、ビデオ／オーディオの混在データの識別等
に使用される。ＢＡ１の８ビットとＢＡ０の６ビット
（ＢＬＫＮ０〜ＢＬＫＮ１３の符号が付されている）の
規定は、下記のものである。
【００２９】（ＢＬＫＮ３〜ＢＬＫＮ１３）１２：１フ
レーム内の１３２０個のマクロブロックのアドレス （ＢＬＫＮ０〜ＢＬＫＮ２）１３：マクロブロック
（Ｙ、Ｙ、Ｙ、Ｙ、Ｕ、Ｖ）内のアドレス
レーム内の１３２０個のマクロブロックのアドレス （ＢＬＫＮ０〜ＢＬＫＮ２）１３：マクロブロック
（Ｙ、Ｙ、Ｙ、Ｙ、Ｕ、Ｖ）内のアドレス
【００３０】ＢＡ２およびＢＡ３のビットの規定を下記
に示す。 （ＱＮＯ０〜ＱＮＯ４）１４：量子化ステップを規定す
る量子化番号 （ＮＥＢＩＴ０〜ＮＥＢＩＴ２）１５：次の最初の直流
分のコードＤＣまでの距離（ビット数） （ＮＥＢＹＴ０〜ＮＥＢＩＴ６）１６：次の最初の直流
分のコードＤＣまでの距離（バイト数） （ＳＨＵＦ）１７：シャフリングの態様の識別 １フレーム内で、マクロブロック単位のシャフリングが
され、そのシャフリングのパターンとして複数の態様が
適応的且つ選択的に使用される。
に示す。 （ＱＮＯ０〜ＱＮＯ４）１４：量子化ステップを規定す
る量子化番号 （ＮＥＢＩＴ０〜ＮＥＢＩＴ２）１５：次の最初の直流
分のコードＤＣまでの距離（ビット数） （ＮＥＢＹＴ０〜ＮＥＢＩＴ６）１６：次の最初の直流
分のコードＤＣまでの距離（バイト数） （ＳＨＵＦ）１７：シャフリングの態様の識別 １フレーム内で、マクロブロック単位のシャフリングが
され、そのシャフリングのパターンとして複数の態様が
適応的且つ選択的に使用される。
【００３１】上述の付加コードＢＡの中で、直流分の位
置を規定するポインタ（ＮＥＢＩＴ０〜ＮＥＢＩＴ２）
１５および（ＮＥＢＹＴ０〜ＮＥＢＩＴ６）１６は、可
変長コードの区切りの検出が誤った場合に、このエラー
が伝搬することを断ち切る（リフレッシュ）することが
できる。また、このポインタによって、変速再生時に１
ブロックのデータの取込みの先頭位置が分かる。
置を規定するポインタ（ＮＥＢＩＴ０〜ＮＥＢＩＴ２）
１５および（ＮＥＢＹＴ０〜ＮＥＢＩＴ６）１６は、可
変長コードの区切りの検出が誤った場合に、このエラー
が伝搬することを断ち切る（リフレッシュ）することが
できる。また、このポインタによって、変速再生時に１
ブロックのデータの取込みの先頭位置が分かる。
【００３２】上述のポインタの生成について説明する。
図４は、ポインタの生成と関連する信号のタイミングチ
ャートである。クロックＣＫは、可変長コードのコード
の区切りと同期している。ブロックパルスＢＬＫＰは、
１ブロックの６４個のコード毎に発生するパルスであ
る。コードは、直流分ＤＣを先頭として、６３個の交流
分ＡＣ０〜ＡＣ６２が順に並べられたデータである。こ
こでは、コードの最大のビット長を１７ビットとしてお
り、ＡＣ０〜ＡＣ６２は、０〜１７ビットの範囲内の有
効ビット長を有する。この有効ビット長を示す５ビット
の長さコードＬＥＮがコードと同期して伝送される。
図４は、ポインタの生成と関連する信号のタイミングチ
ャートである。クロックＣＫは、可変長コードのコード
の区切りと同期している。ブロックパルスＢＬＫＰは、
１ブロックの６４個のコード毎に発生するパルスであ
る。コードは、直流分ＤＣを先頭として、６３個の交流
分ＡＣ０〜ＡＣ６２が順に並べられたデータである。こ
こでは、コードの最大のビット長を１７ビットとしてお
り、ＡＣ０〜ＡＣ６２は、０〜１７ビットの範囲内の有
効ビット長を有する。この有効ビット長を示す５ビット
の長さコードＬＥＮがコードと同期して伝送される。
【００３３】図５は、ポインタの生成の説明のためのも
ので、簡単のため座標データＨＶについては、省略され
ている。シンクブロック内のデータエリア長がＤで表さ
れ、データのビット幅（この例ではバイト）がＢで表さ
れる。ポインタは、データエリア内の先頭から最初の直
流分のコード迄の距離（バイト数ＮＢＹおよびビット数
ＮＢＩ）を示す。
ので、簡単のため座標データＨＶについては、省略され
ている。シンクブロック内のデータエリア長がＤで表さ
れ、データのビット幅（この例ではバイト）がＢで表さ
れる。ポインタは、データエリア内の先頭から最初の直
流分のコード迄の距離（バイト数ＮＢＹおよびビット数
ＮＢＩ）を示す。
【００３４】図６で示すポインタ生成回路で加算器２１
に長さコードＬＥＮが供給され、加算器２１の出力が１
クロック遅延のためのフリップフロップ２２に供給さ
れ、フリップフロップ２２の出力が加算器２１に帰還さ
れる。フリップフロップ２２の出力は、デコーダ２４お
よびフリップフロップ２６にも供給される。フリップフ
ロップ２２は、ＮＯＲゲート２３の出力が“０”の時に
クリアされる。ＮＯＲゲート２３には、クリア信号ＩＮ
Ｃおよびデコーダ２４の出力が供給される。
に長さコードＬＥＮが供給され、加算器２１の出力が１
クロック遅延のためのフリップフロップ２２に供給さ
れ、フリップフロップ２２の出力が加算器２１に帰還さ
れる。フリップフロップ２２の出力は、デコーダ２４お
よびフリップフロップ２６にも供給される。フリップフ
ロップ２２は、ＮＯＲゲート２３の出力が“０”の時に
クリアされる。ＮＯＲゲート２３には、クリア信号ＩＮ
Ｃおよびデコーダ２４の出力が供給される。
【００３５】フリップフロップ２２がクリア信号ＩＮＣ
でゼロクリアされてから、長さコードＬＥＮを累算す
る。この累算結果がデコーダ２４に供給され、デコーダ
２４は、累算結果が（Ｄ×Ｂ）に到達した時に、出力を
発生し、これによりフリップフロップ２２がクリアされ
る。このようにして、モジュロ（Ｄ×８）の加算が実現
される。デコーダ２４の出力を反転したものがパルスＮ
ＸＳＹとされる。このパルスＮＸＳＹは、シンクブロッ
クの有効なデータエリア長Ｄを飛び越えたタイミング、
すなわち、次のシンクブロックに値が渡ったタイミング
を示す。
でゼロクリアされてから、長さコードＬＥＮを累算す
る。この累算結果がデコーダ２４に供給され、デコーダ
２４は、累算結果が（Ｄ×Ｂ）に到達した時に、出力を
発生し、これによりフリップフロップ２２がクリアされ
る。このようにして、モジュロ（Ｄ×８）の加算が実現
される。デコーダ２４の出力を反転したものがパルスＮ
ＸＳＹとされる。このパルスＮＸＳＹは、シンクブロッ
クの有効なデータエリア長Ｄを飛び越えたタイミング、
すなわち、次のシンクブロックに値が渡ったタイミング
を示す。
【００３６】このパルスＮＸＳＹが発生した後のブロッ
クパルスＢＬＫＰは、そのシンクブロックで最初の直流
分のコードＤＣの位置を示している。コントローラ２５
は、パルスＮＸＳＹの後のブロックパルスＢＬＫＰのタ
イミングでイネーブル信号をフリップフロップ２６に与
える。フリップフロップ２２がデコーダ２４の出力でク
リアされる直前に、フリップフロップ２２の出力がコン
トローラ２５からのイネーブル信号でフリップフロップ
２６に取り込まれる。
クパルスＢＬＫＰは、そのシンクブロックで最初の直流
分のコードＤＣの位置を示している。コントローラ２５
は、パルスＮＸＳＹの後のブロックパルスＢＬＫＰのタ
イミングでイネーブル信号をフリップフロップ２６に与
える。フリップフロップ２２がデコーダ２４の出力でク
リアされる直前に、フリップフロップ２２の出力がコン
トローラ２５からのイネーブル信号でフリップフロップ
２６に取り込まれる。
【００３７】図７は、上述のブロックパルスＢＬＫＰと
パルスＮＸＳＹとフリップフロップ２２の内容の関係を
示している。フリップフロップ２２の内容が（Ｄ×Ｂ）
の値に到達し、パルスＮＸＳＹが発生してから最初にブ
ロックパルスＢＬＫＰが発生する迄の値２７ａ、２７
ｂ、２７ｃ、・・・がそのシンクブロックの最初の直流
分のコードの位置を示している。加算器２１フリップフ
ロップ２２は、２進数で動作しているので、フリップフ
ロップ２６の出力の下位３ビットがＮＢＩを示し、これ
が付加コードにＮＥＢＩＴ０〜２としてそのシンクブロ
ックに挿入され、また、その上位７ビットがＮＢＹを示
し、これが付加コードＮＥＢＹ０〜６としてそのシンク
ブロックに挿入される。
パルスＮＸＳＹとフリップフロップ２２の内容の関係を
示している。フリップフロップ２２の内容が（Ｄ×Ｂ）
の値に到達し、パルスＮＸＳＹが発生してから最初にブ
ロックパルスＢＬＫＰが発生する迄の値２７ａ、２７
ｂ、２７ｃ、・・・がそのシンクブロックの最初の直流
分のコードの位置を示している。加算器２１フリップフ
ロップ２２は、２進数で動作しているので、フリップフ
ロップ２６の出力の下位３ビットがＮＢＩを示し、これ
が付加コードにＮＥＢＩＴ０〜２としてそのシンクブロ
ックに挿入され、また、その上位７ビットがＮＢＹを示
し、これが付加コードＮＥＢＹ０〜６としてそのシンク
ブロックに挿入される。
【００３８】なお、この発明は、ディジタルＶＴＲに限
らず、ディスク記録／再生装置、ディジタル画像信号を
通信路を介して伝送する場合等にも適用できる。
らず、ディスク記録／再生装置、ディジタル画像信号を
通信路を介して伝送する場合等にも適用できる。
【００３９】
【発明の効果】この発明によれば、シンクブロック内に
１ブロックの係数データと対応するコードをまとめて配
しているので、フレーム化の回路および処理が簡単であ
り、必要なメモリ容量を低減できる。また、変速再生時
には、再生されたシンクブロックのデータが直流分およ
び交流分の両方を含むので、再生画像の画質を良好とで
きる。さらに、この発明は、直流分の位置を示すポイン
タをシンクブロック毎に付加しているので、可変長コー
ドの区切りの検出が誤っても、ポインタを用いてリフレ
ッシュすることができ、エラーの伝搬を最小限に抑える
ことができる。
１ブロックの係数データと対応するコードをまとめて配
しているので、フレーム化の回路および処理が簡単であ
り、必要なメモリ容量を低減できる。また、変速再生時
には、再生されたシンクブロックのデータが直流分およ
び交流分の両方を含むので、再生画像の画質を良好とで
きる。さらに、この発明は、直流分の位置を示すポイン
タをシンクブロック毎に付加しているので、可変長コー
ドの区切りの検出が誤っても、ポインタを用いてリフレ
ッシュすることができ、エラーの伝搬を最小限に抑える
ことができる。
【図１】この発明の一実施例におけるフレーム化のため
の構成を示すブロック図である。
の構成を示すブロック図である。
【図２】ＤＣＴで発生した係数データの説明のための略
線図である。
線図である。
【図３】伝送データのシンクブロックの配列、付加コー
ドの構成およびエラー訂正符号の説明のための略線図で
ある。
ドの構成およびエラー訂正符号の説明のための略線図で
ある。
【図４】ポインタ生成の説明のためのタイミングチャー
トである。
トである。
【図５】ポインタの説明のための略線図である。
【図６】ポインタ生成回路の一例のブロック図である。
【図７】ポインタ生成回路の動作説明のためのタイミン
グチャートである。
グチャートである。
【図８】従来のデータ配列の一例の略線図である。
【図９】従来のフレーム化回路のブロック図である。
１ 量子化回路 ２ 発生データ量の見積り器 ５ 可変長符号化回路 ７ パッキング回路
───────────────────────────────────────────────────── フロントページの続き (51)Int.Cl.5 識別記号 庁内整理番号 ＦＩ 技術表示箇所 Ｈ０４Ｎ 7/133 Ｚ 4228−5Ｃ
Claims (2)
- 【請求項１】 入力ディジタル画像信号をＤＣＴによっ
て圧縮符号化し、上記符号化されたディジタル画像信号
を伝送するようにしたディジタル画像信号の伝送装置に
おいて、 上記符号化によって生じた係数データを直流分、交流分
の低次のものから高次のものに向かう順序で、ビット方
向および所定のビット幅方向に順次詰め込み、また、一
定量のデータ毎にシンクブロック同期信号を付加するた
めの手段と、 上記シンクブロック同期信号が付加された上記所定のビ
ット幅のデータを伝送するための手段とからなることを
特徴とするディジタル画像信号の伝送装置。 - 【請求項２】 入力ディジタル画像信号をＤＣＴによっ
て圧縮符号化し、上記符号化されたディジタル画像信号
を伝送するようにしたディジタル画像信号の伝送装置に
おいて、 上記符号化によって生じた係数データを直流分、交流分
の低次のものから高次のものに向かう順序で、ビット方
向および所定のビット幅方向に順次詰め込み、また、上
記直流分の係数データのそのシンクブロック内のバイト
位置およびビット位置を示すポインタを付加し、さら
に、一定量のデータ毎にシンクブロック同期信号を付加
するための手段と、 上記シンクブロック同期信号が付加された上記所定のビ
ット幅のデータを伝送するための手段とからなることを
特徴とするディジタル画像信号の伝送装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP35782791A JP3353317B2 (ja) | 1991-12-25 | 1991-12-25 | ディジタル画像信号の記録装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP35782791A JP3353317B2 (ja) | 1991-12-25 | 1991-12-25 | ディジタル画像信号の記録装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH05176178A true JPH05176178A (ja) | 1993-07-13 |
| JP3353317B2 JP3353317B2 (ja) | 2002-12-03 |
Family
ID=18456131
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP35782791A Expired - Fee Related JP3353317B2 (ja) | 1991-12-25 | 1991-12-25 | ディジタル画像信号の記録装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP3353317B2 (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO1999044291A1 (fr) * | 1998-02-26 | 1999-09-02 | Sony Corporation | Dispositif et procede de codage, dispositif et procede de decodage, support d'enregistrement de programme et de donnees |
| US6026191A (en) * | 1995-01-09 | 2000-02-15 | Matsushita Electric Industrial Co., Ltd. | Digital coding apparatus |
-
1991
- 1991-12-25 JP JP35782791A patent/JP3353317B2/ja not_active Expired - Fee Related
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6026191A (en) * | 1995-01-09 | 2000-02-15 | Matsushita Electric Industrial Co., Ltd. | Digital coding apparatus |
| WO1999044291A1 (fr) * | 1998-02-26 | 1999-09-02 | Sony Corporation | Dispositif et procede de codage, dispositif et procede de decodage, support d'enregistrement de programme et de donnees |
| US6661923B1 (en) | 1998-02-26 | 2003-12-09 | Sony Corporation | Coding device, coding method, decoding device, decoding method, program recording medium and data recording medium |
Also Published As
| Publication number | Publication date |
|---|---|
| JP3353317B2 (ja) | 2002-12-03 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
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|
| FPAY | Renewal fee payment (event date is renewal date of database) |
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