JPH05144879A - チツプ部品取付構造 - Google Patents

チツプ部品取付構造

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JPH05144879A
JPH05144879A JP3308882A JP30888291A JPH05144879A JP H05144879 A JPH05144879 A JP H05144879A JP 3308882 A JP3308882 A JP 3308882A JP 30888291 A JP30888291 A JP 30888291A JP H05144879 A JPH05144879 A JP H05144879A
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JP
Japan
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chip component
green sheet
flip chip
connection
holes
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JP3308882A
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English (en)
Inventor
Nobutomo Matsumura
暢智 松村
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Fujitsu General Ltd
Original Assignee
Fujitsu General Ltd
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Publication date
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    • H01L2224/15—Structure, shape, material or disposition of the bump connectors after the connecting process
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Abstract

(57)【要約】 【目的】微細な接続パッドが片面に形成されているフリ
ップチップ部品を表面実装する基板の正確な位置へ容易
に載置し確実な溶融接続を行う。 【構成】接続ランド６と導体パターン７の形成された第
１のグリーンシート１と接続ランド６に合わせて貫通孔
９を穿孔した第２のグリーンシート８とを重ね合わせて
多層基板10とし、前記貫通孔９に半田ペースト12を充填
すると共に、搭載するフリップチップ部品２のパッド３
にバンプ11を形成し、該バンプ11の先端部を貫通孔９を
ガイドとして載置し、リフローして接続する。

Description

【発明の詳細な説明】
【０００１】
【産業上の利用分野】本発明はファインパターンが形成
され高密度の表面実装を行うハイブリッドＩＣ等のセラ
ミック多層基板にパッド間隔の微細なフリップチップ等
を正確な位置に能率良く載置するための構造に関するも
のである。
【０００２】
【従来の技術】従来、ハイブリッドＩＣ等高密度の表面
実装を行う方法として、ＩＣのセラミック基板を多層と
しファインパターンを形成して小型化したチップ部品を
搭載すると共に、能動素子としてはフリップチップを使
用することが有効である。しかしフリップチップの接続
端子部であるパッドはチップの片面に形成されており、
またパッド面積も間隔も小さく、他のチップ部品に比し
て半田使用量も少ないため、半田ペーストの印刷塗布も
同一のマスクで出来ないために装着は非常に難しいもの
があった。即ち図２に示す如くセラミック多層基板10に
形成された導体パターン７の接続ランド６に他のチップ
部品４とは別に、極薄い金属板若しくはメッシュ膜で精
密に製作された印刷マスクで微量の半田ペースト12が印
刷塗布され、予めパターン形成と共に設けられたフリッ
プチップ部品２を載置するためのマーク13に合わせてフ
リップチップ部品２を載置し、リフロー炉を通して溶着
した後、半田ペースト12の中に含まれてんるフラックス
を洗浄するという工程を取っていた。
【０００３】
【発明が解決しようとする課題】前述のように、表面実
装においてフリップチップ部品の片面に形成された接続
端子である微小なパッドをセラミック多層基板の接続ラ
ンドに、印刷マスクにて塗布された半田ペーストの上
に、セラミック多層基板に予め設けられている定置マー
クを目標として、顕微鏡等を介しながら載置しなければ
ならないという微細動作で、手間の掛かる困難な作業の
上、リフローの結果の状態を視覚で確認できず、ＩＣを
動作させて初めて良否が判明するという問題があった。
【０００４】
【課題を解決するための手段】上記課題を解決するため
に、接続ランドと導体パターンが印刷形成された第１の
グリーンシートと、実装するチップ部品の接続端子部に
合わせて貫通孔を穿孔した第２のグリーンシートを重ね
合わせて成形し、前記貫通孔に半田ペーストを充填し内
部パターンと接続するようにすると共に、フリップチッ
プ部品のパッドにバンプを形成し、該バンプの先端部を
前記貫通孔に挿入するようにして接続することを特徴と
するチップ部品取付構造を提供する。
【０００５】
【作用】前述のように、セラミック多層基板を成形する
時に実装するチップ部品の接続端子部に合わせて貫通孔
を穿孔した第２のグリーンシートを接続ランドと導体パ
ターンが印刷形成された第１のグリーンシートに重ね合
わせて成形することにより、第２のグリーンシートの貫
通孔に半田ペーストを充填しフリップチップ部品を基板
に搭載する際、貫通孔がフリップチップ部品のパッドに
形成されたバンプ先端部のガイドとなって正確な位置合
わせが容易にでき、リフロー時半田が溶融しても孔の外
に拡がることがないのでバンプ間のショートもない確実
な接続が得られ、接続ランドと導体パターンをグリーン
シートが覆うのでマイグレーションも防止できる。
【０００６】
【実施例】以下、この発明の実施例を図面を参照しなが
ら詳細に説明する。図１（Ａ）（Ｂ）（Ｃ）（Ｄ）は本
発明によるチップ部品取付構造の一実施例を説明する一
部分図である。
【０００７】図において、１は型抜きされた焼成前の第
１のグリーンシートであって、搭載するフリップチップ
部品２のパッド３とその他のチップ部品４の接続端子部
５に合わせた接続ランド６と導体パターン７が印刷形成
されている。〔図１（Ａ）〕 ８は型抜きされた焼成前の第２のグリーンシートであっ
て、搭載するフリップチップ部品２のパッド３及びその
他のチップ部品４の接続端子部５に合わせた大きさの貫
通孔９が穿孔されている。〔図１（Ｂ）〕
【０００８】前述の第１のグリーンシート１及び第２の
グリーンシート８を重ね合わせて押圧し、焼成して貫通
孔９を介し接続ランド６を露出させたセラミック多層基
板10が得られた。〔図１（Ｃ）〕
【０００９】一方フリップチップ部品２のパッド３にバ
ンプ11を、例えばワイヤーボンダー等にて、形成する。
【００１０】以上のように構成されたセラミック多層基
板10の貫通孔９に半田ペースト12をノズル方式等の印刷
機にて充填し、フリップチップ部品２のバンプ11の先端
部を貫通孔９をガイドとして嵌入させると共に、他のチ
ップ部品４も半田ペースト12を充填した貫通孔９に合わ
せて載置し、リフロー炉を通して接続実装する。〔図１
（Ｄ）〕
【００１１】
【発明の効果】前述のように、セラミック多層基板を成
形する時に実装するチップ部品の接続端子部に合わせて
貫通孔を穿孔した第２のグリーンシートを接続ランドと
導体パターンが印刷形成された第１のグリーンシートに
重ね合わせて成形することにより、第２のグリーンシー
トの貫通孔に半田ペーストを充填しフリップチップ部品
を基板に搭載する際、貫通孔がフリップチップ部品のパ
ッドに形成されたバンプ先端部のガイドとなって正確な
位置合わせが容易にでき、リフロー時半田が溶融しても
孔の外に拡がることがないのでバンプ間のショートもな
い確実な接続が得られ、接続ランドと導体パターンをグ
リーンシートが覆うのでマイグレーションも防止できる
ことは、作業工数を低減させ歩留向上が計れることはコ
スト低減と共に信頼性の高い接続実装ができること顕著
である。
【図面の簡単な説明】
【図１】本発明によるチップ部品取付構造の一実施例の
一部分図で、（Ａ）は接続ランドと導体パターンが形成
されたグリーンシートの平面図、（Ｂ）は接続ランドに
合わせた貫通孔を形成したグリーンシートの平面図、
（Ｃ）は第１および第２のグリーンシートを重合わせて
完成したセラミック多層基板の断面図、（Ｄ）はセラミ
ック多層基板にチップ部品を実装する状態を示した要部
断面図である。
【図２】従来のチップ部品取付構造の一例の状態を示し
た一部分図で、（Ａ）はその要部断面図、（Ｂ）は基板
の接続ランドと導体パターンを示した平面図である。
【符号の説明】
１ パターン形成済グリーンシート ２ フリップチップ部品 ３ パッド ４ チップ部品 ５ 接続端子部 ６ 接続ランド ７ 導体パターン ８ 貫通孔形成済グリーンシート ９ 貫通孔 10 セラミック多層基板 11 バンプ 12 半田ペースト 13 定置マーク

Claims (1)

    【特許請求の範囲】
  1. 【請求項１】接続ランドと導体パターンが印刷形成され
    た第１のグリーンシートと、実装するチップ部品の接続
    端子部に合わせて貫通孔を穿孔した第２のグリーンシー
    トを重ね合わせて成形し、前記貫通孔に半田ペーストを
    充填し内部パターンと接続するようにすると共に、フリ
    ップチップ部品のパッドにバンプを形成し、該バンプの
    先端部を前記貫通孔に挿入するようにして接続すること
    を特徴とするチップ部品取付構造。
JP3308882A 1991-11-25 1991-11-25 チツプ部品取付構造 Pending JPH05144879A (ja)

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Cited By (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH07169873A (ja) * 1993-12-15 1995-07-04 Nec Corp 多層基板およびその製造方法
US5686764A (en) * 1996-03-20 1997-11-11 Lsi Logic Corporation Flip chip package with reduced number of package layers
US5768109A (en) * 1991-06-26 1998-06-16 Hughes Electronics Multi-layer circuit board and semiconductor flip chip connection
US5885855A (en) * 1996-11-12 1999-03-23 Lsi Logic Corporation Method for distributing connection pads on a semiconductor die

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