JPH04227167A - 映像合成装置 - Google Patents
映像合成装置Info
- Publication number
- JPH04227167A JPH04227167A JP2418509A JP41850990A JPH04227167A JP H04227167 A JPH04227167 A JP H04227167A JP 2418509 A JP2418509 A JP 2418509A JP 41850990 A JP41850990 A JP 41850990A JP H04227167 A JPH04227167 A JP H04227167A
- Authority
- JP
- Japan
- Prior art keywords
- cpu
- bus selection
- section
- control
- microprocessors
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
- 230000015572 biosynthetic process Effects 0.000 claims description 16
- 238000003786 synthesis reaction Methods 0.000 claims description 16
- 230000002194 synthesizing effect Effects 0.000 abstract 2
- 238000010586 diagram Methods 0.000 description 4
- 230000005540 biological transmission Effects 0.000 description 3
- 239000013256 coordination polymer Substances 0.000 description 2
- 230000000694 effects Effects 0.000 description 2
- 238000010187 selection method Methods 0.000 description 2
- 238000004519 manufacturing process Methods 0.000 description 1
Landscapes
- Studio Circuits (AREA)
- Processing Of Color Television Signals (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【０００１】
【産業上の利用分野】本発明は映像合成装置に関し、特
にＣＰＵバス選択方式を改善した映像合成装置に関する
。
にＣＰＵバス選択方式を改善した映像合成装置に関する
。
【０００２】
【従来の技術】一般に映像合成装置は放送局、ポストプ
ロダクションにおいて使用されている。図３は従来の映
像合成装置のブロック図であり、映像合成部１はラック
側コントロール棚に設けられた複数個、ここでは３個の
中央処理装置（ＣＰＵ）２Ａ〜２Ｃと、これら中央処理
装置２Ａ〜２Ｃに夫々シリアル回線３Ａ〜３Ｃで接続さ
れて送受信を行うマイクロプロセッサ４Ａ〜４Ｃとで構
成される。又、コントロール部５は前記各マイクロプロ
セッサ４Ａ〜４Ｃに夫々ＣＰＵバス７Ａ〜７Ｃで接続さ
れたパネル６Ａ〜６Ｃで構成される。そして、これらの
パネル６Ａ〜６Ｃを操作することで、操作信号をＣＰＵ
バス７Ａ〜７Ｃを通して各マイクロプロセッサに送出し
、マイクロプロセッサではこれをシリアル信号に変換し
た上でＣＰＵ２Ａ〜２Ｃに送信し、ＣＰＵにおいて所要
の映像合成を行っている。
ロダクションにおいて使用されている。図３は従来の映
像合成装置のブロック図であり、映像合成部１はラック
側コントロール棚に設けられた複数個、ここでは３個の
中央処理装置（ＣＰＵ）２Ａ〜２Ｃと、これら中央処理
装置２Ａ〜２Ｃに夫々シリアル回線３Ａ〜３Ｃで接続さ
れて送受信を行うマイクロプロセッサ４Ａ〜４Ｃとで構
成される。又、コントロール部５は前記各マイクロプロ
セッサ４Ａ〜４Ｃに夫々ＣＰＵバス７Ａ〜７Ｃで接続さ
れたパネル６Ａ〜６Ｃで構成される。そして、これらの
パネル６Ａ〜６Ｃを操作することで、操作信号をＣＰＵ
バス７Ａ〜７Ｃを通して各マイクロプロセッサに送出し
、マイクロプロセッサではこれをシリアル信号に変換し
た上でＣＰＵ２Ａ〜２Ｃに送信し、ＣＰＵにおいて所要
の映像合成を行っている。
【０００３】
【発明が解決しようとする課題】このような従来の映像
合成装置はパネルが各映像合成部に対応して複数個設け
られているため、コントロール部では同じ構成のパネル
を複数個配設する必要があり、コントロール部における
卓面の面積が大きいという問題がある。又、卓面の増大
に伴って操作を行うための範囲が広くなり、操作性が悪
いという問題もある。本発明の目的はこの問題を解消し
たＣＰＵ制御バス選択方式を提供することにある。
合成装置はパネルが各映像合成部に対応して複数個設け
られているため、コントロール部では同じ構成のパネル
を複数個配設する必要があり、コントロール部における
卓面の面積が大きいという問題がある。又、卓面の増大
に伴って操作を行うための範囲が広くなり、操作性が悪
いという問題もある。本発明の目的はこの問題を解消し
たＣＰＵ制御バス選択方式を提供することにある。
【０００４】
【課題を解決するための手段】本発明の映像合成装置は
、複数個の中央処理装置を有する映像合成部と、この映
像合成部を制御するためのコントロール部とで構成され
、各中央処理装置に夫々対応して設けたマイクロプロセ
ッサにつながる複数のＣＰＵ制御バスと、コントロール
部に設けた１つのパネルとをＣＰＵバス選択部で接続し
、かつ各マイクロプロセッサとＣＰＵバス選択部とをＣ
ＰＵバス選択情報線で接続し、ＣＰＵバス選択部はＣＰ
Ｕバス選択情報線を通して入力される情報に基づいて複
数のＣＰＵ制御バスを選択してパネルに接続するように
構成する。
、複数個の中央処理装置を有する映像合成部と、この映
像合成部を制御するためのコントロール部とで構成され
、各中央処理装置に夫々対応して設けたマイクロプロセ
ッサにつながる複数のＣＰＵ制御バスと、コントロール
部に設けた１つのパネルとをＣＰＵバス選択部で接続し
、かつ各マイクロプロセッサとＣＰＵバス選択部とをＣ
ＰＵバス選択情報線で接続し、ＣＰＵバス選択部はＣＰ
Ｕバス選択情報線を通して入力される情報に基づいて複
数のＣＰＵ制御バスを選択してパネルに接続するように
構成する。
【０００５】
【実施例】次に、本発明について図面を参照して説明す
る。図１は本発明の映像合成装置の一実施例のブロック
図である。この映像合成装置は従来と同様に映像合成部
１とコントロール部５とを備えている。映像合成部１に
はラック側コントロール棚に設けられた複数個（３個）
の中央処理装置（ＣＰＵ）２Ａ〜２Ｃと、これらＣＰＵ
２Ａ〜２Ｃに夫々シリアル回線３Ａ〜３Ｃで接続されて
送受信を行うマイクロプロセッサ４Ａ〜４Ｃとで構成さ
れる。又、コントロール部５には１つのパネル６のみを
設けている。そして、前記３つのマイクロプロセッサ４
Ａ〜４Ｃには夫々ＣＰＵ制御バス７Ａ〜７Ｃを介して１
つのＣＰＵ制御バス選択部８を接続し、このＣＰＵ制御
バス選択部８にはＣＰＵ制御バス９を介して前記パネル
６を接続している。更に、前記各マイクロプロセッサ４
Ａ〜４ＣとＣＰＵ制御バス選択部８は夫々ＣＰＵ制御バ
ス選択情報線１１Ａ〜１１Ｃを用いて接続している。
る。図１は本発明の映像合成装置の一実施例のブロック
図である。この映像合成装置は従来と同様に映像合成部
１とコントロール部５とを備えている。映像合成部１に
はラック側コントロール棚に設けられた複数個（３個）
の中央処理装置（ＣＰＵ）２Ａ〜２Ｃと、これらＣＰＵ
２Ａ〜２Ｃに夫々シリアル回線３Ａ〜３Ｃで接続されて
送受信を行うマイクロプロセッサ４Ａ〜４Ｃとで構成さ
れる。又、コントロール部５には１つのパネル６のみを
設けている。そして、前記３つのマイクロプロセッサ４
Ａ〜４Ｃには夫々ＣＰＵ制御バス７Ａ〜７Ｃを介して１
つのＣＰＵ制御バス選択部８を接続し、このＣＰＵ制御
バス選択部８にはＣＰＵ制御バス９を介して前記パネル
６を接続している。更に、前記各マイクロプロセッサ４
Ａ〜４ＣとＣＰＵ制御バス選択部８は夫々ＣＰＵ制御バ
ス選択情報線１１Ａ〜１１Ｃを用いて接続している。
【０００６】前記ＣＰＵ制御バス選択部８は、ＣＰＵ制
御バス選択情報線１１Ａ〜１１Ｃを通して入力される情
報に基づいて、３つのＣＰＵ制御バス７Ａ〜７Ｃのいず
れか１つを選択し、選択されたＣＰＵ制御バス７Ａ〜７
Ｃにつながるマイクロプロセッサ４Ａ〜４ＣをＣＰＵ制
御バス９を介してパネル６に接続することができる。
御バス選択情報線１１Ａ〜１１Ｃを通して入力される情
報に基づいて、３つのＣＰＵ制御バス７Ａ〜７Ｃのいず
れか１つを選択し、選択されたＣＰＵ制御バス７Ａ〜７
Ｃにつながるマイクロプロセッサ４Ａ〜４ＣをＣＰＵ制
御バス９を介してパネル６に接続することができる。
【０００７】図２は図１に示した映像合成装置における
ＣＰＵ制御バス選択処理のフローチャートである。電源
がオンされ、いずれかのＣＰＵ２Ａ〜２Ｃから割り込み
が入り、マイクロプロセッサ４Ａ〜４Ｃがアサイン情報
を受信し（ステップ１１）、アサイン情報がオンか否か
を判断し（ステップ１２）、オンの場合前記ＣＰＵ制御
バス選択情報線１１Ａ〜１１Ｃをオンにし（ステップ１
３）てＣＰＵ制御バス選択部８に情報を出力する。する
と、ＣＰＵ制御バス選択部８では、この情報が出力され
たマイクロプロセッサ４Ａ〜４ＣのＣＰ制御バス７Ａ〜
７ＣをＣＰＵ制御バス９に接続し、この結果そのマイク
ロプロセッサをパネル８に接続する。その上でタリード
ライブ処理し（ステップ１４）、送信処理し（ステップ
１５）、前記ＣＰＵ制御バス選択情報線１１Ａ〜１１Ｃ
をオフにし（ステップ１６）、ＣＰＵ制御バス選択部８
によってＣＰＵ制御バス７Ａ〜７Ｃを切り離し、次の割
り込みを待つ。又、ステップ１２においてアサイン情報
がオフの場合、前記ＣＰＵ制御バス選択情報線７はオフ
にする（ステップ１７）。尚、前記実施例では３つのＣ
ＰＵを備える例について説明したが、２個或いは４個以
上のＣＰＵを備える映像合成装置においても本発明を同
様に適用することができる。
ＣＰＵ制御バス選択処理のフローチャートである。電源
がオンされ、いずれかのＣＰＵ２Ａ〜２Ｃから割り込み
が入り、マイクロプロセッサ４Ａ〜４Ｃがアサイン情報
を受信し（ステップ１１）、アサイン情報がオンか否か
を判断し（ステップ１２）、オンの場合前記ＣＰＵ制御
バス選択情報線１１Ａ〜１１Ｃをオンにし（ステップ１
３）てＣＰＵ制御バス選択部８に情報を出力する。する
と、ＣＰＵ制御バス選択部８では、この情報が出力され
たマイクロプロセッサ４Ａ〜４ＣのＣＰ制御バス７Ａ〜
７ＣをＣＰＵ制御バス９に接続し、この結果そのマイク
ロプロセッサをパネル８に接続する。その上でタリード
ライブ処理し（ステップ１４）、送信処理し（ステップ
１５）、前記ＣＰＵ制御バス選択情報線１１Ａ〜１１Ｃ
をオフにし（ステップ１６）、ＣＰＵ制御バス選択部８
によってＣＰＵ制御バス７Ａ〜７Ｃを切り離し、次の割
り込みを待つ。又、ステップ１２においてアサイン情報
がオフの場合、前記ＣＰＵ制御バス選択情報線７はオフ
にする（ステップ１７）。尚、前記実施例では３つのＣ
ＰＵを備える例について説明したが、２個或いは４個以
上のＣＰＵを備える映像合成装置においても本発明を同
様に適用することができる。
【０００８】
【発明の効果】以上説明したように本発明は、ＣＰＵ制
御バス選択部を設けることで、映像合成部の複数個のＣ
ＰＵに繋がるＣＰＵ制御バスを選択して１つのパネルに
接続することができ、これにより１つのパネルで複数個
のＣＰＵに対するコントロールを可能にして所要の映像
処理が実現でき、卓面の面積を小さくするとともに、操
作性を向上させることができる効果がある。
御バス選択部を設けることで、映像合成部の複数個のＣ
ＰＵに繋がるＣＰＵ制御バスを選択して１つのパネルに
接続することができ、これにより１つのパネルで複数個
のＣＰＵに対するコントロールを可能にして所要の映像
処理が実現でき、卓面の面積を小さくするとともに、操
作性を向上させることができる効果がある。
【図１】本発明の映像合成装置の一実施例のブロック図
である。
である。
【図２】図１のＣＰＵ制御バス選択処理のフローチャー
トである。
トである。
【図３】従来の映像合成装置のブロック図である。
１ 映像合成部
２Ａ〜２Ｃ 中央処理装置（ＣＰＵ）４Ａ〜４Ｃ
マイクロプロセッサ ５ コントロール部 ６，６Ａ〜６Ｃ パネル ７Ａ〜７Ｃ ＣＰＵ制御バス ８ ＣＰＵ制御バス選択部 ９ ＣＰＵ制御バス
マイクロプロセッサ ５ コントロール部 ６，６Ａ〜６Ｃ パネル ７Ａ〜７Ｃ ＣＰＵ制御バス ８ ＣＰＵ制御バス選択部 ９ ＣＰＵ制御バス
Claims (1)
- 【請求項１】 複数個の中央処理装置を有する映像合
成部と、この映像合成部を制御するためのコントロール
部とで構成される映像合成装置において、前記各中央処
理装置に夫々対応して設けたマイクロプロセッサにつな
がる複数のＣＰＵ制御バスと、前記コントロール部に設
けた１つのパネルとをＣＰＵバス選択部で接続し、かつ
前記各マイクロプロセッサとＣＰＵバス選択部とをＣＰ
Ｕバス選択情報線で接続し、前記ＣＰＵバス選択部は、
前記ＣＰＵバス選択情報線を通して入力される情報に基
づいて複数のＣＰＵ制御バスを選択して前記パネルに接
続するように構成したことを特徴とする映像合成装置
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2418509A JPH04227167A (ja) | 1990-12-29 | 1990-12-29 | 映像合成装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2418509A JPH04227167A (ja) | 1990-12-29 | 1990-12-29 | 映像合成装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH04227167A true JPH04227167A (ja) | 1992-08-17 |
Family
ID=18526342
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2418509A Pending JPH04227167A (ja) | 1990-12-29 | 1990-12-29 | 映像合成装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH04227167A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| CN106186658A (zh) * | 2014-12-26 | 2016-12-07 | 株式会社藤仓 | 光纤线的制造方法以及制造装置 |
-
1990
- 1990-12-29 JP JP2418509A patent/JPH04227167A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| CN106186658A (zh) * | 2014-12-26 | 2016-12-07 | 株式会社藤仓 | 光纤线的制造方法以及制造装置 |
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