JPH04137085A - Icメモリカード - Google Patents
IcメモリカードInfo
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Abstract
め要約のデータは記録されません。
Description
ータを記憶するためのICメモリカードに関する。
文字データを記録する媒体として、フロッピーディスク
に変わり、半導体メモリを用いた小型なICメモリカー
ドが使用されるようになってきた。
情報、たとえばカードに使用されている半導体メモリの
種類、そのメモリ容量やメモリ速度等の固定情報があら
かじめ書き込まれている。
読み取られて、そのカードに適合した制御信号によって
データの書き込みまたは読み出しを行う場合に必須のも
のであった。
定情報と書き換えが行われる情報との区別を行っておら
ず、固定情報を単に蓄積部の所定の部分、たとえば領域
の最初の部分に格納しているだけであり、もしホスト処
理装置側に何らかの異常が生じて、固定情報を書き換え
るアクセスが生じた場合、その領域が固定情報以外のも
のに書き換えられてしまう危険性があった。固定情報が
書き換えられてしまうと、そのカードは、使用不能とな
って、蓄積されているデータを読み出せなくなるという
重大な問題があった。
情報が間違ってアクセスされた場合に、その固定情報を
保護することができるICメモリカードを提供すること
を目的とする。
力部と、データを蓄積するための半導体メモリからなる
蓄積部と、この蓄積部にホスト側のデータを書き込みま
たはホスト側へ蓄積部のデータを読み出すための制御を
行う制御部とを備えたICメモリカードにおいて、蓄積
部に、書き換え不可な固定情報があらかしめ書き込まれ
た固定領域と、書き換え可能なデータの管理情報および
データが書き込まれる変動領域とを有し、制御部が、蓄
積部の固定領域がアクセスされたことを検知して検知信
号を送出するアドレス検知手段と、このアドレス検知手
段にて固定領域にアクセスが行われたことを検知した場
合に、ホスト側から供給されるデータの書き込みのため
の制御信号をアドレス検知手段から送出された検知信号
にてマスクして蓄積部へのデータの書き込みを禁止する
リードライト制御手段とが備えられていることを特徴と
する。
参照して詳細に説明する。
ように、データを記憶するためのメインメモリ部IOと
、このメインメモリ部10の書き込み制御、または読み
出し制御を行うための制御部20と、ホスト処理装置に
着脱自在に形成された入出力部30とから構成されてい
る。
(電気的に消去・書込可能なROM)にて構成されてい
る。このEEPRO&4の消去単位(ブロック)は、こ
の実施例の場合、たとえば、画像データの記憶単位すな
わちクラスタ単位にて行われる。このメインメモリ部I
Oは、その記憶領域が固定情報領域と、カード情報領域
と、画像データ等の記録データを記憶するデータ領域と
から形成されている。
る半導体メモリがEEPROMにて構成されている旨を
示すメモリ種類、そのメモリサイズ、バイト当たりの書
き込み所要時間、消去時間、アクセス時間等のメモリ速
度、およびメーカ名等のカード固有の固定情報が書き込
まれている。この固定情報は、メインメモリ部lOの記
゛l領域の先頭アドレス゛’oooooo°°からたと
えば”0000 F F ”のクラスタに書き込まれて
おり、この固定情報は、カードをホストに装着した時点
にて読み出されて、そのカードを使用するために適合し
た制御信号をホスト側にて送出するための指針となる情
報である。この固定情報がホスト側に適合しないもので
あれば、ホスト側にエラー表示等が行われて、データの
読み込みおよび書き込みが一切禁止される。カード情報
領域には、記録データの種類、その撮影年月日、記録デ
ータのスタートクラスタナンバー、エンドクラスタナン
バー、圧縮モード、入力デバイス、水平画素数、垂直画
素数等の記録データに関する情報が書き込まれる。この
カード情報は、固定情報のクラスタに続くクラスタに書
き込まれて、データを書き込むたびに書き換えられる。
、カード情報が書き込まれたアドレス以下のクラスタ全
域に割り当てられている。これらカード情報領域とデー
タ領域がホスト側にて書き込み可能な可変領域を構成し
ている。このメインメモリ部10には、データの書き込
みまたは読み出しのためのアドレス信号がそれぞれ供給
される複数のアドレス端子ATと、書き込みまたは読み
出しもしくは消去のための制御信号が供給される制御端
子CTと、データを書き込むまたは読み出すためのデー
タ端子DTとが備えられている。
ス信号またはデータ信号をアドレス線500またはデー
タ線502に振り分け、メインメモリ 10から読み出
されたデータをコネクタ30を介してホスト側へ転送す
る双方向のバス制御器200と、コネクタ30を介して
供給される制御信号を読み込んで、メインメモリ部IO
に書き込みまたは読み出しもしくは消去のための制御信
号を送出するリードライト制御器202と、バス制御器
200からアドレス線を介して転送されるアドレス信号
をラッチするアドレスカウンタ204と、このアドレス
カウンタ200からメインメモリ部lOへ転送されるア
ドレス信号を読み取って、そのアドレスが固定情報領域
” o o o o o o”〜”0OOOFF”の場
合に検知信号Detを送出するアドレスデコーダ206
とを備えている。
ら転送される書き込みまたは読み出しのためにメインメ
モリをアクセスするためのアドレス信号をアドレスカウ
ンタ207へ転送する制御と、アドレス信号と同一信号
線にて供給されるデータ信号をメインメモリ部IOに転
送、またはメインメモリ部から読み出されたデータをホ
スト側へ転送する双方向の制御回路である。
給されるリードライト識別信号R/Wと、アドレスデー
タ識別信号と、バスクロックBCKとを読み込んでメイ
ンメモリ部10に書き込みまたは読み出しもしくは消去
のための制御信号を送出する。
ベルにて供給されて、アドレスデータ識別信号がHig
hレベルで供給されているときに、バスクロックB(J
が供給されると、データを書き込むための許可信号RE
を送出し、リードライト制御信号R/Wが旧ghレベル
にて供給されて、アドレスブタ識別信号A/Dが旧gh
レベルで供給されているときに、バスクロックBGKが
供給されると、データを読み出すための許可信号WEを
送出し、メインメモリ部lOのクラスタに上書きが生し
た場合に図示されていない回路から消去信号を受けてメ
インメモリ部IOに消去信号ERを供給する。また、こ
の実施例におけるリードライト制御器202は、アドレ
スデコーダ206から固定領域のアドレスを検知した信
号Detを受けた場合に、上記書き込みのための許可信
号WEをマスクしてその制御信号を送出させないように
構成されている。より詳細には、第2図に示すように、
書き込みのための許可信号WEを送出するアンドゲート
300にアドレスデコーダ206から送出される検知信
号netを供給して許可信号WEをマスクしてライトパ
ルスWEが送出しない構成である。なお、この第2図は
、書き込みのための制御回路のみを示し、読み出しおよ
び消去の部分は説明の都合上省略されている。
対応した個数のカウンタからなり、バイト単位にて読み
込まれるアドレス信号をそれぞれバスクロックBCKに
同期してラッチして、メインメモリ部lOの所定のアド
レス端子ATに転送する回路である。
ら送出されるアドレス信号を各バイト毎に読み取って、
そのアドレスがoooooo°′〜”0OOOFF”の
場合に、検知信号netをリードライト制御器202へ
送出する。より詳細には、アドレス信号が3バイトにて
送信されるこの実施例の場合、上位8ビツトの論理和が
”0゛°、かつ中位8ビツトの論理和が°0”、かつ下
位8ビツトの論理和が”0”または′”1′°の場合に
検知信号netを送出する。この検知信号netは、ア
ドレスデータ識別信号A/Dの立ち上がり前から立ち下
がり時点まで送出されている。
fJEIDAl r ICメモリカードガイドライン
」第3版で提唱されている20ビンのI10バスインタ
フェースが用いられている。このガイドラインの入出力
部30には、2つのGND端子と、アドレス信号および
データ信号が供給される8つのデータ端子fDO〜07
1 と、共通電源Vccが供給される共通電源端子と、
書き込みまたは消去の際にプログラム電源Vl)I)が
供給されるプログラム電源端子と、2つのステート端子
および2つのクロック端子等が備えられており、この実
施例においては、そのステート端子の1つに、アドレス
信号とデータ信号とを識別するための2値信号が供給さ
れるアドレスデータ識別(A/D)端子が割り当てられ
、もう1つのステート端子に、データの書き込みおよび
読み出しの区別を行うための2値信号が供給されるリー
ドライト(R/11端子が割り当てられ、1つのクロッ
ク端子に、アドレス信号およびデータ信号の各バイト毎
に同期したバスクロックが供給されるバスクロックfB
cに)端子が割り当てられている。この実施例の場合、
もう1つのクロック端子は、データの書き込みまたは読
み出しに直接関係がなく、予備端子となって他の機能が
割り当てられる。なお、第1図において、人出力部30
が接続されるホスト側のバスは、データバス400と制
御バス410にて示されている。
データ人出力方法を説明する。
を電子スチルカメラ等のホスト処理装置に接続すること
により装着して、ホスト処理装置の所定の操作を行う。
うに、ホスト側からデータの書き込み番地を指定するア
ドレス信号が入出力部30のデータ端子DO〜D7を介
して1バイトづつ連続的に3回続けて送られてくる。こ
の場合、ホスト側から制御信号として、アドレスデータ
識別信号A/Dが入出力部30の端子にLOWレベルと
なって供給され、さらにリードライト識別信号R/Wが
LOWレベルとなって入出力部30の端子へ供給される
。これら制御信号は、入出力部30を介してリードライ
ト制御器202に供給されて、また、アドレスデータ識
別信号A/Dは、バス制御器200に供給される。これ
により、リードライト制御器202は、バスクロツタB
CKの出力待ち状態となり、バス制御器200は、アド
レスデータ識別信号A/Dがアドレス信号の読み込みで
あることを判断して、送出バスをアドレス線500に切
り換える。この状態で、ホスト側から上位8ビツトのア
ドレス信号AO〜A7が供給され、これとともに−回目
のバスクロックBCKIが供給されると、アドレスカウ
ンタ204は、上位8ビツトのアドレス信号をラッチし
て、−回目のバスクロックBCKIに同期してメインメ
モリ部10へ転送する。このとき、アドレスレコーダ2
06は、アドレスカウンタ204から送出される上位8
ビツトのアドレス信号を読み取ってその論理和を取り、
その論理和が”0”か否かを判別する。次いで、ホスト
からアドレスの中位8ビツトが供給され、これとともに
二回目のバスクロックBCK2がされると、上記と同様
にアドレスカウンタ204は、ブタ制御部200を介し
て転送された中位8ビツトのアドレス信号をラッチして
メインメモリlロム転送する。このとき、アドレスデコ
ーダ206は、メインメモリ部10へ転送されるアドレ
ス信号を読み取って、その論理和をとり、その論理和か
”0”か否かを判別する。続いて、ホスト側から下位8
ビツトのアドレス信号が供給され、三回目のバスクロッ
クBCK3が供給されると、アドレスカウンタ204は
、上記と同様に下位8ビツトのアドレス信号をラッチし
てメインメモリ部IOに転送する。またこのとき、上記
と同様にアドレスレコーダ206は、転送される下位8
ビツトのアドレス信号の論理和をとる。これにより、ア
ドレスレコーダ206は、前回の2バイトの論理和と合
わせてアクセスされるアドレスが“oooooo”〜″
0OOOFF”の固定領域の場合に、検知信号netを
リードライト制御器202へ送出して、それ以外の可変
領域のアドレスのときには検知信号を送出しない。
くる。この際に、ホストは、アドレス識別端子A/Dを
旧ghレベルとする信号を送出する。
502に切り換えて、ホスト側から供給されるデータ信
号をメインメモリ部lOのデータ端子DTへ転送する。
ると、リードライト制御器202は、書き込みのための
許可信号WEを送出する。このときアクセスされている
アドレスが固定領域″oooooo″〜”0OOOFF
″であるときは、リードライト制御器202のアントゲ
ート300に検知信号Detが供給されているので、許
可信号WEは検知信号netにマスクされて送出されず
、メインメモリ部10に供給されたデータの書き込みは
行われない。
ータ識別信号−A/D7!i:Lowレベルに戻して1
次の処理に移る。このとき、アドレスカウンタ206は
、アドレスデータ識別信号A/Dの立ち下がりを検出し
て、検知信号netを発生を停止する。
みのアクセスが生した場合、そのアドレスを検知して、
書き込み許可信号WEをマスクするので、固定領域の書
き換えが行なわれるおそれがなく、ICメモリカードが
使用できなくなることを防止することができる。
ROMにて構成したが、この発明の場合、SRAMであ
ってもよい。
ドによれば、アドレス検知手段によって、蓄積部の固定
領域がアクセスされたことを検知して、その検知信号を
送出することにより、リードライト制御部が、その検知
信号にて、ホスト側から送出される書き込みのための制
御信号をマスクして蓄積部へのデータの書き込みを禁止
するように構成したので、ホスト側に異常が生じて固定
情報の書き換えが発生しても、その書き換えが行われる
ことがない。したがって、ICメモリカードが使用でき
なくなって、今まで記録されていたブタを読み出せなく
なるという問題を解消することができる。
ブロック図、 第2図は同実施例におけるリードライト剥tky’4−
9部分構成を示す回路図、 第3図は、同実施例におけるデータ人出力方法を説明す
るためのフローチャートである。 主要部 の″−の説明 10 、、、メインメモリ部 20 、、、制御部 30 、、、入出力部 200、、、バス制御器 202、 、 リードライト制御器 204、 、 、アドレスカウンタ 206、 、 、アドレスレコーダ 500、 、 、アドレス線 502、 、 、データ線 A/D、 、 、アドレスデータ識別信号BCK 、、
、バスクロック R/W、 、 、リードライト識別信号WE、、、書き
込み許可信号
Claims (1)
- 【特許請求の範囲】 ホスト側に着脱自在に形成された入出力部と、データ
を蓄積するための半導体メモリからなる蓄積部と、該蓄
積部にホスト側のデータを書き込みまたはホスト側へ蓄
積部のデータを読み出すための制御を行う制御部とを備
えたICメモリカードにおいて、 前記蓄積部は、書き換え不可な固定情報があらかじめ書
き込まれた固定領域と、書き換え可能なデータの管理情
報およびデータが書き込まれる可変領域とを有し、 前記制御部は、前記蓄積部の固定領域がアクセスされた
ことを検知して検知信号を送出するアドレス検知手段と
、該アドレス検知手段にて固定領域にアクセスが行われ
たことを検知した場合に、ホスト側から供給されるデー
タの書き込みのための制御信号をアドレス検知手段から
送出された検知信号にてマスクして前記蓄積部へのデー
タの書き込みを禁止するリードライト制御手段とが備え
られていることを特徴とするICメモリカード。
Priority Applications (2)
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Application Number | Priority Date | Filing Date | Title |
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JP2257379A JP3016490B2 (ja) | 1990-09-28 | 1990-09-28 | Icメモリカード |
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JPH04137085A true JPH04137085A (ja) | 1992-05-12 |
JP3016490B2 JP3016490B2 (ja) | 2000-03-06 |
Family
ID=17305572
Family Applications (1)
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JP2257379A Expired - Lifetime JP3016490B2 (ja) | 1990-09-28 | 1990-09-28 | Icメモリカード |
Country Status (2)
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