JPS5894021U - マイクロコンピユ−タ - Google Patents

マイクロコンピユ−タ

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Publication number
JPS5894021U
JPS5894021U JP18690081U JP18690081U JPS5894021U JP S5894021 U JPS5894021 U JP S5894021U JP 18690081 U JP18690081 U JP 18690081U JP 18690081 U JP18690081 U JP 18690081U JP S5894021 U JPS5894021 U JP S5894021U
Authority
JP
Japan
Prior art keywords
flop
flip
output
setting
microcomputer
Prior art date
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Pending
Application number
JP18690081U
Other languages
English (en)
Inventor
岩田 利喜
Original Assignee
日本電気株式会社
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Filing date
Publication date
Application filed by 日本電気株式会社 filed Critical 日本電気株式会社
Priority to JP18690081U priority Critical patent/JPS5894021U/ja
Publication of JPS5894021U publication Critical patent/JPS5894021U/ja
Pending legal-status Critical Current

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  • Debugging And Monitoring (AREA)
  • Stored Programmes (AREA)
  • Test And Diagnosis Of Digital Computers (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第1図は本考案の一実施例の要部ブロック図、第2図は
そのタイミング図である。 1〜23・・・・・・ステート信号発生側御用ゲート群
、   24.25・・・・・・フリップ−フロップ、
26.30・・・・・・レジスタ内容読出し制御ゲート
群、31・・・・・・レジスタA132・・・・・・レ
ジスタB133・・・・・・外部データバス、34・・
・・・・内部データバス。

Claims (1)

    【実用新案登録請求の範囲】
  1. セット/リセットすることが可能なフリップ・フロップ
    と、このフリップ・フロップの出力状態に応じて処理実
    行期間を制御する手段とを有し、前記フリップ・フロッ
    プをセットすることによってその出力により長い処理実
    行期間を設定し、リセットすることによってその出力に
    より短い処理実行期間を設定するようにしたことを特徴
    とするマイクロコンピュータ。
JP18690081U 1981-12-15 1981-12-15 マイクロコンピユ−タ Pending JPS5894021U (ja)

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JP18690081U JPS5894021U (ja) 1981-12-15 1981-12-15 マイクロコンピユ−タ

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP18690081U JPS5894021U (ja) 1981-12-15 1981-12-15 マイクロコンピユ−タ

Publications (1)

Publication Number Publication Date
JPS5894021U true JPS5894021U (ja) 1983-06-25

Family

ID=30102708

Family Applications (1)

Application Number Title Priority Date Filing Date
JP18690081U Pending JPS5894021U (ja) 1981-12-15 1981-12-15 マイクロコンピユ−タ

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JP (1) JPS5894021U (ja)

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