JPH0157378B2 - - Google Patents

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JPH0157378B2
JPH0157378B2 JP58073279A JP7327983A JPH0157378B2 JP H0157378 B2 JPH0157378 B2 JP H0157378B2 JP 58073279 A JP58073279 A JP 58073279A JP 7327983 A JP7327983 A JP 7327983A JP H0157378 B2 JPH0157378 B2 JP H0157378B2
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Juko Kusaka
Keiji Matsumoto
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NEC Corp
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Nippon Electric Co Ltd
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    • H03K19/08—Logic circuits, i.e. having at least two inputs acting on one output; Inverting circuits using specified components using semiconductor devices
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    • H03K19/09425—Multistate logic
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Description

【発明の詳細な説明】 本発明は、データ処理システムに関し、とくに
その制御系（データ処理装置）と被制御系との結
合機構に関するものである。
近年、CMOC製造技術の発達により低消費電
力で動作するデータ処理システムが数多く出現し
ている。しかし、低消費電力化の波はそれをはる
かに超えるものに、最近では次のような工夫がな
されている。即ち、制御系（データ処理装置）が
処理を停止してもかまわない期間には、データ処
理装置内部へクロツクが供給されないようにし
て、非処理時での消費電力を低減させている。こ
の状態はスタンバイ・モードと呼ばれている。
従来、このスタンバイ・モードでは、多くの場
合制御系のポート出力はハイレベルに固定されて
いた。従つて、この出力ポートに接続されるべき
被制御系の入力インピーダンスが小さいと、スタ
ンバイ時に制御系の出力ポートから周辺の被制御
系へと電流が流れてしまい、不要な電力が消費さ
れてしまう。
一方、上述の考察より、スタンバイ・モード時
の制御系のポート出力をハイレベルではなく、ハ
イ・インピーダンスにすることも考えられるが、
その場合には周辺の被制御系がCMOSで構成さ
れているものについてはポート出力の論理が確定
せず誤動作の原因となる。
すなわち、従来は制御系のポート出力の論理レ
ベルに応じて、これに接続される周辺装置を選択
しなければならず、システムアーキテクチヤーが
複雑になり高いパフオーマンスが得られないとい
う欠点があつた。
従つて本発明は被制御系の入力ポートインピー
ダンスに関係なく使用可能な制御系（データ処理
装置）を有する処理システムを提供することを目
的とする。
上記目的を達成するために本発明はスタンバイ
機能を有するデータ処理システムに於いて、ハイ
インピーダンスとロウインピーダンスとの両方の
論理レベルの設定ができる出力ポートと、前記２
つのインピーダンスのうちいずれか一方を選択す
る手段とを有するデータ処理装置を設けたことを
特徴とする。
本発明によれば制御系となるデータ処理装置は
そのポート出力のインピーダンスレベルがハイ、
ロウいずれにも簡単に切換えて設定できるので
（例えば命令によつて任意に設定できるので）、こ
の１個制御系でポートレベルの異なる複数の被制
御系を消費電力を増加することなく十分制御する
ことができる。
次に、本発明の一実施例について、図面を用い
て説明する。
第１図は、本発明の構成を示すブロツク図、第
２図は、ポートの構成例を示す回路ブロツク図で
ある。
第１図に於いて１０はリセツト信号、１は第１
のストツプ命令を実行するとアクテイブになる第
１の制御信号、２は第２のストツプ命令２を実行
するとアクテイブになる第２の制御信号、１００
は命令デコーダ、２００は第１の制御信号１また
は第２の制御信号２によつてセツトされ、リセツ
ト信号１０によつてリセツトされるラツチ回路、
３は第１の制御信号１がラツチ回路２００を通過
して出力される制御信号、４は第２の制御信号２
がラツチ回路２００を通過して出力される制御信
号、５は外部クロツク信号、６は内部クロツク信
号、７および９は２入力NOR回路、８はNOT回
路、３００は出力ポート、４００は内部バス、３
８０は出力ポート３００と内部バス４００との接
続ライン、３９０は出力ポート３００と外部周辺
システムとの接続ラインである。
第２図は第１図の出力ポート３００、接続ライ
ン３８０、接続ライン３９０の構成例を示してお
り、３，４はそれぞれ第１図と同じ制御信号、３
８１は前記接続ライン３８０のうちの１つのデー
タ信号、３０１，３０３，３０４および３０６に
いずれも２入力NOR回路、３０２，３０５およ
び３０７はいずれもNOT回路、、３０８および３
０９はＰチヤンネルトランジスタ、３１０はｎチ
ヤンネルトランジスタ、３１１は電源電圧端子、
３９１は接続ライン３９０のうちの１端子であ
る。
本実施例の動作を、まず第１図を中心に述べ
る。本実施例では、ロウインピーダンスをハイレ
ベル出力で実施している。当該データ処理装置
（制御系）は命令群の中に第１のストツプ命令と
第２のストツプ命令とを有する。命令デコーダ１
００は第１のストツプ命令あるいは第２のストツ
プ命令をデコーダすると、第１のストツプ命令に
対しては第１の制御信号１を、第２のストツプ命
令に対しては第２の制御信号２をアクテイブにす
る。ラツチ回路２００は第１の制御信号１あるい
は第２の制御信号２に応じて、第１の制御信号１
に対しては制御信号３を、第２の制御信号２に対
しては制御信号４をアクテイブにする。制御信号
３と制御信号４はリセツト信号１０によつてリセ
ツトされるまでアクテイブの状態が保たれる。本
実施例では、制御信号はすべてアクテイブ・ハイ
とする。制御信号３または制御信号４がアクテイ
ブになると、NOR回路７の出力はロウ、NOT回
路８の出力はハイとなり、外部クロツク５が供給
されてもNOR回路９の出力は常にロウ、すなわ
ち内部クロツク６は停止し、スタンバイ・モード
となる。一方、出力ポート３００では、制御信号
３あるいは制御信号４を受けて後述する動作を行
ない、接続ライン３９０をハイ・インピーダンス
あるいはハイのうちいずれかの状態にする。尚、
出力ポート３００の通常の動作としては、内部バ
ス４００から接続ライン３８０を介してデータを
引き取り、接続ライン３９０からデータの出力を
行なう。
次に第２図を参照し、出力ポート３００の動作
を述べる。
第１のストツプ命令の場合、制御信号３がハイ
になつている。したがつてNOR回路３０４と３
０１の出力はロウ、NOT回路３０５と３０２の
出力はいずれもハイになる。NOR回路３０６の
出力はロウ、NOT回路３０７の出力はハイで、
Ｐチヤンネルトランジスタ３０８と３０９はいず
れもオフになる。また、NOR回路３０３の出力
はロウとなり、ｎチヤンネルトランジスタ３１０
はオフになる。よつてＰチヤンネルトランジスタ
３０８と３０９、ｎチヤンネルトランジスタ３１
０とがいずれもオフになるので、端子３９１はハ
イインピーダンス状態となる。
第２のストツプ命令９の場合、制御信号４がハ
イになつている。したがつて、Ｐチヤンネルトラ
ンジスタ３０８がハイ、ｎチヤンネルトランジス
タ３１０がロウになる。これは第１のストツプ命
令の場合と同じである。しかし、制御信号３はロ
ウなのでNOR回路３０４の出力はハイ、NOT回
路３０５の出力はロウになり、Ｐチヤンネルトラ
ンジスタ３０９がオンとなる。この結果、電源電
圧端子３１１から電流が流れ、端子３９１はハイ
レベルを出力する。
尚、通常のポートの動作は制御信号３と制御信
号４とがともにロウの時で、データ信号３８１の
ハイ、ロウに応じてＰチヤンネルトランジスタ３
０８とｎチヤンネルトランジスタ３１０とのオ
ン、オフを制御し、端子３９１の出力レベルをハ
イあるいはロウにするものである。
以上説明したように制御系としてのデータ処理
装置にスタンバイ・モード時のポート出力レベル
を２種類（ハイ・インピーダンスとハイ）用意
し、それぞれについて動作の停止と同時にポート
出力を制御する命令を実行する回路を設けること
により、スタンバイ・モード時にスタンバイ・モ
ードの設定とポートに接続されている周辺装置
（被制御系）、に応じたポートの出力レベルの設定
とを簡単に行なうことができる。
【図面の簡単な説明】
第１図は本発明の一実施例の構成を示すブロツ
ク図、第２図はポートの要部を示す回路ブロツク
図である。 １００……命令デコード、２００……ラツチ回
路、３００……出力ポート、３８０……出力ポー
ト３００の内部バス４００との接続ライン、３９
０……出力ポート３００の外部周辺システムとの
接続ライン、４００……内部バス、１０……リセ
ツト信号、１，２，３，４……制御信号、５……
外部クロツク、６……内部クロツク、７，９……
２入力NOR回路、８……NOT回路、３０１，３
０３，３０４，３０６……２入力NOR回路、３
０２，３０５，３０７……NOT回路、３０８，
３０９……Ｐチヤンネルトランジスタ、３１０…
…ｎチヤンネルトランジスタ、３１１……電源電
圧端子、３８１……接続ライン３８０のうちの１
データ信号、３９１……接続ライン３９０のうち
の１端子。

Claims (1)

    【特許請求の範囲】
  1. １ 出力ポートの端子と、データ信号に応じて前
    記出力ポートの端子をハイ又はローレベルに設定
    するデータ出力状態と、前記データ信号にかかわ
    らず前記出力ポートの端子をハイインピーダンス
    に固定する第１のスタンバイ状態と、前記データ
    信号にかかわらず前記出力ポートの端子をローイ
    ンピーダンスのハイレベルに固定化する第２のス
    タンバイ状態とを有する制御部とを有することを
    特徴とするデータ処理装置。
JP58073279A 1983-04-26 1983-04-26 データ処理装置 Granted JPS59200326A (ja)

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JP58073279A JPS59200326A (ja) 1983-04-26 1983-04-26 データ処理装置
EP84104699A EP0162932B1 (en) 1983-04-26 1984-04-26 Data processing system with output switching circuit
DE8484104699T DE3485418D1 (de) 1983-04-26 1984-04-26 Datenverarbeitungssystem mit ausgangsschaltkreis.
US06/604,249 US4728822A (en) 1983-04-26 1984-04-26 Data processing system with improved output function
US07/087,842 US4823309A (en) 1983-04-26 1987-08-21 Data processing system with improved output function

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JP58073279A JPS59200326A (ja) 1983-04-26 1983-04-26 データ処理装置

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JPS59200326A JPS59200326A (ja) 1984-11-13
JPH0157378B2 true JPH0157378B2 (ja) 1989-12-05

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