JP7131748B2 - 表示パネルの駆動回路、表示パネルの駆動方法及び表示パネル - Google Patents
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Description
本出願は、2017年8月7に中国特許庁に提出された中国特許出願201710665973.0の優先権を主張し、その全ての内容が援用により本出願に取り込まれる。
Claims (19)
- 表示パネルの駆動回路であって、オン電圧調整回路を含み、
前記オン電圧調整回路は、制御サブ回路と、スイッチング及び分圧サブ回路とを含み、
前記スイッチング及び分圧サブ回路は、スイッチングサブ回路と、基本分圧サブ回路とを含み、
前記スイッチングサブ回路は、制御端子と、第1入力端子と、第2入力端子と、出力端子とを含み、前記スイッチングサブ回路の制御端子は、対応する解像度の制御信号を入力するように構成され、前記スイッチングサブ回路の第1入力端子は、前記制御サブ回路の出力端子に電気的に接続され、前記第2入力端子は、グランド電力供給信号をアクセスするように構成され、前記スイッチングサブ回路の出力端子は、分圧帰還ノードVFBに電気的に接続され、
前記スイッチングサブ回路は、前記制御信号の制御下で、前記制御サブ回路の出力端子により出力される信号の分圧を実行して前記対応する解像度の分圧帰還信号を形成し、前記分圧帰還信号を前記分圧帰還ノードVFBに出力するように構成され、
前記制御サブ回路は、第1入力端子と、第2入力端子と、第3入力端子と、前記出力端子とを含み、前記制御サブ回路の第1入力端子は、前記分圧帰還ノードVFBに電気的に接続され、前記制御サブ回路の第2入力端子は、初期レベル信号Vinを入力するように構成され、前記制御サブ回路の第3入力端子は、基準信号REFを入力するように構成され、前記制御サブ回路の出力端子は、前記スイッチング及び分圧サブ回路の第1入力端子に電気的に接続され、且つ前記対応する解像度のオン電圧信号を出力するように構成されることを特徴とする駆動回路。 - 複数のカスケード接続されたシフトレジスタを更に含み、
前記オン電圧調整回路は、ピクセルスイッチをオンするための前記初期レベル信号Vinを前記表示パネルの現解像度にマッチングするオン電圧信号に調整し、前記オン電圧信号を前記複数のカスケード接続されたシフトレジスタの各々の基準レベル信号端子に出力するように構成され、
前記複数のカスケード接続されたシフトレジスタの各々は、前記表示パネルが駆動走査を実行する場合、前記基準レベル信号端子における前記オン電圧信号に基づいて、前記表示パネルの現解像度に対応する走査信号を対応して接続されるゲートラインに入力するように構成されることを特徴とする請求項1に記載の駆動回路。 - 前記スイッチングサブ回路は、
第3抵抗器と、
第4抵抗器と、
第1スイッチングトランジスタと、
第2スイッチングトランジスタと
を含み、
前記第3抵抗器の一端子は、前記第4抵抗器の一端子に電気的に接続され、且つ前記制御サブ回路の出力端子により出力される信号をアクセスするように構成され、前記第3抵抗器の他端子は、前記第1スイッチングトランジスタのソース電極に電気的に接続され、
前記第1スイッチングトランジスタのゲート電極は、前記第4抵抗器の他端子及び前記第2スイッチングトランジスタのドレイン電極にそれぞれ電気的に接続され、前記第1スイッチングトランジスタのドレイン電極は、前記分圧帰還ノードVFBに電気的に接続され、
前記第2スイッチングトランジスタのゲートは、前記対応する解像度の制御信号を入力するように構成され、前記第2スイッチングトランジスタのソースは、前記グランド電力供給信号をアクセスするように構成されることを特徴とする請求項1に記載の駆動回路。 - 前記スイッチングサブ回路は、
第1分圧抵抗器と、
第5スイッチングトランジスタと
を含み、
前記第1分圧抵抗器の一端子は、前記制御サブ回路の出力端子により出力される信号をアクセスするように構成され、前記第1分圧抵抗器の他端子は、前記第5スイッチングトランジスタのソース電極に電気的に接続され、
前記第5スイッチングトランジスタのゲート電極は、前記対応する解像度の制御信号を入力するように構成され、前記第5スイッチングトランジスタのドレイン電極は、前記分圧帰還ノードVFBに電気的に接続されることを特徴とする請求項1に記載の駆動回路。 - 前記基本分圧サブ回路は、
第1抵抗器と、
第2抵抗器とを含み、
前記第1抵抗器の一端子は、前記制御サブ回路の出力端子により出力される信号をアクセスするように構成され、前記第1抵抗器の他端子は、前記分圧帰還ノードVFBに電気的に接続され、
前記第2抵抗器の一端子は、前記分圧帰還ノードVFBに電気的に接続され、前記第2抵抗器の他端子は、前記グランド電力供給信号をアクセスするように構成されることを特徴とする請求項1に記載の駆動回路。 - 前記制御サブ回路は、
分圧帰還処理サブ回路と、
電圧調整サブ回路と
を含み、
前記分圧帰還処理サブ回路の第1制御端子は、パルス制御信号OSCを入力するように構成され、前記分圧帰還処理サブ回路の第2制御端子は、前記基準信号REFを入力するように構成され、前記分圧帰還処理サブ回路の第1入力端子は、前記初期レベル信号Vinを入力するように構成され、前記分圧帰還処理サブ回路の第2入力端子は、前記分圧帰還ノードVFBに電気的に接続され、前記分圧帰還処理サブ回路の出力端子は、前記電圧調整サブ回路の入力端子に電気的に接続され、前記パルス制御信号OSC、前記基準信号REF及び前記分圧帰還信号の制御下で、前記分圧帰還処理サブ回路は、前記初期レベル信号Vinの帰還を実行して対応するカップリング充電信号を形成し、前記対応するカップリング充電信号を前記電圧調整サブ回路の第1入力端子に出力するように構成され、
前記電圧調整サブ回路の第2入力端子は、前記初期レベル信号Vinを入力するように構成され、前記電圧調整サブ回路の出力端子は、電圧調整後に前記オン電圧信号を出力するように構成され、前記電圧調整サブ回路は、前記カップリング充電信号に基づいて前記初期レベル信号Vinの電圧調整を実行して前記対応する解像度のオン電圧信号を形成し、前記オン電圧信号を出力するように構成されることを特徴とする請求項1乃至5のいずれか1項に記載の駆動回路。 - 前記オン電圧調整回路は、複数のスイッチングサブ回路を含み、前記複数のスイッチングサブ回路の各々は、異なる解像度に対応することを特徴とする請求項1乃至6のいずれか1項に記載の駆動回路。
- 共通電圧調整回路を更に含み、
前記共通電圧調整回路は、共通電圧を提供するための電力供給信号を前記表示パネルの対応する解像度にマッチングする共通電圧信号に調整し、前記共通電圧信号を出力するように構成されることを特徴とする請求項1乃至7のいずれか1項に記載の駆動回路。 - 前記共通電圧調整回路は、共通電圧スイッチングサブ回路を含み、
前記共通電圧スイッチングサブ回路の制御端子は、現解像度に対応するスイッチング制御信号を入力するように構成され、前記共通電圧スイッチングサブ回路の第1入力端子は、前記電力供給信号をアクセスするように構成され、前記共通電圧スイッチングサブ回路の第2入力端子は、前記グランド電力供給信号に接続するように構成され、前記共通電圧スイッチングサブ回路の出力端子は、前記対応する解像度の共通電圧信号を出力するように構成され、前記スイッチング制御信号の制御下で、前記共通電圧スイッチングサブ回路は、前記電力供給信号を前記対応する解像度の共通電圧信号に調整し、前記共通電圧信号を出力するように構成されることを特徴とする請求項8に記載の駆動回路。 - 前記共通電圧スイッチングサブ回路は、
第7抵抗器と、
第8抵抗器と、
第3スイッチングトランジスタと、
第4スイッチングトランジスタと
を含み、
前記第7抵抗器の一端子は、前記電力供給信号をアクセスするように構成され、前記第7抵抗器の他端子は、前記第3スイッチングトランジスタのソース電極に電気的に接続され、
前記第3スイッチングトランジスタのゲート電極は、前記第8抵抗器の一端子及び前記第4スイッチングトランジスタのドレイン電極にそれぞれ電気的に接続され、前記第3スイッチングトランジスタのドレイン電極は、前記対応する解像度の共通電圧信号を出力するように構成され、
前記第8抵抗器の他端子は、前記電力供給信号をアクセスするように構成され、
前記第4スイッチングトランジスタのゲート電極は、前記対応する解像度のスイッチング制御信号を入力するように構成され、前記第4スイッチングトランジスタのソース電極は、前記グランド電力供給信号に電気的に接続されることを特徴とする請求項9に記載の駆動回路。 - 前記共通電圧スイッチングサブ回路は、第2分圧抵抗器と、第16スイッチングトランジスタとを含み、
前記第2分圧抵抗器は、前記電力供給信号をアクセスするように構成され、前記第2分圧抵抗器の他端子は、前記第16スイッチングトランジスタのソース電極に電気的に接続され、
前記第16スイッチングトランジスタのゲート電極は、前記対応する解像度のスイッチング制御信号を入力するように構成され、前記第16スイッチングトランジスタのドレイン電極は、前記対応する解像度の共通電圧信号を出力するように構成されることを特徴とする請求項9に記載の駆動回路。 - 前記共通電圧調整回路は、初期電圧サブ回路を更に含み、
前記初期電圧サブ回路の第1入力端子は、前記電力供給信号をアクセスするように構成され、前記初期電圧サブ回路の第2入力端子は、前記グランド電力供給信号に電気的に接続され、前記初期電圧サブ回路の出力端子は、前記対応する解像度の共通電圧信号を出力するように構成され、前記初期電圧サブ回路は、前記電力供給信号の分圧を実行し、前記対応する解像度の共通電圧信号を出力するように構成されることを特徴とする請求項9に記載の駆動回路。 - 前記初期電圧サブ回路は、第15抵抗器と、第16抵抗器とを含み、
前記第15抵抗器の第1端子は、前記電力供給信号をアクセスするように構成され、前記第15抵抗器の他端子は、前記第16抵抗器の一端子に電気的に接続され、且つ前記対応する解像度の共通電圧信号を出力するように構成され、前記第16抵抗器の他端子は、前記グランド電力供給信号をアクセスするように構成されることを特徴とする請求項12に記載の駆動回路。 - 前記共通電圧調整回路は、出力サブ回路を更に含み、
前記出力サブ回路の第1入力端子は、前記共通電圧スイッチングサブ回路の出力端子及び前記初期電圧サブ回路の出力端子にそれぞれ電気的に接続され、前記出力サブ回路の第2入力端子は、その出力端子に電気的に接続され、前記出力サブ回路は、前記共通電圧スイッチングサブ回路及び前記初期電圧サブ回路により出力される前記共通電圧信号の電流増幅を実行してから増幅された共通電圧信号を出力するように構成されることを特徴とする請求項12又は13に記載の駆動回路。 - 前記出力サブ回路は、オペアンプを含み、
前記オペアンプの第1入力端子は、前記初期電圧サブ回路の出力端子及び前記共通電圧スイッチングサブ回路の出力端子にそれぞれ電気的に接続され、前記オペアンプの第2入力端子は、その出力端子に電気的に接続されることを特徴とする請求項14に記載の駆動回路。 - 前記共通電圧調整回路は、複数の共通電圧スイッチングサブ回路を含み、前記共通電圧スイッチングサブ回路の各々は、異なる解像度に対応することを特徴とする請求項8乃至15のいずれか1項に記載の駆動回路。
- 請求項1に記載の駆動回路を含む表示パネル。
- シフトレジスタ及び前記オン電圧調整回路は、前記表示パネルの周辺領域に位置することを特徴とする請求項17に記載の表示パネル。
- 請求項1に記載の駆動回路の駆動方法であって、
前記初期レベル信号Vinを前記制御サブ回路の第2入力端子に提供するステップと、
前記表示パネルの対応する解像度の制御信号を前記スイッチングサブ回路に提供して、前記表示パネルの対応する解像度にマッチングするオン電圧信号が前記オン電圧調整回路からシフトレジスタの各々の基準レベル信号端子に出力されるステップと
を含むことを特徴とする方法。
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