JP6411292B2 - ラダー型フィルタ、デュプレクサおよびモジュール - Google Patents
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Description
を具備し、前記インダクタは前記基板に搭載されたチップ部品である構成とすることができる。
21 フィルタチップ
22 弾性表面波共振器
24 金属層
26 バンプ
30 多層基板
38 チップインダクタ
40 PCB
Claims (10)
- 入力端子と出力端子との間に直列に接続された1または複数の直列共振器と、
前記入力端子と前記出力端子との間に並列に接続された1または複数の並列共振器と、
前記1または複数の並列共振器のうち少なくとも1つの並列共振器が直列に分割された並列共振器と、
一端が前記入力端子から前記出力端子に至る前記1または複数の直列共振器を通る経路内に位置する第1ノードに接続され、他端が前記分割された並列共振器の間に位置する第2ノードに接続されたインダクタと、
を具備し、
前記インダクタにより、通過帯域より低い周波数を有する第1減衰極および前記通過帯域より高い周波数を有する第2減衰極が形成されることを特徴とするラダー型フィルタ。 - 前記少なくとも1つの並列共振器は、回路上において、前記入力端子に最も近い並列共振器および前記出力端子に最も近い並列共振器の少なくとも一方を含むことを特徴とする請求項1記載のラダー型フィルタ。
- 前記第1ノードは、前記入力端子と前記少なくとも1つの並列共振器との間のノードと、前記出力端子と前記少なくとも1つの並列共振器との間のノードと、の少なくとも一方であることを特徴とする請求項2記載のラダー型フィルタ。
- 前記第1ノードと前記少なくとも1つの並列共振器との間には直列共振器は接続されていないことを特徴とする請求項1から3のいずれか一項記載のラダー型フィルタ。
- 前記第1ノードと前記少なくとも1つの並列共振器との間には、1または複数の並列共振器のうち他の並列共振器は接続されていないことを特徴とする請求項1から4のいずれか一項記載のラダー型フィルタ。
- 前記分割された並列共振器の容量値は略同じであることを特徴とする請求項1から5のいずれか一項記載のラダー型フィルタ。
- 前記1または複数の直列共振器および前記1または複数の並列共振器が形成されたフィルタチップと、
前記フィルタチップを搭載する基板と、
を具備し、
前記インダクタは前記基板に搭載されたチップ部品であることを特徴とする請求項1から6のいずれか一項記載のラダー型フィルタ。 - 前記1または複数の直列共振器および前記1または複数の並列共振器が形成されたフィルタチップと、
前記フィルタチップを搭載する基板と、
を具備し、
前記インダクタは前記基板内に形成されていることを特徴とする請求項1から6のいずれか一項記載のラダー型フィルタ。 - 送信端子と共通端子との間に接続された送信フィルタと、
受信端子と前記共通端子との間に接続された受信フィルタと、
を具備し、
前記送信フィルタおよび前記受信フィルタの少なくとも一方は請求項1から8のいずれか一項記載のラダー型フィルタであることを特徴とするデュプレクサ。 - 請求項1から8のいずれか一項記載のラダー型フィルタを備えることを特徴とするモジュール。
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