JP6250299B2 - 極符号化された符号語を不揮発性メモリ装置のマルチビットデータにマッピングするマッピングパターン選択方法 - Google Patents
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Description
実施形態として、前記マッピングする段階は、前記反復されたマッピングパターンに従って、前記符号語の各ビットを最下位ビット又は最上位ビットにマッピングする段階を含む。
実施形態として、前記マッピングする段階は、前記反復されたマッピングパターンに従って、前記符号語の各ビットを最下位ビット、中間ビット(CSB:Central Significant Bit)、又は最上位ビットにマッピングする段階を含む。
実施形態として、前記不揮発性メモリ装置からマルチビット読出しデータを受信する段階と、前記反復されたマッピングパターンに基づいて前記マルチビット読出しデータを読み出された符号語に変換する段階と、前記読み出された符号語をデコーディングする段階と、をさらに含む。
実施形態として、前記不揮発性メモリ装置から最上位ビット読出しデータ及び最下位ビット読出しデータを受信する段階と、前記最上位ビット読出しデータ及び最下位ビット読出しデータをエラー訂正デコーディングする段階と、前記反復されたマッピングパターンに基づいて前記エラー訂正デコーディングされた最上位ビット読出しデータ及び最下位ビット読出しデータを読み出された符号語に変換する段階と、前記読み出された符号語を復号する段階と、をさらに含む。
実施形態として、前記エラー率を各々計算する段階は、前記マルチビットの確率密度関数に基づいて、極符号化器の入力端のビットのエラー率を各々計算する段階を含む。
実施形態として、前記極符号化器の入力端のビットのエラー率の中で少なくとも1つのエラー率が基準値より大きい時、該当反復されたパターンは非選択される。
実施形態として、前記選択された反復されたパターンに対応するパターンを不揮発性メモリ装置のコントローラに格納する段階をさらに含む。
実施形態として、前記反復されたパターンの長さは前記極符号化された符号語の長さと同一である。
不揮発性メモリ装置1100はコントローラ1200の制御に従って書込み、読出し、及び消去を遂行するように構成される。
RAM(1230)はプロセッサー1220の動作メモリ(working_memory、スクラッチパッドともいう)、キャッシュメモリ、及びバッファメモリの中で少なくとも1つに利用され得る。
例えば、符号語の第1番目ビットはMSBにマッピングされ、第2番目ビットはMSBにマッピングされ、第3番目ビットはLSBにマッピングされ、そして第4番目ビットはLSBにマッピングされる。
[数学式1]
(n!)/((n/2)!)2
[数学式2]
(n!)/((n/m)!)m
位置情報LIは固定ビット(frozen bit)が挿入される位置に関する情報を示す。
符号語Cnはソースデータであり、不揮発性メモリ装置1100から読み出されたデータは符号語Cnが複数のメモリメモリセルによって形成されるチャンネルを通じて受信されたデータであり得る。パラメーター格納部1320は不揮発性メモリ装置1100の複数のチャンネル、即ちマルチビットデータが格納されるチャンネル(以下で、メモリセルのチャンネルは第1チャンネルと称する)に各々対応する確率密度関数PDFに関する情報を格納する。
メモリシステム5600は不揮発性メモリ装置5610及びコントローラ5620を含む。不揮発性メモリ装置5610は複数の不揮発性メモリチップを含む。メモリシステム5600は図1又は図17を参照して説明されたメモリシステム1000、又は2000の何れかである。
1100、2100、3100、4100 不揮発性メモリ装置
1110、1110a、1110b メモリセルアレイ
1120 アドレスデコーダー
1130 読出し/書込み回路
1140 制御ロジック
1200、2200、3200、4200 コントローラ
1210 システムバス
1220 プロセッサー
1230 RAM
1240 ホストインターフェイス
1250 メモリインターフェイス
1260 極符号エンコーダー/デコーダー
1270 エラー訂正ブロック
1261 パターン及び位置情報格納部
1262 固定ビット挿入部
1263、1263a、1263b 生成行列エンコーディング部
1264 パターン反復部
1265 ビット分類部
1266 マッピング及びデマッピング部
1267 連続除去デコーディング部
1300 テスト装置
1310 パターン生成部
1320 パラメーター格納部
1330 エラー測定部
1340 選択部
1400 ホスト
3000 メモリカード
3300、4300 コネクター
4000 ソリッドステートドライブ
5000 コンピューティングシステム
5100 中央処理装置
5200 RAM
5300 使用者インターフェイス
5400 モデム
5500 システムバス
5600 メモリシステム
Claims (4)
- 極符号化された符号語を不揮発性メモリ装置のマルチビットにマッピングするマッピングパターンを選択するマッピングパターン選択方法において、
複数のパターンを生成する段階と、
前記複数のパターンを各々反復して複数の反復されたパターンを生成する段階と、
前記複数の反復されたパターンのエラー率を各々計算する段階と、
前記計算されたエラー率に従って、前記複数の反復されたパターンの中で1つの反復されたパターンを選択する段階と、を含むことを特徴とするマッピングパターン選択方法。 - 前記エラー率を各々計算する段階は前記マルチビットの確率密度関数に基づいて遂行されることを特徴とする請求項1に記載のマッピングパターン選択方法。
- 前記エラー率を各々計算する段階は、
前記マルチビットの確率密度関数に基づいて、極符号化器の入力端のビットのエラー率を各々計算する段階を含むことを特徴とする請求項2に記載のマッピングパターン選択方法。 - 前記極符号化器の入力端のビットのエラー率の中で少なくとも1つのエラー率が基準値より大きい時、該当反復されたパターンは非選択されることを特徴とする請求項3に記載のマッピングパターン選択方法。
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