JP5752623B2 - 受光回路 - Google Patents
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Description
したがって、電流icは、出力電流ipが増加しても、電流ib(=電流ia)が第3の定電流i3と等しくなるまでは流れない。そして、電流icは、電流ib(=電流ia)が第3の定電流i3より大きくなると、電流iaと同じ割合で増加する。
図7は、第3の実施形態に係る受光回路300の構成の一例を示す回路図である。なお、図7において、図1の符号と同じ符号は、第1の実施形態と同様の構成を示す。
101 トランスインピーダンスアンプ
102 電流コンパレータ
103 自動閾値調整回路
M0 基準MOSトランジスタ
IS0 基準定電流源
PD フォトダイオード
Claims (7)
- 一端が第1の電位線に接続され、他端が第1の内部端子に接続され、光信号を電気信号に光電変換するフォトダイオードと、
前記第1の内部端子に一端が接続された帰還抵抗と、ゲートが前記第1の内部端子に接続され、ドレインが第2の内部端子に接続された第1導電型の第1のMOSトランジスタと、前記第2の内部端子と第2の電位線との間に接続され、第1の定電流を出力する第1の定電流源と、を有するトランスインピーダンスアンプと、
ドレインが出力端子に接続され、ソースが前記第1の電位線に接続され、ゲートが前記第2の内部端子に接続された第1導電型の第2のMOSトランジスタと、前記出力端子と前記第2の電位線との間に接続され、第2の定電流を出力する第2の定電流源と、を有する電流コンパレータと、
ソースが前記第2の電位線に接続され、ドレインが第1の接続点に接続され、ダイオード接続された第2導電型の第4のMOSトランジスタと、ソースが前記第2の電位線に接続され、ドレインが前記第2のMOSトランジスタのドレインに接続され、ゲートが前記第4のMOSトランジスタのゲートに接続された第2導電型の第5のMOSトランジスタと、を有するカレントミラー回路と、
一端が前記第2の電位線に接続され、前記第1の接続点に他端が接続され、第3の定電流を出力する第3の定電流源と、
ドレインが前記第1の接続点に接続され、ソースが前記第1の電位線に接続され、ゲートが前記第2の内部端子に接続された第1導電型の第3のMOSトランジスタと、
を備えたことを特徴とする受光回路。 - 前記受光回路は、
前記フォトダイオードが光信号を光電変換した出力電流に応じた電流が、前記第2の定電流と、前記第2の電位線と前記第1の接続点との間に流れる電流をカレントミラーしたミラー電流との和で規定される閾値以上のとき、第1レベルの信号を前記出力端子から出力し、
一方、前記出力電流に応じた前記電流が、前記閾値未満のとき、第2レベルの信号を前記出力端子から出力することを特徴とする請求項1に記載の受光回路。 - 前記受光回路は、
前記カレントミラー回路が前記第1の接続点に出力する電流を遅延させる遅延回路をさらに有することを特徴とする請求項1または2に記載の受光回路。 - 前記遅延回路は、前記第1の接続点と前記第1の電位線との間に接続されたコンデンサであることを特徴とする請求項3に記載の受光回路。
- 前記受光回路は、
前記第2のMOSトランジスタのソースと前記第1の電位線との間に接続された第1の抵抗と、
前記第3のMOSトランジスタのソースと前記第1の電位線との間に接続された第2の抵抗と、
をさらに有することを特徴とする請求項1または2に記載の受光回路。 - 前記第1の定電流源は、ソースが前記第2の電位線に接続され、ドレインが前記第2の内部端子に接続され、前記第1の定電流が流れるようにゲートに電圧が印加された第2導電型の第6のMOSトランジスタであり、
前記第2の定電流源は、ソースが前記第2の電位線に接続され、ドレインが前記出力端子に接続され、ゲートが前記第6のMOSトランジスタのゲートに接続された第2導電型の第7のMOSトランジスタであり、
前記第3の定電流源は、ソースが前記第2の電位線に接続され、ドレインが前記第1の接続点に接続され、ゲートが前記第6のMOSトランジスタのゲートに接続された第2導電型の第8のMOSトランジスタであることを特徴とする請求項1ないし5のいずれか一項に記載の受光回路。 - ソースが前記第2の電位線に接続され、ゲートが前記第6のMOSトランジスタのゲートに接続され、ダイオード接続された第2導電型の基準MOSトランジスタと、
一端が前記基準MOSトランジスタのドレインに接続され、他端が前記第1の電位線に接続され、定電流を出力する基準定電流源と、をさらに備えることを特徴とする請求項6に記載の受光回路。
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