JP5614896B2 - ターボ符号化方法及びターボ符号化方法を具現するための装置 - Google Patents
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Description
図1に示すように、前記CTC符号化器は、1/3符号化器101、インターリーバ102、パンクチャリング(puncturing)103を備えて構成される。
前記図2に示すように、シンボル分離モジュールは、符号化されたビットをサブブロックA,B,Y1,Y2,W1及びW2に分離する(ステップ201)。
前記図3に示すように、ビットのマッピング順序は、i1i2q1q2で、ここで、i1=0及びi1=1に対しては、信号点配置図上において右側半分プレーン及び左側半分プレーンでの各々のポイントに該当する。そして、i2=0及びi2=1に対しては、信号点配置図上において中間及び両側サイドに該当する。
前記図4に示すように、入力ビットAi 401及びBi 402は、1/3CTC符号化器に対する入力集合として使用される。そして、パリティビット(Yi及びWi)は、情報ビットAiとBiの併合情報を統合(embody)する。
インターリーブされた情報サブブロックB(ここで、情報サブブロックAとBとは、バイパスされる(by−passed))と、インターリーブされたY1及びY2サブブロックシーケンスのビット単位(bit by bit)で多重化(multiplex)されたパリティシーケンスと(ここで、前記インターリーブされたY1及びY2サブブロックシーケンスのビット単位で多重化されたパリティシーケンスは、Y1サブブロックインターリーバからの第1出力ビット、Y2サブブロックインターリーバからの第1出力ビット、Y1サブブロックインターリーバからの第2出力ビット、及びY2サブブロックインターリーバからの第2出力ビットを含む。)、インターリーブされたW2及びW1サブブロックシーケンスのビット単位(bit by bit)で多重化されたパリティシーケンスとを備え、前記インターリーブされたW2及びW1サブブロックシーケンスのビット単位で多重化されたパリティシーケンスは、W2サブブロックインターリーバからの第1出力ビット、W1サブブロックインターリーバからの第1出力ビット、W2サブブロックインターリーバからの第2出力ビット、及びW1サブブロックインターリーバからの第2出力ビットを含むことを特徴とする装置。
前記図5において、インターリーバにおいてサブブロックインターリーブモジュールからの出力は、シーケンスA´,B´,Y´1,Y´2,W´1,W´2と仮定する。
前記図6に示すように、シーケンスY´1が第1番目にマッピングされる。IEEE 802.16e標準において、Y´1,iと共に同時に符号化器から出力されるパリティビットは、W´1,iである。以後、W´1がマッピングされる。
前記図7に示すように、シーケンスA´が第1番目にマッピングされる。A´iと共に同時にCTC符号化器に入力されるシーケンスB´での該当ビットは、B´iである。以後、シーケンスB´がマッピングされる。
102 インターリーバ
103 パンクチャリング
104 構成符号化器
105 CTCインターリーバ
Claims (20)
- コーディング方法において、
(a)CTC(Convolutional Turbo Coding)インターリーバを利用して、構成符号化器(constituent encoder)を利用して情報ビットA及びBをインタリーブして、インターリーブした情報ビットC及びDをそれぞれ出力する過程と、
(b)構成符号化器(constituent encoder)を利用して、前記情報ビットA及びBと前記インターリーブした情報ビットC及びDを符号化し、パリティシーケンスY1及びW1、Y2及びW2をそれぞれ出力する過程と、
(c)前記情報ビットA及びB、前記パリティシーケンスY1及びY2、前記パリティシーケンスW2及びW1をそれぞれインターリーブする過程と、
(d)インターリーブされた情報サブブロックA、インターリーブされた情報サブブロックB、インターリーブされたY1及びY2サブブロックシーケンスのビット単位(bit by bit)で多重化(multiplexed)されたシーケンス、インターリーブされたW2及びW1サブブロックシーケンスのビット単位で多重化されたシーケンスを出力する過程と、を含み、
前記インターリーブされたY1及びY2サブブロックシーケンスのビット単位で多重化されたシーケンスは、Y1サブブロックインターリーバからの第1出力ビット、Y2サブブロックインターリーバからの第1出力ビット、Y1サブブロックインターリーバからの第2出力ビット、Y2サブブロックインターリーバからの第2出力ビットの順番に応じて、前記Y1サブブロックインターリーバからの第1出力ビット、前記Y2サブブロックインターリーバからの第1出力ビット、前記Y1サブブロックインターリーバからの第2出力ビット、前記Y2サブブロックインターリーバからの第2出力ビットを含み、
前記インターリーブされたW2及びW1サブブロックシーケンスのビット単位で多重化されたシーケンスは、W2サブブロックインターリーバからの第1出力ビット、W1サブブロックインターリーバからの第1出力ビット、W2サブブロックインターリーバからの第2出力ビット、W1サブブロックインターリーバからの第2出力ビットの順番に応じて、前記W2サブブロックインターリーバからの第1出力ビット、前記W1サブブロックインターリーバからの第1出力ビット、前記W2サブブロックインターリーバからの第2出力ビット、前記W1サブブロックインターリーバからの第2出力ビットを含む方法。 - インターリーブされたY2サブブロックシーケンスのビットが高い信頼度を有する信号点配置図ポイント(constellation points)のビットにマッピングされると、インターリーブされたW2サブブロックシーケンスの該当ビットは低い信頼度を有する信号点配置図ポイントのビットにマッピングされ、
インターリーブされたY2サブブロックシーケンスのビットが低い信頼度を有する信号点配置図ポイントのビットにマッピングされると、インターリーブされたW2サブブロックシーケンスの該当ビットは高い信頼度を有する信号点配置図ポイントのビットにマッピングされ、
インターリーブされたY1サブブロックシーケンスのビットが高い信頼度を有する信号点配置図ポイントのビットにマッピングされると、インターリーブされたW1サブブロックシーケンスの該当ビットは低い信頼度を有する信号点配置図ポイントのビットにマッピングされ、
インターリーブされたY1サブブロックシーケンスのビットが低い信頼度を有する信号点配置図ポイントのビットにマッピングされると、インターリーブされたW1サブブロックシーケンスの該当ビットは高い信頼度を有する信号点配置図ポイントのビットにマッピングされる請求項1に記載の方法。 - 装置において、
情報ビットA及びBをインタリーブして、インターリーブした情報ビットC及びDをそれぞれ出力するCTC(Convolutional Turbo Coding)インターリーバと、
前記情報ビットA及びBと前記インターリーブした情報ビットC及びDを符号化し、パリティシーケンスY1及びW1、Y2及びW2をそれぞれ出力する構成符号化器(constituent encoder)と、
前記情報ビットA及びB、前記パリティシーケンスY1及びY2、前記パリティシーケンスW2及びW1をそれぞれインターリーブし、インターリーブされた情報サブブロックA、インターリーブされた情報サブブロックB、インターリーブされたY1及びY2サブブロックシーケンスのビット単位(bit by bit)で多重化(multiplexed)されたシーケンス、インターリーブされたW2及びW1サブブロックシーケンスのビット単位で多重化されたシーケンスを出力する多数のインターリーバと、を含み、
前記インターリーブされたY1及びY2サブブロックシーケンスのビット単位で多重化されたシーケンスは、Y1サブブロックインターリーバからの第1出力ビット、Y2サブブロックインターリーバからの第1出力ビット、Y1サブブロックインターリーバからの第2出力ビット、Y2サブブロックインターリーバからの第2出力ビットの順番に応じて、前記Y1サブブロックインターリーバからの第1出力ビット、前記Y2サブブロックインターリーバからの第1出力ビット、前記Y1サブブロックインターリーバからの第2出力ビット、前記Y2サブブロックインターリーバからの第2出力ビットを含み、
前記インターリーブされたW2及びW1サブブロックシーケンスのビット単位で多重化されたシーケンスは、W2サブブロックインターリーバからの第1出力ビット、W1サブブロックインターリーバからの第1出力ビット、W2サブブロックインターリーバからの第2出力ビット、W1サブブロックインターリーバからの第2出力ビットの順番に応じて、前記W2サブブロックインターリーバからの第1出力ビット、前記W1サブブロックインターリーバからの第1出力ビット、 前記W2サブブロックインターリーバからの第2出力ビット、前記W1サブブロックインターリーバからの第2出力ビットを含む装置。 - インターリーブされたY2サブブロックシーケンスのビットが高い信頼度を有する信号点配置図ポイント(constellation points)のビットにマッピングされると、インターリーブされたW2サブブロックシーケンスの該当ビットは低い信頼度を有する信号点配置図ポイントのビットにマッピングされ、
インターリーブされたY2サブブロックシーケンスのビットが低い信頼度を有する信号点配置図ポイントのビットにマッピングされると、インターリーブされたW2サブブロックシーケンスの該当ビットは高い信頼度を有する信号点配置図ポイントのビットにマッピングされ、
インターリーブされたY1サブブロックシーケンスのビットが高い信頼度を有する信号点配置図ポイントのビットにマッピングされると、インターリーブされたW1サブブロックシーケンスの該当ビットは低い信頼度を有する信号点配置図ポイントのビットにマッピングされ、
インターリーブされたY1サブブロックシーケンスのビットが低い信頼度を有する信号点配置図ポイントのビットにマッピングされると、インターリーブされたW1サブブロックシーケンスの該当ビットは高い信頼度を有する信号点配置図ポイントのビットにマッピングされる請求項3に記載の装置。 - 装置において、
情報サブブロックA、情報サブブロックB、Y1サブブロックのパリティシーケンス、Y2サブブロックのパリティシーケンス、W2サブブロックのパリティシーケンス、W1サブブロックのパリティシーケンスを受信し、
インターリーブされた情報サブブロックA、インターリーブされた情報サブブロックB、インターリーブされたY1及びY2サブブロックシーケンスのビット単位(bit by bit)で多重化(multiplexed)されたシーケンス、インターリーブされたW2及びW1サブブロックシーケンスのビット単位で多重化されたシーケンスを出力する多数のサブブロックインターリーバを含み、
前記インターリーブされたY1及びY2サブブロックシーケンスのビット単位で多重化されたシーケンスは、Y1サブブロックインターリーバからの第1出力ビット、Y2サブブロックインターリーバからの第1出力ビット、Y1サブブロックインターリーバからの第2出力ビット、Y2サブブロックインターリーバからの第2出力ビットの順番に応じて、前記Y1サブブロックインターリーバからの第1出力ビット、前記Y2サブブロックインターリーバからの第1出力ビット、前記Y1サブブロックインターリーバからの第2出力ビット、前記Y2サブブロックインターリーバからの第2出力ビットを含み、
前記インターリーブされたW2及びW1サブブロックシーケンスのビット単位で多重化されたシーケンスは、W2サブブロックインターリーバからの第1出力ビット、W1サブブロックインターリーバからの第1出力ビット、W2サブブロックインターリーバからの第2出力ビット、W1サブブロックインターリーバからの第2出力ビットの順番に応じて、前記W2サブブロックインターリーバからの第1出力ビット、前記W1サブブロックインターリーバからの第1出力ビット、 前記W2サブブロックインターリーバからの第2出力ビット、前記W1サブブロックインターリーバからの第2出力ビットを含む装置。 - インターリーブされたY2サブブロックシーケンスのビットが高い信頼度を有する信号点配置図ポイント(constellation points)のビットにマッピングされると、インターリーブされたW2サブブロックシーケンスの該当ビットは低い信頼度を有する信号点配置図ポイントのビットにマッピングされ、
インターリーブされたY2サブブロックシーケンスのビットが低い信頼度を有する信号点配置図ポイントのビットにマッピングされると、インターリーブされたW2サブブロックシーケンスの該当ビットは高い信頼度を有する信号点配置図ポイントのビットにマッピングされ、
インターリーブされたY1サブブロックシーケンスのビットが高い信頼度を有する信号点配置図ポイントのビットにマッピングされると、インターリーブされたW1サブブロックシーケンスの該当ビットは低い信頼度を有する信号点配置図ポイントのビットにマッピングされ、
インターリーブされたY1サブブロックシーケンスのビットが低い信頼度を有する信号点配置図ポイントのビットにマッピングされると、インターリーブされたW1サブブロックシーケンスの該当ビットは高い信頼度を有する信号点配置図ポイントのビットにマッピングされる請求項5に記載の装置。 - 方法において、
多数のサブブロックインターリーバが、情報サブブロックA、情報サブブロックB、Y1サブブロックのパリティシーケンス、Y2サブブロックのパリティシーケンス、W2サブブロックのパリティシーケンス、W1サブブロックのパリティシーケンスを受信する過程と、
前記多数のサブブロックインターリーバがインターリーブされた情報サブブロックA、インターリーブされた情報サブブロックB、インターリーブされたY1及びY2サブブロックシーケンスのビット単位(bit by bit)で多重化(multiplexed)されたシーケンス、インターリーブされたW2及びW1サブブロックシーケンスのビット単位で多重化されたシーケンスを出力する過程と、を含み、
前記インターリーブされたY1及びY2サブブロックシーケンスのビット単位で多重化されたシーケンスは、Y1サブブロックインターリーバからの第1出力ビット、Y2サブブロックインターリーバからの第1出力ビット、Y1サブブロックインターリーバからの第2出力ビット、Y2サブブロックインターリーバからの第2出力ビットの順番に応じて、前記Y1サブブロックインターリーバからの第1出力ビット、 前記 Y2サブブロックインターリーバからの第1出力ビット、前記Y1サブブロックインターリーバからの第2出力ビット、前記Y2サブブロックインターリーバからの第2出力ビットを含み、
前記インターリーブされたW2及びW1サブブロックシーケンスのビット単位で多重化されたシーケンスは、W2サブブロックインターリーバからの第1出力ビット、W1サブブロックインターリーバからの第1出力ビット、W2サブブロックインターリーバからの第2出力ビット、W1サブブロックインターリーバからの第2出力ビットの順番に応じて、前記W2サブブロックインターリーバからの第1出力ビット、前記W1サブブロックインターリーバからの第1出力ビット、 前記W2サブブロックインターリーバからの第2出力ビット、前記W1サブブロックインターリーバからの第2出力ビットを含む方法。 - インターリーブされたY2サブブロックシーケンスのビットが高い信頼度を有する信号点配置図ポイント(constellation points)のビットにマッピングされると、インターリーブされたW2サブブロックシーケンスの該当ビットは低い信頼度を有する信号点配置図ポイントのビットにマッピングされ、
インターリーブされたY2サブブロックシーケンスのビットが低い信頼度を有する信号点配置図ポイントのビットにマッピングされると、インターリーブされたW2サブブロックシーケンスの該当ビットは高い信頼度を有する信号点配置図ポイントのビットにマッピングされ、
インターリーブされたY1サブブロックシーケンスのビットが高い信頼度を有する信号点配置図ポイントのビットにマッピングされると、インターリーブされたW1サブブロックシーケンスの該当ビットは低い信頼度を有する信号点配置図ポイントのビットにマッピングされ、
インターリーブされたY1サブブロックシーケンスのビットが低い信頼度を有する信号点配置図ポイントのビットにマッピングされると、インターリーブされたW1サブブロックシーケンスの該当ビットは高い信頼度を有する信号点配置図ポイントのビットにマッピングされる請求項7に記載の方法。 - パリティシーケンスがビット単位で多重化されると、前記インターリーブされた情報サブブロックA及びBはバイパスされる請求項7に記載の方法。
- 前記インターリーブされたY1及びY2サブブロックシーケンスのビット単位で多重化されたシーケンスは、Yと呼ばれる請求項7に記載の方法。
- 前記インターリーブされたW2及びW1サブブロックシーケンスのビット単位で多重化されたシーケンスは、Wと呼ばれる請求項7に記載の方法。
- パリティシーケンスがビット単位で多重化されると、インターリーブされた情報サブブロックA及びBはバイパスされる請求項1に記載の方法。
- 前記インターリーブされたY1及びY2サブブロックシーケンスのビット単位で多重化されたシーケンスは、Yと呼ばれる請求項1に記載の方法。
- 前記インターリーブされたW2及びW1サブブロックシーケンスのビット単位で多重化されたシーケンスは、Wと呼ばれる請求項1に記載の方法。
- パリティシーケンスがビット単位で多重化されると、インターリーブされた情報サブブロックA及びBはバイパスされる請求項3に記載の装置。
- 前記インターリーブされたY1及びY2サブブロックシーケンスのビット単位で多重化されたシーケンスは、Yと呼ばれる請求項3に記載の装置。
- 前記インターリーブされたW2及びW1サブブロックシーケンスのビット単位で多重化されたシーケンスは、Wと呼ばれる請求項3に記載の装置。
- パリティシーケンスがビット単位で多重化されると、前記インターリーブされた情報サブブロックA及びBはバイパスされる請求項5に記載の装置。
- 前記インターリーブされたY1及びY2サブブロックシーケンスのビット単位で多重化されたシーケンスは、Yと呼ばれる請求項5に記載の装置。
- 前記インターリーブされたW2及びW1サブブロックシーケンスのビット単位で多重化されたシーケンスは、Wと呼ばれる請求項5に記載の装置。
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