JP5512000B2 - 表示装置およびその駆動方法 - Google Patents
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Description
Ids=(1/2)・(W/L)・μ・Cox(Vgs−Vth)2 …(1)
ただし、式(1)において、Wは駆動用TFT110のチャネル幅、Lは駆動用TFT110のチャネル長、μは駆動用TFT110の移動度、Coxは駆動用TFT110のゲート酸化膜容量、Vthは駆動用TFT110の閾値電圧を表す。
複数の走査線と複数のデータ線の各交差点に対応して配置された複数の画素回路と、
前記走査線を用いて書き込み対象の画素回路を選択し、前記データ線に対して表示データに応じたデータ電位を与える駆動回路とを備え、
前記画素回路は、
第1の電源配線と第2の電源配線との間に設けられた電気光学素子と、
前記第1の電源配線と前記第2の電源配線との間に前記電気光学素子と直列に設けられた駆動素子と、
前記駆動素子の制御端子に第1の電極が接続され、前記駆動回路によって制御される第1の制御配線に第2の電極が接続された補償用コンデンサと、
前記駆動素子の制御端子と一方の電流入出力端子との間に設けられ、前記走査線に制御端子が接続された補償用スイッチング素子と、
前記駆動素子の一方の電流入出力端子と前記第1の電源配線との間に設けられ、前記駆動回路によって制御される第2の制御配線に制御端子が接続された遮断用スイッチング素子と、
前記駆動素子の他方の電流入出力端子と前記データ線との間に設けられ、前記走査線に制御端子が接続された書き込み用スイッチング素子とを含み、
前記駆動回路は、書き込み対象の画素回路について、前記データ線に前記データ電位を与えながら、前記書き込み用スイッチング素子と前記補償用スイッチング素子を導通状態に、前記遮断用スイッチング素子を非導通状態に制御することにより、前記駆動素子の制御端子に前記表示データと前記駆動素子の閾値電圧に応じた電位を与え、その後に、前記書き込み用スイッチング素子、前記補償用スイッチング素子および前記遮断用スイッチング素子の状態を保ったままで、前記第1の制御配線に与える電位を切り替えることにより、前記補償用コンデンサの第2の電極に与える電位を切り替えて、前記駆動素子の制御端子に前記表示データと前記閾値電圧に応じた書き込み電位を与えることを特徴とする。
前記駆動回路は、書き込み対象の画素回路について、前記書き込み用スイッチング素子を導通状態に制御している間、前記データ線に対して、前記表示データと前記制御配線に与える電位の変化量とによって定まる電位を与えることを特徴とする。
前記駆動回路は、書き込み対象の画素回路について、前記書き込み用スイッチング素子を導通状態に制御している間、前記データ線に対して、前記電気光学素子への印加電圧が発光閾値電圧以下となる電位を与えることを特徴とする。
前記画素回路が、第1の電源配線と第2の電源配線との間に設けられた電気光学素子と、前記第1の電源配線と前記第2の電源配線との間に前記電気光学素子と直列に設けられた駆動素子と、前記駆動素子の制御端子に第1の電極が接続され、第1の制御配線に第2の電極が接続された補償用コンデンサと、前記駆動素子の制御端子と一方の電流入出力端子との間に設けられ、前記走査線に制御端子が接続された補償用スイッチング素子と、前記駆動素子の一方の電流入出力端子と前記第1の電源配線との間に設けられ、第2の制御配線に制御端子が接続された遮断用スイッチング素子と、前記駆動素子の他方の電流入出力端子と前記データ線との間に設けられ、前記走査線に制御端子が接続された書き込み用スイッチング素子とを含む場合に、
前記走査線を用いて書き込み対象の画素回路を選択する選択ステップと、
書き込み対象の画素回路について、前記データ線に表示データに応じたデータ電位を与えながら、前記書き込み用スイッチング素子と前記補償用スイッチング素子を導通状態に、前記遮断用スイッチング素子を非導通状態に制御することにより、前記駆動素子の制御端子に前記表示データと前記駆動素子の閾値電圧に応じた電位を与える閾値状態設定ステップと、
前記閾値状態設定ステップの後に、書き込み対象の画素回路について、前記書き込み用スイッチング素子、前記補償用スイッチング素子および前記遮断用スイッチング素子の状態を保ったままで、前記第1の制御配線に与える電位を切り替えることにより、前記補償用コンデンサの第2の電極に与える電位を切り替えて、前記駆動素子の制御端子に前記表示データと前記閾値電圧に応じた書き込み電位を与える導通状態設定ステップとを備える。
図2は、第1の参考例に係る表示装置に含まれる画素回路の回路図である。図2に示す画素回路100は、駆動用TFT110、スイッチ用TFT111〜113、コンデンサ121、122、および、有機EL素子130を備えている。画素回路100に含まれるTFTは、いずれもpチャネル型である。画素回路100は、特許文献1(国際公開第98/48403号パンフレット)にも記載されている。
Vg =VDD+Vth+(Vdata−Vpc) …(2)
Vgs=Vth+(Vdata−Vpc) …(3)
Vg =VDD+Vth+(Vdata−Vpc)+ΔV …(4)
Vgs=Vth+(Vdata−Vpc)+ΔV …(5)
図5は、本発明の第1の実施形態に係る表示装置に含まれる画素回路の回路図である。図5に示す画素回路200は、駆動用TFT210、スイッチ用TFT211〜213、コンデンサ221、および、有機EL素子230を備えている。画素回路200に含まれるTFTは、いずれもnチャネル型である。画素回路200は、本出願と出願人および発明者が共通する別の出願(日本国特願2008−131568号)にも記載されている。
Vth_oled≧Vdata−VSS …(6)
Vgs=VDD−Vdata …(7)
Vg=Vdata+Vth+V1−V2 …(8)
Vg=Vdata+Vth+V1−V2−ΔV …(9)
Vdata=Vdata’−(V1−V2) …(10)
本発明の第2の実施形態に係る表示装置は、第1の実施形態に係る表示装置と同じく、図5に示す画素回路200を備えている。本実施形態に係る表示装置は、画素回路200を第1の実施形態とは異なるタイミングチャート(図9)に従って駆動する。
Vpc<Vm+Vth+V1−V2 …(11)
図11は、第2の参考例に係る表示装置に含まれる画素回路の回路図である。図11に示す画素回路300は、駆動用TFT310、スイッチ用TFT311〜315、コンデンサ321、および、有機EL素子330を備えている。画素回路300に含まれるTFTは、いずれもpチャネル型である。画素回路300は、特許文献2(日本国特開2007−133369号公報)に記載された画素回路(図14)を、すべてのスイッチ用TFTのゲート端子を互いに異なる信号線に接続するように変形したものである。
Vg =VDD+Vth+(Vpc−Vdata) …(12)
Vgs=Vth+(Vpc−Vdata) …(13)
Vg =VDD+Vth+(Vpc−Vdata)+ΔV …(14)
Vgs=Vth+(Vpc−Vdata)+ΔV …(15)
11…表示制御回路
12…ゲートドライバ回路
13…ソースドライバ回路
21…シフトレジスタ
22…レジスタ
23…ラッチ回路
24…D/A変換器
100、200、300、Aij…画素回路
110、210、310…駆動用TFT
111〜113、211〜213、311〜315…スイッチ用TFT
121、122、221、321…コンデンサ
130、230、330…有機EL素子
Gi、G1i、G2i、G3i…走査線
Ri、Ui、Wi、E1i、E2i…制御配線
Sj…データ線
Vp…電源配線
Vcom…共通陰極
Claims (4)
- 電流駆動型の表示装置であって、
複数の走査線と複数のデータ線の各交差点に対応して配置された複数の画素回路と、
前記走査線を用いて書き込み対象の画素回路を選択し、前記データ線に対して表示データに応じたデータ電位を与える駆動回路とを備え、
前記画素回路は、
第1の電源配線と第2の電源配線との間に設けられた電気光学素子と、
前記第1の電源配線と前記第2の電源配線との間に前記電気光学素子と直列に設けられた駆動素子と、
前記駆動素子の制御端子に第1の電極が接続され、前記駆動回路によって制御される第1の制御配線に第2の電極が接続された補償用コンデンサと、
前記駆動素子の制御端子と一方の電流入出力端子との間に設けられ、前記走査線に制御端子が接続された補償用スイッチング素子と、
前記駆動素子の一方の電流入出力端子と前記第1の電源配線との間に設けられ、前記駆動回路によって制御される第2の制御配線に制御端子が接続された遮断用スイッチング素子と、
前記駆動素子の他方の電流入出力端子と前記データ線との間に設けられ、前記走査線に制御端子が接続された書き込み用スイッチング素子とを含み、
前記駆動回路は、書き込み対象の画素回路について、前記データ線に前記データ電位を与えながら、前記書き込み用スイッチング素子と前記補償用スイッチング素子を導通状態に、前記遮断用スイッチング素子を非導通状態に制御することにより、前記駆動素子の制御端子に前記表示データと前記駆動素子の閾値電圧に応じた電位を与え、その後に、前記書き込み用スイッチング素子、前記補償用スイッチング素子および前記遮断用スイッチング素子の状態を保ったままで、前記第1の制御配線に与える電位を切り替えることにより、前記補償用コンデンサの第2の電極に与える電位を切り替えて、前記駆動素子の制御端子に前記表示データと前記閾値電圧に応じた書き込み電位を与えることを特徴とする、表示装置。 - 前記駆動回路は、書き込み対象の画素回路について、前記書き込み用スイッチング素子を導通状態に制御している間、前記データ線に対して、前記表示データと前記制御配線に与える電位の変化量とによって定まる電位を与えることを特徴とする、請求項1に記載の表示装置。
- 前記駆動回路は、書き込み対象の画素回路について、前記書き込み用スイッチング素子を導通状態に制御している間、前記データ線に対して、前記電気光学素子への印加電圧が発光閾値電圧以下となる電位を与えることを特徴とする、請求項1に記載の表示装置。
- 複数の走査線と複数のデータ線の各交差点に対応して配置された複数の画素回路を備えた電流駆動型の表示装置の駆動方法であって、
前記画素回路が、第1の電源配線と第2の電源配線との間に設けられた電気光学素子と、前記第1の電源配線と前記第2の電源配線との間に前記電気光学素子と直列に設けられた駆動素子と、前記駆動素子の制御端子に第1の電極が接続され、第1の制御配線に第2の電極が接続された補償用コンデンサと、前記駆動素子の制御端子と一方の電流入出力端子との間に設けられ、前記走査線に制御端子が接続された補償用スイッチング素子と、前記駆動素子の一方の電流入出力端子と前記第1の電源配線との間に設けられ、第2の制御配線に制御端子が接続された遮断用スイッチング素子と、前記駆動素子の他方の電流入出力端子と前記データ線との間に設けられ、前記走査線に制御端子が接続された書き込み用スイッチング素子とを含む場合に、
前記走査線を用いて書き込み対象の画素回路を選択する選択ステップと、
書き込み対象の画素回路について、前記データ線に表示データに応じたデータ電位を与えながら、前記書き込み用スイッチング素子と前記補償用スイッチング素子を導通状態に、前記遮断用スイッチング素子を非導通状態に制御することにより、前記駆動素子の制御端子に前記表示データと前記駆動素子の閾値電圧に応じた電位を与える閾値状態設定ステップと、
前記閾値状態設定ステップの後に、書き込み対象の画素回路について、前記書き込み用スイッチング素子、前記補償用スイッチング素子および前記遮断用スイッチング素子の状態を保ったままで、前記第1の制御配線に与える電位を切り替えることにより、前記補償用コンデンサの第2の電極に与える電位を切り替えて、前記駆動素子の制御端子に前記表示データと前記閾値電圧に応じた書き込み電位を与える導通状態設定ステップとを備えた、表示装置の駆動方法。
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