JP5410468B2 - フレームレート制御方法 - Google Patents
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Description
2:ゲート駆動部
3:ソース駆動部
4:電圧発生部
5:タイミング制御部
51:データ処理ブロック
52:制御信号生成ブロック
Claims (2)
- 液晶表示装置外部のグラフィックソースからそれぞれ2進nビットの階調値で構成されるRGBデータの入力を受ける第1段階と、
前記RGBデータが示す階調値を利用してeビット(e≧n+1)にRGBデータを拡張する第2段階と、
前記拡張されたRGBデータの下位dビットを抽出し、連続する2d個のフレーム内に、前記拡張されたRGBデータの下位dビットによって前記拡張されたRGBデータの下位dビットを除いた上位(e−d)ビットが示す階調データとその直上位階調データの発生頻度が調整されるように、4×2画素ブロックまたは4×4画素ブロックの画素配列を決定したフレームデータを変換する第3段階と、
前記第3段階で得られた2d個のフレームデータのうち、最初半分のフレームについては画素配列をそのままにしたノーマルフレーム、残り半分のフレームについては画素配列を垂直方向に逆転させたプラスフレームと定義し、前記ノーマルフレームとプラスフレームは毎フレームごとに互いに交互に表示されるようにフレームデータを再配置する第4段階とを含み、
前記第1乃至第4段階は所定数の単位画素ブロックに対して行われ、各単位画素ブロック内では前記RGBデータの下位dビットを除いた上位(e−d)ビットが示す階調データとその直上位階調データの発生頻度が空間的に調整されるように配置され、
前記dビットの最下位ビットが’0’であれば、2 d 個のフレーム内に前記dビットの残りのビットによって前記RGBデータの上位(e−d)ビットが示す階調データとその直上位階調データの発生頻度が調整されるようにフレームデータを変換させ、
前記dビットの最下位ビットが’1’であれば、最初2 d-1 フレーム間には前記dビットの残りのビットによって前記RGBデータの上位(e−d)ビットが示す階調データとその直上位階調データの発生頻度が調整されるようにフレームデータを変換させ、残り2 d-1 フレーム内には前記dビットの残りのビットに’1’を足した値によって前記RGBデータの(e−d)ビットが示す階調データとその直上位階調データの発生頻度が調整されるようにフレームデータを変換させ、
前記nは8ビット、dは3ビット、eは9ビットであり、
前記第2段階は、
- 一つのフレームを構成しようとする表示画面において、所定の画素ブロック単位にノーマルフレーム又はプラスフレームの中の一つが表示されると同時に、前記画素ブロック単位に隣接した周辺の画素ブロックではノーマルフレーム又はプラスフレームの中の他の一つが表示されるように画素パターンを空間的に再配置する第5段階をさらに含むことを特徴とする、請求項1に記載の液晶表示装置のフレームレート制御方法。
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