JP5148178B2 - 表示基板、及びそれを具備した表示装置 - Google Patents
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Description
表示パネルは表示領域と周辺領域とに分けられる。表示領域ではゲート配線とソース配線とが縦横に延びている。それらの配線は周辺領域まで延び、その端部が、周辺領域に設けられたパッド部に接続されている。ゲート配線とソース配線とで区切られた表示領域の各部分は画素部を含む。各画素部は一般に、二枚の電極と液晶とを含む。それらは回路的にはキャパシタ(液晶キャパシタという)と等価である。各画素部は更に、液晶キャパシタに連結されたスイッチング素子を含む。スイッチング素子はゲート配線とソース配線とに連結されている。スイッチング素子は、ゲート配線を通して外部から印加されるゲート信号に応じてオンオフすることにより、液晶キャパシタとソース配線との間の接続を制御する。
図1に、本発明の実施例による表示装置の平面図を示す。図1に示されているように、この表示装置は、印刷回路基板100、表示パネル400、及びフレキシブル印刷回路基板500を含む。
印刷回路基板100にはメイン駆動回路110が実装される。メイン駆動回路110は、外部の装置から原始制御信号及び原始駆動信号を受信し、それらを用いて制御信号及び駆動信号を生成し、表示パネル300に出力する。
第1電圧配線部240は、ソース駆動チップLD1、…、RD4より表示領域DAに近い領域に形成され、ソース駆動チップLD1、…、RD4の長辺方向に延びている。各ソース駆動チップLD1、…、RD4は第1電圧配線部240に共通に接続され、第1電圧配線部240を通して外部電源から第1駆動電圧(第1電源電圧及び第1アース電圧)を受ける。第1電圧配線部240は特に、ファンアウト部230と交差している。第1電圧配線部240をそのような位置までソース駆動チップ(特にその底面)に近づけることにより、第1電圧配線240からソース駆動チップまでの経路長が短く抑えられ、その経路の抵抗による第1駆動電圧の降下が十分に小さく抑えられている。第1電圧配線部240は更に、各ソース駆動チップの長辺に隣接する部分が緩やかなV字形状に折れ曲がっている。後述のように、そのV字形状の開き(すなわち、各ソース駆動チップの長辺方向に対する第1電圧配線部240の傾き)を調節することにより、第1電圧配線部240とファンアウト部230の各配線との交差部分の面積を最小化できる。更に、ファンアウト部230の配線間でのその面積のバラツキを最小化し、その交差部分の寄生容量に起因するファンアウト部230の配線間での抵抗(インピーダンス)のバラツキを最小化できる。
連結配線部260は、ソース駆動チップLD1、…、RD4より表示基板200の端に近い領域に形成され、隣接する二つのソース駆動チップ(例えば、LD4、LD3)の間をそれぞれ連結している。すなわち、ソース駆動チップLD1、…、RD4の全体が連結配線部260によりカスケード接続されている。連結配線部260では、隣接する二つのソース駆動チップの一方から他方へデータ信号及びガンマ信号が伝達される。
図2に示されているように、第1周辺領域PA1では、隣接する二つの実装領域CAの間が分離領域IAで区分されている。ここで、第1周辺領域PA1には好ましくは、第1導電層と第2導電層とが(絶縁層を隔てて)積層されている。実装領域CA及び分離領域IAの両方には、第1電圧配線部240及び第2電圧配線部250が第1導電層から形成されている。一方、主に分離領域IAには、連結配線部260が第2導電層から形成されている。更に、実装領域CAから表示領域(図2では下方)に向かって拡がる第2導電層からはファンアウト部230が形成されている。
また、第1電圧配線部240はファンアウト部230と交差し、第2電圧配線部250の一部は連結配線部260に重なっている。このように、第1電圧配線部240及び第2電圧配線部250を第1導電層に形成して第2導電層と重ねることにより、それらの電圧配線部240、250から、実装領域CAに実装されるソース駆動チップまでの経路長を最小化できる。従って、その経路の抵抗による駆動電圧の降下を最小化できる。
図4に、比較例として、実装領域CAの長辺方向に対して平行な電源配線VDLとアース配線VSLとの拡大図を示す。一方、図5には、本発明の上記の実施例による電源配線VDLとアース配線VSLとの拡大図を示す。図4及び図5では、電圧配線VDL及びアース配線VSLの上に、ファンアウト部F0の中央に対して左側に位置する、1番目から240番目までの配線OL1、…、OL240が重なっている。
200 表示基板
210 直線部
220 斜線部
230 ファンアウト部
240 第1電圧配線部
250 第2電圧配線部
260 連結配線部
300 対向基板
400 表示パネル
500 フレキシブル印刷回路基板
510〜560 信号配線部
610、620 ゲート駆動部
CA 実装領域
Claims (17)
- 表示領域とその周りを囲む周辺領域とに分けられている基板であり、
前記表示領域に形成されたソース配線、
前記表示領域に形成され、前記ソース配線と交差するゲート配線、
前記周辺領域の一部であり、駆動チップが実装される実装領域、
前記周辺領域に形成され、前記駆動チップと電気的に接続される出力パッド部、
前記出力パッド部と前記ソース配線との間を連結するファンアウト部、及び、
前記周辺領域に形成され、前記駆動チップに駆動電圧を伝達する配線であり、一定の線幅を維持しながら前記実装領域の一辺に対して斜めに傾いて前記ファンアウト部と交差している第1電圧配線部、
を有する表示基板。 - 前記第1電圧配線部が、前記実装領域の中心線に対して左右対称なV字形状である、請求項1に記載の表示基板。
- 前記第1電圧配線部が、第1電源電圧を前記駆動チップに伝達する第1電源配線、及び、第1アース電圧を前記駆動チップに伝達する第1アース配線、を含む、請求項1に記載の表示基板。
- 前記ファンアウト部が、前記実装領域の一辺に対して実質的に垂直に延びている直線部、及び、前記実装領域の一辺に対して斜めに延びている斜線部、を含み、
前記直線部がジグザグパターンを含む、
請求項1に記載の表示基板。 - 前記実装領域に形成され、前記駆動チップの入力端子と電気的に接続される入力パッド部、及び、
隣接する二つの前記入力パッド部の間を電気的に連結する連結配線部、
をさらに有する、請求項1に記載の表示基板。 - 前記周辺領域に形成され、前記駆動チップに駆動電圧を伝達する配線であり、前記連結配線部に重なって延びている第2電圧配線部、
をさらに有する、請求項5に記載の表示基板。 - 前記第2電圧配線部が、第2電源電圧を前記駆動チップに伝達する第2電源配線、及び、第2アース電圧を前記駆動チップに伝達する第2アース配線、を含む、請求項6に記載の表示基板。
- 前記第1電圧配線部及び前記第2電圧配線部は前記ゲート配線と同一の第1導電層から形成され、
前記ファンアウト部及び前記連結配線部は前記ソース配線と同一の第2導電層から形成されている、
請求項6に記載の表示基板。 - 表示領域とその周りを囲む周辺領域とに分けられている表示基板、
前記表示領域に形成されたソース配線、
前記表示領域に形成され、前記ソース配線と交差するゲート配線、
前記ゲート配線にゲート信号を出力するゲート駆動部、
前記周辺領域の一部である実装領域に実装され、前記ソース配線にデータ信号を出力するソース駆動チップ、
前記ソース駆動チップと前記ソース配線との間を連結するファンアウト部、及び、
前記周辺領域に形成され、前記ソース駆動チップに駆動電圧を伝達する配線であり、一定の線幅を維持しながら前記実装領域の一辺に対して斜めに傾いて前記ファンアウト部と交差している第1電圧配線部、
を有する表示装置。 - 前記第1電圧配線部が、前記実装領域の中心線に対して左右対称なV字形状である、請求項9に記載の表示装置。
- 前記ファンアウト部が、前記実装領域の一辺に対して実質的に垂直に延びている直線部、及び、前記実装領域の一辺に対して斜めに延びている斜線部、を含み、
前記直線部がジグザグパターンを含む、
請求項9に記載の表示装置。 - 前記実装領域に形成され、前記ソース駆動チップの入力端子と電気的に接続される入力パッド部、
隣接する二つの前記入力パッド部の間を電気的に連結することにより、複数の前記ソース駆動チップをカスケード接続する連結配線部、及び、
前記周辺領域に形成され、前記ソース駆動チップに駆動電圧を伝達する配線であり、一定の線幅を維持しながら前記連結配線部と重なって延びている第2電圧配線部、
をさらに有する、請求項9に記載の表示装置。 - 前記第1電圧配線部は、前記ソース駆動チップに第1電源電圧を伝達する第1電源配線と、前記ソース駆動チップに第1アース電圧を伝達する第1アース配線と、を含み、
前記第2電圧配線部は、前記ソース駆動チップに第2電源電圧を伝達する第2電源配線と、前記ソース駆動チップに第2アース電圧を伝達する第2アース配線と、を含む、
請求項12に記載の表示装置。 - 前記第1電圧配線部及び前記第2電圧配線部は前記ゲート配線と同一の第1導電層から形成され、
前記ファンアウト部及び前記連結配線部は前記ソース配線と同一の第2導電性層から形成されている、
請求項12に記載の表示装置。 - 表示領域とその周りを囲む周辺領域とに分けられている基板であり、
前記表示領域に配置されたソース配線、
前記表示領域に配置され、前記ソース配線と交差するゲート配線、
前記周辺領域の一部である実装領域に配置された駆動チップ、
前記駆動チップと前記ソース配線との間を連結するファンアウト部、及び、
前記周辺領域に形成され、前記駆動チップに駆動電圧を伝達する配線であり、一定の線幅を維持しながら前記実装領域の一辺に対して斜めに傾いて前記ファンアウト部と交差している第1電圧配線部、
を有する表示基板。 - 前記ファンアウト部が、前記実装領域の一辺に対して実質的に垂直に延びている直線部、及び、前記実装領域の一辺に対して斜めに延びている斜線部、を含み、
前記直線部がジグザグパターンを含む、
請求項15に記載の表示基板。 - 前記ファンアウト部の抵抗が、前記ファンアウト部によって連結されている前記駆動チップと前記ソース配線との対のすべてで均一である、請求項16に記載の表示基板。
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