JP5081618B2 - プラズマディスプレイパネル装置とその駆動方法 - Google Patents
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Description
初期化期間の前半部において、走査電極SCN1〜SCNnに緩やかに上昇するランプ電圧を印加したとき、通常は、走査電極SCN1〜SCNnを陽極とし維持電極SUS1〜SUSnおよびデータ電極D1〜Dmを陰極とする微弱放電(肉眼で見えない正常初期化発光)が発生する(図5のa)。
そこで当該強放電の対策として、例えば特許文献2では、全セル初期化期間終了後に走査電極に補助消去パルス電圧を印加することで、初期化期間で消去しきれなかった過剰な壁電圧を消去し、万一発生した前記強放電が及ぼす書込期間及び維持期間に対する悪影響を予め回避する技術が開示されている。
第一に、全セル初期化終了後に全放電セルを対象として、走査電極に一括して補助消去パルスを印加するものであるため、正常に初期化された放電セルの壁電圧にも影響を及ぼし、その後の書込み放電のマージンが狭くなるという新たな問題がある。
ここで「マージン」とは、印加可能な書込電圧により正常に書込放電ができる書込電圧の範囲等を示す。
本発明はこのような課題に鑑みてなされたものであって、例え高精細なディスプレイ規格のプラズマディスプレイパネルであっても、前記消去期間終了後に補助消去パルスを用いることなく、初期化期間において発生する偶発的な強放電による誤維持放電の問題を抑制することにより、チラツキのない良好な品質で画像表示させることができるプラズマディスプレイパネルと、その駆動方法を提供することを目的とする。
また、前記電位変化波形はパルス状とすることもでき、さらに当該電位変化波形を前記走査電極に印加することもできる。また、前記電位変化波形の印加中、または当該波形終了後に維持電極の電位を変化させることもできる。
また前記電位変化波形は、前記維持電極に印加することもできる。この場合、前記電位変化波形は、前記初期化期間前半部が終了し、且つ前記走査電極の電位が変化する前に印加することもできる。また前記電位変化波形は、前記初期化期間前半部が終了し、且つ前記走査電極の電位が変化した後に印加することもできる。
上記データ電極の電位変化波形は、前記維持電極の電位が変化する前後いずれにも印加することもできる。
或いは前記電位変化波形を印加する電極として、前記走査電極および前記維持電極の両方とすることもできる。この前記電位変化波形は、前記走査電極の電位変化波形の印加中もしくはその終了後に、前記維持電極に印加することもできる。
さらに前記電位変化波形は、前記データ電極が陽極若しくは陰極となるように印加することもできる。この前記電位変化波形は、前記走査電極の電位変化波形の印加中および前期維持電極の電位変化波形の印加終了後に前記データ電極の電位を変化させることもできる。また、このデータ電極の電位変化波形は、前記データ電極が正極或いは負極のいずれの電位であっても印加することができる。
また本発明の駆動方法では、所定の基準値に対し、表示すべき画像のAPLが低いときは全セル初期化動作を行う初期化期間を有するサブフィールドの数を減らし、前記所定の基準値に対し、前記表示すべき画像のAPLが高いときは全セル初期化動作を行う初期化期間を有するサブフィールドの数を増やすこともできる。
また本発明は、走査電極及び維持電極からなる複数の表示電極対と、前記各表示電極対に対して放電空間を挟んで交差するように配されたデータ電極とを有し、前記交差部分に対応して複数の放電セルが配設された構造のプラズマディスプレイパネルと、複数のサブフィールドからなるフィールドを含む駆動プロセスに基づき前記走査電極、前記維持電極および前記データ電極に電圧を印加して駆動する駆動回路を備えるプラズマディスプレイ装置であって、前記駆動回路は、サブフィールドの全放電セルの初期化放電を行う全セル初期化期間中を、前記走査電極に上がり傾斜波形電圧を印加して、当該走査電極と、前記データ電極および前記維持電極の両方或いはその少なくとも一方の電極との間で第一の初期化放電を行う初期化期間前半部と、前記走査電極に下り傾斜波形電圧を印加して、前記走査電極と前記データ電極および前記維持電極または少なくともその一方の電極との間で第二の初期化放電を行う初期化期間後半部とを構成し、且つ、前記初期化期間前半部終了後、前記初期化期間後半部との間に、前記初期化期間前半部で正常に初期化された放電セルが放電開始電圧に満たない電圧を前記走査電極と前記データ電極のそれぞれに印加して前記放電セル内の過剰壁電圧を消去するための過剰壁電圧消去期間を構成する
ことを特徴とするプラズマディスプレイ装置とした。
この電位変化波形を用いれば、初期化期間前半部において強放電が発生し、放電セル内に過剰な壁電圧が蓄積されたとしても、初期化期間後半部に入る前に積極的に消去されるので、全セル初期化期間の後半部において不要な強放電が発生するのが防止される。つまり、全セル初期化期間の終了時点で、あたかも書込放電が行われたのと同様の誤放電を生じる恐れがなく、当該サブフィールドにおける維持期間で不要な放電を生じることがないため、チラツキのない良好な画像表示性能を呈することが可能である。
また本発明によれば、前記初期化期間の後半部に移行する前に過剰壁電圧を消去できるため、前記初期化期間の後半部において正常な初期化が可能となる。従って、その後の書込み放電も可能となるため、前記過剰壁電圧を消去することができるだけでなく、階調も犠牲にすることがないため、より良好な画像表示性能を呈することが可能である。すなわち本発明の駆動方法における過剰壁電圧消去期間は、初期化期間の前半部において強放電が発生し、続く後半部において強放電が発生する恐れのある放電セルでの過剰な壁電圧を、予め下り傾斜波形(初期化期間後半部)に至る前に確実に消去するものであり、いわば初期化期間後半部において発生する書き込み放電と同様の効果となってしまう強放電のトラップとして作用するものである。このため、当該強放電に至るような過剰な壁電圧を持たない放電セルに当該過剰電圧消去期間を設けても、何ら壁電圧を損なうことがなく、良好な書込放電を行うことが可能となっている。
<実施の形態1>
(PDP装置の全体構成)
図1はPDPの構成例を示す部分的な斜視図である。当図に示すPDP1は、全体的には前述した従来構成と同様であり、重複する説明を適宜省略する。なお当該PDPとその駆動装置の構成は、後述の各実施の形態においてほぼ共通する。
前面基板2の片主面上には、表示電極対を構成する走査電極SCN1〜SCNnとSUS1〜SUSnとが互いに平行に複数対にわたり配設されている。そして、当該複数の走査電極SCN1〜SCNnおよびSUS1〜SUSnを全体的に覆うように誘電体層6及び保護層7が順次積層されている。
背面基板3上には、複数のデータ電極D1〜Dmが併設されるとともに、当該データ9を覆うように絶縁体層9が被覆される。さらに、各データ電極D1〜Dmに対応する絶縁体層8の位置には、各データ電極D1〜Dmと平行して隔壁10が設けられている。絶縁体層8の表面および隣接する隔壁10間には、赤色(R)、緑色(G)、青色(B)各色のいずれかの蛍光体を塗布し、これらを順次併設してなる蛍光体層11が設けられている。
緑色蛍光体には、Zn2SiO4:Mn、(Y、Gd)BO3:Tb、BaAl12O19:Mn、等を単独で使用したもの、或いはこれらの混合蛍光体が用いられる。
青色蛍光体には、BaMgAl10O17:Eu、CaMgSi2O6;Eu、等を単独で使用したもの、或いはこれらの混合蛍光体が用いられる。
次に示す図2は、前記PDP1の模式的な電極配列図である。当図に示されるように、PDP1には行方向にn本の走査電極SCN1〜SCNnおよびn本の維持電極SUS1〜SUSnが交互に配列され、列方向にm本のデータ電極D1〜Dmが配列されている。そして、1対の走査電極SCNiおよび維持電極SUSi(i=1〜n)と1つのデータ電極Dj(j=1〜m)とが交差した部分に放電セルが形成され、放電セルは放電空間内にm×n個形成されている。
当該PDP装置は、全体的には公知の構成からなり、当図に示すようにPDP(パネル)1、データ電極駆動回路12、走査電極駆動回路13、維持電極駆動回路14、タイミング発生回路15、A/D(アナログ・デジタル)変換器16、走査数変換部17、サブフィールド変換部18、APL(アベレージ・ピクチャ・レベル)検出部19および電源回路(図示せず)とで構成される。
A/D変換器16は、画像信号VDをデジタル信号の画像データに変換し、その画像データを走査数変換部17およびAPL検出部19に出力するものである。
走査数変換部17は、画像データをPDP1の画素数に応じた画像データに変換し、サブフィールド変換部18に出力する。サブフィールド変換部18は、各画素の画像データを複数のサブフィールドに対応する複数のビットに分割し、サブフィールド毎の画像データをデータ電極駆動回路12に出力する。
タイミング発生回路15は、APL検出部19から出力されるAPLに基づいて駆動波形を制御する。具体的には後述するように、APLに基づいて1フィールドを構成する各々のサブフィールドの初期化動作を全セル初期化か選択初期化のいずれかに決定して、1フィールド内の全セル初期化動作の回数を制御する。当該タイミング発生回路15は、合計(a+b)本の配線によって、走査電極駆動回路13にタイミング信号を供給する。ここで、前記(a+b)本のうちのb本の配線は、後述する過剰壁電圧消去期間における電位変化を制御するためのものである。
維持電極駆動回路14は、タイミング信号に基づいて維持電極SUS1〜SUSnに駆動波形を供給する。
データ電極駆動回路12は、サブフィールド毎の画像データを各データ電極D1〜Dmに対応する信号に変換し各データ電極を駆動するものである。タイミング発生回路15は、水平同期信号Hおよび垂直同期信号Vをもとにしてタイミング信号を発生し、各々走査電極駆動回路13および維持電極駆動回路14に出力する。
(PDPの駆動方法)
次に、当該PDP装置は、公知のサブフィールド法を用いた駆動方法により、初期化期間、書込期間、維持期間の順に駆動される。従って、ここでは各期間を順に説明する。
(a)初期化期間について
当該初期化期間に印加する駆動波形としては、全セル初期化サブフィールドの駆動波形、及び選択初期化サブフィールドの駆動波形の2種類が存在する。
(a-1) 全セル初期化期間について
全セル初期化サブフィールドの初期化動作は、全ての放電セルで一斉に初期化放電を行い、それ以前の個々の放電セルにおける壁電圧の履歴を消去すとともに、書込動作のために必要な壁電圧形成を行うものである。また、放電遅れを小さくし、書込放電を安定して発生させるためのプライミング(放電のための起爆剤=励起粒子)を発生させる働きもなされる。
なお、本実施の形態1の特徴は、当該前半部・後半部の間に別途期間を設けた点にあるが、これについては別途詳説する。
初期化期間の前半部では、図4に示すように、維持電極SUS1〜SUSnおよびデータ電極D1〜Dmを0(V)に保持し、走査電極SCN1〜SCNnに対して放電開始電圧以下となる電圧Vp(V)から放電開始電圧を超える電圧Vr(V)に向かって緩やかに上昇するランプ電圧を印加する。
こうして、全ての放電セルにおいて1回目の微弱な初期化放電を発生させ、走査電極SCN1〜SCNn上に負の壁電圧を蓄えるとともに維持電極SUS1〜SUSn上およびデータ電極D1〜Dm上に正の壁電圧を蓄える。ここで、電極上の壁電圧とは、電極を覆う誘電体層あるいは蛍光体層上に蓄積した壁電圧により生じる電圧を表す。この初期化期間の前半部の微弱放電は前のサブフィールドでの維持放電の有無に関わらず、全ての放電セルにおいて発生するものである。
一方、選択初期化サブフィールドの初期化動作は、前のサブフィールドで維持放電を行った放電セルにおいて初期化放電させる選択的な初期化動作となる。
次に、選択初期化サブフィールドの駆動波形とその動作について説明する。
選択初期化期間では、維持電極SUS1〜SUSnを電圧Vh(V)に保持し、データ電極D1〜Dmを0(V)に保持し、走査電極SCN1〜SCNnに電圧Vq(V)から電圧Va(V)に向かって緩やかに下降するランプ電圧を印加する。これにより前のサブフィールドの維持期間で維持放電を行った放電セルでは、微弱な初期化放電が発生し、走査電極SCNi上および維持電極SUSi上の壁電圧が弱められ、データ電極Dk上の壁電圧も書込動作に適した値に調整される。一方、前のサブフィールドで書込放電および維持放電を行わなかった放電セルについては放電することはなく、前のサブフィールドの初期化期間終了時における壁電圧状態がそのまま保たれる。
一般に、初期化期間の前半部では、維持電極SUS1〜SUSnおよびデータ電極D1〜Dmを0(V)に保持し、走査電極SCN1〜SCNnに対して放電開始電圧以下となる電圧Vp(V)から放電開始電圧を超える電圧Vr(V)に向かって緩やかに上昇するランプ電圧を印加するとともに、走査電極SCN1〜SCNnを陽極とし、維持電極SUS1〜SUSnおよびデータ電極D1〜Dmを陰極とすることで、微弱な初期化放電が発生する。こうして全ての放電セルにおいて1回目の微弱な初期化放電を発生させ、走査電極SCN1〜SCNn上に負の壁電圧を蓄えるとともに、維持電極SUS1〜SUSn上およびデータ電極D1〜Dm上に正の壁電圧を蓄える。
一方、この強放電の問題に対しては特許文献2で示すように、全セル初期化期間終了後に走査電極に補助消去パルスを印加し、これによって過剰な壁電圧を削除する対策も講じられているが、当該方法では、補助消去パルスが正常に初期化された放電セルの壁電圧にも影響を及ぼしてしまうため、書込マージンが狭くなったり、過剰な壁電圧は消去できるものの階調表示を犠牲にする等の問題がある。
このような過剰壁電圧消去期間の導入によって、全セル初期化期間前半部において強放電が発生し、過剰な壁電圧が蓄積された放電セルのみ、全セル初期化期間後半部に移行する前にその過剰な壁電圧を消去させることができるため、初期化期間後半部において実質的に早期に書込放電がなされるのを防止できる。
一方、本発明では、過剰壁電圧消去期間の導入により、放電空間の容積が従来規格より小さいHD(High Definition)以上の解像度を有する高精細なPDPにおいて、駆動時にプライミング粒子が隔壁の電荷と結合しやすい構成でも、壁電荷を適正に調整することができる。
さらに本発明は、前記過剰壁電圧消去期間におけるパルスは初期化期間後半部における強放電のトラップとして作用するものであり、当該強放電に至る過剰な壁電圧を持たない正常な放電セルには影響を及ぼさない。これにより、本発明では全セル初期化期間に前記過剰壁電圧消去期間を設けても、従来技術2のように全セル初期化期間終了後の放電セルの壁電圧に影響を及ぼす問題が回避されるので、書込みマージンが低下するのを防止できる。
また、本実施の形態1に示したPDPのように、R、G、B蛍光体層を構成する蛍光体中にYVO3:Eu、Zn2SiO4:Mn、CaMgSi2O6:Eu、等の負に帯電し易い蛍光体が存在する場合には、全セル初期化期間における強放電の発生がより顕著になるため、本駆動方法がより効果的に働くことが発明者らの実験により分かっている。
一方、初期化期間の後半部では、維持電極SUS1〜SUSnを電圧Vh(V)に保ち、走査電極SCN1〜SCNnに電圧Vg(V)から電圧Va(V)に向かって緩やかに下降するランプ電圧を印加する。すると、全ての放電セル(過剰壁電圧消去期間で放電した放電セルも)において、走査電極SCN1〜SCNnを陰極とし維持電極SUS1〜SUSnおよびデータ電極D1〜Dmを陽極とする2回目の微弱な初期化放電が起きる。そして、走査電極SCN1〜SCNn上の壁電圧および維持電極SUS1〜SUSn上の壁電圧が弱められ、データ電極D1〜Dm上の壁電圧も書込期間における書込動作に適した値に調整される。
(b)書込期間について
次に、書込期間の駆動波形と動作について説明する。
以上の書込動作をn行目の放電セルに至るまで順次行い、書込期間が終了する。このように書込期間では、走査電極に順次走査パルスを印加するとともに、データ電極には表示すべき画像信号に対応した書込パルス電圧を印加し、走査電極とデータ電極との間で選択的に書込放電を起こすことで壁電圧形成を行う。
(c)維持期間について
次に、維持期間の駆動波形と動作について説明する。
このとき、書込放電を起こした放電セルにおいては、走査電極SCNi上と維持電極SUSi上との間の電圧は、維持パルス電圧Vm(V)に走査電極SCNi上および維持電極SUSi上の壁電圧の大きさが加算されたものとなり、放電開始電圧を超える。これにより走査電極SCNiと維持電極SUSiとの間に維持放電が起こり、走査電極SCNi上に負の壁電圧が蓄積され、維持電極SUSi上に正の壁電圧が蓄積される。このとき、データ電極Dk上にも正の壁電圧が蓄積される。一方、書込期間において書込放電が起きなかった放電セルでは維持放電は発生せず、初期化期間の終了時における壁電圧状態が保持される。
なお、維持期間の最後には走査電極SCN1〜SCNnと維持電極SUS1〜SUSnとの間にいわゆる細幅パルスを印加して、データ電極Dk上の正の壁電圧を残したまま、走査電極SCN1〜SCNnおよび維持電極SUS1〜SUSn上の壁電圧を消去している。こうして維持期間における維持動作が終了する。
尚、本実施の形態1では、各駆動波形を図6(a)、を用いて説明したが、図6(b)のように、維持電極SUS1〜SUSnに印加する電圧Vh(V)を過剰壁電圧消去期間中に印加する駆動としても良い。このように、過剰壁電圧消去期間において走査電極SCN1〜SCNnおよび維持電極SUS1〜SUSnの両方に電圧を印加することで、それぞれの電極間の印加電圧が大きくなるため、より確実に消去放電を行うことができる。
図7は、前述した実施の形態1におけるPDP(実施例)の駆動方法に係る設定例を示す図であり、表示すべき画像信号のAPLに基づいてサブフィールド構成を切替える設定を示すものである。当該サブフィールド構成の切り替えは、具体的には前記サブフィールド変換部18によって実現される。
図7のbは、APLが1.5〜5%の画像信号時に使用する構成であり、第1SF及び第4SFの初期化期間が全セル初期化動作を行い、第2SF、第3SFと第5SF〜第10SFの初期化期間は選択初期化期間であるサブフィールド構成となっている。
図7のdは、APLが10〜15%の画像信号時に使用する構成であり、第1SF、第4SF、第8SF、第10SFの初期化期間は全セル初期化期間、第2SF、第3SF、第5SF〜第7SF、第9SFの初期化期間は選択初期化期間であるサブフィールド構成となっている。
以下に示す表1に、上述のサブフィールド構成とAPLとの関係を示す。
[表1]
本実施の形態においては、駆動時の1フィールドあたりの全セル初期化期間の回数はAPLに依存して決定される。
具体的には表1に示されるように、APLの高い画像表示時においては、黒表示領域が狭いと考えられるため、全セル初期化回数を増加させてプライミングを増やし、安定した初期化放電および書込み放電を図っている。また逆に、APLの低い画像表示時においては黒の画像表示領域が広いと考えられるため全セル初期化回数を減らし、黒表示品質を向上させている。
なお、本実施例においては、1フィールドを10SFで構成し、全セル初期化回数を1〜5回に制御する例について説明したが、本発明はこれに限定されるものではない。
また、表3には全セル初期化回数を1〜3回の範囲で制御し、先頭に近いサブフィールドの初期化を優先する例である。
[表2]
また、過剰壁電圧消去期間における消去放電は、初期化期間前半部直後であるため、前半部に発生してしまった強放電や隣接セルの微弱放電により発生した十分なプライミングにより放電遅れも小さくなっているため、確実に消去放電できる期間を短くできる。このようなことから従来技術2のような消去期間の設計マージンも比較的容易に確保できる。
<実施の形態2>
図8は、本発明の実施の形態2によるPDPの全セル初期化期間における駆動波形を示した図である。
本実施の形態2における初期化期間前半部と後半部の動作およびサブフィールド構成は実施の形態1と同様であるため説明を省略し、実施の形態1と異なる過剰壁電圧消去期間について説明する。
電圧Vera(V)はXe分圧によって変化するため、上記のように、初期化前半部において過剰な壁電圧が蓄積されたセルのみが放電可能な値に各Xe分圧値により設定する必要がある。また、この過剰壁電圧消去期間は、万一別の理由で放電遅れを生じても確実に消去放電できる時間とする(例えば0.5〜50μs程度)。
また、図8(a)および(b)とも電圧Vera(V)は正の電圧を印加しているが、負の電圧を印加することによっても過剰な壁電圧を消去することができる。
<実施の形態3>
図9は、本発明の実施の形態3によるPDPの全セル初期化期間における駆動波形を示した図である。
本実施の形態3における初期化期間前半部と後半部の動作およびサブフィールド構成は実施の形態1と同様であるためここでは説明を省略し、実施の形態1と異なる過剰壁電圧消去期間について説明する。
尚、本実施の形態では図9(a)を用いて説明したが、図9(b)のように、過剰壁電圧消去期間において維持電極SUS1〜SUSnが0(V)にすることによっても同様の効果が得られる。
また、図9(a)および(b)とも電圧Vera(V)は正の電圧を印加しているが、負の電圧を印加することによっても過剰な壁電圧を消去することができる。
図10は、本発明の実施の形態4によるPDPの全セル初期化期間における駆動波形を示した図である。
本実施の形態4の特徴は、図4の代表的なPDPの各電極に印加する駆動波形において、全セル初期化期間に図10に示すように、全セル初期化期間の前半部と後半部の間に走査電極SCN1〜SCNnおよび維持電極SUS1〜SUSnにおいて上下の電位変化波形を印加する過剰壁電圧消去期間を設けることにある。
図10(a)において、初期化前半部終了後、前半部で正常に初期化された放電セルが放電開始電圧に満たない電圧Vera1(V)を走査電極SCN1〜SCNnに印加し、その後、電圧Vg(V)を印加するとともに、前半部で正常に初期化された放電セルが放電開始電圧に満たない電圧Vera2(V)を維持電極SUS1〜SUSnに印加する。この過剰壁電圧消去期間においては、正常な初期化放電を行った放電セルでは放電せず、その壁電圧も初期化期間前半部の状態が保持される。しかしながら、走査電極SCNi上、維持電極SUSi上およびデータ電極Dj上に過剰な壁電圧が蓄積している放電セルに対しては、走査電極SCN1〜SCNnに電圧Veraを印加すると放電開始電圧(Vf)を超えて強放電が発生し、走査電極SCNi、維持電極SUSiおよびデータ電極Dj上の壁電圧が反転して放電セル内部の壁電圧が消去される。電圧Vera(V)はXe分圧によって変化するため、上記のように、初期化前半部において過剰な壁電圧が蓄積されたセルのみが放電可能な値に各Xe分圧値により設定する必要がある。また、この過剰壁電圧消去期間は、万一別の理由で放電遅れを生じても確実に消去放電できる時間とする(例えば0.5〜50μs程度)。このような駆動方法によっても、実施の形態1〜3とほぼ同様の効果が奏される。
また、図10(a)および(b)とも電圧Vera2(V)は正の電圧を印加しているが、負の電圧を印加することによっても過剰な壁電圧を消去することができる。
図11は、本発明の実施の形態5によるPDPの全セル初期化期間における駆動波形を示した図である。
本実施の形態5の特徴は、図4の代表的なPDPの各電極に印加する駆動波形において、全セル初期化期間に図11に示すように、全セル初期化期間の前半部と後半部の間に走査電極SCN1〜SCNnおよびデータ電極D1〜Dmにおいて上下の電位変化波形を印加する過剰壁電圧消去期間を設けることにある。
図11(a)において、初期化前半部終了後、前半部で正常に初期化された放電セルが放電開始電圧に満たない電圧Vera1(V)を走査電極SCN1〜SCNnに、電圧Vera2をデータ電極D1〜Dmに印加する。電圧Vera1およびVera2はそれぞれ0.5〜20μsの間保持する。この過剰壁電圧消去期間においては、正常な初期化放電を行った放電セルでは放電せず、その壁電圧も初期化期間前半部の状態が保持される。
尚、本実施の形態5では図11(a)を用いて説明したが、図11(b)のように、データ電極D1〜Dmに印加する電圧Vera2が負の電圧であっても同様の効果が得られる。
また、図11(a)および(b)とも過剰壁電圧消去期間終了後に維持電極SUS1〜SUSnに電圧Vh(V)を印加しているが、過剰壁電圧消去期間中に印加することによっても過剰な壁電圧を消去することができる。
図12は、本発明の実施の形態6の全セル初期化期間における駆動波形を示した図である。
本実施の形態6の特徴は、図4の代表的なPDPの各電極に印加する駆動波形において、全セル初期化期間に図12に示すように、全セル初期化期間の前半部と後半部の間に維持電極SUS1〜SUSnおよびデータ電極D1〜Dmにおいて上下の電位変化波形を印加する過剰壁電圧消去期間を設けることにある。
図12(a)において、初期化前半部終了後、前半部で正常に初期化された放電セルが放電開始電圧に満たない電圧Vera1(V)を維持電極SUS1〜SUSnに、電圧Vera2をデータ電極D1〜Dmに印加する。この過剰壁電圧消去期間においては、正常な初期化放電を行った放電セルでは放電せず、その壁電圧も初期化期間前半部の状態が保持される。しかしながら、走査電極SCNi上、維持電極SUSi上およびデータ電極Dj上に過剰な壁電圧が蓄積している放電セルに対しては、走査電極SCN1〜SCNnに電圧Veraを印加すると放電開始電圧(Vf)を超えて強放電が発生し、走査電極SCNi、維持電極SUSiおよびデータ電極Dj上の壁電圧が反転して放電セル内部の壁電圧が消去される。電圧Vera(V)はXe分圧によって変化するため、上記のように、初期化前半部において過剰な壁電圧が蓄積されたセルのみが放電可能な値に各Xe分圧値により設定する必要がある。また、この過剰壁電圧消去期間は、万一別の理由で放電遅れを生じても確実に消去放電できる時間とする(例えば0.5〜50μs程度)。
尚、本実施の形態6では図12(a)を用いて説明したが、図12(b)のように、データ電極D1〜Dmに印加する電圧Vera2が負の電圧であっても同様の効果が得られる。
また、図12(a)および(b)とも電圧Vera2(V)は電圧Vera1が印加された後に印加されているが、印加前に印加することによっても過剰な壁電圧を消去することができる。
上記実施の形態1〜6では、過剰壁電圧消去期間に設けた上下の電位変化波形はパルス電圧となっているが、ランプ電圧や時定数を持った電圧のように時間とともに変化するような電圧としてもよい。
上記実施の形態1〜6では、APLに応じて全セル初期化期間の回数を変化させる構成としているが、本発明は各全セル初期化期間ごとに過剰壁電圧消去期間を設ける駆動方法に限定するものではなく、例えば各放電セル毎に異なる輝度重みなどによって、選択的に過剰壁電圧消去期間を設けるようにしてもよい。
また、その温度情報により過剰壁電圧消去期間の時間や電圧Vera(V)を変化させるようにしてもよい。
また、新たに使用時間を計測する全使用時間計測部を儲け、その使用時間情報により初期化回数や選択的に設ける過剰壁電圧消去期間の回数を変化させるようにしてもよい。
また、上記各実施の形態では、三電極面放電型のPDPの構成について説明したが、本発明はこれ以外の電極構造を持つPDPにも適用が可能である。例えば、各走査電極、各維持電極、各データ電極のいずれか1種と平行に延伸して補助電極を配し、前記過剰壁電圧消去期間における電位変化波形を印加する専用の電極としてこれを用いる構成とすることもできる。
a.パネルサイズが37インチの場合;1024×720(画素)のHDパネルよりも高解像度のパネル
b.パネルサイズが42インチの場合;1024×768(画素)のHDパネルよりも高解像度のパネル
c.パネルサイズが50インチの場合;1366×768(画素)のHDパネルよりも高解像度のパネル
また、HD以上の解像度を有するパネルには、フルHDパネル(1920×1080(画素))も含んでいる。
2 前面基板
3 背面基板
6 誘電体層
7 保護層
8 絶縁体層
10 隔壁
11 蛍光体層
12 データ電極駆動回路
13 走査電極駆動回路
14 維持電極駆動回路
15 タイミング発生回路
16 A/D変換器
17 走査数変換部
18 サブフィールド変換部
19 APL検出部
D1〜Dm データ電極
SCN1〜SCNn 走査電極
SUS1〜SUSn 維持電極
Claims (3)
- 走査電極及び維持電極からなる複数の表示電極対と、前記各表示電極対に対して放電空間を挟んで交差するように配されたデータ電極とを有し、前記交差部分に対応して複数の放電セルが配設された構造のプラズマディスプレイパネルを、複数のサブフィールドからなるフィールドを含む駆動プロセスに基づき駆動するプラズマディスプレイパネルの駆動方法であって、
前記フィールドに含まれるサブフィールドの全放電セルの初期化放電を行う全セル初期化期間中には、前記走査電極に上がり傾斜波形電圧を印加することにより、当該走査電極と、前記データ電極および前記維持電極の両方或いはその少なくとも一方の電極との間で第一の初期化放電を行う初期化期間前半部と、
前記走査電極に下り傾斜波形電圧を印加することにより前記走査電極と前記データ電極および前記維持電極または少なくともその一方の電極との間で第二の初期化放電を行う初期化期間後半部とが存在し、且つ、
前記初期化期間前半部終了後、前記初期化期間後半部との間に、前記初期化期間前半部で正常に初期化された放電セルが放電開始電圧に満たない電圧を前記走査電極と前記データ電極のそれぞれに印加して前記放電セル内の過剰壁電圧を消去するための過剰壁電圧消去期間が介在している
ことを特徴とするプラズマディスプレイパネルの駆動方法。 - 前記過剰壁電圧消去期間の長さは、0.5マイクロ秒から50マイクロ秒の間である
ことを特徴とする請求項1記載のプラズマディスプレイの駆動方法。 - 走査電極及び維持電極からなる複数の表示電極対と、前記各表示電極対に対して放電空間を挟んで交差するように配されたデータ電極とを有し、前記交差部分に対応して複数の放電セルが配設された構造のプラズマディスプレイパネルと、複数のサブフィールドからなるフィールドを含む駆動プロセスに基づき前記走査電極、前記維持電極および前記データ電極に電圧を印加して駆動する駆動回路を備えるプラズマディスプレイ装置であって、
前記駆動回路は、サブフィールドの全放電セルの初期化放電を行う全セル初期化期間中を、前記走査電極に上がり傾斜波形電圧を印加して、当該走査電極と、前記データ電極および前記維持電極の両方或いはその少なくとも一方の電極との間で第一の初期化放電を行う初期化期間前半部と、前記走査電極に下り傾斜波形電圧を印加して、前記走査電極と前記データ電極および前記維持電極または少なくともその一方の電極との間で第二の初期化放電を行う初期化期間後半部とを構成し、且つ、前記初期化期間前半部終了後、前記初期化期間後半部との間に、前記初期化期間前半部で正常に初期化された放電セルが放電開始電圧に満たない電圧を前記走査電極と前記データ電極のそれぞれに印加して前記放電セル内の過剰壁電圧を消去するための過剰壁電圧消去期間を構成する
ことを特徴とするプラズマディスプレイ装置。
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