JP4917901B2 - 受信装置 - Google Patents
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Description
前記複数のレーンのそれぞれに対応して、前記受信した分割データ列の前記第1のシンボルの個数を1個もしくはそれ以上に調整する処理を行って処理済み分割データ列を生成する弾性バッファを備えるとともに、前記処理済み分割データ列の間のスキュー調整を行うスキュー調整回路を備え、
前記スキュー調整回路は、前記複数のレーンのそれぞれに対応して設けられて前記処理済み分割データ列内の前記第1のシンボルを判別する判別回路を有し、該判別回路の判別結果に基づいて、それぞれの前記処理済み分割データ列における前記第1のシンボルの終了を検出し、該終了を検出したタイミングに基づいて前記処理済み分割データ列の間のスキュー調整を行うことを特徴とする受信装置を提供するものである。
前記第1の期間と異なる第2の期間において、前記分割データ列は、前記第2のシンボルのみが共通のタイミングで挿入されて送信され、
前記判別回路は、前記処理済み分割データ列内の前記第1のシンボルに加えて前記第2のシンボルを、前記第1のシンボルとを区別することなく判別し、前記スキュー調整回路は、前記第1の期間および第2の期間の両方において、前記判別回路の判別結果に基づいて、前記それぞれの処理済み分割データ列における前記第1もしくは第2のシンボルの終了を検出し、該終了を検出したタイミングに基づいて前記処理済み分割データ列の間のスキュー調整を行うことが好ましい。
前記スキュー調整回路は、前記バッファに一時的に記憶したデータの読み出しのタイミングを調整することによって前記スキュー調整を行うことが好ましい。
前記複数のレーンのそれぞれに対応して設けられ、同一のレーンの前記処理済み分割データ列における前記第1のシンボルの終了を検出した時点から、前記クロック信号に同期してカウントするカウンタを有し、全ての前記処理済み分割データ列における前記第1のシンボルの終了を検出した時点での前記それぞれのカウンタのカウント値に応じて、前記バッファに一時的に記憶したデータの読み出しのタイミングを調整するか、もしくは、
前記処理済み分割データ列のいずれかにおいて最初に前記第1のシンボルの終了を検出した時点から、前記クロック信号に同期してカウントするカウンタを有し、前記処理済み分割データ列のそれぞれにおいて前記第1のシンボルの終了を検出した時点での前記カウンタのカウント値に応じて、前記バッファに一時的に記憶したデータの読み出しのタイミングを調整することが好ましい。
以上、本発明の受信装置について詳細に説明したが、本発明は上記実施形態に限定されず、本発明の主旨を逸脱しない範囲において、種々の改良や変更をしてもよいのはもちろんである。
12 パイプレーン
14 レーンデスキュー処理回路
16 シリアライザ・デシリアライザ
18 弾性バッファ
20 スキュー調整回路
22 FIFO
24 COM,SKP判別回路
26 スキュー調整カウンタ
28 全レーンCOM,SKP判定回路
30 COMシンボルないしSKPシンボルの比較回路
32、36a、36b、36c、36d、36e フリップフロップ
34 AND回路
38 マルチプレクサ
Claims (5)
- 第1の期間において、送信すべきデータ列を分割して生成した複数の分割データ列であって、第1のシンボルを共通のタイミングで所定の個数だけ連続して挿入した後に、それぞれに対応するレーンを通じて送信された複数の分割データ列を受信する受信装置において、
前記複数のレーンのそれぞれに対応して、前記受信した分割データ列の前記第1のシンボルの個数を1個もしくはそれ以上に調整する処理を行って処理済み分割データ列を生成する弾性バッファを備えるとともに、前記処理済み分割データ列の間のスキュー調整を行うスキュー調整回路を備え、
前記スキュー調整回路は、前記複数のレーンのそれぞれに対応して設けられて前記処理済み分割データ列内の前記第1のシンボルを判別する判別回路を有し、該判別回路の判別結果に基づいて、それぞれの前記処理済み分割データ列における前記第1のシンボルの終了を検出し、該終了を検出したタイミングに基づいて前記処理済み分割データ列の間のスキュー調整を行うことを特徴とする受信装置。 - 前記第1の期間において、前記第1のシンボルは、第2のシンボルに続いて挿入され、
前記第1の期間と異なる第2の期間において、前記分割データ列は、前記第2のシンボルのみが共通のタイミングで挿入されて送信され、
前記判別回路は、前記処理済み分割データ列内の前記第1のシンボルに加えて前記第2のシンボルを、前記第1のシンボルとを区別することなく判別し、前記スキュー調整回路は、前記第1の期間および第2の期間の両方において、前記判別回路の判別結果に基づいて、前記それぞれの処理済み分割データ列における前記第1もしくは第2のシンボルの終了を検出し、該終了を検出したタイミングに基づいて前記処理済み分割データ列の間のスキュー調整を行うことを特徴とする請求項1記載の受信装置。 - 前記複数のレーンのそれぞれに対応して設けられ、クロック信号に同期して対応する前記処理済み分割データ列のデータを一時的に記憶するバッファをさらに備え、
前記スキュー調整回路は、前記バッファに一時的に記憶したデータの読み出しのタイミングを調整することによって前記スキュー調整を行うことを特徴とする請求項1記載の受信装置。 - 前記スキュー調整回路は、さらに、
前記複数のレーンのそれぞれに対応して設けられ、同一のレーンの前記処理済み分割データ列における前記第1のシンボルの終了を検出した時点から、前記クロック信号に同期してカウントするカウンタを有し、全ての前記処理済み分割データ列における前記第1のシンボルの終了を検出した時点での前記それぞれのカウンタのカウント値に応じて、前記バッファに一時的に記憶したデータの読み出しのタイミングを調整するか、もしくは、
前記処理済み分割データ列のいずれかにおいて最初に前記第1のシンボルの終了を検出した時点から、前記クロック信号に同期してカウントするカウンタを有し、前記処理済み分割データ列のそれぞれにおいて前記第1のシンボルの終了を検出した時点での前記カウンタのカウント値に応じて、前記バッファに一時的に記憶したデータの読み出しのタイミングを調整することを特徴とする請求項3記載の受信装置。 - 前記分割データ列をシリアルデータ列として受信し、パラレルデータ列に変換してから前記弾性バッファによる処理を行うことを特徴とする請求項1ないし4のいずれかに記載の受信装置。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2007005426A JP4917901B2 (ja) | 2007-01-15 | 2007-01-15 | 受信装置 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2007005426A JP4917901B2 (ja) | 2007-01-15 | 2007-01-15 | 受信装置 |
Publications (2)
Publication Number | Publication Date |
---|---|
JP2008172657A JP2008172657A (ja) | 2008-07-24 |
JP4917901B2 true JP4917901B2 (ja) | 2012-04-18 |
Family
ID=39700306
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2007005426A Expired - Fee Related JP4917901B2 (ja) | 2007-01-15 | 2007-01-15 | 受信装置 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP4917901B2 (ja) |
Families Citing this family (6)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP5426326B2 (ja) * | 2009-11-09 | 2014-02-26 | ルネサスエレクトロニクス株式会社 | データ受信装置、データ受信方法、及びプログラム |
JP5544896B2 (ja) | 2010-01-22 | 2014-07-09 | 富士通株式会社 | 受信回路、情報処理装置、およびバッファ制御方法 |
JP5595303B2 (ja) * | 2011-02-23 | 2014-09-24 | ルネサスエレクトロニクス株式会社 | データ受信装置、データ受信方法及びプログラム |
EP2833593A1 (en) * | 2012-03-29 | 2015-02-04 | Fujitsu Limited | Information processing device and information processing device control method |
JP6413585B2 (ja) | 2014-10-06 | 2018-10-31 | 株式会社ソシオネクスト | 送信回路、集積回路及びパラレルシリアル変換方法 |
US10581587B1 (en) * | 2019-04-29 | 2020-03-03 | Advanced Micro Devices, Inc. | Deskewing method for a physical layer interface on a multi-chip module |
Family Cites Families (6)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH04178047A (ja) * | 1990-11-13 | 1992-06-25 | Fujitsu Ltd | スキュー補償方式 |
JPH06164564A (ja) * | 1992-11-19 | 1994-06-10 | Nec Eng Ltd | データ転送システム |
US6675327B1 (en) * | 1998-12-14 | 2004-01-06 | Agere Systems Inc. | Communications system including lower rate parallel electronics with skew compensation and associated methods |
JP4456432B2 (ja) * | 2004-08-02 | 2010-04-28 | 富士通株式会社 | 基準信号を用いて同期伝送を行う装置および方法 |
JP4330146B2 (ja) * | 2004-08-19 | 2009-09-16 | Necエンジニアリング株式会社 | スキュー調整回路 |
KR20060081522A (ko) * | 2005-01-10 | 2006-07-13 | 삼성전자주식회사 | 피씨아이 익스프레스의 바이트 스큐 보상방법 및 이를위한 피씨아이 익스프레스 물리 계층 수신기 |
-
2007
- 2007-01-15 JP JP2007005426A patent/JP4917901B2/ja not_active Expired - Fee Related
Also Published As
Publication number | Publication date |
---|---|
JP2008172657A (ja) | 2008-07-24 |
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A621 | Written request for application examination |
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A977 | Report on retrieval |
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A01 | Written decision to grant a patent or to grant a registration (utility model) |
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FPAY | Renewal fee payment (event date is renewal date of database) |
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R150 | Certificate of patent or registration of utility model |
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