JP4904677B2 - 液晶表示素子 - Google Patents
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Description
図1はこの発明の第1実施形態としてのアクティブマトリクス型で半透過反射型の液晶表示素子の要部の断面図を示し、図2はそのうちの薄膜トランジスタ基板側の透過平面図を示す。この場合、図1は図2のA−A線に沿う部分に相当する断面図である。この液晶表示素子は、ガラス基板等からなる薄膜トランジスタ基板1および対向基板31を備えている。
図3はこの発明の第2実施形態としての液晶表示素子の図1同様の断面図を示す。この液晶表示素子において、図1に示す場合と大きく異なる点は、オーバーコート膜20の上面にエポキシ系樹脂やポリイミド系樹脂等の有機材料からなる表面凸凹膜23を設け、表面凸凹膜23の凸凹表面に、この凸凹表面に追従する凸凹表面を有する透過用画素電極5を設け、透過用画素電極5の凸凹表面のほぼ左半分に、この凸凹表面に追従する凸凹表面を有する反射用画素電極6を設けた点である。
上記各実施形態では、薄膜トランジスタ4がアモルファスシリコン薄膜トランジスタである場合について説明したが、この発明はポリシリコン薄膜トランジスタにも適用することができる。そこで、次に、図1同様の断面図である図4を参照して、この発明の第3実施形態としてのポリシリコン薄膜トランジスタを備えた液晶表示素子について説明する。
上述の実施形態では、透過用画素電極5(および反射用画素電極6)が列方向に直線状に配列されたストライプ配列とし、データライン3および第1の補助容量電極7aをこの透過用画素電極5間において列方向に直線状に形成した場合で説明したが、透過用画素電極5を1行毎に半ピッチずつずらした、所謂、デルタ配列となしたものにも適用することが可能であり、その場合には、データライン3および第1の補助容量電極7aは、透過用画素電極5の各行間において、走査ライン2と平行に透過用画素電極5の半ピッチ分延出されたジグザグ形状に形成される。また、スイッチング素子として薄膜トランジスタを用いているが、ダイオード等、他のスイッチング素子を適用することができる。
2 走査ライン
3 データライン
4 薄膜トランジスタ
5 透過用画素電極
5a 第1の画素電極部
5b 第2の画素電極部
6 反射用画素電極
7 補助容量電極
22 ギャップ規制膜
Claims (4)
- 液晶層及び薄膜トランジスタが設けられた液晶表示素子であって、
第1の方向に延伸するように設けられ、前記薄膜トランジスタのゲート電極に接続された走査ラインと、
前記走査ラインよりも前記液晶層に近い側に、前記第1の方向に対して交差する第2の方向に延伸するように設けられ、前記薄膜トランジスタのドレイン電極及びソース電極のうちの一方の電極に接続されたデータラインと、
透明材料からなり、前記データラインよりも前記液晶層に近い側に設けられ、前記薄膜トランジスタのドレイン電極及びソース電極のうちの他方の電極に接続された第1の画素電極と、
前記第1の画素電極と前記データラインとの間の層として設けられた遮光性材料からなる補助容量電極と、
前記補助容量電極との間に前記第1の画素電極が介在するように且つ前記第1の画素電極に対して部分的に接触するように設けられた光反射性材料からなる第2の画素電極と、
を備え、
前記補助容量電極は、前記データラインよりも幅広に形成されるとともに前記データラインを覆うように配置され、
前記第2の画素電極は、前記第1の画素電極を前記第1の方向に2分割した領域のうちの一方の領域に重なるように、且つ、前記データラインに隣接する辺が前記補助容量電極に対して重なるように、配置されていることを特徴とする液晶表示素子。 - 前記第2の画素電極が設けられた領域の液晶層の厚さが、前記第1の画素電極を前記第1の方向に2分割した領域のうちの他方の領域に対応する領域の液晶層の厚さよりも薄く形成されていることを特徴とする請求項1に記載の液晶表示素子。
- 前記補助容量電極は、前記薄膜トランジスタを覆うように配置され、
前記第2の画素電極は、前記補助容量電極によって覆われた前記薄膜トランジスタをさらに覆うように配置されていることを特徴とする請求項1または2に記載の液晶表示素子。 - 前記第1の画素電極は、前記他方の領域に設けられたコンタクトホールを介して前記他方の電極に接続されていることを特徴とする請求項2に記載の液晶表示素子。
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