JP4735059B2 - サーマルプリンタ - Google Patents
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Description
サーマルプリントヘッドのシフトレジスタへ1ビットデータが転送される度にラッチオフするラッチ信号に同期させてストローブ信号をオンオフし、且つ前記ストローブ信号のディーティ比を制御する手段を備え、
前記制御手段は1ビットデータのデータ転送周波数とラッチ信号発生周波数とストローブ信号発生周波数を一致させ、
且つ一つの1ビットデータ毎に前記ストローブ信号をオンオフしディーティ比を変化させることにより印刷濃度を制御するように構成したことを特徴とするサーマルプリンタを提供するものである。
2 ラインバッファ
3 マルチビット/1ビットデータ変換回路
4 通電データバッファ
5 クロック発生器
6 ラッチ信号発生器
7 ストローブ信号発生器
8 通電カウンタ
9 サーマルプリントヘッド
10 シフトレジスタ
11 ラッチ回路
12 発熱素子
13 電源
Claims (2)
- 1ドット毎の階調を複数ビットで表現した画像データを複数の連続する1ビットデータに変換し、前記1ビットデータに基づきドット単位の発熱体通電時間を制御することにより、印刷濃度をドット単位で変化させて階調を表現するサーマルプリンタにおいて、
サーマルプリントヘッドのシフトレジスタへ1ビットデータが転送される度にラッチオフするラッチ信号に同期させてストローブ信号をオンオフし、且つ前記ストローブ信号のディーティ比を制御する手段を備え、
前記制御手段は1ビットデータのデータ転送周波数とラッチ信号発生周波数とストローブ信号発生周波数を一致させ、
且つ一つの1ビットデータ毎に前記ストローブ信号をオンオフしディーティ比を変化させることにより印刷濃度を制御するように構成したことを特徴とするサーマルプリンタ。 - サーミスタなどの感温素子を介した温度情報、及び発熱素子の発熱履歴情報に応じて前記ディーティ比を制御するように構成した請求項1記載のサーマルプリンタ。
Priority Applications (1)
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---|---|---|---|
JP2005164843A JP4735059B2 (ja) | 2005-06-03 | 2005-06-03 | サーマルプリンタ |
Applications Claiming Priority (1)
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JP2005164843A JP4735059B2 (ja) | 2005-06-03 | 2005-06-03 | サーマルプリンタ |
Publications (2)
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JP2006335009A JP2006335009A (ja) | 2006-12-14 |
JP4735059B2 true JP4735059B2 (ja) | 2011-07-27 |
Family
ID=37555944
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
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JP2005164843A Active JP4735059B2 (ja) | 2005-06-03 | 2005-06-03 | サーマルプリンタ |
Country Status (1)
Country | Link |
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Families Citing this family (2)
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Citations (2)
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- 2005-06-03 JP JP2005164843A patent/JP4735059B2/ja active Active
Patent Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH02292061A (ja) * | 1989-04-29 | 1990-12-03 | Nec Home Electron Ltd | サーマルプリンタ |
JPH05309860A (ja) * | 1992-05-14 | 1993-11-22 | Casio Comput Co Ltd | サーマルヘッド通電制御装置 |
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