JP4689700B2 - 遊技機 - Google Patents
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Description
また、特定入賞部への遊技媒体の入賞を検出するスイッチの出力は、遊技制御手段と数値取得手段とにそれぞれ入力される。
まず、遊技機の一例であるパチンコ遊技機の全体の構成について説明する。図1はパチンコ遊技機1を正面からみた正面図である。なお、ここでは、遊技機の一例としてパチンコ遊技機を示すが、本発明はパチンコ遊技機に限られず、例えばコイン遊技機等であってもよく、特定入賞部への遊技媒体の進入により特別遊技を行い、特別遊技の結果が所定の態様になったことにもとづいて遊技者に所定の遊技価値が付与可能となる全ての遊技機に適用可能である。
可変表示装置8の背面では、図2に示すように、機構板36の上部に景品玉タンク38が設けられ、パチンコ遊技機1が遊技機設置島に設置された状態でその上方から景品玉が景品玉タンク38に供給される。景品玉タンク38内の景品玉は、誘導樋39を通って玉払出装置に至る。
図5は、発振回路75、16ビットカウンタ76および乱数確定レジスタ77を、CPU56とともに示すブロック図である。この実施の形態では、発振回路75は、20MHzでクロック信号を発生する。発振回路75からのクロック信号は、16ビットカウンタ76に入力される。16ビットカウンタ76は、例えば、4個の4ビットカウンタ(ここでは74HC161)76a〜76dを直列接続して構成される。すなわち、発振回路75からのクロック信号は4ビットカウンタ76aのクロック入力端子に入力され、4ビットカウンタ76aの桁上げ信号が4ビットカウンタ76bのクロック入力端子に入力される。また、4ビットカウンタ76bの桁上げ信号が4ビットカウンタ76cのクロック入力端子に入力され、4ビットカウンタ76cの桁上げ信号が4ビットカウンタ76dのクロック入力端子に入力される。従って、4個の4ビットカウンタ76a〜76dの出力は、16ビットのカウンタ出力となる。
図6は、主基板31における基本回路53の動作を示すフローチャートである。上述したように、この処理は、定期リセット回路66が発するリセットパルスによって、例えば2ms毎に起動される。基本回路53が起動されると、基本回路53は、まず、スタックポインタの指定アドレスをセットするためのスタックセット処理を行う(ステップS1)。次いで、初期化処理を行う(ステップS2)。初期化処理では、基本回路53は、RAM55にエラーが含まれているか判定し、エラーが含まれている場合には、RAM55を初期化するなどの処理を行う。そして、表示制御基板80に送出されるコマンドコードをRAM55の所定の領域に設定する処理を行った後に(ステップS3)、コマンドコードを表示制御データとして出力する処理を行う(ステップS4)。
図7は、各乱数を示す説明図である。各乱数は、以下のように使用される。
(1)ランダム1:大当りを発生させるか否か決定する(大当り判定用)
(2)ランダム2−1〜2−3:左右中のはずれ図柄決定用
(3)ランダム3:大当り時の図柄の組合せを決定する(大当り図柄決定用=特定図柄判定用)
(4)ランダム4:はずれ時にリーチするか否か決定する(リーチ判定用)
(5)ランダム5:リーチ種類を決定する(リーチ動作決定用)
ステップS7では、基本回路53は、(3)の大当り図柄判定用乱数のカウントアップ(1加算)を行う。なお、(1)の大当り判定用乱数も判定用乱数であるが、メイン処理では、大当り判定用乱数の更新は行われない。
また、ステップS10のスイッチ処理では始動口スイッチ17以外のスイッチの検出処理も行われる。
まず、始動入賞記憶数の値を確認する(ステップS50)。始動入賞記憶数が0でなければ、始動入賞記憶数=1に対応する乱数値格納エリアに格納されている値を読み出すとともに(ステップS51)、始動入賞記憶数の値を1減らし、かつ、各乱数値格納エリアの値をシフトする(ステップS52)。すなわち、始動入賞記憶数=n(n=2,3,・・・)に対応する乱数値格納エリアに格納されている値を、始動入賞記憶数=n−1に対応する乱数値格納エリアに格納する。
第1の実施の形態では始動口スイッチ17からの信号をI/Oポート57とともにCPU56の割込端子にも接続し、CPU56の割込処理によって外部乱数をラッチするようにしたが、割込処理によらずに、外部乱数をラッチしてもよい。図13は、そのような処理を行うための発振回路75、16ビットカウンタ76および乱数確定レジスタ77を、CPU56とともに示すブロック図である。この実施の形態でも外部乱数を始動口スイッチ17のオンにもとづいてラッチするが、第1の実施の形態とは異なり、CPU56は、外部乱数のラッチのための始動口スイッチ17のオンを、I/Oポート57を介して入力する始動口スイッチ17の状態を用いて認識する。
また、ステップS10のスイッチ処理では始動口スイッチ17以外のスイッチの検出処理も行われる。
図17は、第3の実施の形態の発振回路75、16ビットカウンタ76および乱数確定レジスタ77を、CPU56とともに示すブロック図である。図17に示すように、この実施の形態では、始動口スイッチ17の出力が、乱数確定レジスタ77のラッチ入力にも接続され、始動口スイッチ17のオンによって、16ビットカウンタ76のカウント値が乱数確定レジスタ77にラッチされる。
また、ステップS10のスイッチ処理では始動口スイッチ17以外のスイッチの検出処理も行われる。
その後、CPU56は、画像表示部9の可変表示を開始できる状態になると、ステップS8の特別図柄プロセス処理において図11のフローチャートに示す処理を行う。
31 主基板
53 基本回路
56 CPU
75 発振回路
76 16ビットカウンタ
77 乱数確定レジスタ
Claims (2)
- 特定入賞部への遊技媒体の入賞により始動口スイッチがオンしたことにもとづいて特別遊技を行い、特別遊技の結果が所定の態様になったことにもとづいて遊技者に所定の遊技価値が付与可能となる遊技機であって、
遊技制御プログラムに従って所定の間隔で前記始動口スイッチがオンしたか否かを判定するスイッチ判定処理を含む定期処理を実行し、前記始動口スイッチからの検出信号が入力される入力ポートを有する遊技制御手段と、
前記遊技制御手段とは別個に設けられ、前記所定の間隔よりも短い間隔で数値が更新される外部カウンタと、
前記遊技制御手段とは別個に設けられ、前記外部カウンタによって更新される数値をラッチするラッチ回路とを備え、
前記外部カウンタは、複数の複数ビットカウンタが直列接続された構成であり、前記複数の複数ビットカウンタのうち初段の複数ビットカウンタのクロック入力端子に外部からのクロック信号が入力され、前記複数の複数ビットカウンタのうち初段以外の複数ビットカウンタのクロック入力端子に前段の複数ビットカウンタの桁上げ信号が入力され、
前記始動口スイッチからの前記検出信号は、分岐されて前記ラッチ回路と前記遊技制御手段の前記入力ポートとに入力され、
前記ラッチ回路は、前記始動口スイッチからの前記検出信号が入力されたことにもとづいて、前記外部カウンタによって更新される数値をラッチし、
前記遊技制御手段は、
前記定期処理で実行される前記スイッチ判定処理において、前記入力ポートに前記始動口スイッチからの前記検出信号が入力されたか否かを所定期間ごとに判定し、前記検出信号が前記入力ポートに所定回入力されたと判定したときに前記始動口スイッチが確かにオンしたと判定し、
前記始動口スイッチが確かにオンしたと判定したときに、始動入賞記憶に空きがあるか否かを判定し、
前記始動入賞記憶に空きがあると判定した場合に前記ラッチ回路によってラッチされた数値を前記ラッチ回路から読み込み、
前記ラッチ回路から読み込んだ数値を用いて、前記特別遊技の結果を前記所定の態様とするか否かを判定する抽選処理を実行する
ことを特徴とする遊技機。 - 外部カウンタによる更新範囲内の全ての数値の更新に要する時間が、前記所定の間隔の整数倍でない非同期の時間になるように前記クロック信号の周波数が設定されている
請求項1記載の遊技機。
Priority Applications (1)
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JP2008141598A JP4689700B2 (ja) | 2008-05-29 | 2008-05-29 | 遊技機 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
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JP2008141598A JP4689700B2 (ja) | 2008-05-29 | 2008-05-29 | 遊技機 |
Related Parent Applications (1)
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JP4689700B2 true JP4689700B2 (ja) | 2011-05-25 |
Family
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Family Applications (1)
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JP2008141598A Expired - Lifetime JP4689700B2 (ja) | 2008-05-29 | 2008-05-29 | 遊技機 |
Country Status (1)
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Families Citing this family (1)
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-
2008
- 2008-05-29 JP JP2008141598A patent/JP4689700B2/ja not_active Expired - Lifetime
Also Published As
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JP2008200535A (ja) | 2008-09-04 |
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