JP4623986B2 - Method for manufacturing display device - Google Patents

Method for manufacturing display device Download PDF

Info

Publication number
JP4623986B2
JP4623986B2 JP2004092233A JP2004092233A JP4623986B2 JP 4623986 B2 JP4623986 B2 JP 4623986B2 JP 2004092233 A JP2004092233 A JP 2004092233A JP 2004092233 A JP2004092233 A JP 2004092233A JP 4623986 B2 JP4623986 B2 JP 4623986B2
Authority
JP
Japan
Prior art keywords
film
insulating film
conductor
conductive
substrate
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Expired - Fee Related
Application number
JP2004092233A
Other languages
Japanese (ja)
Other versions
JP2004310085A5 (en
JP2004310085A (en
Inventor
馨太郎 今井
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Semiconductor Energy Laboratory Co Ltd
Original Assignee
Semiconductor Energy Laboratory Co Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Semiconductor Energy Laboratory Co Ltd filed Critical Semiconductor Energy Laboratory Co Ltd
Priority to JP2004092233A priority Critical patent/JP4623986B2/en
Publication of JP2004310085A publication Critical patent/JP2004310085A/en
Publication of JP2004310085A5 publication Critical patent/JP2004310085A5/ja
Application granted granted Critical
Publication of JP4623986B2 publication Critical patent/JP4623986B2/en
Anticipated expiration legal-status Critical
Expired - Fee Related legal-status Critical Current

Links

Images

Description

本発明は、表示装置の作製方法に関し、より詳しくはインクジェット方式による配線形成工程およびそれらを電気的に接続するコンタクトプラグ形成工程を含む表示装置の作製方法に関する。   The present invention relates to a method for manufacturing a display device, and more particularly to a method for manufacturing a display device including a wiring forming process by an ink jet method and a contact plug forming process for electrically connecting them.

絶縁表面上の薄膜を用いて形成された薄膜トランジスタ(TFT)は集積回路等に広く応用され、多くの場合スイッチング素子として用いられる。そのうち、TFTを使用した表示パネルは、特に大型の表示装置に用途が大きく拡大していることから、更に、画面サイズの高精細化、高開口率化、高信頼性、大型化の要求が高まっている。   Thin film transistors (TFTs) formed using a thin film over an insulating surface are widely applied to integrated circuits and the like, and are often used as switching elements. Among them, display panels using TFTs have greatly expanded their use especially to large display devices, and further demands for higher screen size, higher aperture ratio, higher reliability, and larger size are increasing. ing.

このような薄膜トランジスタを用いたデバイスにおける配線の作製方法としては、基板の特定領域に連通するコンタクト孔をフォトリソグラフィと異方性エッチングの組み合わせにより形成した後、全面に導電層の被膜を形成し、その後マスクを用いてフォトリソグラフィと異方性エッチング処理を行う方法がある(特許文献1参照。)。   As a method for manufacturing wiring in a device using such a thin film transistor, a contact hole communicating with a specific region of a substrate is formed by a combination of photolithography and anisotropic etching, and then a conductive layer film is formed on the entire surface. Thereafter, there is a method of performing photolithography and anisotropic etching using a mask (see Patent Document 1).

特開2002-359246号公報JP 2002-359246 A

上記の特許文献1のように、下地導電層に連通するコンタクト孔を開口する場合、一旦フォトリソグラフィ法によってレジストのパターニングを行い、この後異方性エッチングによって選択的に開口し、最後に余分なレジストの除去を行う。しかる後配線を形成する場合、全面に導電体層を全面に堆積した後、再びフォトリソグラフィ法によってレジストのパターニングを行い、後異方性エッチングによって配線の加工を行う。斯くの如く、コンタクト形成から配線形成に至るまで2回のフォトリソグラフィ法を用い多くの工程を経ることになる。しかもこの配線のエッチング加工の場合、例えばICPエッチング装置を例に挙げると、バイアス電力密度、ICP電力密度、圧力、エッチングガスの総流量、酸素添加率および下部電極の温度などのエッチング条件によってレジストと導電層との選択比が変化し、基板内で導電層の幅や長さがばらつく場合がある。また、エッチング処理を行う場合、マスクを作製する工程が必要となるため、スループットが悪化する。さらに、全面に導電層を形成後、所望の形状になるようにエッチング処理を行うため、無駄となる材料が発生する。このような問題は、一片が1メートルを超える大型基板上に配線を形成する場合に、深刻な問題となる。   When the contact hole communicating with the base conductive layer is opened as in the above-mentioned Patent Document 1, the resist is patterned once by a photolithography method, and then selectively opened by anisotropic etching, and finally an extra portion is formed. The resist is removed. Thereafter, in the case of forming a wiring, after depositing a conductor layer on the entire surface, the resist is patterned again by photolithography, and the wiring is processed by post-anisotropic etching. As described above, many processes are performed by using photolithography twice from contact formation to wiring formation. In addition, in the case of etching processing of this wiring, for example, an ICP etching apparatus is taken as an example. The selection ratio with the conductive layer may change, and the width and length of the conductive layer may vary within the substrate. In addition, when etching is performed, a step of manufacturing a mask is required, and thus throughput is deteriorated. Furthermore, after forming a conductive layer on the entire surface, an etching process is performed so as to obtain a desired shape, and thus a wasteful material is generated. Such a problem becomes a serious problem when a wiring is formed on a large substrate having a piece exceeding 1 meter.

本発明はこのような問題点を鑑みてなされたものであり、基板の大型化に対応できる複数層からなる配線あるいは導電層及びその間を電気的に連通する柱状の導電体(コンタクトプラグ、ピラー、プラグ等とも呼ばれる)を有する表示装置の作製方法を提供することを課題とする。また、スループットや材料の利用効率を向上させたコンタクトプラグおよび配線、導電層の形成工程を用いた表示装置の作製方法を提供することを課題とする。   The present invention has been made in view of such problems, and is composed of a plurality of layers of wiring or conductive layers that can cope with an increase in the size of a substrate, and columnar conductors (contact plugs, pillars, It is an object to provide a method for manufacturing a display device including a plug or the like. It is another object of the present invention to provide a method for manufacturing a display device using a process of forming contact plugs, wirings, and conductive layers with improved throughput and material utilization efficiency.

上述した従来技術の課題を解決するために、本発明においては以下の手段を講じる。   In order to solve the above-described problems of the prior art, the following measures are taken in the present invention.

本発明は、一層或いは複数の層からなる導電体パターンとさらにその上層に形成された配線または導電体パターンとを電気的に導通するプラグを形成するに当たり、一旦導電体で形成したピラーを下地導電層パターン上に形成し、その後一層或いは多層の絶縁膜を全面に形成した後、該絶縁膜をエッチバックさせて前記導電体ピラーを露出させ、最後に導電体パターンをインクジェット方式により作製することを特徴とする。この場合、導電体ピラーを加工するに当たり、マスクとなるレジスト自体インクジェット法で形成することが可能である。この場合レジストとなる材料は、従来の有機樹脂のみならず、ドライエッチング加工時に選択性のとれる材料で有れば適用可能であり、例えばSiO2等の無機材料或いは金属材料、特にドライエッチングされにくいAu,Ag,Cu,Pt等の貴金属等を用いることも可能である。金属材料をエッチングのレジスト材料に用いた場合には、加工後に除去する必要が無くなる利点も有する。 In the present invention, in forming a plug for electrically conducting a conductive pattern composed of one or a plurality of layers and a wiring or a conductive pattern formed on the conductive pattern, a pillar once formed of a conductive material is used as a base conductive material. After forming on the layer pattern and then forming a single-layer or multi-layer insulation film on the entire surface, the insulation film is etched back to expose the conductor pillars, and finally the conductor pattern is produced by an inkjet method. Features. In this case, when the conductor pillar is processed, the resist itself serving as a mask can be formed by an ink jet method. In this case, the resist material can be applied not only to the conventional organic resin but also to a material that can be selected at the time of dry etching. For example, an inorganic material such as SiO 2 or a metal material, particularly dry etching is difficult. It is also possible to use noble metals such as Au, Ag, Cu, and Pt. When a metal material is used as an etching resist material, there is an advantage that it is not necessary to remove after processing.

つまり、インクヘッドからレジストを吐出することで、容易にパターニングを行い、また導電性材料を含む組成物を吐出することで、絶縁表面上に導電層を形成し、これらを組み合わせることによってフォトリソグラフィ法によらずして、コンタクトプラグとそれに連通する配線等の導電層パターンを形成することを特徴とする。そして、前記導電層とは、導電性を有するソース配線、ドレイン配線や、画素電極、対向電極などが挙げられ、このような導電層は本発明により作製することができる。   In other words, patterning is easily performed by ejecting a resist from the ink head, and a conductive layer is formed on an insulating surface by ejecting a composition containing a conductive material. Regardless of this, a conductive layer pattern such as a contact plug and wiring connected to the contact plug is formed. Examples of the conductive layer include conductive source wiring, drain wiring, a pixel electrode, a counter electrode, and the like. Such a conductive layer can be manufactured according to the present invention.

また本発明は、絶縁表面を有する基板上に形成された半導体上に、インクジェット方式により一層或いは複数の層からなる導電体層を作製し、この導電層上の特定領域上に前記導電体と同種の導電体、あるいは別種の導電体を材料とするピラーを形成する。ここで、このピラーは、例えば、一旦導電体層を全面に堆積した後、この導電体層の所望の局所部分にインクジェット法によりレジストパターンを形成し、しかる後に異方性エッチングを行うことによって形成することが可能である。この後に、一層或いは多層の絶縁膜を全面に形成した後、この絶縁膜をエッチバックさせて導電体ピラーを露出させる。最後に、導電体ピラーに電気的に接続する配線、画素電極、発光層及び対向電極等の導電体パターンをインクジェット方式を用いて作製することを特徴とする。   In the present invention, a conductor layer made of one layer or a plurality of layers is formed on a semiconductor formed over a substrate having an insulating surface by an inkjet method, and the same kind of the conductor is formed on a specific region on the conductive layer. A pillar made of the above-mentioned conductor or another kind of conductor is formed. Here, the pillar is formed, for example, by once depositing a conductor layer on the entire surface, forming a resist pattern on a desired local portion of the conductor layer by an ink jet method, and then performing anisotropic etching. Is possible. Thereafter, after a single-layer or multi-layer insulating film is formed on the entire surface, the insulating film is etched back to expose the conductor pillars. Finally, a conductive pattern such as a wiring, a pixel electrode, a light emitting layer, and a counter electrode that are electrically connected to the conductive pillar is manufactured using an ink jet method.

上述の通り、導電層をインクジェット方式により形成する本発明は、インクヘッドから吐出する組成物を交換するか、又は組成物が充填されたインクヘッドを交換すれば、例えば発光素子の画素電極、発光層、対向電極を連続的に大気に晒すことなく連続的に作製することができる。   As described above, in the present invention in which the conductive layer is formed by the ink jet method, for example, the pixel electrode of the light emitting element, the light emission can be obtained by replacing the composition ejected from the ink head or replacing the ink head filled with the composition. The layer and the counter electrode can be continuously produced without being exposed to the atmosphere.

なお、本発明では、上記構成を有する表示装置をスクリーン印刷法、オフセット印刷法に代表される印刷法、液滴吐出法を用いて形成する。なお、液滴吐出法とは、所定の組成物を含む液滴を細孔から吐出して特定のパターンを形成する方法を意味する。上記の印刷法や液滴吐出法を用いることで、露出用のパターンを用いることなく、信号線、走査線に代表される各種配線、TFTのゲート電極、発光素子の電極などを形成することが可能になる。さらに、インクジェット方式に代表される液滴吐出法を用いると、印刷ロールや印刷すべきパターンが彫り込まれた凸版を用いて、溶液を塗布後、焼成して薄膜(代表的には発光層)を作成するスクリーン印刷法と比較すると、膜厚の均一性が優れている等の優位点を有する。ただし、本発明の表示装置はパターンを形成する全ての工程に印刷法または液滴吐出法を用いる必要はない。よって、例えば、配線およびゲート電極の形成には印刷法または液滴吐出法を用い、半導体膜のパターニングにはリソグラフィ法を用いる、というように、少なくとも一部の工程において印刷法または液滴吐出法を用いればよく、リソグラフィ法を併用してもよい。また、パターニングの際に用いるマスクを印刷法または液滴吐出法で形成してもよい。   Note that in the present invention, the display device having the above structure is formed by a screen printing method, a printing method typified by an offset printing method, or a droplet discharge method. The droplet discharge method means a method of forming a specific pattern by discharging droplets containing a predetermined composition from the pores. By using the above printing method or droplet discharge method, various wirings typified by signal lines and scanning lines, TFT gate electrodes, light emitting element electrodes, and the like can be formed without using an exposure pattern. It becomes possible. Furthermore, when a droplet discharge method typified by an ink jet method is used, a thin film (typically, a light emitting layer) is formed by applying a solution using a printing roll or a relief plate engraved with a pattern to be printed, followed by baking. Compared with the screen printing method to be created, it has advantages such as excellent film thickness uniformity. However, the display device of the present invention does not need to use a printing method or a droplet discharge method for all the steps of forming a pattern. Therefore, for example, a printing method or a droplet discharge method is used in at least a part of the process such that a printing method or a droplet discharge method is used for forming a wiring and a gate electrode, and a lithography method is used for patterning a semiconductor film. May be used, and a lithography method may be used in combination. Further, a mask used for patterning may be formed by a printing method or a droplet discharge method.

上述の構成を有する本発明は、一辺が1メートルを超えるような大型基板に対しても簡単に配線、導電層を形成することができる。また、所望の箇所に必要な量の材料のみを塗布すればよいため、無駄な材料が僅かとなることから材料の利用効率の向上、さらには、作製費用の削減を実現する。   In the present invention having the above-described configuration, a wiring and a conductive layer can be easily formed even on a large substrate whose one side exceeds 1 meter. In addition, since only a necessary amount of material needs to be applied to a desired location, wasteful material is reduced, so that the utilization efficiency of the material is improved and the manufacturing cost is reduced.

また、マスクが不要であることから、露光、現像などの工程を大幅に削減することができる。また、インクヘッドから吐出する組成物の変更、又は組成物が充填されたインクヘッドの変更を行うことで、例えば発光素子の発光層と電極などの複数の薄膜を連続的に作製することができる。その結果、スループットが高くなり、生産性を向上させることができる。さらに、露光を目的としたマスクが不要となることで、例えばパソコンなどに入力された回路配線を即座に作製することができる。 In addition, since a mask is not required, steps such as exposure and development can be greatly reduced. In addition, by changing the composition ejected from the ink head or changing the ink head filled with the composition, for example, a plurality of thin films such as a light emitting layer and an electrode of the light emitting element can be continuously formed. . As a result, throughput is increased and productivity can be improved. Furthermore, since a mask for the purpose of exposure is not necessary, circuit wiring input to, for example, a personal computer can be immediately produced.

本発明の実施の形態について、図1、7を用いて、アクティブマトリクス型の液晶表示装置を例として作製工程を以下に示す。   A manufacturing process of an embodiment of the present invention will be described below with reference to FIGS. 1 and 7 using an active matrix liquid crystal display device as an example.

最初に、透光性を有する基板101を用いてアクティブマトリクス基板を作製する。基板サイズとしては、600mm×720mm、680mm×880mm、1000mm×1200mm、1100mm×1250mm、1150mm×1300mm、1500mm×1800mm、1800mm×2000mm、2000mm×2100mm、2200mm×2600mm、または2600mm×3100mmのような大面積基板を用い、製造コストを削減することが好ましい。用いることのできる基板として、コーニング社の#7059ガラスや#1737ガラスなどに代表されるバリウムホウケイ酸ガラスやアルミノホウケイ酸ガラスなどのガラス基板を用いることができる。更に他の基板として、石英基板、プラスチック基板などの透光性基板を用いることもできる。 First, an active matrix substrate is manufactured using a light-transmitting substrate 101. Substrate size is 600mm x 720mm, 680mm x 880mm, 1000mm x 1200mm, 1100mm x 1250mm, 1150mm x 1300mm, 1500mm x 1800mm, 1800mm x 2000mm, 2000mm x 2100mm, 2200mm x 2600mm, or 2600mm x 3100mm It is preferable to use a substrate and reduce manufacturing costs. As a substrate that can be used, a glass substrate such as barium borosilicate glass or aluminoborosilicate glass represented by Corning # 7059 glass or # 1737 glass can be used. Furthermore, a light-transmitting substrate such as a quartz substrate or a plastic substrate can be used as another substrate.

図1に示すように、まず、本実施の形態では、基板101上に、絶縁膜から成る下地膜102を形成する。 次いで、下地膜102上に半導体層103を形成する。半導体層103は、まず公知の方法(スパッタリング法、LPCVD法、プラズマCVD法等)により25〜80nmの厚さで半導体膜を成膜する。本実施の形態では、プラズマCVD法を用いて、膜厚50nmの非晶質珪素膜を成膜する。次いで、エキシマレーザーによるレーザー結晶化を追加し結晶性の向上を図った。また半導体層を形成後、TFTのしきい値を制御するために微量な不純物元素(ボロン)のドーピング(チャネルドーピング)を行ってもよい。その後、インクジェット方式によってレジストのパターニングを行い、該レジストパターンをマスクとしてドライエッチング法によって半導体層103を形成した。   As shown in FIG. 1, first, in this embodiment mode, a base film 102 made of an insulating film is formed over a substrate 101. Next, the semiconductor layer 103 is formed over the base film 102. The semiconductor layer 103 is first formed into a semiconductor film with a thickness of 25 to 80 nm by a known method (sputtering method, LPCVD method, plasma CVD method or the like). In this embodiment mode, an amorphous silicon film with a thickness of 50 nm is formed by a plasma CVD method. Next, laser crystallization with an excimer laser was added to improve crystallinity. Further, after forming the semiconductor layer, a small amount of impurity element (boron) may be doped (channel doping) in order to control the threshold value of the TFT. Thereafter, the resist was patterned by an inkjet method, and the semiconductor layer 103 was formed by a dry etching method using the resist pattern as a mask.

次いで、半導体層103を覆うゲート絶縁膜105を形成する。ゲート絶縁膜105はプラズマCVD法やスパッタ法を用いて、膜厚を40〜150nmとして珪素を含む絶縁膜で形成する。本形態では、ゲート絶縁膜(キャパシタ絶縁膜)105としてプラズマCVD法により酸化窒化珪素膜を115nmの厚さに形成した。   Next, a gate insulating film 105 that covers the semiconductor layer 103 is formed. The gate insulating film 105 is formed of an insulating film containing silicon with a film thickness of 40 to 150 nm by plasma CVD or sputtering. In this embodiment, a silicon oxynitride film having a thickness of 115 nm is formed as the gate insulating film (capacitor insulating film) 105 by a plasma CVD method.

続いて、インクジェット方式により、減圧又は真空中で第1の導電層(ゲート配線、ゲート電極、キャパシタ電極)106を形成する。このときの、斜視図を図7に示す。   Subsequently, the first conductive layer (gate wiring, gate electrode, capacitor electrode) 106 is formed by reduced pressure or vacuum by an inkjet method. A perspective view at this time is shown in FIG.

図7において、401は基板、402は水平走査駆動回路、403は垂直走査駆動回路、404はインクヘッド、である。インクヘッド404は、1個又は複数個用いて、上下左右に基板401の表面と平行に走査することで、溶液塗布が行われる。本構成により、所望の箇所のみに配線を塗布することができる。   In FIG. 7, 401 is a substrate, 402 is a horizontal scanning drive circuit, 403 is a vertical scanning drive circuit, and 404 is an ink head. One or a plurality of ink heads 404 are used, and solution application is performed by scanning vertically and horizontally in parallel with the surface of the substrate 401. With this configuration, the wiring can be applied only to a desired location.

図7には、1つのインクヘッドを示したが、複数個のインクヘッドを用いてもよい。また、ノズル径の異なるインクヘッドを複数用意し、用途に応じて、ノズル径の異なるインクヘッドを使い分けてもよい。なお、通常のインクヘッドのノズル径は50〜100μmであり、このノズル径にも依存するが、スループットを考慮して、一度の走査で形成できるようにするために、一行又は一列と同じ長さになるように、複数のノズルを並列に配置してもよい。また、任意の個数のノズルを配置して、複数回走査しても構わないし、また同じ箇所を複数回走査することで重ね塗りをしてもよい。さらに、インクヘッド404を走査することが好ましいが、基板401を移動させても構わない。なお基板401とインクヘッド404との距離は、所望の箇所に滴下するために、できるだけ近づけておくことが好ましく、具体的には、0.1〜2ミリ程度が好ましい。   Although one ink head is shown in FIG. 7, a plurality of ink heads may be used. Alternatively, a plurality of ink heads having different nozzle diameters may be prepared, and ink heads having different nozzle diameters may be used properly according to the application. In addition, the nozzle diameter of a normal ink head is 50 to 100 μm and depends on the nozzle diameter, but considering the throughput, in order to be able to form by one scanning, the same length as one row or one column A plurality of nozzles may be arranged in parallel so that Further, an arbitrary number of nozzles may be arranged and scanned a plurality of times, or the same portion may be scanned a plurality of times and overcoated. Further, although it is preferable to scan the ink head 404, the substrate 401 may be moved. The distance between the substrate 401 and the ink head 404 is preferably as close as possible so as to be dropped at a desired location, and specifically, about 0.1 to 2 mm is preferable.

インクヘッドから1回に吐出する組成物の量は10〜70pl、粘度は100cp以下、粒径0.1μm以下が好ましい。これは、乾燥が起こることを防ぎ、また粘度が高すぎると、吐出口から組成物を円滑に吐出できなくなったりするためである。用いる溶媒や、用途に合わせて組成物の粘度、表面張力、乾燥速度などは適宜調節する。またインクヘッドから吐出される組成物は、基板上で連続して滴下して線状又はストライプ状に形成することが好ましい。しかし、例えば1ドット毎などの所定の箇所毎に滴下してもよい。   The amount of the composition ejected from the ink head at one time is preferably 10 to 70 pl, the viscosity is 100 cp or less, and the particle size is 0.1 μm or less. This is because drying is prevented and the composition cannot be smoothly discharged from the discharge port if the viscosity is too high. The viscosity, surface tension, drying rate and the like of the composition are adjusted as appropriate according to the solvent used and the application. Moreover, it is preferable that the composition discharged from the ink head is continuously dropped on the substrate to form a linear shape or a stripe shape. However, it may be dropped at predetermined locations such as every dot.

インクヘッドから吐出する組成物は、タンタル(Ta)、タングステン(W)、チタン(Ti)、モリブデン(Mo)、アルミニウム(Al)、銅(Cu)、クロム(Cr)、Nd(ネオジム)から選択された元素、または前記元素を主成分とする合金材料若しくは化合物材料、AgPdCu合金などから適宜選択された導電性の材料を溶媒に溶解又は分散させたものを用いる。溶媒には、酢酸ブチル、酢酸エチル等のエステル類、イソプロピルアルコール、エチルアルコール等のアルコール類、メチルエチルケトン、アセトン等の有機溶剤などを用いる。溶媒の濃度は、導電性材料の種類などに適宜決定するとよい。   The composition ejected from the ink head is selected from tantalum (Ta), tungsten (W), titanium (Ti), molybdenum (Mo), aluminum (Al), copper (Cu), chromium (Cr), and Nd (neodymium). Or a conductive material appropriately selected from an alloy material or a compound material containing the above element as a main component, an AgPdCu alloy, or the like is used. As the solvent, esters such as butyl acetate and ethyl acetate, alcohols such as isopropyl alcohol and ethyl alcohol, and organic solvents such as methyl ethyl ketone and acetone are used. The concentration of the solvent may be appropriately determined depending on the type of conductive material.

また、インクヘッドから吐出する組成物として、銀(Ag)、金(Au)、白金(Pt)を粒径10nm以下で分散させた超微粒子(ナノメタル粒子)を用いてもよい。このように、粒径の微細な粒子を溶媒に分散又は溶解した組成物を用いると、ノズルの目詰まりという問題を解決することができる。なお、インクジェット方式を用いる本発明では、組成物の構成材料の粒径は、ノズルの粒径よりも小さいことが必要となる。また、ポリエチレンジオキシチオフェン/ポリスチレンスルホン酸(PEDT/PSS)水溶液などの導電性ポリマー(導電性高分子)を用いてもよい。   Further, as a composition ejected from the ink head, ultrafine particles (nanometal particles) in which silver (Ag), gold (Au), and platinum (Pt) are dispersed with a particle diameter of 10 nm or less may be used. As described above, when a composition in which fine particles having a small particle size are dispersed or dissolved in a solvent is used, the problem of nozzle clogging can be solved. In the present invention using the ink jet method, the particle size of the constituent material of the composition needs to be smaller than the particle size of the nozzle. Alternatively, a conductive polymer (conductive polymer) such as a polyethylenedioxythiophene / polystyrene sulfonic acid (PEDT / PSS) aqueous solution may be used.

また、銀または銅といった低抵抗金属を配線材料として用いると、配線抵抗の低抵抗化を図ることができるため、大型の基板を用いる場合に好ましい。しかも、これらの金属材料は通常のドライエッチング法によって加工することが難しいため、インクジェット法で直接パターニングを行うことは、極めて効果的である。但し、例えば銅などの場合には、トランジスタの電気的特性に悪影響を及ぼさないようにするために、拡散を防ぐバリア性の導電膜を設けることが好ましい。バリア性の導電膜により、トランジスタが有する半導体に銅が拡散することなく、配線を形成することができる。このバリア性の導電膜としては、窒化タンタル(TaN)、窒化チタン(TiN)又は窒化タングステン(WN)から選ばれた一種又は複数種の積層膜を用いることができる。また、銅は酸化しやすいため、酸化防止剤などを併用することが好ましい。   In addition, when a low-resistance metal such as silver or copper is used as a wiring material, the wiring resistance can be reduced, which is preferable when a large substrate is used. Moreover, since it is difficult to process these metal materials by a normal dry etching method, it is extremely effective to perform patterning directly by the ink jet method. However, in the case of copper, for example, it is preferable to provide a barrier conductive film that prevents diffusion in order not to adversely affect the electrical characteristics of the transistor. With the barrier conductive film, a wiring can be formed without diffusion of copper into a semiconductor included in the transistor. As the barrier conductive film, one or more kinds of laminated films selected from tantalum nitride (TaN), titanium nitride (TiN), and tungsten nitride (WN) can be used. Moreover, since copper is easily oxidized, it is preferable to use an antioxidant together.

その後、第1の導電層が形成された基板に常圧または減圧、あるいは真空中で、150〜300度の範囲で加熱処理を施すことで、その溶媒を揮発させて、その組成物の密度が増し、抵抗値が低減するようにする。但し、インクヘッド404から吐出する組成物における溶媒は、基板に滴下後に揮発するものが適している。特にトルエンなどの揮発性の高い溶媒を用いると、組成物を基板に滴下後、揮発する。そのような場合には、加熱処理の工程は削除しても構わない。しかし、組成物の溶媒は特に限定されず、滴下後に揮発する溶媒を用いた場合であっても、加熱処理を施すことで、その組成物の密度が増し、抵抗値が低減するようにするようにしてもよい。またこの加熱処理は、インクジェット方式により薄膜を形成した毎に行ってもよいし、任意の工程毎に行ってもよいし、全ての工程が終了した後に一括して行ってもよい。   Thereafter, the substrate on which the first conductive layer is formed is subjected to heat treatment in the range of 150 to 300 degrees under normal pressure, reduced pressure, or vacuum to volatilize the solvent, and the density of the composition is reduced. Increase and decrease resistance. However, as the solvent in the composition discharged from the ink head 404, a solvent that volatilizes after dropping on the substrate is suitable. In particular, when a highly volatile solvent such as toluene is used, the composition is volatilized after being dropped onto the substrate. In such a case, the heat treatment process may be omitted. However, the solvent of the composition is not particularly limited, and even when a solvent that volatilizes after dropping is used, the density of the composition increases and the resistance value decreases by performing heat treatment. It may be. Further, this heat treatment may be performed every time a thin film is formed by an ink jet method, may be performed every arbitrary step, or may be performed collectively after all steps are completed.

加熱処理は、加熱源にハロゲンなどのランプを用いて、直接基板を高速加熱するランプアニール装置や、レーザー光を照射するレーザー照射装置を用いる。両者とも加熱源を走査することで、所望の箇所のみに加熱処理を施すことができる。その他の方法として、所定の温度に設定されたファーネスアニール炉を用いてもよい。但し、ランプを用いる場合には、加熱処理を行う薄膜の組成を破壊せず、加熱のみを可能とする波長の光であり、例えば、400nmよりも波長の長い光、即ち赤外光以上の波長の光が好ましい。取り扱いの面からは、遠赤外線(代表的な波長は4〜25μm)を用いることが好ましい。またレーザー光を用いる場合、レーザー発振装置から発振されるレーザー光の基板におけるビームスポットの形状は、列又は行の長さと同じ長さになるように線状に成形することが好ましい。そうすると、一度の走査でレーザー照射を終了させることができる。本形態では、加熱処理として、線状に成形したビームスポットを照射して行った。   The heat treatment uses a lamp annealing apparatus that directly heats the substrate at high speed using a lamp such as halogen as a heating source, or a laser irradiation apparatus that irradiates laser light. In both cases, the heat treatment can be performed only on a desired portion by scanning the heat source. As another method, a furnace annealing furnace set at a predetermined temperature may be used. However, in the case of using a lamp, it is light having a wavelength that enables heating only without destroying the composition of the thin film to be heat-treated, for example, light having a wavelength longer than 400 nm, that is, a wavelength longer than infrared light Are preferred. From the viewpoint of handling, it is preferable to use far infrared rays (typical wavelength is 4 to 25 μm). In the case of using laser light, the shape of the beam spot on the substrate of the laser light oscillated from the laser oscillation device is preferably linearly formed so as to have the same length as the column or row. If it does so, laser irradiation can be completed by one scan. In this embodiment, the heat treatment is performed by irradiating a beam spot formed in a linear shape.

続いて、ゲート電極106をマスクとして、半導体層103に、N型又はP型を付与する不純物元素を添加するドーピング処理を行い、同時に、不純物元素が全く添加されない領域又は微量の不純物元素が添加された領域(チャネル形成領域と総称)を形成した。さらに、第一の導電層106をマスクとして、ゲート絶縁膜の一部をエッチング除去し、不純物領域の半導体層103の表面を露出させる。   Subsequently, using the gate electrode 106 as a mask, the semiconductor layer 103 is doped with an impurity element imparting N-type or P-type, and at the same time, a region where no impurity element is added or a small amount of impurity element is added. A region (generally referred to as a channel formation region) was formed. Further, using the first conductive layer 106 as a mask, a part of the gate insulating film is removed by etching to expose the surface of the semiconductor layer 103 in the impurity region.

この後、実施例1、2で示すようにして、一旦全面に厚さ1.5μmのAl膜を堆積し、該導電体膜上の所望の特定領域にインクジェット法によってレジストパターンした後、異方性ドライエッチングにより、Alのピラー108,109を形成する。そして、絶縁膜からなる第1の層間絶縁膜110を形成する。第1の層間絶縁膜110としては、プラズマCVD法により膜厚100nmの酸化窒化珪素膜を形成した。次いで、第1の層間絶縁膜110上に、第2の層間絶縁膜111を形成する。第2の層間絶縁膜111としては、スピン塗布法で全面に膜厚1.6μmのアクリル膜を形成し、さらに第3の層間絶縁膜112として膜厚50nmの窒化珪素膜を形成した。なお、アクリル膜の代わりに他の透明な絶縁材料を用いてもよい。  Thereafter, as shown in Examples 1 and 2, an Al film having a thickness of 1.5 μm is once deposited on the entire surface, and a resist pattern is formed on a desired specific region on the conductor film by an ink jet method. Al pillars 108 and 109 are formed by reactive dry etching. Then, a first interlayer insulating film 110 made of an insulating film is formed. As the first interlayer insulating film 110, a 100-nm-thick silicon oxynitride film was formed by a plasma CVD method. Next, a second interlayer insulating film 111 is formed on the first interlayer insulating film 110. As the second interlayer insulating film 111, an acrylic film having a thickness of 1.6 μm was formed on the entire surface by spin coating, and a silicon nitride film having a thickness of 50 nm was further formed as the third interlayer insulating film 112. Note that another transparent insulating material may be used instead of the acrylic film.

この後、第3の層間絶縁膜(窒化珪素膜)112、第2の層間絶縁膜(アクリル膜)111、第1の層間絶縁膜(酸化窒化珪素膜)110を順次エッチバックすることによって、ピラー108,109の頂部を露出させる。   Thereafter, the third interlayer insulating film (silicon nitride film) 112, the second interlayer insulating film (acrylic film) 111, and the first interlayer insulating film (silicon oxynitride film) 110 are sequentially etched back to thereby form pillars. The tops of 108 and 109 are exposed.

しかる後、インクジェット方式により、第2の導電層(ソース配線、ドレイン配線)113、114を前記導電体ピラー108,109に接するように形成する。吐出する組成物の粘度を最適な値に設定することが必要である。   Thereafter, second conductive layers (source wiring and drain wiring) 113 and 114 are formed in contact with the conductor pillars 108 and 109 by an inkjet method. It is necessary to set the viscosity of the composition to be discharged to an optimum value.

続いて、全面に第2の導電層と電気的に接続されるように、透明導電体からなる画素電極115を形成する。画素電極115には、一例として、酸化インジウムと酸化スズの化合物(ITO)、酸化インジウムと酸化亜鉛の化合物、酸化亜鉛、酸化スズ、酸化インジウム、窒化チタンなどが挙げられる。本形態では画素電極115として、インクジェット法で、0.1μmの厚さでITO膜を形成した。
以上、画素部においてはソース配線と、画素部のTFT及び保持容量と、端子部で構成されたアクティブマトリクス基板を作製することができる。
Subsequently, a pixel electrode 115 made of a transparent conductor is formed on the entire surface so as to be electrically connected to the second conductive layer. Examples of the pixel electrode 115 include a compound of indium oxide and tin oxide (ITO), a compound of indium oxide and zinc oxide, zinc oxide, tin oxide, indium oxide, and titanium nitride. In this embodiment, an ITO film having a thickness of 0.1 μm is formed as the pixel electrode 115 by an inkjet method.
As described above, an active matrix substrate including a source wiring, a TFT and a storage capacitor of the pixel portion, and a terminal portion can be manufactured in the pixel portion.

次いで、アクティブマトリクス基板上に配向膜137を形成しラビング処理を行う。なお、本実施の形態では配向膜137を形成する前に、アクリル樹脂膜等の有機樹脂膜をパターニングすることによって基板間隔を保持するための柱状のスペーサ116を所望の位置に形成した。また、柱状のスペーサに代えて、球状のスペーサを基板全面に散布してもよい。   Next, an alignment film 137 is formed on the active matrix substrate and a rubbing process is performed. In this embodiment mode, before the alignment film 137 is formed, the columnar spacer 116 for maintaining the substrate interval is formed at a desired position by patterning an organic resin film such as an acrylic resin film. Further, instead of the columnar spacers, spherical spacers may be scattered over the entire surface of the substrate.

次いで、対向基板を用意する。この対向基板には、着色層、遮光層が各画素に対応して配置されたカラーフィルタ134が設けられている。また、このカラーフィルタと遮光層とを覆う平坦化膜を設けている。次いで、平坦化膜上に透明導電膜からなる対向電極1370を画素部と重なる位置に形成し、対向基板の全面に配向膜136を形成し、ラビング処理を施す。   Next, a counter substrate is prepared. The counter substrate is provided with a color filter 134 in which a colored layer and a light shielding layer are arranged corresponding to each pixel. Further, a flattening film is provided to cover the color filter and the light shielding layer. Next, a counter electrode 1370 made of a transparent conductive film is formed on the planarizing film at a position overlapping the pixel portion, an alignment film 136 is formed on the entire surface of the counter substrate, and a rubbing process is performed.

そして、アクティブマトリクス基板の画素部を囲むようにシール材を描画した後、減圧下でシール材に囲まれた領域にインクジェット法で液晶を吐出する。次いで、大気にふれることなく、減圧下でアクティブマトリクス基板と対向基板とをシール材121で貼り合わせる。シール材121にはフィラー(図示しない)が混入されていて、このフィラーと柱状スペーサ116によって均一な間隔を持って2枚の基板が貼り合わせられる。インクジェット法で液晶を吐出する方法を用いることによって作製プロセスで使用する液晶の量を削減することができ、特に、大面積基板を用いる場合に大幅なコスト低減を実現することができる。   Then, after drawing a sealing material so as to surround the pixel portion of the active matrix substrate, liquid crystal is discharged by an inkjet method to a region surrounded by the sealing material under reduced pressure. Next, the active matrix substrate and the counter substrate are attached to each other with the sealant 121 under reduced pressure without being exposed to the atmosphere. Filler (not shown) is mixed in the sealing material 121, and two substrates are bonded to each other with a uniform interval by the filler and the columnar spacer 116. By using a method of discharging liquid crystal by an inkjet method, the amount of liquid crystal used in the manufacturing process can be reduced. In particular, when a large-area substrate is used, significant cost reduction can be realized.

つまり、本実施の形態では、インクジェット法によって基板上に設けられた画素電極上、即ち画素部上のみに液晶材料の噴射(または滴下)を行った後、シールが設けられた対向基板と貼り合わせる。また、対向基板にシール描画と液晶滴下との両方をおこなってもよいし、画素部が設けられた基板にシール描画と液晶滴下との両方をおこなってもよい。   That is, in this embodiment mode, after the liquid crystal material is sprayed (or dropped) only on the pixel electrode provided on the substrate by the inkjet method, that is, on the pixel portion, the liquid crystal material is attached to the counter substrate provided with the seal. . Further, both seal drawing and liquid crystal dropping may be performed on the counter substrate, or both seal drawing and liquid crystal dropping may be performed on the substrate provided with the pixel portion.

インクジェット法としては、インク滴の制御性に優れインク選択の自由度の高いことからインクジェットプリンターで利用されているピエゾ方式を用いてもよい。なお、ピエゾ方式には、MLP(Multi Layer Piezo)タイプとMLChip(Multi Layer Ceramic Hyper Integrated Piezo Segments)タイプがある。   As the ink jet method, a piezo method used in an ink jet printer may be used because of excellent controllability of ink droplets and a high degree of freedom in ink selection. Note that there are two types of piezo methods: MLP (Multi Layer Piezo) type and MLChip (Multi Layer Ceramic Hyper Integrated Piezo Segments) type.

なお本実施の形態において、画素電極に向けて微量の液晶を複数滴噴射(または滴下)を行うことで、液晶表示装置を作成するものである。インクジェット法を用いることによって、吐出回数、または吐出ポイントの数などで微量な液晶の量を自由に調節することができる。   Note that in this embodiment, a liquid crystal display device is formed by ejecting (or dropping) a small amount of liquid crystal toward a pixel electrode. By using the inkjet method, the amount of a small amount of liquid crystal can be freely adjusted by the number of discharges or the number of discharge points.

このようにしてアクティブマトリクス型液晶表示装置が完成する。そして、必要があれば、アクティブマトリクス基板または対向基板を所望の形状に分断する。さらに、公知の技術を用いて偏光板117等の光学フィルムを適宜設ける。そして、公知の技術を用いてFPCを貼りつける。   In this way, an active matrix liquid crystal display device is completed. If necessary, the active matrix substrate or the counter substrate is divided into a desired shape. Further, an optical film such as a polarizing plate 117 is appropriately provided using a known technique. Then, the FPC is pasted using a known technique.

以上の工程によって得られた液晶モジュールに、バックライト120、導光板119を設け、カバー122で覆えば、図1にその断面図の一部を示したようなアクティブマトリクス型液晶表示装置(透過型)が完成する。なお、カバーと液晶モジュールは接着剤や有機樹脂を用いて固定する。また、透過型であるので偏光板117は、アクティブマトリクス基板と対向基板の両方に貼り付ける。   If a backlight 120 and a light guide plate 119 are provided in the liquid crystal module obtained by the above steps and covered with a cover 122, an active matrix liquid crystal display device (transmission type) as shown in FIG. ) Is completed. The cover and the liquid crystal module are fixed using an adhesive or an organic resin. Further, since it is a transmissive type, the polarizing plate 117 is attached to both the active matrix substrate and the counter substrate.

また、本実施の形態は透過型の例を示したが、特に限定されず、反射型や半透過型の液晶表示装置も作製することができる。反射型の液晶表示装置を得る場合は、画素電極として光反射率の高い金属膜、代表的にはアルミニウムまたは銀を主成分とする材料膜、またはそれらの積層膜等を用いればよい。   Although this embodiment mode shows a transmissive type example, there is no particular limitation, and a reflective or transflective liquid crystal display device can also be manufactured. In the case of obtaining a reflective liquid crystal display device, a metal film with high light reflectivity, typically a material film containing aluminum or silver as a main component, or a laminated film thereof may be used as the pixel electrode.

また、液晶表示装置には、大きく分けてパッシブ型(単純マトリクス型)とアクティブ型(アクティブマトリクス型)の2種類があり、どちらにも本発明を適用することができる。   In addition, there are two types of liquid crystal display devices, a passive type (simple matrix type) and an active type (active matrix type), and the present invention can be applied to both types.

本実施の形態は、以上の例に限定されることなく、本発明の趣旨を逸脱しない範囲において、種々の用途を満たすことが可能である。   The present embodiment is not limited to the above examples, and can satisfy various applications without departing from the spirit of the present invention.

本発明の第一の実施例について、図2、3を用いて詳細に説明する。本発明においては、従来のフォトリソグラフィ法を用いたパターニング処理を全く用いずに、インクジェット法を用いたパターニング処理によって、液晶表示装置を作成している。但し、本発明は以下の説明に限定されず、本発明の趣旨及びその範囲から逸脱することなくその詳細を様々に変更し得ることは当業者であれば容易に理解される。従って、本発明は以下に示す実施例の記載内容に限定して解釈されるものではない。尚、以下に説明する本発明の構成において、同じものを指す符号は異なる図面間で共通して用いることとする。ここでは、本発明を用いて、Nチャネル型TFT(スイッチ用)と容量を同一基板上に形成する作製工程について説明する。   A first embodiment of the present invention will be described in detail with reference to FIGS. In the present invention, a liquid crystal display device is formed by patterning using an inkjet method without using any patterning using a conventional photolithography method. However, the present invention is not limited to the following description, and it will be easily understood by those skilled in the art that various details can be changed without departing from the spirit and scope of the present invention. Therefore, the present invention should not be construed as being limited to the description of the following examples. Note that in the structure of the present invention described below, the same reference numerals are used in common in different drawings. Here, a manufacturing process in which an N-channel TFT (for a switch) and a capacitor are formed over the same substrate using the present invention will be described.

基板201には、ガラス基板、プラスチック基板に代表される可撓性基板など、本工程の処理温度に耐えうる基板を用いる(図2(A))。本実施例ではガラス基板を用いた。続いて基板201上に、絶縁膜から成る下地膜202を形成する。下地膜202は単層又は積層構造のいずれでもよく、本実施例では、2層構造として、スパッタリング法を用い、1層目として窒化酸化珪素膜を50nm、2層目として酸化窒化珪素膜を50nmの厚さに形成し、その後CMP法などの方法により表面を平坦化した。   As the substrate 201, a substrate that can withstand the processing temperature of this step such as a flexible substrate typified by a glass substrate or a plastic substrate is used (FIG. 2A). In this example, a glass substrate was used. Subsequently, a base film 202 made of an insulating film is formed on the substrate 201. The base film 202 may be either a single layer or a laminated structure. In this embodiment, a sputtering method is used as a two-layer structure, a silicon nitride oxide film is 50 nm as the first layer, and a silicon oxynitride film is 50 nm as the second layer. After that, the surface was flattened by a method such as CMP.

次いで、下地膜202上に半導体層203を形成する。半導体層203は、まず公知の方法(スパッタリング法、LPCVD法、プラズマCVD法等)により25〜80nmの厚さで半導体膜を成膜する。次いで前記半導体膜を公知の結晶化法(レーザー結晶化法、RTA又はファーネスアニール炉を用いる熱結晶化法、結晶化を助長する金属元素を用いる熱結晶化法等)を用いて結晶化させる。そして、得られた結晶質半導体膜を所望の形状にパターニングして半導体層203を形成する。なお前記半導体膜としては、非晶質半導体膜、微結晶半導体膜、結晶質半導体膜又は非晶質珪素ゲルマニウム膜などの非晶質構造を有する化合物半導体膜などを用いても良い。   Next, the semiconductor layer 203 is formed over the base film 202. The semiconductor layer 203 is first formed into a semiconductor film with a thickness of 25 to 80 nm by a known method (sputtering method, LPCVD method, plasma CVD method, or the like). Next, the semiconductor film is crystallized by using a known crystallization method (a laser crystallization method, a thermal crystallization method using an RTA or a furnace annealing furnace, a thermal crystallization method using a metal element that promotes crystallization, or the like). Then, the obtained crystalline semiconductor film is patterned into a desired shape to form a semiconductor layer 203. Note that as the semiconductor film, a compound semiconductor film having an amorphous structure such as an amorphous semiconductor film, a microcrystalline semiconductor film, a crystalline semiconductor film, or an amorphous silicon germanium film may be used.

本実施例では、プラズマCVD法を用いて、膜厚50nmの非晶質珪素膜を成膜した。その後、ニッケルを含む溶液を非晶質珪素膜上に保持させ、この非晶質珪素膜に脱水素化(500℃、1時間)を行った後、熱結晶化(550℃、4時間)を行って結晶質珪素膜を形成した。その後、インクジェット方式によってインクジェットノズル204より吐出したレジスト205のパターニングを行い、該レジストパターンをマスクとしてドライエッチング法によって半導体層203を形成した(図2(B))。   In this example, an amorphous silicon film having a thickness of 50 nm was formed by plasma CVD. Thereafter, a solution containing nickel is held on the amorphous silicon film, and after dehydrogenation (500 ° C., 1 hour) is performed on the amorphous silicon film, thermal crystallization (550 ° C., 4 hours) is performed. A crystalline silicon film was formed. After that, the resist 205 discharged from the inkjet nozzle 204 was patterned by an inkjet method, and the semiconductor layer 203 was formed by a dry etching method using the resist pattern as a mask (FIG. 2B).

なお、レーザー結晶化法で結晶質半導体膜を作製する場合のレーザーは、連続発振またはパルス発振の気体レーザー又は固体レーザーを用いれば良い。前者の気体レーザーとしては、エキシマレーザー等が挙げられ、後者の固体レーザーとしては、Cr、Nd等がドーピングされたYAG、YVO4等の結晶を使ったレーザー等が挙げられる。なお非晶質半導体膜の結晶化に際し、大粒径に結晶を得るためには、連続発振が可能な固体レーザーを用い、基本波の第2〜第4高調波を適用するのが好ましい。上記レーザーを用いる場合には、レーザー発振器から放射されたレーザービームを光学系で線状に集光して、半導体膜に照射すると良い。 Note that as a laser for forming a crystalline semiconductor film by a laser crystallization method, a continuous wave or pulsed gas laser or solid laser may be used. Examples of the former gas laser include an excimer laser, and examples of the latter solid laser include a laser using a crystal such as YAG or YVO 4 doped with Cr, Nd, or the like. In order to obtain a crystal with a large grain size when the amorphous semiconductor film is crystallized, it is preferable to use a solid-state laser capable of continuous oscillation and apply the second to fourth harmonics of the fundamental wave. In the case of using the above laser, the semiconductor film may be irradiated with a laser beam emitted from a laser oscillator in a linear shape by an optical system.

但し、本実施例では、結晶化を助長する金属元素を用いて非晶質珪素膜の結晶化を行ったため、前記金属元素が結晶質珪素膜中に残留している。そのため、前記結晶質珪素膜上に50〜100nmの非晶質珪素膜を形成し、加熱処理(RTA法、ファーネスアニール炉を用いた熱アニール等)を行って、該非晶質珪素膜中に前記金属元素を拡散させ、前記非晶質珪素膜は加熱処理後にエッチングを行って除去する。その結果、前記結晶質珪素膜中の金属元素の含有量を低減または除去することができる。また半導体層203を形成後、TFTのしきい値を制御するために微量な不純物元素(ボロン)のドーピング(チャネルドーピング)を行ってもよい。   However, in this embodiment, since the amorphous silicon film was crystallized using a metal element that promotes crystallization, the metal element remains in the crystalline silicon film. Therefore, an amorphous silicon film having a thickness of 50 to 100 nm is formed on the crystalline silicon film, and heat treatment (RTA method, thermal annealing using a furnace annealing furnace, etc.) is performed, and the amorphous silicon film Metal elements are diffused, and the amorphous silicon film is removed by etching after the heat treatment. As a result, the content of the metal element in the crystalline silicon film can be reduced or removed. In addition, after forming the semiconductor layer 203, a small amount of impurity element (boron) may be doped (channel doping) in order to control the threshold value of the TFT.

次いで、半導体層203を覆うゲート絶縁膜206を形成する。ゲート絶縁膜206はプラズマCVD法やスパッタ法を用いて、膜厚を40〜150nmとして珪素を含む絶縁膜で形成する。本実施例では、ゲート絶縁膜としてプラズマCVD法により酸化窒化珪素膜を115nmの厚さに形成した。
続いて、インクジェット方式により、減圧又は真空中で第1の導電層(ゲート配線、ゲート電極、キャパシタ電極)207を形成する(図2(C))。このときの、斜視図を図07に示す。
Next, a gate insulating film 206 that covers the semiconductor layer 203 is formed. The gate insulating film 206 is formed of an insulating film containing silicon with a thickness of 40 to 150 nm by plasma CVD or sputtering. In this embodiment, a silicon oxynitride film having a thickness of 115 nm is formed as a gate insulating film by a plasma CVD method.
Subsequently, a first conductive layer (gate wiring, gate electrode, capacitor electrode) 207 is formed by an inkjet method in reduced pressure or in vacuum (FIG. 2C). A perspective view at this time is shown in FIG.

図07において、401は基板、402は水平走査駆動回路、403は垂直走査駆動回路、404はインクヘッド、である。インクヘッド404は、1個又は複数個用いて、上下左右に基板401の表面とを平行に走査することで、溶液塗布が行われる。本構成により、所望の箇所のみに配線を塗布することができる。   In FIG. 07, 401 is a substrate, 402 is a horizontal scanning drive circuit, 403 is a vertical scanning drive circuit, and 404 is an ink head. One or a plurality of ink heads 404 are used, and solution coating is performed by scanning the surface of the substrate 401 in parallel in the vertical and horizontal directions. With this configuration, the wiring can be applied only to a desired location.

図07には、3つのノズルを有するインクヘッドを示したが、1個のノズルを有するインクヘッドを用いてもよい。また、ノズル径の異なるインクヘッドを複数用意し、用途に応じて、ノズル径の異なるインクヘッドを使い分けてもよい。なお、通常のインクヘッドのノズル径は50〜100μmであり、このノズル径にも依存するが、スループットを考慮して、一度の走査で形成できるようにするために、一行又は一列と同じ長さになるように、複数のノズルを並列に配置してもよい。また、任意の個数のノズルを配置して、複数回走査しても構わないし、また同じ箇所を複数回走査することで重ね塗りをしてもよい。さらに、インクヘッド404を走査することが好ましいが、基板401を移動させても構わない。なお、基板401とインクヘッド404との距離は、所望の箇所に滴下するために、できるだけ近づけておくことが好ましく、具体的には、0.1〜2ミリ程度が好ましい。   Although an ink head having three nozzles is shown in FIG. 07, an ink head having one nozzle may be used. Alternatively, a plurality of ink heads having different nozzle diameters may be prepared, and ink heads having different nozzle diameters may be used properly according to the application. In addition, the nozzle diameter of a normal ink head is 50 to 100 μm and depends on the nozzle diameter, but considering the throughput, in order to be able to form by one scanning, the same length as one row or one column A plurality of nozzles may be arranged in parallel so that Further, an arbitrary number of nozzles may be arranged and scanned a plurality of times, or the same portion may be scanned a plurality of times and overcoated. Further, although it is preferable to scan the ink head 404, the substrate 401 may be moved. The distance between the substrate 401 and the ink head 404 is preferably as close as possible so as to be dropped at a desired location, and specifically, about 0.1 to 2 mm is preferable.

インクヘッドから1回に吐出する組成物の量は10〜70pl、粘度は100cp以下、粒径0.1μm以下が好ましい。これは、乾燥が起こることを防ぎ、また粘度が高すぎると、吐出口から組成物を円滑に吐出できなくなったりするためである。用いる溶媒や、用途に合わせて組成物の粘度、表面張力、乾燥速度などは適宜調節する。またインクヘッドから吐出される組成物は、基板上で連続して滴下して線状又はストライプ状に形成することが好ましい。しかし、例えば1ドット毎などの所定の箇所毎に滴下してもよい。   The amount of the composition ejected from the ink head at one time is preferably 10 to 70 pl, the viscosity is 100 cp or less, and the particle size is 0.1 μm or less. This is because drying is prevented and the composition cannot be smoothly discharged from the discharge port if the viscosity is too high. The viscosity, surface tension, drying rate and the like of the composition are adjusted as appropriate according to the solvent used and the application. Moreover, it is preferable that the composition discharged from the ink head is continuously dropped on the substrate to form a linear shape or a stripe shape. However, it may be dropped at predetermined locations such as every dot.

インクヘッドから吐出する組成物は、タンタル(Ta)、タングステン(W)、チタン(Ti)、モリブデン(Mo)、アルミニウム(Al)、銅(Cu)、クロム(Cr)、Nd(ネオジム)から選択された元素、または前記元素を主成分とする合金材料若しくは化合物材料、AgPdCu合金などから適宜選択された導電性の材料を溶媒に溶解又は分散させたものを用いる。溶媒には、酢酸ブチル、酢酸エチル等のエステル類、イソプロピルアルコール、エチルアルコール等のアルコール類、メチルエチルケトン、アセトン等の有機溶剤などを用いる。溶媒の濃度は、導電性材料の種類などに適宜決定するとよい。   The composition ejected from the ink head is selected from tantalum (Ta), tungsten (W), titanium (Ti), molybdenum (Mo), aluminum (Al), copper (Cu), chromium (Cr), and Nd (neodymium). Or a conductive material appropriately selected from an alloy material or a compound material containing the above element as a main component, an AgPdCu alloy, or the like is used. As the solvent, esters such as butyl acetate and ethyl acetate, alcohols such as isopropyl alcohol and ethyl alcohol, and organic solvents such as methyl ethyl ketone and acetone are used. The concentration of the solvent may be appropriately determined depending on the type of conductive material.

また、インクヘッドから吐出する組成物として、銀(Ag)、金(Au)、白金(Pt)を粒径10nm以下で分散させた超微粒子(ナノメタル粒子)を用いてもよい。このように、粒径の微細な粒子を溶媒に分散又は溶解した組成物を用いると、ノズルの目詰まりという問題を解決することができる。なお、インクジェット方式を用いる本発明では、組成物の構成材料の粒径は、ノズルの粒径よりも小さいことが必要となる。また、ポリエチレンジオキシチオフェン/ポリスチレンスルホン酸(PEDT/PSS)水溶液などの導電性ポリマー(導電性高分子)を用いてもよい。   Further, as a composition ejected from the ink head, ultrafine particles (nanometal particles) in which silver (Ag), gold (Au), and platinum (Pt) are dispersed with a particle diameter of 10 nm or less may be used. As described above, when a composition in which fine particles having a small particle size are dispersed or dissolved in a solvent is used, the problem of nozzle clogging can be solved. In the present invention using the ink jet method, the particle size of the constituent material of the composition needs to be smaller than the particle size of the nozzle. Alternatively, a conductive polymer (conductive polymer) such as a polyethylenedioxythiophene / polystyrene sulfonic acid (PEDT / PSS) aqueous solution may be used.

また、銀または銅といった低抵抗金属を配線材料として用いると、配線抵抗の低抵抗化を図ることができるため、大型の基板を用いる場合に好ましい。しかも、これらの金属材料は通常のドライエッチング法によって加工することが難しいため、インクジェット法で直接パターニングを行うことは、極めて効果的である。但し、例えば銅などの場合には、トランジスタの電気的特性に悪影響を及ぼさないようにするために、拡散を防ぐバリア性の導電膜を設けることが好ましい。バリア性の導電膜により、トランジスタが有する半導体に銅が拡散することなく、配線を形成することができる。このバリア性の導電膜としては、窒化タンタル(TaN)、窒化チタン(TiN)又は窒化タングステン(WN)から選ばれた一種又は複数種の積層膜を用いることができる。また、銅は酸化しやすいため、配線材料として用いる際には、酸化防止剤などを併用することが好ましい。   In addition, when a low-resistance metal such as silver or copper is used as a wiring material, the wiring resistance can be reduced, which is preferable when a large substrate is used. Moreover, since it is difficult to process these metal materials by a normal dry etching method, it is extremely effective to perform patterning directly by the ink jet method. However, in the case of copper, for example, it is preferable to provide a barrier conductive film that prevents diffusion in order not to adversely affect the electrical characteristics of the transistor. With the barrier conductive film, a wiring can be formed without diffusion of copper into a semiconductor included in the transistor. As the barrier conductive film, one or more kinds of laminated films selected from tantalum nitride (TaN), titanium nitride (TiN), and tungsten nitride (WN) can be used. Also, since copper is easily oxidized, it is preferable to use an antioxidant together when used as a wiring material.

その後、第1の導電層が形成された基板に常圧または減圧、あるいは真空中で、150〜300度の範囲で加熱処理を施すことで、その溶媒を揮発させて、その組成物密度を向上させて、抵抗値が低くなるようにする。但し、インクヘッド204から吐出する組成物における溶媒は、基板に滴下後に揮発するものが適している。特にトルエンなどの揮発性の高い溶媒を用いると、組成物を基板に滴下後、揮発する。そのような場合には、加熱処理の工程は削除しても構わない。しかし、組成物の溶媒は特に限定されず、滴下後に揮発する溶媒を用いた場合であっても、加熱処理を施すことで、その組成物密度を向上させて、所望の抵抗値になるようにしてもよい。またこの加熱処理は、インクジェット方式により薄膜を形成した毎に行ってもよいし、任意の工程毎に行ってもよいし、全ての工程が終了した後に一括して行ってもよい。   Thereafter, the substrate on which the first conductive layer is formed is subjected to heat treatment in the range of 150 to 300 degrees at normal pressure, reduced pressure, or vacuum, thereby volatilizing the solvent and improving the composition density. To reduce the resistance value. However, as the solvent in the composition discharged from the ink head 204, a solvent that volatilizes after dropping on the substrate is suitable. In particular, when a highly volatile solvent such as toluene is used, the composition is volatilized after being dropped onto the substrate. In such a case, the heat treatment process may be omitted. However, the solvent of the composition is not particularly limited, and even when a solvent that volatilizes after dropping is used, the density of the composition is improved by heating treatment so that a desired resistance value is obtained. May be. Further, this heat treatment may be performed every time a thin film is formed by an ink jet method, may be performed every arbitrary step, or may be performed collectively after all steps are completed.

加熱処理は、加熱源にハロゲンなどのランプを用いて、直接基板を高速加熱するランプアニール装置や、レーザー光を照射するレーザー照射装置を用いる。両者とも加熱源を走査することで、所望の箇所のみに加熱処理を施すことができる。その他の方法として、所定の温度に設定されたファーネスアニール炉を用いてもよい。但し、ランプを用いる場合には、加熱処理を行う薄膜の組成を破壊せず、加熱のみを可能とする波長の光であり、例えば、400nmよりも波長の長い光、即ち赤外光以上の波長の光が好ましい。取り扱いの面からは、遠赤外線(代表的な波長は4〜25μm)を用いることが好ましい。またレーザー光を用いる場合、レーザー発振装置から発振されるレーザー光の基板におけるビームスポットの形状は、列又は行の長さと同じ長さになるように線状に成形することが好ましい。そうすると、一度の走査でレーザー照射を終了させることができる。本実施例では、加熱処理として、線状に成形したビームスポットを照射して行った。   The heat treatment uses a lamp annealing apparatus that directly heats the substrate at high speed using a lamp such as halogen as a heating source, or a laser irradiation apparatus that irradiates laser light. In both cases, the heat treatment can be performed only on a desired portion by scanning the heat source. As another method, a furnace annealing furnace set at a predetermined temperature may be used. However, in the case of using a lamp, it is light having a wavelength that enables heating only without destroying the composition of the thin film to be heat-treated, for example, light having a wavelength longer than 400 nm, that is, a wavelength longer than infrared light Are preferred. From the viewpoint of handling, it is preferable to use far infrared rays (typical wavelength is 4 to 25 μm). In the case of using laser light, the shape of the beam spot on the substrate of the laser light oscillated from the laser oscillation device is preferably linearly formed so as to have the same length as the column or row. If it does so, laser irradiation can be completed by one scan. In this embodiment, the heat treatment was performed by irradiating a beam spot formed in a linear shape.

続いて、ゲート電極207をマスクとして、半導体層203に、N型又はP型を付与する不純物元素を添加するドーピング処理を行う。本実施例では、半導体層203にN型を付与する不純物元素を添加し、半導体層203にP型を付与する不純物元素を添加して、不純物領域を形成した。同時に、不純物元素が全く添加されない領域又は微量の不純物元素が添加された領域(チャネル形成領域と総称)を形成した。さらに、ゲート電極205をマスクとして、ゲート絶縁膜の一部をエッチング除去し、不純物領域の半導体層表面を露出させる(図2(C))。   Subsequently, doping treatment for adding an impurity element imparting N-type or P-type to the semiconductor layer 203 is performed using the gate electrode 207 as a mask. In this example, an impurity element imparting N-type conductivity is added to the semiconductor layer 203, and an impurity element imparting P-type conductivity is added to the semiconductor layer 203, so that an impurity region is formed. At the same time, a region to which no impurity element was added or a region to which a small amount of impurity element was added (generally referred to as a channel formation region) was formed. Further, using the gate electrode 205 as a mask, a part of the gate insulating film is removed by etching to expose the surface of the semiconductor layer in the impurity region (FIG. 2C).

この後、一旦全面に厚い導電体膜208を堆積し、導電体膜上の所望の特定領域にインクジェット法によってレジストパターン209を形成する。導電体膜としては、Al, Ti, TiN等の金属、或いは炭素や導電性の有機材料なども適宜用いることができる。また、レジストパターン209の材料としては、通常の有機材料の代わりにSiO2のような無機材料や金属材料を用いることも可能である。特に、金属材料を用いれば、後述するピラーの加工後に除去せずそのまま用いることが出来る。金属材料はピラーをエッチング加工する際に選択性を有するものであれば適用することが可能である。例えば一般にドライエッチングされにくいAu,Ag,Cu,Pt等の貴金属も用いることが可能である(図2(D))。 Thereafter, a thick conductor film 208 is once deposited on the entire surface, and a resist pattern 209 is formed in a desired specific region on the conductor film by an ink jet method. As the conductor film, a metal such as Al, Ti, or TiN, carbon, a conductive organic material, or the like can be used as appropriate. Further, as a material of the resist pattern 209, an inorganic material such as SiO 2 or a metal material can be used instead of a normal organic material. In particular, if a metal material is used, it can be used as it is without being removed after the pillar processing described later. Any metal material can be used as long as it has selectivity when the pillar is etched. For example, noble metals such as Au, Ag, Cu, and Pt that are generally difficult to dry-etch can be used (FIG. 2D).

引き続き、レジストパターン209をマスクとして、異方性ドライエッチングによって導電体ピラー210を形成する。そして、絶縁膜からなる第1の層間絶縁膜211を形成する。第1の層間絶縁膜211としては、プラズマCVD法またはスパッタリング法を用い、厚さを50〜200nmとして珪素を含む絶縁膜で形成する。本実施例では、第1の層間絶縁膜211として、プラズマCVD法により膜厚100nmの酸化窒化珪素膜を形成した。   Subsequently, the conductive pillar 210 is formed by anisotropic dry etching using the resist pattern 209 as a mask. Then, a first interlayer insulating film 211 made of an insulating film is formed. The first interlayer insulating film 211 is formed of an insulating film containing silicon with a thickness of 50 to 200 nm by using a plasma CVD method or a sputtering method. In this example, a silicon oxynitride film having a thickness of 100 nm was formed as the first interlayer insulating film 211 by a plasma CVD method.

次いで、第1の層間絶縁膜211上に、第2の層間絶縁膜212を形成する。第2の層間絶縁膜212としては、CVD法によって形成された酸化珪素膜、SOG(Spin On Glass)法又はスピンコート法によって塗布された酸化珪素膜、アクリル等の有機絶縁膜又は非感光性の有機絶縁膜が0.7〜5μmの厚さで形成する。本実施例では、CVD法で膜厚1.6μmのアクリル膜を形成した。なお第2の層間絶縁膜212は、基板200上に形成されたTFTによる凹凸を緩和し、平坦化する意味合いが強いので、平坦性に優れた膜が好ましい。さらに、第3の層間絶縁膜213となる窒化珪素膜を0.1μmの厚さで形成する。 Next, a second interlayer insulating film 212 is formed on the first interlayer insulating film 211. As the second interlayer insulating film 212, a silicon oxide film formed by a CVD method, a silicon oxide film applied by an SOG (Spin On Glass) method or a spin coating method, an organic insulating film such as acrylic, or a non-photosensitive material The organic insulating film is formed with a thickness of 0.7 to 5 μm. In this example, an acrylic film having a film thickness of 1.6 μm was formed by the CVD method. Note that the second interlayer insulating film 212 is preferably a film having excellent flatness because it has a strong meaning of alleviating unevenness due to TFTs formed over the substrate 200 and flattening. Further, a silicon nitride film to be the third interlayer insulating film 213 is formed with a thickness of 0.1 μm.

この後、第3の層間絶縁膜(窒化珪素膜)213、第2の層間絶縁膜(アクリル膜)212、第1の層間絶縁膜(酸化珪素膜)211を順次エッチバックすることによって、前記導電体ピラー210の頂部を露出させる。しかる後、インクジェット方式により、第2の導電層(ソース配線、ドレイン配線)214を前記導電体ピラー210に接するように形成する。このときの断面図を図3(A)に示す。   Thereafter, the third interlayer insulating film (silicon nitride film) 213, the second interlayer insulating film (acrylic film) 212, and the first interlayer insulating film (silicon oxide film) 211 are sequentially etched back, thereby the conductive layer. The top of the body pillar 210 is exposed. Thereafter, the second conductive layer (source wiring, drain wiring) 214 is formed in contact with the conductor pillar 210 by an inkjet method. A cross-sectional view at this time is shown in FIG.

インクヘッドから吐出する組成物は、第1の導電層と同様に、導電性の材料を溶媒に溶解又は分散させたものを用いて、単層又は積層構造で作成する。なお、第2の導電層を形成する場合には、吐出する組成物の粘度を最適な値に設定することが必要である。本実施例では、第2の導電層214を3層構造として、1層目をチタン、2層目を銀とした。続いて、加熱処理を行う。ここまでの工程により、絶縁表面を有する基板201上にトランジスタを形成することができた。 The composition ejected from the ink head is formed in a single layer or a laminated structure using a material obtained by dissolving or dispersing a conductive material in a solvent, similarly to the first conductive layer. When forming the second conductive layer, it is necessary to set the viscosity of the composition to be discharged to an optimum value. In this embodiment, the second conductive layer 214 has a three-layer structure, and the first layer is titanium and the second layer is silver. Subsequently, heat treatment is performed. Through the above steps, a transistor can be formed over the substrate 201 having an insulating surface.

続いて、全面に第2の導電層214と電気的に接続されるように、透明導電体からなる画素電極215を形成する(図3(B))。画素電極215には、一例として、酸化インジウムと酸化スズの化合物(ITO)、酸化インジウムと酸化亜鉛の化合物、酸化亜鉛、酸化スズ、酸化インジウム、窒化チタンなどが挙げられる。本実施例では画素電極215として、インクジェット法で、0.1μmの厚さでITO膜を形成した(図3(B))。 Subsequently, a pixel electrode 215 made of a transparent conductor is formed so as to be electrically connected to the second conductive layer 214 on the entire surface (FIG. 3B). Examples of the pixel electrode 215 include a compound of indium oxide and tin oxide (ITO), a compound of indium oxide and zinc oxide, zinc oxide, tin oxide, indium oxide, and titanium nitride. In this embodiment, an ITO film having a thickness of 0.1 μm is formed as the pixel electrode 215 by an inkjet method (FIG. 3B).

以上、画素部においてはソース配線と、画素部のTFT及び保持容量と、端子部で構成されたアクティブマトリクス基板を作製することができる。
この後、共通電極216、カラーフィルタ217、ブラックマトリックス218などが形成された対向基板219と貼り合わせる。そして所定の方法で液晶220を注入し、液晶表示装置を完成する。(図3(C))。なお、ここでは、バックライト等の取り付け工程は省略した。
以上、本発明の第1の実施例について、アクティブマトリックス型の液晶表示装置について説明したが、本実施実施例に限定されることなく、本発明の趣旨に基づき適用が可能となる。例えば、実施例2で示すように、アクティブマトリックス型有機EL表示装置の場合についても同様に適用することが可能である。また、本発明例で取り上げた材料、形成方法に関しても、本発明の趣旨に則り適宜選択して用いることが可能である。
As described above, an active matrix substrate including a source wiring, a TFT and a storage capacitor of the pixel portion, and a terminal portion can be manufactured in the pixel portion.
After that, it is bonded to the counter substrate 219 on which the common electrode 216, the color filter 217, the black matrix 218, and the like are formed. Then, the liquid crystal 220 is injected by a predetermined method to complete the liquid crystal display device. (FIG. 3C). Here, the attaching process of the backlight or the like is omitted.
As described above, the active matrix type liquid crystal display device has been described with respect to the first embodiment of the present invention. However, the present invention is not limited to this embodiment, and can be applied based on the gist of the present invention. For example, as shown in the second embodiment, the present invention can be similarly applied to an active matrix organic EL display device. Further, the materials and forming methods taken up in the examples of the present invention can be appropriately selected and used in accordance with the gist of the present invention.

本発明の第二の実施例について、図4〜6を用いて詳細に説明する。本発明においては、従来のフォトリソグラフィ法を用いたパターニング処理を全く用いずに、インクジェット法を用いたパターニング処理によって、EL表示装置を作成している。但し、本発明は以下の説明に限定されず、本発明の趣旨及びその範囲から逸脱することなくその詳細を様々に変更し得ることは当業者であれば容易に理解される。従って、本発明は以下に示す実施例の記載内容に限定して解釈されるものではない。尚、以下に説明する本発明の構成において、同じものを指す符号は異なる図面間で共通して用いることとする。ここでは、本発明を用いて、Nチャネル型TFT(スイッチ用)と2つのPチャネル型TFT(駆動用)を同一基板上に形成するEL表示装置の作製工程について説明する。   A second embodiment of the present invention will be described in detail with reference to FIGS. In the present invention, an EL display device is formed by patterning using an inkjet method without using any patterning using a conventional photolithography method. However, the present invention is not limited to the following description, and it will be easily understood by those skilled in the art that various details can be changed without departing from the spirit and scope of the present invention. Therefore, the present invention should not be construed as being limited to the description of the following examples. Note that in the structure of the present invention described below, the same reference numerals are used in common in different drawings. Here, a manufacturing process of an EL display device in which an N-channel TFT (for switching) and two P-channel TFTs (for driving) are formed over the same substrate using the present invention will be described.

基板301には、ガラス基板、プラスチック基板に代表される可撓性基板など、本工程の処理温度に耐えうる基板を用いる(図4(A))。本実施例ではガラス基板を用いた。続いて基板301上に、絶縁膜から成る下地膜302を形成する。下地膜302は単層又は積層構造のいずれでもよく、本実施例では、2層構造として、スパッタリング法を用い、1層目として窒化酸化珪素膜を50nm、2層目として酸化窒化珪素膜を50nmの厚さに形成し、その後CMP法などの方法により表面を平坦化した(図4(A))。   As the substrate 301, a substrate that can withstand the processing temperature in this step, such as a flexible substrate typified by a glass substrate or a plastic substrate, is used (FIG. 4A). In this example, a glass substrate was used. Subsequently, a base film 302 made of an insulating film is formed on the substrate 301. The base film 302 may be either a single layer or a laminated structure. In this embodiment, a sputtering method is used as a two-layer structure, a silicon nitride oxide film is 50 nm as the first layer, and a silicon oxynitride film is 50 nm as the second layer. After that, the surface was flattened by a method such as CMP (FIG. 4A).

次いで、下地膜302上に半導体層303を形成する。半導体層303は、まず公知の方法(スパッタリング法、LPCVD法、プラズマCVD法等)により25〜80nmの厚さで半導体膜を成膜する。次いで前記半導体膜を公知の結晶化法(レーザー結晶化法、RTA又はファーネスアニール炉を用いる熱結晶化法、結晶化を助長する金属元素を用いる熱結晶化法等)を用いて結晶化させる。そして、得られた結晶質半導体膜を所望の形状にパターニングして半導体層303を形成する。なお前記半導体膜としては、非晶質半導体膜、微結晶半導体膜、結晶質半導体膜又は非晶質珪素ゲルマニウム膜などの非晶質構造を有する化合物半導体膜などを用いても良い。   Next, a semiconductor layer 303 is formed over the base film 302. As the semiconductor layer 303, a semiconductor film is first formed to a thickness of 25 to 80 nm by a known method (sputtering method, LPCVD method, plasma CVD method, or the like). Next, the semiconductor film is crystallized by using a known crystallization method (a laser crystallization method, a thermal crystallization method using an RTA or a furnace annealing furnace, a thermal crystallization method using a metal element that promotes crystallization, or the like). Then, the obtained crystalline semiconductor film is patterned into a desired shape to form a semiconductor layer 303. Note that as the semiconductor film, a compound semiconductor film having an amorphous structure such as an amorphous semiconductor film, a microcrystalline semiconductor film, a crystalline semiconductor film, or an amorphous silicon germanium film may be used.

第一の実施例と同様にして、プラズマCVD法を用いて、膜厚50nmの非晶質珪素膜を成膜した。その後、ニッケルを含む溶液を非晶質珪素膜上に保持させ、この非晶質珪素膜に脱水素化(500℃、1時間)を行った後、熱結晶化(550℃、4時間)を行って結晶質珪素膜を形成した。その後、インクジェット方式によってインクジェットノズル304より吐出したレジスト305のパターニングを行い、ここでパターニングしたレジスト305をマスクとしてドライエッチング法によって半導体層303を形成した(図4(B))
続いて、ゲート絶縁膜306を形成する。ゲート絶縁膜306はプラズマCVD法により酸化窒化珪素膜を115nmの厚さに形成した(図4(C))。
In the same manner as in the first example, an amorphous silicon film having a thickness of 50 nm was formed by plasma CVD. Thereafter, a solution containing nickel is held on the amorphous silicon film, and after dehydrogenation (500 ° C., 1 hour) is performed on the amorphous silicon film, thermal crystallization (550 ° C., 4 hours) is performed. A crystalline silicon film was formed. After that, the resist 305 discharged from the inkjet nozzle 304 is patterned by an inkjet method, and the semiconductor layer 303 is formed by a dry etching method using the patterned resist 305 as a mask (FIG. 4B).
Subsequently, a gate insulating film 306 is formed. As the gate insulating film 306, a silicon oxynitride film was formed to a thickness of 115 nm by a plasma CVD method (FIG. 4C).

続いて、インクジェット方式により、減圧又は真空中で第1の導電層(ゲート配線、ゲート電極)307を形成する。(図4(D))   Subsequently, a first conductive layer (gate wiring, gate electrode) 307 is formed by reduced pressure or vacuum by an inkjet method. (Fig. 4 (D))

その後、第1の導電層が形成された基板に常圧または減圧、あるいは真空中で、150〜300度の範囲で加熱処理を施すことで、その溶媒を揮発させ良好な導電特性を得る。但し、インクヘッドノズル304から吐出する組成物における溶媒は、基板に滴下後に揮発するものが適している。特にトルエンなどの揮発性の高い溶媒を用いると、組成物を基板に滴下後、揮発する。そのような場合には、加熱処理の工程は削除しても構わない。しかし、組成物の溶媒は特に限定されず、滴下後に揮発する溶媒を用いた場合であっても、加熱処理を施すことで、その組成物の粘度を低下させて、所望の粘度になるようにしてもよい。またこの加熱処理は、インクジェット方式により薄膜を形成した毎に行ってもよいし、任意の工程毎に行ってもよいし、全ての工程が終了した後に一括して行ってもよい。   Thereafter, the substrate on which the first conductive layer is formed is subjected to heat treatment in the range of 150 to 300 degrees under normal pressure, reduced pressure, or vacuum, whereby the solvent is volatilized to obtain good conductive characteristics. However, as the solvent in the composition discharged from the ink head nozzle 304, a solvent that volatilizes after dropping onto the substrate is suitable. In particular, when a highly volatile solvent such as toluene is used, the composition is volatilized after being dropped onto the substrate. In such a case, the heat treatment process may be omitted. However, the solvent of the composition is not particularly limited, and even when a solvent that volatilizes after dropping is used, the viscosity of the composition is lowered to a desired viscosity by performing heat treatment. May be. Further, this heat treatment may be performed every time a thin film is formed by an ink jet method, may be performed every arbitrary step, or may be performed collectively after all steps are completed.

さらに、ゲート電極307をマスクとして、半導体層303に、N型又はP型を付与する不純物元素を添加するドーピング処理を行う。本実施例では、半導体層303にN型を付与する不純物元素を添加し、半導体層303にP型を付与する不純物元素を添加して、不純物領域を形成した。同時に、不純物元素が全く添加されない領域又は微量の不純物元素が添加された領域(チャネル形成領域と総称)を形成した。さらに、ゲート電極307をマスクとして、ゲート絶縁膜の一部をエッチング除去し、不純物領域の半導体層303の表面を露出させる。   Further, doping treatment for adding an impurity element imparting N-type or P-type to the semiconductor layer 303 is performed using the gate electrode 307 as a mask. In this embodiment, an impurity region is formed by adding an impurity element imparting n-type conductivity to the semiconductor layer 303 and adding an impurity element imparting p-type conductivity to the semiconductor layer 303. At the same time, a region to which no impurity element was added or a region to which a small amount of impurity element was added (generally referred to as a channel formation region) was formed. Further, using the gate electrode 307 as a mask, part of the gate insulating film is removed by etching to expose the surface of the semiconductor layer 303 in the impurity region.

この後、一旦全面に厚い導電体膜308を堆積し、導電体膜308上の所望の特定領域にインクジェット法によってレジストパターン309を形成する。導電体膜308としては、Al, Ti, TiN等の金属、或いは炭素や導電性の有機材料なども適宜用いることができる。(図5(A)) Thereafter, a thick conductor film 308 is once deposited on the entire surface, and a resist pattern 309 is formed in a desired specific region on the conductor film 308 by an ink jet method. As the conductor film 308, a metal such as Al, Ti, or TiN, carbon, a conductive organic material, or the like can be used as appropriate. (Fig. 5 (A))

引き続き、レジストパターン309をマスクとして、異方性ドライエッチングによって導電体ピラー310を形成する。そして、絶縁膜からなる第1の層間絶縁膜311を形成する(図5(B))。第1の層間絶縁膜311としては、プラズマCVD法またはスパッタリング法を用い、厚さを50〜200nmとして珪素を含む絶縁膜で形成する。本実施例では、プラズマCVD法により膜厚100nmの酸化窒化珪素膜を形成した。 Subsequently, the conductive pillar 310 is formed by anisotropic dry etching using the resist pattern 309 as a mask. Then, a first interlayer insulating film 311 made of an insulating film is formed (FIG. 5B). The first interlayer insulating film 311 is formed of an insulating film containing silicon with a thickness of 50 to 200 nm by using a plasma CVD method or a sputtering method. In this embodiment, a silicon oxynitride film having a thickness of 100 nm is formed by plasma CVD.

続いて、第1の層間絶縁膜(酸化窒化珪素膜)311上に、第2の層間絶縁膜312を形成する。第2の層間絶縁膜312としては、CVD法によって形成された酸化珪素膜、SOG(Spin On Glass)法又はスピンコート法によって塗布された酸化珪素膜、アクリル等の有機絶縁膜又は非感光性の有機絶縁膜が0.7〜5μmの厚さで形成する。本実施例では、CVD法で膜厚1.6μmのアクリル膜を形成した。なお第2の層間絶縁膜312は、基板301上に形成されたTFTによる凹凸を緩和し、平坦化する意味合いが強いので、平坦性に優れた膜が好ましい。(図5(B)) Subsequently, a second interlayer insulating film 312 is formed over the first interlayer insulating film (silicon oxynitride film) 311. As the second interlayer insulating film 312, a silicon oxide film formed by a CVD method, a silicon oxide film applied by an SOG (Spin On Glass) method or a spin coating method, an organic insulating film such as acrylic, or a non-photosensitive material The organic insulating film is formed with a thickness of 0.7 to 5 μm. In this example, an acrylic film having a film thickness of 1.6 μm was formed by the CVD method. Note that the second interlayer insulating film 312 is preferably a film having excellent flatness because it has a strong meaning of alleviating unevenness due to the TFT formed on the substrate 301 and flattening. (Fig. 5 (B))

第1乃至第3層間絶縁膜311、312、315をそれぞれ設けることにより、酸素や空気中の水分をはじめ各種イオン性の不純物の侵入を阻止するブロッキング作用を得ることができる。 By providing the first to third interlayer insulating films 311, 312, and 315, it is possible to obtain a blocking action that prevents entry of various ionic impurities including oxygen and moisture in the air.

この後、第2の層間絶縁膜(アクリル膜)312、および第1の層間絶縁膜(酸化窒化珪素膜)311を順次エッチバックすることによって、導電体ピラー310の頂部を露出させる。しかる後、インクジェット方式により、第2の導電層(ソース配線、ドレイン配線)313を導電体ピラー310に接するように形成する。このときの断面図を図5(C)に示す。 Thereafter, the second interlayer insulating film (acrylic film) 312 and the first interlayer insulating film (silicon oxynitride film) 311 are sequentially etched back to expose the top portion of the conductor pillar 310. Thereafter, the second conductive layer (source wiring, drain wiring) 313 is formed in contact with the conductor pillar 310 by an inkjet method. A cross-sectional view at this time is shown in FIG.

インクヘッドから吐出する組成物は、第1の導電層と同様に、導電性の材料を溶媒に溶解又は分散させたものを用いて、単層又は積層構造で作成する。本実施例では、第2の導電層313を2層構造として、1層目をチタン、2層目をCuとした。続いて、加熱処理を行う。 The composition ejected from the ink head is formed in a single layer or a laminated structure using a material obtained by dissolving or dispersing a conductive material in a solvent, similarly to the first conductive layer. In this embodiment, the second conductive layer 313 has a two-layer structure, and the first layer is titanium and the second layer is Cu. Subsequently, heat treatment is performed.

この後、さらに同様にして一旦全面に厚い導電体膜を堆積し、この導電体層上の所望の特定領域にインクジェット法によってレジストパターンを形成した後、ここで形成したレジストパターンをマスクとして、異方性ドライエッチングによって導電体ピラー314を形成する。同様にして、導電体膜としては、Al, Ti, TiN等の金属、或いは炭素や導電性の有機材料なども適宜用いることができる。また、この場合のレジストの材料としても、通常の有機材料の代わりにSiO2のような無機材料や金属材料を用いることも可能である。特に、金属材料を用いれば、後述する導電体ピラーの加工後に除去せずそのまま用いることが出来る。金属材料はピラーをエッチング加工する際に選択性を有するものであれば適用することが可能である。例えば一般にドライエッチングされにくいAu,Ag,Cu,Pt等の貴金属も用いることが可能である。 Thereafter, in the same manner, a thick conductor film is once deposited on the entire surface, a resist pattern is formed on a desired specific region on the conductor layer by an ink jet method, and the resist pattern formed here is used as a mask. Conductive pillars 314 are formed by isotropic dry etching. Similarly, a metal such as Al, Ti, or TiN, carbon, or a conductive organic material can be used as appropriate as the conductor film. Further, as a resist material in this case, an inorganic material such as SiO 2 or a metal material can be used instead of a normal organic material. In particular, when a metal material is used, it can be used as it is without being removed after processing of a conductor pillar described later. Any metal material can be used as long as it has selectivity when the pillar is etched. For example, noble metals such as Au, Ag, Cu, and Pt that are generally difficult to dry-etch can be used.

続いて、全面に第3の層間絶縁膜316を形成する。第3の層間絶縁膜316は、スパッタリング法で、窒化珪素膜または窒化酸化珪素膜を0.1〜0.2μmの厚さで形成する。本実施例では、第3の層間絶縁膜316として、窒化珪素膜をスパッタリング法を用いて0.1μmの厚さに形成した。第3の層間絶縁膜316を設けることにより、酸素や空気中の水分をはじめ各種イオン性の不純物の侵入を阻止するブロッキング作用を得ることができる。さらに、全面に、第4の層間絶縁膜315を形成する。第4の層間絶縁膜315としては、CVD法によって形成された酸化珪素膜、SOG(Spin On Glass)法又はスピンコート法によって塗布された酸化珪素膜、アクリル等の有機絶縁膜又は非感光性の有機絶縁膜を0.7〜5μmの厚さで形成する。本実施例では、スピンコート法で膜厚1.6μmのアクリル膜を形成した。なお第4の層間絶縁膜315は、平坦性に優れた膜であればよく、アクリル膜以外にもシロキサン(珪素と酸素との結合で骨格構造が構成され、置換基に少なくとも水素を含む材料、フッ素、アルキル基、または芳香族炭化水素のうち少なくとも一種を有する物質が含まれる物質)、TOF膜、無機層間絶縁膜、low-k(低誘電率)材料を用いた膜などを用いることができる。   Subsequently, a third interlayer insulating film 316 is formed on the entire surface. As the third interlayer insulating film 316, a silicon nitride film or a silicon nitride oxide film is formed with a thickness of 0.1 to 0.2 μm by a sputtering method. In this embodiment, as the third interlayer insulating film 316, a silicon nitride film is formed to a thickness of 0.1 μm by a sputtering method. By providing the third interlayer insulating film 316, it is possible to obtain a blocking action that prevents intrusion of various ionic impurities including oxygen and moisture in the air. Further, a fourth interlayer insulating film 315 is formed on the entire surface. As the fourth interlayer insulating film 315, a silicon oxide film formed by a CVD method, a silicon oxide film applied by an SOG (Spin On Glass) method or a spin coating method, an organic insulating film such as acrylic, or a non-photosensitive material An organic insulating film is formed with a thickness of 0.7 to 5 μm. In this example, an acrylic film having a thickness of 1.6 μm was formed by spin coating. Note that the fourth interlayer insulating film 315 may be a film having excellent flatness, and other than an acrylic film, siloxane (a material in which a skeleton structure is formed by a bond of silicon and oxygen, and a substituent includes at least hydrogen, A substance including a substance having at least one of fluorine, an alkyl group, and an aromatic hydrocarbon), a TOF film, an inorganic interlayer insulating film, a film using a low-k (low dielectric constant) material, and the like can be used. .

この後、第4の層間絶縁膜(アクリル膜)315、および第3の層間絶縁膜(窒化珪素膜)316を順次エッチバックすることによって、導電体ピラー314の頂部を露出させる。このときの断面図を図5(D)に示す。 Thereafter, the top portion of the conductor pillar 314 is exposed by sequentially etching back the fourth interlayer insulating film (acrylic film) 315 and the third interlayer insulating film (silicon nitride film) 316. A cross-sectional view at this time is shown in FIG.

しかる後、インクジェット方式により、第3の導電層(ソース配線、ドレイン配線)317を導電体ピラー314に接するように形成する。   Thereafter, a third conductive layer (source wiring, drain wiring) 317 is formed in contact with the conductor pillar 314 by an inkjet method.

続いて、全面に駆動用TFTの配線と電気的に接続されるように、透明導電体からなる第1の画素電極318を形成する(図6(A))。第1の画素電極318としては、仕事関数の大きい材料を用いて作製することが望ましく、一例としては、酸化インジウムと酸化スズの化合物(ITO)、酸化インジウムと酸化亜鉛の化合物、酸化亜鉛、酸化スズ、酸化インジウム、窒化チタンなどが挙げられる。本実施例では第1の画素電極318として、インクジェット法で、0.1μmの厚さでITO膜を形成する。(図6(A)) Subsequently, a first pixel electrode 318 made of a transparent conductor is formed over the entire surface so as to be electrically connected to the wiring of the driving TFT (FIG. 6A). The first pixel electrode 318 is preferably manufactured using a material having a high work function. Examples of the first pixel electrode 318 include a compound of indium oxide and tin oxide (ITO), a compound of indium oxide and zinc oxide, zinc oxide, and oxidation. Examples thereof include tin, indium oxide, and titanium nitride. In this embodiment, an ITO film having a thickness of 0.1 μm is formed as the first pixel electrode 318 by an inkjet method. (Fig. 6 (A))

しかる後、有機ELによる発光素子の形成工程に入ることになる。第1の画素電極318の端面を覆うように絶縁膜を形成する。絶縁膜を形成する材料は特に限定されず、無機又は有機の材料で形成することができる。この後、発光層となる有機ELを含む領域を形成することになるが、第1の画素電極318と接するように発光層320を減圧又は真空中で順次形成する(図6(B))。発光層320の材料は特に限定されるものではないが、カラー表示を行う場合には、赤、緑、青の各色の材料を用いる。ついで、第2の画素電極(陰極)321を減圧又は真空中で蒸着法により形成する(図6(C))。   Thereafter, a process for forming a light emitting element by organic EL is started. An insulating film is formed so as to cover the end face of the first pixel electrode 318. The material for forming the insulating film is not particularly limited, and the insulating film can be formed using an inorganic or organic material. After that, a region including an organic EL serving as a light-emitting layer is formed. The light-emitting layer 320 is sequentially formed under reduced pressure or in vacuum so as to be in contact with the first pixel electrode 318 (FIG. 6B). The material of the light emitting layer 320 is not particularly limited, but when performing color display, materials of each color of red, green, and blue are used. Next, a second pixel electrode (cathode) 321 is formed by evaporation in a reduced pressure or vacuum (FIG. 6C).

第2の画素電極(陰極)321は、仕事関数の小さい金属(リチウム(Li)、マグネシウム(Mg)、セシウム(Cs))を含む薄膜、Li、Mg等を含む薄膜上に積層した透明導電膜との積層膜で形成する。膜厚は陰極として作用するように適宜設定すればよいが、0.01〜1μm程度の厚さで形成する。本実施例では、第2の画素電極321としてアルミニウムとリチウムの合金膜(Al-Li)を0.1μmの厚さで形成した。なお第2の画素電極321は、全面に成膜する。   The second pixel electrode (cathode) 321 is a transparent conductive film stacked on a thin film containing a metal having a low work function (lithium (Li), magnesium (Mg), cesium (Cs)), or a thin film containing Li, Mg, or the like. And a laminated film. The film thickness may be appropriately set so as to act as a cathode, but is formed with a thickness of about 0.01 to 1 μm. In this embodiment, an aluminum-lithium alloy film (Al—Li) is formed to a thickness of 0.1 μm as the second pixel electrode 321. Note that the second pixel electrode 321 is formed over the entire surface.

陰極として良く用いられる金属膜は、周期律表の1族若しくは2族に属する元素を含む金属膜であるが、これらの金属膜は酸化しやすいので表面を保護しておくことが望ましい。また、必要な膜厚も薄いため、抵抗率の低い導電膜を補助的に設けて陰極の抵抗を下げ、加えて陰極の保護を図るとよい。抵抗率の低い導電膜としてはアルミニウム、銅又は銀を主成分とする金属膜が用いられる。   A metal film often used as a cathode is a metal film containing an element belonging to Group 1 or Group 2 of the periodic table. However, since these metal films are easily oxidized, it is desirable to protect the surface. In addition, since the necessary film thickness is thin, it is preferable to provide a conductive film having a low resistivity to lower the resistance of the cathode and to protect the cathode. As the conductive film having a low resistivity, a metal film containing aluminum, copper, or silver as a main component is used.

発光層320と第2の画素電極321の形成は、インクヘッドノズル304から吐出される組成物の変更、又は組成物が充填されたインクヘッドノズル304の変更により実現する。この場合、大気開放されることなく行うことができるため、水分などに弱い発光素子の高信頼性につながる。吐出された組成物の粘度を所望の値(50cp以下)とするために、150〜300度の範囲で加熱処理を行う。   The formation of the light emitting layer 320 and the second pixel electrode 321 is realized by changing the composition ejected from the ink head nozzle 304 or changing the ink head nozzle 304 filled with the composition. In this case, since it can be performed without being exposed to the atmosphere, it leads to high reliability of a light-emitting element that is weak against moisture or the like. In order to set the viscosity of the discharged composition to a desired value (50 cp or less), heat treatment is performed in the range of 150 to 300 degrees.

これまでの工程において形成された、第1の画素電極318、発光層320及び第2の電極321の積層体が発光素子、すなわち画素部に相当する。第1の画素電極321は陽極、第2の画素電極321は陰極に相当する。発光素子の励起状態には一重項励起と三重項励起があるが、発光はどちらの励起状態を経てもよい。   A stacked body of the first pixel electrode 318, the light emitting layer 320, and the second electrode 321 formed in the above steps corresponds to a light emitting element, that is, a pixel portion. The first pixel electrode 321 corresponds to an anode, and the second pixel electrode 321 corresponds to a cathode. There are singlet excitation and triplet excitation in the excited state of the light-emitting element, and light emission may pass through either excited state.

本実施例では、発光素子から発せられる光を基板301側(底面)側から取り出す、所謂下面出射を行う場合を示した。しかし、基板301の表面から光を取り出す、所謂上面出射を行うようにしてもよい。その場合、第1の画素電極318を陰極、第2の画素電極321を陽極に相当するように形成し、さらに第2の画素電極321は透明材料で形成するとよい。また、駆動用TFTはNチャネル型TFTで形成することが好ましい。なお、駆動用TFTの導電型は適宜変更しても構わないが、容量素子は該駆動用TFTのゲート・ソース間電圧を保持するように配置する。なお本実施例では、発光素子を用いた表示装置の場合を例示したが、液晶素子を用いた液晶表示装置やその他の表示装置に本発明を適用してもよい。   In this embodiment, the case where so-called bottom emission is performed in which light emitted from the light emitting element is extracted from the substrate 301 side (bottom surface) side is shown. However, so-called top emission, in which light is extracted from the surface of the substrate 301, may be performed. In that case, the first pixel electrode 318 may be formed as a cathode, the second pixel electrode 321 may be formed as an anode, and the second pixel electrode 321 may be formed of a transparent material. The driving TFT is preferably formed of an N-channel TFT. Note that the conductivity type of the driving TFT may be changed as appropriate, but the capacitor is arranged so as to hold the gate-source voltage of the driving TFT. Note that in this embodiment, the case of a display device using a light emitting element is illustrated, but the present invention may be applied to a liquid crystal display device using a liquid crystal element and other display devices.

上記構成を有する本発明は、基板の大型化に対応可能で、スループットや材料の利用効率を向上させた配線、導電層及び表示装置の作製方法を提供することができる。   The present invention having the above structure can provide a method for manufacturing a wiring, a conductive layer, and a display device that can cope with an increase in the size of a substrate and has improved throughput and material utilization efficiency.

本実施例では、実施例2で形成した発光素子を有する、発光表示モジュールの断面図を、図8を用いて示す。   In this example, a cross-sectional view of a light-emitting display module including the light-emitting element formed in Example 2 is shown with reference to FIG.

図8(A)は、アクティブマトリクス基板801と対向基板802とが、シール剤800により固着された発光表示モジュールの断面を示しており、これらの間には画素部803とが設けられ表示領域を形成している。 FIG. 8A shows a cross section of a light-emitting display module in which an active matrix substrate 801 and a counter substrate 802 are fixed to each other with a sealant 800, and a pixel portion 803 is provided between them to display a display region. Forming.

対向基板802と、画素部803との間には、空間804が形成される。空間804には、不活性ガス、例えば窒素ガスを充填したり、吸水性の高い材料を有する透光性樹脂を形成して、さらに水分や酸素の侵入の防止を高めることができる。また透光性を有し、吸水性の高い樹脂を形成してもよい。透光性を有する樹脂により、発光素子からの光が第2の基板側へ出射される場合であっても、透過率を低減することなく形成することができる。 A space 804 is formed between the counter substrate 802 and the pixel portion 803. The space 804 can be filled with an inert gas such as nitrogen gas, or a light-transmitting resin including a material with high water absorption can be formed to further prevent moisture and oxygen from entering. Further, a resin having translucency and high water absorption may be formed. Even when light from the light-emitting element is emitted to the second substrate side with the light-transmitting resin, the resin can be formed without reducing transmittance.

また、コントランスを高めるため、モジュールの少なくとも画素部に偏光板、又は円偏光板(偏光板、1/4λ板及び1/2λ板)を備えるとよい。対向基板802側から表示を認識する場合、封止基板側から順に、1/4λ板及び1/2λ板805、偏光板806を設けるとよい。さらに偏光板上に反射防止膜を設けてもよい。 In order to increase the contrast, at least the pixel portion of the module may be provided with a polarizing plate or a circular polarizing plate (a polarizing plate, a 1 / 4λ plate and a 1 / 2λ plate). In the case where the display is recognized from the counter substrate 802 side, a ¼λ plate, a ½λ plate 805, and a polarizing plate 806 are preferably provided in this order from the sealing substrate side. Further, an antireflection film may be provided on the polarizing plate.

また、対向基板802及びアクティブマトリクス基板801の両方から表示を認識する場合、アクティブマトリクス基板の表面にも同様に、1/4λ板及び1/2λ板、偏光板を設けるとよい。 In addition, in the case where display is recognized from both the counter substrate 802 and the active matrix substrate 801, a 1 / 4λ plate, a 1 / 2λ plate, and a polarizing plate may be similarly provided on the surface of the active matrix substrate.

アクティブマトリクス基板801に設けられた接続端子808には、FPC809を介して配線基板810が接続されている。FPC又は接続配線には画素駆動回路(ICチップ、ドライバIC等)811が設けられ、配線基板810には、コントロール回路や電源回路などの外部回路812が組み込まれている。   A wiring board 810 is connected to a connection terminal 808 provided on the active matrix substrate 801 through an FPC 809. A pixel driving circuit (IC chip, driver IC, or the like) 811 is provided in the FPC or connection wiring, and an external circuit 812 such as a control circuit or a power supply circuit is incorporated in the wiring substrate 810.

また、図8(B)に示すように、画素部803と偏光板の間、又は画素部と円偏光板の間に着色層807を設けることができる。この場合、画素部に白色発光が可能な発光素子を設け、RGBを示す着色層を別途設けることでフルカラー表示することができる。また、画素部に青色発光が可能な発光素子を設け、色変換層などを別途設けることによってフルカラー表示することができる。また、各画素部、赤色、緑色、青色の発光を示す発光素子を形成し、且つ着色層を用いることもできる。このような表示モジュールは、各RBGの色純度が高く、高精細な表示が可能となる。 In addition, as illustrated in FIG. 8B, a colored layer 807 can be provided between the pixel portion 803 and the polarizing plate or between the pixel portion and the circularly polarizing plate. In this case, a full color display can be performed by providing a light emitting element capable of emitting white light in the pixel portion and separately providing a colored layer showing RGB. Further, full color display can be performed by providing a light emitting element capable of emitting blue light in the pixel portion and separately providing a color conversion layer or the like. In addition, each pixel portion, a light emitting element that emits red, green, and blue light can be formed, and a colored layer can be used. Such a display module has high color purity of each RBG and enables high-definition display.

図8(C)においては、図8(A)と異なり、対向基板を用いずフィルム又は樹脂等の保護膜821を用いてアクティブマトリクス基板及び発光素子を封止する場合を示す。画素部803の第2の画素電極を覆って、保護膜821が設けられている。第2の保護膜として、エポキシ樹脂、ウレタン樹脂、又はシリコーン樹脂等の有機材料を用いることができる。また第2の保護膜は、液滴吐出法によりポリマー材料を滴下して形成してもよい。本実施の形態では、ディスペンサを用いてエポキシ樹脂を吐出し、乾燥させる。さらに保護膜上に、対向基板を設けてもよい。その他の構成は、図8(A)と同様である。 FIG. 8C shows a case where the active matrix substrate and the light-emitting element are sealed using a protective film 821 such as a film or a resin without using the counter substrate, unlike FIG. 8A. A protective film 821 is provided to cover the second pixel electrode of the pixel portion 803. An organic material such as an epoxy resin, a urethane resin, or a silicone resin can be used as the second protective film. Further, the second protective film may be formed by dropping a polymer material by a droplet discharge method. In this embodiment mode, the epoxy resin is discharged using a dispenser and dried. Further, a counter substrate may be provided over the protective film. Other structures are similar to those in FIG.

このように対向基板を用いず封止すると、表示装置の軽量化、小型化、薄膜化を向上させることができる。 When sealing is performed without using the counter substrate in this manner, the weight, size, and thickness of the display device can be improved.

本実施例のモジュールは、配線基板810がFPC809を用いて実装されているが、必ずしもこの構成に限定されない。COG(Chip on Glass)方式を用い、画素駆動回路811、外部回路812を直接基板上に実装させるようにしてもよい。 In the module of this embodiment, the wiring board 810 is mounted using the FPC 809, but the configuration is not necessarily limited thereto. The pixel drive circuit 811 and the external circuit 812 may be directly mounted on the substrate using a COG (Chip on Glass) method.

なお、本発明の実施の形態及び他の実施例のいずれも本実施例に適応することができる。また、本実施例では、表示モジュールとして発光表示モジュールの例を示したが、これに限られるものではなく、液晶表示モジュール、DMD(Digital Micromirror Device;デジタルマイクロミラーデバイス)、PDP(Plasma Display Panel;プラズマディスプレイパネル)、FED(Field Emission Display;フィールドエミッションディスプレイ)、電気泳動表示装置(電子ペーパー)等の表示モジュールに適宜適応することができる。   Note that any of the embodiment modes and other examples of the present invention can be applied to this example. In this embodiment, an example of a light emitting display module is shown as a display module. However, the present invention is not limited to this, but a liquid crystal display module, DMD (Digital Micromirror Device), PDP (Plasma Display Panel; It can be suitably applied to display modules such as plasma display panels), FEDs (Field Emission Displays), and electrophoretic display devices (electronic paper).

上記実施例に示される半導体装置を筺体に組み込むことによって様々な電子機器を作製することができる。電子機器としては、テレビジョン装置、ビデオカメラ、デジタルカメラ、ゴーグル型ディスプレイ(ヘッドマウントディスプレイ)、ナビゲーションシステム、音響再生装置(カーオーディオ、オーディオコンポ等)、ノート型パーソナルコンピュータ、ゲーム機器、携帯情報端末(モバイルコンピュータ、携帯電話、携帯型ゲーム機または電子書籍等)、記録媒体を備えた画像再生装置(具体的にはDigital Versatile Disc(DVD)等の記録媒体を再生し、その画像を表示しうるディスプレイを備えた装置)などが挙げられる。ここでは、これらの電子機器の代表例としてテレビジョン装置の構成を示すブロック図及びテレビジョン装置をそれぞれ図9及び図10に、デジタルカメラを図11に示す。 Various electronic devices can be manufactured by incorporating the semiconductor device described in any of the above embodiments into a housing. Electronic devices include television devices, video cameras, digital cameras, goggle-type displays (head-mounted displays), navigation systems, sound playback devices (car audio, audio components, etc.), notebook personal computers, game machines, and portable information terminals (Mobile computer, mobile phone, portable game machine, electronic book, or the like), an image playback apparatus equipped with a recording medium (specifically, a recording medium such as a digital versatile disc (DVD) can be played back and the image can be displayed. And a device equipped with a display). Here, as representative examples of these electronic devices, a block diagram and a television device showing a configuration of a television device are shown in FIGS. 9 and 10, respectively, and a digital camera is shown in FIG.

図9は、アナログのテレビジョン放送を受信するテレビジョン装置の一般的な構成のブロック図である。図9において、アンテナ901で受信されたテレビ放送用の電波は、チューナ902に入力される。チューナ902は、アンテナ901より入力された高周波テレビ信号を希望受信周波数に応じて制御された局部発振周波数の信号と混合することにより、中間周波数(IF)信号を生成して出力する。   FIG. 9 is a block diagram of a general configuration of a television apparatus that receives an analog television broadcast. In FIG. 9, radio waves for television broadcasting received by the antenna 901 are input to the tuner 902. The tuner 902 generates and outputs an intermediate frequency (IF) signal by mixing the high-frequency television signal input from the antenna 901 with a signal having a local oscillation frequency controlled according to a desired reception frequency.

チューナ902により取り出されたIF信号は、中間周波数増幅器(IFアンプ)903により必要な電圧まで増幅された後、映像検波回路904によって映像検波されると共に、音声検波回路905によって音声検波される。映像検波回路904により出力された映像信号は、映像系処理回路906により、輝度信号と色信号とに分離され、さらに所定の映像信号処理が施されて映像信号となり、本発明の半導体装置である表示装置、代表的には液晶表示装置、発光表示装置、DMD(Digital Micromirror Device;デジタルマイクロミラーデバイス)、PDP(Plasma Display Panel;プラズマディスプレイパネル)、FED(Field Emission Display;フィールドエミッションディスプレイ)、電気泳動表示装置(電子ペーパー)等の映像系出力部908に出力される。なお、表示装置に液晶表示装置を用いたものは、液晶テレビジョンとなり、発光表示装置を用いたものはELテレビジョンとなる。また、他の表示装置を用いた場合も同様である。   The IF signal extracted by the tuner 902 is amplified to a necessary voltage by an intermediate frequency amplifier (IF amplifier) 903 and then detected by the video detection circuit 904 and also detected by the audio detection circuit 905. The video signal output from the video detection circuit 904 is separated into a luminance signal and a color signal by the video processing circuit 906, and further subjected to predetermined video signal processing to become a video signal, which is the semiconductor device of the present invention. Display devices, typically liquid crystal display devices, light-emitting display devices, DMD (Digital Micromirror Device), PDP (Plasma Display Panel), FED (Field Emission Display), electricity It is output to a video output unit 908 such as an electrophoretic display device (electronic paper). A display device using a liquid crystal display device is a liquid crystal television, and a display device using a light emitting display device is an EL television. The same applies when other display devices are used.

また、音声検波回路905により出力された信号は、音声系処理回路907により、FM復調などの処理が施されて音声信号となり、適宜増幅されてスピーカ等の音声系出力部909に出力される。   The signal output from the sound detection circuit 905 is subjected to processing such as FM demodulation by the sound system processing circuit 907 to become a sound signal, is appropriately amplified, and is output to the sound system output unit 909 such as a speaker.

なお、本発明を用いたテレビジョン装置は、VHF帯やUHF帯などの地上波放送、ケーブル放送、又はBS放送などのアナログ放送に対応するものに限らず、地上波デジタル放送、ケーブルデジタル放送、又はBSデジタル放送に対応するものであっても良い。   Note that the television apparatus using the present invention is not limited to a terrestrial broadcast such as a VHF band or a UHF band, a cable broadcast, or an analog broadcast such as a BS broadcast, but also a terrestrial digital broadcast, a cable digital broadcast, Or it may correspond to BS digital broadcasting.

図10はテレビジョン装置を前面方向から見た斜視図であり、筐体1051、表示部1052、スピーカ部1053、操作部1054、ビデオ入力端子1055等を含む。また、図10に示すような構成となっている。   FIG. 10 is a perspective view of the television device as viewed from the front, and includes a housing 1051, a display portion 1052, a speaker portion 1053, an operation portion 1054, a video input terminal 1055, and the like. Moreover, it has a structure as shown in FIG.

表示部1052は、図10の映像系出力部1008の一例であり、ここで映像を表示する。   The display unit 1052 is an example of the video system output unit 1008 in FIG. 10 and displays video here.

スピーカ部1053は、図10の音声系出力部の一例であり、ここで音声を出力する。   The speaker unit 1053 is an example of the audio system output unit of FIG. 10, and outputs audio here.

操作部1054は、電源スイッチ、ボリュームスイッチ、選局スイッチ、チューナースイッチ、選択スイッチ等が設けられており、該ボタンの押下によりテレビジョン装置の電源のON/OFF、映像の選択、音声の調整、及びチューナの選択等を行う。なお、図示していないが、リモートコントローラ型操作部によって、上記の選択を行うことも可能である。   The operation unit 1054 is provided with a power switch, a volume switch, a channel selection switch, a tuner switch, a selection switch, and the like. By pressing the button, the television apparatus is turned on / off, an image is selected, an audio is adjusted, And selecting a tuner. Although not shown, the above selection can also be performed by a remote controller type operation unit.

ビデオ入力端子1055は、VTR、DVD、ゲーム機等の外部からの映像信号をテレビジョン装置に入力する端子である。   The video input terminal 1055 is a terminal for inputting a video signal from the outside such as a VTR, a DVD, a game machine, or the like to the television device.

本実施例で示されるテレビジョン装置を壁掛け用テレビジョン装置の場合、本体背面に壁掛け用の部位が設けられている。 In the case where the television device shown in this embodiment is a wall-mounted television device, a wall-hanging portion is provided on the back of the main body.

テレビジョン装置の表示部に本発明の半導体装置の一例である表示装置を用いることにより、低コストで、スループットや歩留まり高くテレビジョン装置を作製することができる。このため、壁掛けテレビジョン装置、鉄道の駅や空港などにおける情報表示板や、街頭における広告表示板など特に大面積の表示媒体として様々な用途に適用することができる。 By using the display device which is an example of the semiconductor device of the present invention for the display portion of the television device, the television device can be manufactured with low cost and high throughput and yield. For this reason, it can be applied to various uses as a display medium having a particularly large area, such as a wall-mounted television device, an information display board in a railway station or airport, and an advertisement display board in a street.

図11(A)及び図11(B)は、デジタルカメラの一例を示す図である。図11(A)は、デジタルカメラの前面方向から見た斜視図、図11(B)は、後面方向から見た斜視図である。図11(A)において、デジタルカメラには、リレーズボタン1101、メインスイッチ1102、ファインダー窓1103、フラッシュ1104、レンズ1105、鏡銅1106、筺体1107が備えられている。   11A and 11B are diagrams illustrating an example of a digital camera. FIG. 11A is a perspective view seen from the front side of the digital camera, and FIG. 11B is a perspective view seen from the rear side. In FIG. 11A, the digital camera includes a relay button 1101, a main switch 1102, a finder window 1103, a flash 1104, a lens 1105, a mirror copper 1106, and a housing 1107.

また、図11(B)において、ファインダー接眼窓1111、モニター1112、操作ボタン1113が備えられている。   In FIG. 11B, a viewfinder eyepiece window 1111, a monitor 1112, and operation buttons 1113 are provided.

リレーズボタン1101は、半分の位置まで押下されると、焦点調整機構および露出調整機構が作動し、最下部まで押下されるとシャッターが開く。   When the relay button 1101 is pressed down to a half position, the focus adjustment mechanism and the exposure adjustment mechanism are operated, and when the relay button 1101 is pressed down to the lowest position, the shutter is opened.

メインスイッチ1102は、押下又は回転によりデジタルカメラの電源のON/OFFを切り替える。   A main switch 1102 switches the power of the digital camera ON / OFF when pressed or rotated.

ファインダー窓1103は、デジタルカメラの前面のレンズ1105の上部に配置されており、図11(B)に示すファインダー接眼窓1111から撮影する範囲やピントの位置を確認するための装置である。   The viewfinder window 1103 is disposed on the front of the lens 1105 on the front surface of the digital camera, and is a device for confirming the shooting range and focus position from the viewfinder eyepiece window 1111 shown in FIG.

フラッシュ1104は、デジタルカメラの全面上部に配置され、被写体輝度が低いときに、レリーズボタンが押下されてシャッターが開くと同時に補助光を照射する。   The flash 1104 is arranged on the entire upper surface of the digital camera. When the subject brightness is low, the release button is pressed and the shutter is opened to irradiate auxiliary light simultaneously.

レンズ1105は、デジタルカメラの正面に配置されている。レンズは、フォーカシングレンズ、ズームレンズ等により構成され、図示しないシャッター及び絞りと共に撮影光学系を構成する。また、レンズの後方には、CCD(Charge Coupled Device)等の撮像素子が設けられている。   The lens 1105 is disposed in front of the digital camera. The lens is composed of a focusing lens, a zoom lens, and the like, and constitutes a photographing optical system together with a shutter and a diaphragm (not shown). An imaging element such as a CCD (Charge Coupled Device) is provided behind the lens.

鏡銅1106は、フォーカシングレンズ、ズームレンズ等のピントを合わせるためにレンズの位置を移動するものであり、撮影時には、鏡銅を繰り出すことにより、レンズ1105を手前に移動させる。また、携帯時は、レンズ1105を沈銅させてコンパクトにする。なお、本実施例においては、鏡銅を繰り出すことにより被写体をズーム撮影することができる構造としているが、この構造に限定されるものではなく、筺体1107内での撮影光学系の構成により鏡銅を繰り出さずともズーム撮影が可能なデジタルカメラでもよい。 The mirror copper 1106 moves the lens position in order to focus the focusing lens, the zoom lens, and the like. During photographing, the lens copper is extended to move the lens 1105 forward. In addition, when carrying, the lens 1105 is made copperless to make it compact. In this embodiment, the structure is such that the subject can be zoomed by extending the mirror copper. However, the present invention is not limited to this structure, and the configuration of the imaging optical system in the housing 1107 is not limited. It is also possible to use a digital camera that can perform zoom shooting without extending the camera.

ファインダー接眼窓1111は、デジタルカメラの後面上部に設けられており、撮影する範囲やピントの位置を確認する際に接眼するために設けられた窓である。   The viewfinder eyepiece window 1111 is provided on the upper rear surface of the digital camera, and is a window provided for eye contact when confirming a shooting range and a focus position.

操作ボタン1113は、デジタルカメラの後面に設けられた各種機能ボタンであり、セットアップボタン、メニューボタン、ディスプレイボタン、機能ボタン、選択ボタン等により構成されている。   The operation buttons 1113 are various function buttons provided on the rear surface of the digital camera, and include a setup button, a menu button, a display button, a function button, a selection button, and the like.

本発明の半導体装置の一実施例である表示装置をモニターに用いことにより、低コストで、スループットや歩留まり高くデジタルカメラを作製することが可能である。 By using a display device which is an embodiment of the semiconductor device of the present invention for a monitor, a digital camera can be manufactured at low cost and with high throughput and yield.

本発明の作製方法を説明する断面図。Sectional drawing explaining the manufacturing method of this invention. 本発明の作製方法を説明する断面図。Sectional drawing explaining the manufacturing method of this invention. 本発明の作製方法を説明する断面図。Sectional drawing explaining the manufacturing method of this invention. 本発明の作製方法を説明する断面図。Sectional drawing explaining the manufacturing method of this invention. 本発明の作製方法を説明する断面図。Sectional drawing explaining the manufacturing method of this invention. 本発明の作製方法を説明する断面図Sectional drawing explaining the manufacturing method of this invention 本発明の作製方法を説明する斜視図。FIG. 9 is a perspective view illustrating a manufacturing method of the present invention. 本発明の発光装置モジュールを示す図。The figure which shows the light-emitting device module of this invention. 本発明を用いた電子機器の構成を示す図。FIG. 11 illustrates a structure of an electronic device using the present invention. 本発明を用いた電子機器を表す図。FIG. 14 illustrates an electronic device using the present invention. 本発明を用いた電子機器を表す図。FIG. 14 illustrates an electronic device using the present invention.

Claims (7)

絶縁表面を有する基板上に、半導体層、ゲート絶縁膜およびゲート電極を形成し、
前記半導体層、前記ゲート絶縁膜および前記ゲート電極を覆って導電体膜を形成し、
前記導電体膜上にインクジェット方式により選択的に金属材料からなるレジストパターンを形成し、
前記レジストパターンをマスクとして前記導電体膜を異方性エッチングすることにより前記半導体層に電気的に接続する導電体ピラーを形成し、
前記導電体ピラーを覆って一層又は多層でなる層間絶縁膜を形成し、
前記層間絶縁膜をエッチバックさせて前記導電体ピラーを露出し、
前記導電体ピラーに電気的に接続する導電層をインクジェット方式により形成することを特徴とする表示装置の作製方法。
Forming a semiconductor layer, a gate insulating film, and a gate electrode over a substrate having an insulating surface;
Forming a conductor film covering the semiconductor layer, the gate insulating film and the gate electrode;
A resist pattern made of a metal material is selectively formed on the conductor film by an inkjet method,
Forming a conductive pillar electrically connected to the semiconductor layer by anisotropically etching the conductive film using the resist pattern as a mask;
Forming an interlayer insulating film consisting of one layer or multiple layers covering the conductor pillar;
Etching back the interlayer insulating film to expose the conductor pillar,
A method for manufacturing a display device, wherein a conductive layer electrically connected to the conductive pillar is formed by an ink jet method.
絶縁表面を有する基板上に、半導体層、ゲート絶縁膜およびゲート電極を形成し、
前記半導体層、前記ゲート絶縁膜および前記ゲート電極を覆って第1の導電体膜を形成し、
前記第1の導電体膜上にインクジェット方式により選択的に金属材料からなる第1のレジストパターンを形成し、
前記第1のレジストパターンをマスクとして前記第1の導電体膜を異方性エッチングすることにより前記半導体層に電気的に接続する第1の導電体ピラーを形成し、
前記第1の導電体ピラーを覆って一層又は多層でなる第1の層間絶縁膜を形成し、
前記第1の層間絶縁膜をエッチバックさせて前記第1の導電体ピラーを露出し、
前記第1の導電体ピラーに電気的に接続する導電層をインクジェット方式により形成し、
前記第1の層間絶縁膜及び前記導電層を覆って第2の導電体膜を形成し、
前記第2の導電体膜上にインクジェット方式により選択的に第2のレジストパターンを形成し、
前記第2のレジストパターンをマスクとして前記第2の導電体膜を異方性エッチングすることにより前記導電層に電気的に接続する第2の導電体ピラーを形成し、
前記第2の導電体ピラーを覆って一層又は多層でなる第2の層間絶縁膜を形成し、
前記第2の層間絶縁膜をエッチバックさせて前記第2の導電体ピラーを露出し、
前記第2の導電体ピラーに電気的に接続する画素電極をインクジェット方式により形成することを特徴とする表示装置の作製方法。
Forming a semiconductor layer, a gate insulating film, and a gate electrode over a substrate having an insulating surface;
Forming a first conductor film covering the semiconductor layer, the gate insulating film and the gate electrode;
A first resist pattern made of a metal material is selectively formed on the first conductive film by an inkjet method,
Forming a first conductor pillar electrically connected to the semiconductor layer by anisotropically etching the first conductor film using the first resist pattern as a mask;
Forming a first interlayer insulating film having a single layer or multiple layers covering the first conductive pillar;
Etching back the first interlayer insulating film to expose the first conductor pillar,
Forming a conductive layer electrically connected to the first conductive pillar by an inkjet method;
Forming a second conductor film covering the first interlayer insulating film and the conductive layer ;
A second resist pattern is selectively formed on the second conductive film by an inkjet method;
Forming a second conductor pillar electrically connected to the conductive layer by anisotropically etching the second conductor film using the second resist pattern as a mask;
Forming a second interlayer insulating film having a single layer or multiple layers covering the second conductor pillar;
Etching back the second interlayer insulating film to expose the second conductor pillar,
A method for manufacturing a display device, wherein a pixel electrode which is electrically connected to the second conductor pillar is formed by an inkjet method.
請求項1において、前記導電体ピラーは、Al、Ti若しくはTiN、又は導電性の有機材料であることを特徴とする表示装置の作製方法。 Oite to claim 1, wherein the conductor Pila chromatography, a method for manufacturing a display device, characterized in that Al, Ti or TiN, or an organic material conductivity. 請求項2において、前記第1の導電体ピラーは、Al、Ti若しくはTiN、又は導電性の有機材料であることを特徴とする表示装置の作製方法。 Oite to claim 2, before Symbol the first conductor pillar, a method for manufacturing a display device, characterized in that Al, Ti or TiN, or an organic material conductivity. 請求項1乃至請求項4のいずれか一において、前記金属材料は、Au、Ag、Cu又はPtであることを特徴とする表示装置の作製方法。 5. The method for manufacturing a display device according to claim 1 , wherein the metal material is Au, Ag, Cu, or Pt. 請求項1乃至請求項のいずれか一において、前記インクジェット方式は、複数のノズルが並列に配置された複数のインクヘッドを有し、前記複数のノズルから選択されたノズルから組成物を吐出することにより行われることを特徴とする表示装置の作製方法。 In any one of claims 1 to 5, wherein the ink jet system has a plurality of ink heads in which a plurality of nozzles are arranged in parallel, discharging the composition from a nozzle selected from the plurality of nozzles A method for manufacturing a display device, which is performed by: 請求項1乃至請求項のいずれか一において、前記インクジェット方式は、ノズル径の異なる複数のインクヘッドを有し、選択された前記ノズルから組成物を吐出することにより行われることを特徴とする表示装置の作製方法。 In any one of claims 1 to 5, wherein the ink jet system has a plurality of different ink heads of nozzle diameter, characterized in that it is carried out by discharging the composition from the selected nozzles A method for manufacturing a display device.
JP2004092233A 2003-03-26 2004-03-26 Method for manufacturing display device Expired - Fee Related JP4623986B2 (en)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP2004092233A JP4623986B2 (en) 2003-03-26 2004-03-26 Method for manufacturing display device

Applications Claiming Priority (2)

Application Number Priority Date Filing Date Title
JP2003086392 2003-03-26
JP2004092233A JP4623986B2 (en) 2003-03-26 2004-03-26 Method for manufacturing display device

Publications (3)

Publication Number Publication Date
JP2004310085A JP2004310085A (en) 2004-11-04
JP2004310085A5 JP2004310085A5 (en) 2007-05-17
JP4623986B2 true JP4623986B2 (en) 2011-02-02

Family

ID=33478336

Family Applications (1)

Application Number Title Priority Date Filing Date
JP2004092233A Expired - Fee Related JP4623986B2 (en) 2003-03-26 2004-03-26 Method for manufacturing display device

Country Status (1)

Country Link
JP (1) JP4623986B2 (en)

Families Citing this family (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP4619060B2 (en) * 2003-08-15 2011-01-26 株式会社半導体エネルギー研究所 Method for manufacturing semiconductor device
JP5103742B2 (en) * 2006-01-23 2012-12-19 凸版印刷株式会社 THIN FILM TRANSISTOR DEVICE, ITS MANUFACTURING METHOD, THIN FILM TRANSISTOR ARRAY AND THIN FILM TRANSISTOR DISPLAY
JP2008046156A (en) * 2006-08-10 2008-02-28 Kyoritsu Kagaku Sangyo Kk Lamination structural body, liquid crystal panel using the same, and method for manufacturing the lamination structural body
KR101779594B1 (en) * 2010-10-26 2017-09-19 엘지디스플레이 주식회사 Touch Screen Panel and Manufacturing Method thereof
CN106502011A (en) * 2016-12-30 2017-03-15 深圳市华星光电技术有限公司 Image element structure and method of work, array base palte

Citations (8)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH02294069A (en) * 1989-05-08 1990-12-05 Matsushita Electric Ind Co Ltd Active matrix array and its manufacture and liquid crystal displaying device and its manufacture
JPH06216258A (en) * 1993-01-15 1994-08-05 Toshiba Corp Manufacture of semiconductor device
JPH1039130A (en) * 1996-07-22 1998-02-13 Toray Ind Inc Color filter producing device, and production of color filter
JPH10186349A (en) * 1996-12-27 1998-07-14 Sharp Corp Liquid crystal display element and production thereof
JPH11340417A (en) * 1998-03-25 1999-12-10 Seiko Epson Corp Semiconductor device, active matrix substrate for liquid display, and their manufacture
JP2002082215A (en) * 1999-08-03 2002-03-22 Canon Inc Method and device for manufacturing color filter, method for manufacturing display device, method for manufacturing device equipped with display device, method and device for manufacturing panel for display device
JP2003015548A (en) * 2001-06-29 2003-01-17 Seiko Epson Corp Method for manufacturing organic el display body, method for arranging semiconductor device, method for manufacturing semiconductor device, method for manufacturing optoelectronic device, optoelectronic device, and electronic equipment
JP2003058077A (en) * 2001-08-08 2003-02-28 Fuji Photo Film Co Ltd Substrate for microfabrication, fabrication method therefor and image-like thin-film forming method

Patent Citations (8)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH02294069A (en) * 1989-05-08 1990-12-05 Matsushita Electric Ind Co Ltd Active matrix array and its manufacture and liquid crystal displaying device and its manufacture
JPH06216258A (en) * 1993-01-15 1994-08-05 Toshiba Corp Manufacture of semiconductor device
JPH1039130A (en) * 1996-07-22 1998-02-13 Toray Ind Inc Color filter producing device, and production of color filter
JPH10186349A (en) * 1996-12-27 1998-07-14 Sharp Corp Liquid crystal display element and production thereof
JPH11340417A (en) * 1998-03-25 1999-12-10 Seiko Epson Corp Semiconductor device, active matrix substrate for liquid display, and their manufacture
JP2002082215A (en) * 1999-08-03 2002-03-22 Canon Inc Method and device for manufacturing color filter, method for manufacturing display device, method for manufacturing device equipped with display device, method and device for manufacturing panel for display device
JP2003015548A (en) * 2001-06-29 2003-01-17 Seiko Epson Corp Method for manufacturing organic el display body, method for arranging semiconductor device, method for manufacturing semiconductor device, method for manufacturing optoelectronic device, optoelectronic device, and electronic equipment
JP2003058077A (en) * 2001-08-08 2003-02-28 Fuji Photo Film Co Ltd Substrate for microfabrication, fabrication method therefor and image-like thin-film forming method

Also Published As

Publication number Publication date
JP2004310085A (en) 2004-11-04

Similar Documents

Publication Publication Date Title
JP5298149B2 (en) Pattern formation method
JP5364779B2 (en) Method for manufacturing semiconductor device
JP5093985B2 (en) Method for forming a film pattern
JP4731913B2 (en) Pattern forming method and semiconductor device manufacturing method
JP5238641B2 (en) Method for manufacturing semiconductor device
JP4536601B2 (en) Method for manufacturing semiconductor device
US7955907B2 (en) Semiconductor device, television set, and method for manufacturing the same
JP5025107B2 (en) Method for manufacturing semiconductor device
US9237657B2 (en) Wiring substrate, semiconductor device, and method for manufacturing thereof
JP4619060B2 (en) Method for manufacturing semiconductor device
JP2005051216A (en) Droplet dispenser and method of forming pattern
KR101172467B1 (en) Display device
JP4754841B2 (en) Method for manufacturing semiconductor device
JP2004241770A (en) Method of manufacturing conductive layer and method of manufacturing semiconductor device
JP4498715B2 (en) Method for manufacturing semiconductor device
JP4623986B2 (en) Method for manufacturing display device
JP4593969B2 (en) Wiring manufacturing method and display device manufacturing method
JP4877868B2 (en) Method for manufacturing display device
JP4817627B2 (en) Method for manufacturing display device
JP4718818B2 (en) Method for manufacturing thin film transistor
JP4916653B2 (en) Wiring substrate manufacturing method and semiconductor device manufacturing method
JP4624078B2 (en) Method for manufacturing liquid crystal display device
JP4683898B2 (en) Method for manufacturing semiconductor device

Legal Events

Date Code Title Description
A521 Written amendment

Free format text: JAPANESE INTERMEDIATE CODE: A523

Effective date: 20070321

A621 Written request for application examination

Free format text: JAPANESE INTERMEDIATE CODE: A621

Effective date: 20070321

A977 Report on retrieval

Free format text: JAPANESE INTERMEDIATE CODE: A971007

Effective date: 20100405

A131 Notification of reasons for refusal

Free format text: JAPANESE INTERMEDIATE CODE: A131

Effective date: 20100803

A521 Written amendment

Free format text: JAPANESE INTERMEDIATE CODE: A523

Effective date: 20100923

TRDD Decision of grant or rejection written
A01 Written decision to grant a patent or to grant a registration (utility model)

Free format text: JAPANESE INTERMEDIATE CODE: A01

Effective date: 20101026

A01 Written decision to grant a patent or to grant a registration (utility model)

Free format text: JAPANESE INTERMEDIATE CODE: A01

A61 First payment of annual fees (during grant procedure)

Free format text: JAPANESE INTERMEDIATE CODE: A61

Effective date: 20101102

R150 Certificate of patent or registration of utility model

Free format text: JAPANESE INTERMEDIATE CODE: R150

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20131112

Year of fee payment: 3

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20131112

Year of fee payment: 3

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

LAPS Cancellation because of no payment of annual fees