JP3821143B2 - フィルタ機能を有する信号レベル検出方法及び装置 - Google Patents
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Description
10 パルス遅延回路
12 バッファ
20 エンコーダ
30 周回数カウンタ
AMP 増幅器
INV CMOSインバータ
Trc 制御トランジスタ
Claims (10)
- アナログ入力信号から高周波ノイズ成分を除去するフィルタ機能を有し、ノイズ除去後の真の入力信号レベルを検出する信号レベル検出方法であって、
ゲート回路からなる遅延ユニットを複数段縦続接続してなるパルス遅延回路に対して、前記アナログ入力信号を、前記各遅延ユニットの遅延時間を制御する信号として入力すると共に、前記パルス遅延回路にパルス信号を入力して、該パルス信号を前記各遅延ユニットの遅延時間にて順次遅延しながら伝送させ、
設定時間毎にクロックが入力される度に、前記パルス遅延回路内でのパルス信号到達位置を検出し、このクロック入力時に検出されたパルス信号の到達位置と、前回のクロック入力時に検出されたパルス信号の到達位置との差を求めることにより、前記設定時間当たりに前記パルス遅延回路内でパルス信号が通過した遅延ユニットの段数を前記信号レベルを表す信号として検知することを特徴とするフィルタ機能を有する信号レベル検出方法。 - 前記アナログ入力信号を、前記各遅延ユニットの駆動電圧とすることにより、前記各遅延ユニットの遅延時間を制御することを特徴とする請求項1記載のフィルタ機能を有する信号レベル検出方法。
- 前記アナログ入力信号にて前記各遅延ユニットに流す駆動電流を制御することにより、前記各遅延ユニットの遅延時間を制御することを特徴とする請求項1記載のフィルタ機能を有する信号レベル検出方法。
- 前記設定時間を変更することにより、前記高周波ノイズ成分を除去するローパスフィルタとしてのフィルタ特性を調整することを特徴とする請求項1〜請求項3いずれか記載のフィルタ機能を有する信号レベル検出方法。
- 前記パルス遅延回路として、前記遅延ユニットがリング状に連結されることにより前記パルス信号を周回させるリングディレイラインを使用し、前記設定時間内に前記パルス信号が通過した遅延ユニットの段数を、前記リングディレイラインでのパルス信号の周回位置と周回回数とから検出することを特徴とする請求項1〜請求項4いずれか記載のフィルタ機能を有する信号レベル検出方法。
- アナログ入力信号から高周波ノイズ成分を除去するフィルタ機能を有し、ノイズ除去後の真の入力信号レベルを検出する信号レベル検出装置であって、
前記アナログ入力信号の信号レベルに応じた遅延時間で入力パルスを遅延させて出力するゲート回路からなる遅延ユニットを複数段縦続接続することにより、パルス信号を各遅延ユニットの遅延時間にて順次遅延しながら伝送させるパルス遅延回路と、
外部から所定周期でクロックが入力される度に、前記パルス遅延回路内でのパルス信号到達位置を検出し、このクロック入力時に検出されたパルス信号の到達位置と、前回のクロック入力時に検出されたパルス信号の到達位置との差を求めることにより、前記所定周期の一周期当たりに前記パルス遅延回路内でパルス信号が通過した遅延ユニットの段数を前記信号レベルを表す信号として検知する検出手段と、を備えることを特徴とするフィルタ機能を有する信号レベル検出装置。 - 前記各遅延ユニットは、前記アナログ入力信号を駆動電圧として受けることにより、前記アナログ入力信号の信号レベルに応じた遅延時間で入力パルスを遅延させることを特徴とする請求項6記載のフィルタ機能を有する信号レベル検出装置。
- 前記パルス遅延回路は、前記各遅延ユニットの駆動電流を制御する制御手段を備え、該制御手段は、前記アナログ入力信号を制御信号として受けることにより、前記各遅延ユニットの遅延時間を制御することを特徴とする請求項6記載のフィルタ機能を有する信号レベル検出装置。
- 前記検出手段は、前記パルス遅延回路内でのパルス信号の到達位置を所定ビットのデジタルデータに変換して出力するエンコーダを備えることを特徴とする請求項6〜請求項8いずれか記載のフィルタ機能を有する信号レベル検出装置。
- 前記パルス遅延回路は、前記遅延ユニットがリング状に連結されることにより前記パルス信号を周回させるリングディレイラインからなり、前記検出手段は、前記エンコーダに加えて、前記リングディレイラインでのパルス信号の周回回数を検出するカウンタを備え、前記エンコーダからの出力を前記入力信号レベルを表す情報の下位ビットデータ、前記カウンタによるカウント値を前記入力信号レベルを表す情報の上位ビットデータとして出力することを特徴とする請求項9記載のフィルタ機能を有する信号レベル検出装置。
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