JP3322485B2 - B級プッシュプル増幅回路 - Google Patents
B級プッシュプル増幅回路Info
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Description
側増幅段と、プッシュ側およびプル側出力段を有するB
級プッシュプル増幅回路に関する。
に示すように、プッシュ側およびプル側増幅段としての
オペアンプ61,62と、プッシュ側およびプル側出力
段としてのFET(field effect transistor)とを有するも
のが知られている。図6において、65は負荷インピー
ダンスである。このようなB級プッシュプル増幅器は、
出力スイングに応じて出力電流iout を負荷に供給する
ので、出力段に流れる電流は図7(a) に示すようにな
る。図7(a) において、出力段のプッシュ側電流を実線
で示し、出力段のプル側電流を破線で示す。
因、例えば、ゲインアンプのオフセット等で出力電流i
out が過剰に流れると、図7(b) に示すように零入力電
流が増大する。逆に、図7(c) に示すように、零入力電
流が流れなくなると、出力にクロスオーバ歪みが発生す
る。出力にクロスオーバ歪みが発生した様子を図7(d)
に示す。
決し、クロスオーバ歪の発生を防止することができるB
級プッシュプル増幅回路を提供することにある。
シュ側およびプル側出力段を有するB級プッシュプル増
幅回路において、前記プッシュ側およびプル側増幅段の
出力電流を加算する加算手段と、該加算手段により加算
して得られた電流の最小値を検出する最小値検出手段
と、該最小値検出手段により検出された最小値と第1基
準値を比較する第1比較手段と、該第1比較手段による
比較結果に応じて前記プッシュ側およびプル側増幅段の
動作点を調整する第1調整手段とを備えたことを特徴と
する。
増幅段と、プッシュ側およびプル側出力段を有するB級
プッシュプル増幅回路において、前記プッシュ側および
プル側増幅段の出力電流を加算する加算手段と、該加算
手段により加算して得られた電流の平均値を演算する平
均値演算手段と、該平均値演算手段により得られた平均
値と第2基準値を比較する第2比較手段と、該第2比較
手段による比較結果に応じて前記増幅段の動作点を調整
する第2調整手段とを備えたことを特徴とする。
力電流を加算手段により加算し、加算して得られた電流
の最小値を最小値検出手段により検出し、検出された最
小値と第1基準値を第1比較手段により比較し、比較結
果に応じて、プッシュ側およびプル側増幅段の動作点を
第1調整手段により調整する。
側増幅段の出力電流を加算手段により加算し、加算して
得られた電流の平均値を平均値演算手段により演算し、
得られた平均値と第2基準値を第2比較手段により比較
し、比較結果に応じて、増幅段の動作点を第2調整手段
により調整する。
に説明する。
を示す。図1において、61ないし65は図6と同一部
分を示す。1はプッシュ側電流検出回路であり、オペア
ンプ61の出力電流を検出するものである。2はプル側
電流検出回路であり、オペアンプ62の出力電流を検出
するものである。3は加算回路であり、プッシュ側電流
検出回路1により検出された電流と、プル側電流検出回
路2により検出された電流とを加算するものである。4
は最小値検出回路であり、加算回路3による加算結果の
最小値を検出するものである。5は比較器であり、最小
値検出回路4の出力値と所定の基準値と比較し、比較結
果に応じて動作点を調整するものである。
流検出回路1により検出し、オペアンプ62の出力電流
をプル側電流検出回路2により検出し、それぞれ検出さ
れた電流を加算回路3により加算する。そして、加算回
路3の出力電流の最小値を最小値検出回路4により検出
し、検出された最小値と基準値を比較器5により比較す
る。比較した結果、最小値検出回路4の出力値が所定の
基準値未満である場合は、オペアンプ61の動作点を下
げるとともに、オペアンプ62の動作点を上げ、他方、
最小値検出回路4の出力値が所定の基準値より大きい場
合は、オペアンプ61の動作点を上げるとともに、オペ
アンプ62の動作点を下げる。
明する。
された電流の波形が図2(a) に実線で示すようになり、
プル側電流検出回路2により検出された電流の波形が図
2(a)破線で示すようになった場合、加算して得られた
電流波形は図2(b)に示すようになる。この場合、検出
された最小値が所定の基準値と等しいので、オペアンプ
61,62の動作点Va,Vbは図2(c) に示すように
なっており、増幅器61,62の動作点Va,Vbは調
整されない。得られた出力電圧は図2(d) に示すように
なる。
1,2により検出された電流の波形が図3(a) に実線お
よび破線で示すようになった場合は、加算回路3により
加算して得られた電流波形も図3(a) に示すようにな
る。この場合、最小値検出回路4により検出された最小
値は、基準値より小さいので、オペアンプ61,62の
動作点Va,Vbは図3(b) に示すようになっており、
比較器5により、オペアンプ61の動作点Vaが下げら
れるとともに、オペアンプ62の動作点Vbが上げられ
る。その結果、得られた出力電圧波形は図2(d) に示す
ようになる。なお、この場合、動作点が調整されない
と、その出力電圧波形は図3(c) に示すようになる。
1,2により検出された電流の波形が図4(a) に実線お
よび破線で示すようになった場合は、加算回路3により
加算して得られた電流波形も図4(a) に示すようにな
る。この場合、最小値検出回路4により検出された最小
値は、基準値より大きいので、オペアンプ61,62の
動作点Va,Vbは図4(c) に示すようになっており、
比較器5により、オペアンプ61の動作点Vaが上げら
れるとともに、オペアンプ62の動作点Vbが下げられ
る。その結果、得られた出力電圧波形は図2(d) に示す
ようになる。なお、この場合、動作点が調整されない
と、その出力電圧波形は図4(d) に示すようになる。
流が流れるように制御される。零入力電流制御用フィー
ドバックループの周波数特性は、信号帯域に比較しては
るかに低く信号の歪みの原因にはならない。というの
は、制御は出力段のプッシュ側とプル側のいわゆる同相
電流を変化させるのみで、差動電流であり、信号成分に
は関係ないからである。つまり、増幅器の信号成分の通
るパスは、最も単純なB級プッシュプル増幅器のみであ
り、より高速な信号に対しても、安定性のある増幅器を
容易に設計することができる。
しても、基準値を実際の零入力電流値から同じ割合だけ
縮小すれば良いので、回路全体の消費電流もほとんど増
加させることなく、増幅器を構成することができる。
ミングを必要とせず、どのような信号であっても、常
に、その最小出力電流値を検出するので、温度や電源電
流等の環境の変化にも強く、負荷やピーク電流信号周波
数の変化にも充分対応することができる。
3により加算して得られた電流値の最小値を最小値検出
回路4により検出し、検出された最小値と基準値を比較
器5により比較し、比較結果に応じて、オペアンプ6
1,62の動作点を制御するようにした。
ように、加算回路3の出力を平滑回路54により平滑
し、平滑回路54の出力値と基準値を比較器55により
比較し、平滑回路54の出力値が所定の基準値未満であ
る場合は、オペアンプ61の動作点を下げるとともに、
オペアンプ62の動作点を上げ、他方、平滑回路54の
出力値が所定の基準値より大きい場合は、オペアンプ6
1の動作点を上げるとともに、オペアンプ62の動作点
を下げるようにした。
わち、
荷インピーダンス65と出力スイングのピーク値Vpeak
から、次式、すなわち、
である。さらに、設定零入力電流値imin は、次式、す
なわち、
平均値は比例関係にあり、第1実施例と同様にオペアン
プ61,62の動作点を調整することができる。
上記のように構成したので、クロスオーバ歪の発生を防
止することができる。
形図である。
形図である。
形図である。
ク図である。
Claims (2)
- 【請求項1】 プッシュ側およびプル側増幅段とプッシ
ュ側およびプル側出力段を有するB級プッシュプル増幅
回路において、 前記プッシュ側およびプル側増幅段の出力電流を加算す
る加算手段と、 該加算手段により加算して得られた電流の最小値を検出
する最小値検出手段と、 該最小値検出手段により検出された最小値と第1基準値
を比較する第1比較手段と、 該第1比較手段による比較結果に応じて前記プッシュ側
およびプル側増幅段の動作点を調整する第1調整手段と
を備えたことを特徴とするB級プッシュプル増幅回路。 - 【請求項2】 プッシュ側およびプル側増幅段と、プッ
シュ側およびプル側出力段を有するB級プッシュプル増
幅回路において、 前記プッシュ側およびプル側増幅段の出力電流を加算す
る加算手段と、 該加算手段により加算して得られた電流の平均値を演算
する平均値演算手段と、 該平均値演算手段により得られた平均値と第2基準値を
比較する第2比較手段と、 該第2比較手段による比較結果に応じて前記増幅段の動
作点を調整する第2調整手段とを備えたことを特徴とす
るB級プッシュプル増幅回路。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP22964994A JP3322485B2 (ja) | 1994-09-26 | 1994-09-26 | B級プッシュプル増幅回路 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP22964994A JP3322485B2 (ja) | 1994-09-26 | 1994-09-26 | B級プッシュプル増幅回路 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPH0897645A JPH0897645A (ja) | 1996-04-12 |
JP3322485B2 true JP3322485B2 (ja) | 2002-09-09 |
Family
ID=16895512
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP22964994A Expired - Lifetime JP3322485B2 (ja) | 1994-09-26 | 1994-09-26 | B級プッシュプル増幅回路 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP3322485B2 (ja) |
Families Citing this family (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP3532365B2 (ja) * | 1996-11-15 | 2004-05-31 | 株式会社ルネサステクノロジ | 増幅回路 |
KR20010083415A (ko) * | 2000-02-12 | 2001-09-01 | 김홍기 | 모니터의 크로스 오버 왜곡 보상 회로 |
JP2003060452A (ja) | 2001-08-20 | 2003-02-28 | Denso Corp | オペアンプ回路 |
JP2005348239A (ja) | 2004-06-04 | 2005-12-15 | Agilent Technol Inc | 電力増幅装置 |
JP4946643B2 (ja) * | 2007-06-08 | 2012-06-06 | 横河電機株式会社 | パワーアンプ回路 |
-
1994
- 1994-09-26 JP JP22964994A patent/JP3322485B2/ja not_active Expired - Lifetime
Also Published As
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---|---|
JPH0897645A (ja) | 1996-04-12 |
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