JP3287184B2 - 半導体デバイスの検査回路構造 - Google Patents
半導体デバイスの検査回路構造Info
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- JP3287184B2 JP3287184B2 JP23448595A JP23448595A JP3287184B2 JP 3287184 B2 JP3287184 B2 JP 3287184B2 JP 23448595 A JP23448595 A JP 23448595A JP 23448595 A JP23448595 A JP 23448595A JP 3287184 B2 JP3287184 B2 JP 3287184B2
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Description
および実装品の検査に用いる検査回路の構造に関する。
は、図5に示す如く検査用ソケット1のソケットピン2
が、配線3によって検査用回路基板4と接続されてい
る。前記ソケット1は、ソケット保持機構5にネジ等で
固定されている。
来の半導体デバイスの検査回路構造においては、配線3
を直接ソケットピン2にハンダ等で接続するため、ソケ
ットピン自体が細い場合、または間隔が狭い場合は配線
3に太い線材を用いることができず、特に電源ピンにつ
いては十分低い電源インピーダンスを得ることが難しい
という問題点があった。
ンスを実現できる半導体デバイスの検査回路構造を提供
することを目的とする。
源ピンと信号ピンとを有する検査用ソケットと、前記検
査用ソケットと対向して設けられた前記検査用回路基板
と、前記検査用回路基板と前記検査用ソケットとの間に
設けられ、前記電源ピンと電気的に接続する電源用回路
基板と、前記電源用回路基板と前記検査用回路基板とを
電気的に接続する第1の配線と、前記信号ピンと前記検
査用回路基板とを電気的に接続する第2の配線と、を含
むことを特徴とする。 (2) 本発明の半導体デバイスの検査回路構造は、電
源ピンと信号ピンとを有する検査用ソケットと、前記検
査用ソケットと対向して設けられた前記検査用回路基板
と、前記検査用回路基板と前記検査用ソケットとの間に
設けられ、前記電源ピンと電気的に接続する電源用回路
基板と、前記電源用回路基板と前記検査用回路基板とを
電気的に接続する第1の配線と、前記信号ピンと前記検
査用回路基板とを電気的に接続する第2の配線と、を含
む半導体デバイスの検査回路構造であって、前記第1の
配線は前記第2の配線よりも太い線材からなることを特
徴とする。
記(1)又は(2)に記載の半導体デバイスの検査回路
構造において、前記電源用回路基板は表面にプリントパ
ターンを有することを特徴とする。 (4) 上記(3)に記載の半導体デバイスの検査回路
構造において、前記プリントパターンと前記第1の配線
とは、電気的に接続されていることを特徴とする。 (5) 上記(1)から(3)のいずれかに記載の半導
体デバイスの検査回路構造において、前記電源用回路基
板は、第1のスルーホールと第2のスルーホールと第3
のスルーホールとを有し、前記第1のスルーホールは前
記第1の配線と電気的に接続されるよう、前記第2のス
ルーホールは前記電源ピンと電気的に接続されるよう、
前記第3のスルーホールは前記信号ピンと電気的に接続
されないように、設けられることを特徴とする。
記検査用ソケットまでの電源配線を行うに当たり、前記
電源回路基板を前記ソケットの直近に配置することで、
この間の短い距離のみは細い、または間隔の狭いソケッ
トピンに直接ハンダ等で接続するため細い配線を使用す
るが、これ以外の大部分には太い線材を用いることがで
きる。
前記ソケット間の電源接続をプリントパターンで行うこ
とができる。
わる検査回路の要部を示す図である。まず、構成を説明
する。検査用ソケット1のソケットピン2の内、電源ピ
ンは電源用中間配線311によって電源用回路基板6に
接続され、さらに電源用配線301によって検査用回路
基板4に接続されている。また、前記ソケットピンの
内、信号ピンは信号用配線302によって直接前記検査
用回路基板4に接続されている。これらの接続は、ハン
ダ等によって行なう。前記ソケット1と前記電源用回路
基板6は、ネジ等でソケット保持機構5に固定され、さ
らに前記検査用回路基板4に同じくネジ等で固定されて
いる。
線302および前記電源用中間配線311よりも太い線
材を用いる。また、前記電源用回路基板6は前記ソケッ
ト1の直近に置く。このため、前記電源用中間配線31
1の長さは非常に短い。
示す図である。前記電源用回路基板6の表面には、プリ
ントパターンによってプラス用電源パターン601とマ
イナス用電源パターン602が設けられている。前記配
線301および311は、ハンダ付け等によって前記パ
ターン601または602と接続される。
わる検査回路の要部を示す図である。まず、検査用ソケ
ット1は電源用回路基板7にハンダ等で直接実装された
上で、ソケット保持機構5にネジ等で固定され、さらに
検査用回路基板4に同じくネジ等で固定されている。前
記ソケット1のソケットピン2の内、信号ピンは信号用
配線302によって前記検査用回路基板4に接続されて
いる。これに対して、前記ソケットピン2の内、電源ピ
ンは前記電源用回路基板7にこの基板上に設けられたプ
リントパターンによって接続され、さらに電源用配線3
01によって前記検査用回路基板4に接続されている。
前記電源用配線301には、前記信号用配線302よ
りも太い線材を用いる。
示す図である。前記電源用回路基板7の表面には、プリ
ントパターンによってプラス用電源パターン701とマ
イナス用電源パターン702が設けられている。スルー
ホール711は、前記電源用配線301を接続するため
のものであり、前記電源パターン701とショートされ
ている。また、スルーホール712はソケットピン2の
内、電源ピンを挿入するためのものであり、同じく前記
電源パターン701とショートされている。これに対し
て、スルーホール713は前記ソケットピン2の内、信
号ピンを挿入するためのものであり、これは前記電源パ
ターン701および702とはショートされず、オープ
ンとなっている。
源用配線301に太い線材を使用するため、前記スルー
ホール712の穴径よりも大きい。
基板から検査用ソケットまでの電源配線の大部分を太い
線材によって行うため、半導体デバイスの検査用回路の
電源インピーダンスの低減を図ることができる。
トのソケットピンの内、電源ピンと電源用回路基板との
接続を、線材によらずプリントパターンで行うため、さ
らに半導体デバイスの検査回路の電源インピーダンスの
低減を図ることができる。
図。
図。
示す図。
Claims (5)
- 【請求項1】 電源ピンと信号ピンとを有する検査用ソ
ケットと、 前記検査用ソケットと対向して設けられた前記検査用回
路基板と、 前記検査用回路基板と前記検査用ソケットとの間に設け
られ、前記電源ピンと電気的に接続する電源用回路基板
と、 前記電源用回路基板と前記検査用回路基板とを電気的に
接続する第1の配線と、 前記信号ピンと前記検査用回路基板とを電気的に接続す
る第2の配線と、を含むことを特徴とする半導体デバイ
スの検査回路構造。 - 【請求項2】 電源ピンと信号ピンとを有する検査用ソ
ケットと、 前記検査用ソケットと対向して設けられた前記検査用回
路基板と、 前記検査用回路基板と前記検査用ソケットとの間に設け
られ、前記電源ピンと電気的に接続する電源用回路基板
と、 前記電源用回路基板と前記検査用回路基板とを電気的に
接続する第1の配線と、 前記信号ピンと前記検査用回路基板とを電気的に接続す
る第2の配線と、を含む半導体デバイスの検査回路構造
であって、 前記第1の配線は前記第2の配線よりも太い線材からな
ることを特徴とする半導体デバイスの検査回路構造。 - 【請求項3】 請求項1又は2に記載の半導体デバイス
の検査回路構造において、前記電源用回路基板は表面に
プリントパターンを有することを特徴とする半導体デバ
イスの検査回路構造。 - 【請求項4】 請求項3記載の半導体デバイスの検査回
路構造において、前記プリントパターンと前記第1の配
線とは、電気的に接続されていることを特徴とする半導
体デバイスの検査回路構造。 - 【請求項5】 請求項1から3のいずれかに記載の半導
体デバイスの検査回路構造において、前記電源用回路基
板は、第1のスルーホールと第2のスルーホールと第3
のスルーホールとを有し、 前記第1のスルーホールは前記第1の配線と電気的に接
続されるよう、前記第2のスルーホールは前記電源ピン
と電気的に接続されるよう、前記第3のスルーホールは
前記信号ピンと電気的に接続されないように、設けられ
ることを特徴とする半導体デバイスの検査回路構造。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP23448595A JP3287184B2 (ja) | 1995-09-12 | 1995-09-12 | 半導体デバイスの検査回路構造 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP23448595A JP3287184B2 (ja) | 1995-09-12 | 1995-09-12 | 半導体デバイスの検査回路構造 |
Related Child Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2001183978A Division JP2002071747A (ja) | 2001-06-18 | 2001-06-18 | 半導体デバイスの検査回路構造 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPH0980119A JPH0980119A (ja) | 1997-03-28 |
JP3287184B2 true JP3287184B2 (ja) | 2002-05-27 |
Family
ID=16971769
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP23448595A Expired - Lifetime JP3287184B2 (ja) | 1995-09-12 | 1995-09-12 | 半導体デバイスの検査回路構造 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP3287184B2 (ja) |
-
1995
- 1995-09-12 JP JP23448595A patent/JP3287184B2/ja not_active Expired - Lifetime
Also Published As
Publication number | Publication date |
---|---|
JPH0980119A (ja) | 1997-03-28 |
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