JP3147808B2 - 異常検出回路 - Google Patents
異常検出回路Info
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Description
【０００１】
【発明の属する技術分野】本発明は、バイアス電流値の
異常検出回路に関し、特にトランジスタを用いた増幅器
のトランジスタのバイアス電流値異常検出回路に関す
る。
異常検出回路に関し、特にトランジスタを用いた増幅器
のトランジスタのバイアス電流値異常検出回路に関す
る。
【０００２】
【従来の技術】従来この種の電流値異常検出回路は、主
に、トランジスタ等の被バイアス素子が過電流状態にな
った場合など電源を断とし、素子および周辺部品の焼損
を防止し、電源を保護する目的で設けられる。このよう
な目的とした電流値異常検出回路としては、例えば、Ｆ
ＥＴのバイアス電圧異常検出回路として実開昭５６−９
６７２４号公報（第１の従来技術）、増幅器過電流検出
回路として特開昭６２−２７６９０７号公報（第２の従
来技術）、電力増幅器の過電流防止回路として特開平３
−１８４４０５号公報（第３の従来技術）に記載された
ものなどがある。また、電流の減少も検出し警報を出力
する機能も備えたものとして、増幅装置の電源電流の異
常増加および異常減少検出警報回路である特開平２−２
１４３１６号公報（第４の従来技術）などがある。
に、トランジスタ等の被バイアス素子が過電流状態にな
った場合など電源を断とし、素子および周辺部品の焼損
を防止し、電源を保護する目的で設けられる。このよう
な目的とした電流値異常検出回路としては、例えば、Ｆ
ＥＴのバイアス電圧異常検出回路として実開昭５６−９
６７２４号公報（第１の従来技術）、増幅器過電流検出
回路として特開昭６２−２７６９０７号公報（第２の従
来技術）、電力増幅器の過電流防止回路として特開平３
−１８４４０５号公報（第３の従来技術）に記載された
ものなどがある。また、電流の減少も検出し警報を出力
する機能も備えたものとして、増幅装置の電源電流の異
常増加および異常減少検出警報回路である特開平２−２
１４３１６号公報（第４の従来技術）などがある。
【０００３】
【発明が解決しようとする課題】前記種々の従来技術の
中で第１から第３の従来技術は、主に過電流状態の検出
に関するものであり、電流減少時の検出に関しては特に
記載は無い。
中で第１から第３の従来技術は、主に過電流状態の検出
に関するものであり、電流減少時の検出に関しては特に
記載は無い。
【０００４】一方、第４の従来技術は電流の異常増加お
よび異常減少状態を検出する回路に関してのものである
が、これは、単に電流値をモニターし電流の増加および
減少を検出して装置の異常を判断する機構を提案するに
過ぎない。
よび異常減少状態を検出する回路に関してのものである
が、これは、単に電流値をモニターし電流の増加および
減少を検出して装置の異常を判断する機構を提案するに
過ぎない。
【０００５】ここで、第４の従来技術に関して図面を用
いて説明する。
いて説明する。
【０００６】図５は、第４の従来技術のバイアス電流の
異常低下検出手段を説明するためのブロック図である。
異常低下検出手段を説明するためのブロック図である。
【０００７】本図において、被バイアス供給物１に対し
てバイアス供給電源端子１０から供給し、その間にバイ
アス電流検出手段２を設けている。
てバイアス供給電源端子１０から供給し、その間にバイ
アス電流検出手段２を設けている。
【０００８】そして、バイアス電流検出手段２で得られ
たバイアス電流は、バイアス電流低下時警報出力手段３
に入力し、バイアス電流が所定の値よりも低下した場合
には警報出力端子１１に出力する。
たバイアス電流は、バイアス電流低下時警報出力手段３
に入力し、バイアス電流が所定の値よりも低下した場合
には警報出力端子１１に出力する。
【０００９】ここで、バイアス電流低下時警報出力手段
３の供給電源は、警報回路用別電源供給端子１０ｂより
被バイアス供給物１やバイアス電流検出手段２とは別の
電源より供給されている。
３の供給電源は、警報回路用別電源供給端子１０ｂより
被バイアス供給物１やバイアス電流検出手段２とは別の
電源より供給されている。
【００１０】実際には、通常、警報出力時には電源を断
とするなどして焼損等を防止する回路を設けるが、前記
図５のごとく単に警報出力するのみでは、電源投入時に
初期電流値は零であるため異常状態と誤認識するという
不都合がある。これを回避するには、特別のシーケンス
回路等の誤動作防止手段を付加する必要があった。すな
わち、この従来技術によれば、単に電流の減少を検出す
るのみであり、電流の減少が、被バイアス素子等の故障
によるものなのか電源が印加されていないためなのかを
判別する手段についての記載はなく、前記誤動作に対す
る不具合に対処されていなかった。
とするなどして焼損等を防止する回路を設けるが、前記
図５のごとく単に警報出力するのみでは、電源投入時に
初期電流値は零であるため異常状態と誤認識するという
不都合がある。これを回避するには、特別のシーケンス
回路等の誤動作防止手段を付加する必要があった。すな
わち、この従来技術によれば、単に電流の減少を検出す
るのみであり、電流の減少が、被バイアス素子等の故障
によるものなのか電源が印加されていないためなのかを
判別する手段についての記載はなく、前記誤動作に対す
る不具合に対処されていなかった。
【００１１】
【課題を解決するための手段】以上説明したように本発
明の異常検出回路は、バイアス供給電源と共通の電源を
用いつつ、かつ、特別のシーケンス回路等の誤動作防止
手段を付加することなく、簡易な手段により電源投入時
の誤認識を防止することを目的としている。
明の異常検出回路は、バイアス供給電源と共通の電源を
用いつつ、かつ、特別のシーケンス回路等の誤動作防止
手段を付加することなく、簡易な手段により電源投入時
の誤認識を防止することを目的としている。
【００１２】本発明の異常検出回路は、請求項１による
と、バイアス電流値の異常を検出する異常検出回路にお
いて、該異常検出回路は、被バイアス供給物に対してバ
イアス電流を供給するバイアス供給電源により動作する
よう構成し、前記異常検出回路は、前記バイアス電流値
の異常検出時、警報信号として、バイアス電源から警報
出力端子に負荷手段を通じてバイアス電源電圧を出力す
るよう構成したことを特徴とする。
と、バイアス電流値の異常を検出する異常検出回路にお
いて、該異常検出回路は、被バイアス供給物に対してバ
イアス電流を供給するバイアス供給電源により動作する
よう構成し、前記異常検出回路は、前記バイアス電流値
の異常検出時、警報信号として、バイアス電源から警報
出力端子に負荷手段を通じてバイアス電源電圧を出力す
るよう構成したことを特徴とする。
【００１３】また、本発明の異常検出回路は、請求項２
によると、前記警報出力端子と地気（ＧＮＤ）との間を
断続する切替手段を有し、前記バイアス電流値の異常を
検出しない時、前記切替手段を閉成し、正常（非警報）
信号として、地気から前記警報出力端子に前記切替手段
を通じて地気電圧を出力するよう構成したことを特徴と
する請求項１記載の異常検出回路である。
によると、前記警報出力端子と地気（ＧＮＤ）との間を
断続する切替手段を有し、前記バイアス電流値の異常を
検出しない時、前記切替手段を閉成し、正常（非警報）
信号として、地気から前記警報出力端子に前記切替手段
を通じて地気電圧を出力するよう構成したことを特徴と
する請求項１記載の異常検出回路である。
【００１４】そして、請求項３によると、前記異常検出
回路は、バイアス電流値が規定値より低下したことを検
出する電流低下検出手段およびバイアス電流値が規定値
より増加したことを検出する電流増加検出手段を有する
ことを特徴とする請求項１または請求項２記載の異常検
出回路である。
回路は、バイアス電流値が規定値より低下したことを検
出する電流低下検出手段およびバイアス電流値が規定値
より増加したことを検出する電流増加検出手段を有する
ことを特徴とする請求項１または請求項２記載の異常検
出回路である。
【００１５】さらに、請求項４によると、前記異常検出
回路は、バイアス電流値が規定値より低下したことを検
出した場合に警報信号を出力する電流低下警報出力端子
と、バイアス電流値が規定値より増加したことを検出し
た場合に警報信号を出力する電流増加警報出力端子とを
有することを特徴とする請求項３記載の異常検出回路で
ある。
回路は、バイアス電流値が規定値より低下したことを検
出した場合に警報信号を出力する電流低下警報出力端子
と、バイアス電流値が規定値より増加したことを検出し
た場合に警報信号を出力する電流増加警報出力端子とを
有することを特徴とする請求項３記載の異常検出回路で
ある。
【００１６】請求項５によると、前記異常検出回路は、
ＦＥＴトランジスタを用いた高周波電力増幅器におい
て、該ＦＥＴトランジスタのバイアス電流値の異常を検
出することを特徴とする請求項１乃至４のうち１に記載
の異常検出回路である。
ＦＥＴトランジスタを用いた高周波電力増幅器におい
て、該ＦＥＴトランジスタのバイアス電流値の異常を検
出することを特徴とする請求項１乃至４のうち１に記載
の異常検出回路である。
【００１７】
【００１８】
【発明の実施の形態】本発明の実施の形態について図面
を用いて説明する。
を用いて説明する。
【００１９】図１は、本発明の異常検出回路の構成を示
すブロック図である。
すブロック図である。
【００２０】本図において、バイアス供給電源端子１０
から被バイアス供給物１に供給するバイアス電流をバイ
アス電流検出手段２により検出する。
から被バイアス供給物１に供給するバイアス電流をバイ
アス電流検出手段２により検出する。
【００２１】そして、バイアス電源はＡ点で分岐され、
バイアス電流低下検出時警報出力手段３にも供給され
る。バイアス電流低下検出時警報出力手段３は、負荷手
段５および切替手段４から構成されている。
バイアス電流低下検出時警報出力手段３にも供給され
る。バイアス電流低下検出時警報出力手段３は、負荷手
段５および切替手段４から構成されている。
【００２２】切替手段４は、バイアス電流検出手段２か
らのバイアス電流をもとに、正常時にスイッチ手段６を
閉じてＤ点の電位を地気（ＧＮＤ）に接続し、ＬＯＷレ
ベルとする。一方、異常時には、スイッチ手段６を開放
してＤ点をＨＩＧＨレベルとする。
らのバイアス電流をもとに、正常時にスイッチ手段６を
閉じてＤ点の電位を地気（ＧＮＤ）に接続し、ＬＯＷレ
ベルとする。一方、異常時には、スイッチ手段６を開放
してＤ点をＨＩＧＨレベルとする。
【００２３】負荷手段５は、バイアス電源端子１０と切
替手段４の間に配置され、警報回路の負荷電流を制限
し、また、動作特性を改善する機能を有している。
替手段４の間に配置され、警報回路の負荷電流を制限
し、また、動作特性を改善する機能を有している。
【００２４】次に、バイアス電流検出手段２の構成につ
いては、種々の回路が考えられるが、例えば、図２に示
すようなオペアンプ（ＯＰ１）２４と電流検出用抵抗
（ＲL）２２を用いた構成が用いることができる。
いては、種々の回路が考えられるが、例えば、図２に示
すようなオペアンプ（ＯＰ１）２４と電流検出用抵抗
（ＲL）２２を用いた構成が用いることができる。
【００２５】すなわち、図２において、電流検出用抵抗
２２の両端の電圧をオペアンプ２４と抵抗（Ｒ１，Ｒ
２）２２で構成される差動増幅器で検出することができ
る。
２２の両端の電圧をオペアンプ２４と抵抗（Ｒ１，Ｒ
２）２２で構成される差動増幅器で検出することができ
る。
【００２６】また、バイアス電流低下時警報出力手段３
の構成については、図３のようなブロック図が適用でき
る。
の構成については、図３のようなブロック図が適用でき
る。
【００２７】すなわち、図３において、切替手段４は、
トランジスタ（ＴＲ１）４１とバイアス抵抗（Ｒ４，Ｒ
５）４２とから構成される。トランジスタ４１は、バイ
アス電流検出手段２の出力電圧が所定の値以上になると
オン状態となり、コレクタ電圧は地気となる。
トランジスタ（ＴＲ１）４１とバイアス抵抗（Ｒ４，Ｒ
５）４２とから構成される。トランジスタ４１は、バイ
アス電流検出手段２の出力電圧が所定の値以上になると
オン状態となり、コレクタ電圧は地気となる。
【００２８】一方、バイアス電流検出手段２の出力電圧
が所定の値以下となると、トランジスタ４１はオープン
状態となる。
が所定の値以下となると、トランジスタ４１はオープン
状態となる。
【００２９】負荷手段５については、例えば、トランジ
スタ４１のコレクタに接続した抵抗（Ｒ３）５２とツェ
ナーダイオード（Ｄ１）５３から構成される。 〔実施例〕次に、本発明の実施例について図面を参照し
て詳細に説明する。
スタ４１のコレクタに接続した抵抗（Ｒ３）５２とツェ
ナーダイオード（Ｄ１）５３から構成される。 〔実施例〕次に、本発明の実施例について図面を参照し
て詳細に説明する。
【００３０】図４は電界効果トランジスタ（以下ＦＥＴ
と記す）を用いた高周波電力増幅器のドレインバイアス
供給回路に本発明の異常検出回路を適用した具体的実施
例を示す回路図である。本回路では、過電流時および電
流低下時のどちらの場合にも警報を出力するように機能
を構成している。
と記す）を用いた高周波電力増幅器のドレインバイアス
供給回路に本発明の異常検出回路を適用した具体的実施
例を示す回路図である。本回路では、過電流時および電
流低下時のどちらの場合にも警報を出力するように機能
を構成している。
【００３１】一般に、ＦＥＴが破壊した場合には、通常
ショートモードないしオープンモードとなる。ショート
モードとなると電源が過負荷となったり、抵抗その他の
周辺部品が焼損する恐れがある。一方、オープンモード
の場合には、シングルエンド構成では上記ショートモー
ドのような焼損等は生じないが、並列動作して合成する
ような増幅器においては、並列動作の一つが破壊した場
合にＲＦ的にバランスをくずし他のＦＥＴを破損したり
終端器等を破損する恐れがある。従って、ＦＥＴがオー
プンモードで破壊した場合にも異常を検出して電源を断
とするなどして保護する必要がある。
ショートモードないしオープンモードとなる。ショート
モードとなると電源が過負荷となったり、抵抗その他の
周辺部品が焼損する恐れがある。一方、オープンモード
の場合には、シングルエンド構成では上記ショートモー
ドのような焼損等は生じないが、並列動作して合成する
ような増幅器においては、並列動作の一つが破壊した場
合にＲＦ的にバランスをくずし他のＦＥＴを破損したり
終端器等を破損する恐れがある。従って、ＦＥＴがオー
プンモードで破壊した場合にも異常を検出して電源を断
とするなどして保護する必要がある。
【００３２】図４の実施例においては、ＦＥＴ１にはド
レイン電流として１０Ａｔｙｐに設定され、約２倍の２
０Ａ以上の過電流時に過電流の警報を出力し、約半分の
５Ａ以下になった場合に電流低下状態として警報を出力
する。
レイン電流として１０Ａｔｙｐに設定され、約２倍の２
０Ａ以上の過電流時に過電流の警報を出力し、約半分の
５Ａ以下になった場合に電流低下状態として警報を出力
する。
【００３３】電流検出手段２は、検出用の低抵抗ＲL の
電圧降下を検出しオペアンプ２４により増幅の後、過電
流警報として端子１１′に警報信号が出力され、また、
電流低下時警報出力手段３を通じて低電流時には端子１
１に警報信号が出力される。
電圧降下を検出しオペアンプ２４により増幅の後、過電
流警報として端子１１′に警報信号が出力され、また、
電流低下時警報出力手段３を通じて低電流時には端子１
１に警報信号が出力される。
【００３４】電流低下時警報出力手段３は電流検出手段
２の出力電圧によりＴＲ１をＯＮ／ＯＦＦするように設
定されている。本実施例の場合には、Ｃ点の電圧は通常
約１．５Ｖ程度となるが、Ｒ４とＲ５の接続点がＴＲ１
のベースエミッタ間電圧ＶBE（〜０．７Ｖ）以下になっ
た場合にＴＲ１はＯＦＦとなり、端子１１にはツェナー
ダイオードＤ１、Ｒ３，ＯＲ用ダイオードＤ３、および
抵抗Ｒ７を経て電源電圧のＨＩＧＨレベルが出力され異
常と認識される。
２の出力電圧によりＴＲ１をＯＮ／ＯＦＦするように設
定されている。本実施例の場合には、Ｃ点の電圧は通常
約１．５Ｖ程度となるが、Ｒ４とＲ５の接続点がＴＲ１
のベースエミッタ間電圧ＶBE（〜０．７Ｖ）以下になっ
た場合にＴＲ１はＯＦＦとなり、端子１１にはツェナー
ダイオードＤ１、Ｒ３，ＯＲ用ダイオードＤ３、および
抵抗Ｒ７を経て電源電圧のＨＩＧＨレベルが出力され異
常と認識される。
【００３５】正常時はＴＲ１がＯＮ状態にある故、点Ｄ
はＧＮＤレベルであり、従って端子１１はＬＯＷレベル
（ＯＰＥＮ）となる。
はＧＮＤレベルであり、従って端子１１はＬＯＷレベル
（ＯＰＥＮ）となる。
【００３６】従って、電源投入時はＬＯＷレベルから変
化していく故、低電流警報が誤動作することはなく、電
源電圧が正常に印加されているにも関わらず電流値が低
下している場合を検出することが可能となる。
化していく故、低電流警報が誤動作することはなく、電
源電圧が正常に印加されているにも関わらず電流値が低
下している場合を検出することが可能となる。
【００３７】図中ツェナーダイオードＤ１は必ずしも必
要ではないが、ツェナー電圧分以上に電源電圧が上昇す
るまでは異常状態と誤動作しないように作用し、回路動
作がより正確になる。
要ではないが、ツェナー電圧分以上に電源電圧が上昇す
るまでは異常状態と誤動作しないように作用し、回路動
作がより正確になる。
【００３８】Ｒ３は１ｋΩであるから、正常時はＴＲ１
がＯＮ状態にある故、ＴＲ１のコレクタ電流は約１０ｍ
Ａとなる。
がＯＮ状態にある故、ＴＲ１のコレクタ電流は約１０ｍ
Ａとなる。
【００３９】低電流異常時はツェナー電圧＝６Ｖ、ダイ
オードＤ３のドロップを〜０．７Ｖとして、端子１１に
は負荷抵抗Ｒ１０との分圧比で決まる電圧が出力され
る。
オードＤ３のドロップを〜０．７Ｖとして、端子１１に
は負荷抵抗Ｒ１０との分圧比で決まる電圧が出力され
る。
【００４０】端子１１，１１′はダイオードＯＲが可能
な構成となっているため、双方を接続しまとめて一つの
警報として出力することも可能である。
な構成となっているため、双方を接続しまとめて一つの
警報として出力することも可能である。
【００４１】図４に示した電流検出手段２や電流低下時
警報出力手段３はあくまで本発明の機能を実現するため
の一実施例に過ぎず、同様の機能を有する他の手段によ
り実現してもよいことは言うまでもない。例えば、オペ
アンプはトランジスタで同機能を達成可能であるし、ま
た、ＴＲ１はＦＥＴまたはリレー等でも可能である。
警報出力手段３はあくまで本発明の機能を実現するため
の一実施例に過ぎず、同様の機能を有する他の手段によ
り実現してもよいことは言うまでもない。例えば、オペ
アンプはトランジスタで同機能を達成可能であるし、ま
た、ＴＲ１はＦＥＴまたはリレー等でも可能である。
【００４２】
【発明の効果】第一の効果は、本発明の異常検出回路に
よれば、バイアス供給電源と共通の電源を用いつつ、か
つ、特別のシーケンス回路等の誤動作防止手段を付加す
ることなく、簡易な手段により電源投入時の低電流異常
の誤認識、誤動作を防止することを可能とすることがで
きる。
よれば、バイアス供給電源と共通の電源を用いつつ、か
つ、特別のシーケンス回路等の誤動作防止手段を付加す
ることなく、簡易な手段により電源投入時の低電流異常
の誤認識、誤動作を防止することを可能とすることがで
きる。
【００４３】その理由は、バイアス供給電源と共通の電
源を用い、バイアス供給電源と同一の極性のＨＩＧＨレ
ベルを異常状態時の警報信号として設定しているからで
ある。これにより、電源投入時に、装置（電源）が立ち
上がらないような不具合を防止し、特別のシーケンス回
路等の誤動作防止手段を付加することなく実現すること
が可能となる。
源を用い、バイアス供給電源と同一の極性のＨＩＧＨレ
ベルを異常状態時の警報信号として設定しているからで
ある。これにより、電源投入時に、装置（電源）が立ち
上がらないような不具合を防止し、特別のシーケンス回
路等の誤動作防止手段を付加することなく実現すること
が可能となる。
【００４４】第二の効果は電源電圧が正常に印加されて
いる状態で電流値が規定の値より低い場合のみを異常と
認識することを簡易な構成により実現できる。
いる状態で電流値が規定の値より低い場合のみを異常と
認識することを簡易な構成により実現できる。
【００４５】その理由は、警報出力手段の出力信号とし
てバイアス電源電圧を意図的に利用して論理回路を構成
しているからである。
てバイアス電源電圧を意図的に利用して論理回路を構成
しているからである。
【図１】本発明の実施の形態の構成を示す図である。
【図２】図１のバイアス電流検出手段２の構成を示す図
である。
である。
【図３】図１のバイアス電流低下時警報出力手段３の構
成を示す図である。
成を示す図である。
【図４】本発明の異常検出回路の実施例を示す図であ
る。
る。
【図５】従来の異常検出回路の構成を示す図である。
１ 被バイアス供給物 ２ バイアス電流検出手段 ３ バイアス電流低下時警報出力手段 ４ 切替手段 ５ 負荷手段 ６ スイッチ手段 １０ バイアス供給電源端子 １０ｂ 警報回路用別電源供給端子 １１ 警報出力端子 ２１ トランジスタ ２２，４２，５２，６２，６３ 抵抗 ５３ ツェナーダイオード ２４ ＦＥＴ ２５，６１ ダイオード ２４ オペアンプ
Claims (5)
- 【請求項１】 バイアス電流値の異常を検出する異常検
出回路において、 該異常検出回路は、被バイアス供給物に対してバイアス
電流を供給するバイアス供給電源により動作するよう構
成し、前記異常検出回路は、前記バイアス電流値の異常
検出時、警報信号として、バイアス電源から警報出力端
子に負荷手段を通じてバイアス電源電圧を出力するよう
構成したことを特徴とする異常検出回路。 - 【請求項２】 前記異常検出回路は、前記警報出力端子
と地気（ＧＮＤ）との間を断続する切替手段を有し、 前記バイアス電流値の異常を検出しない時、前記切替手
段を閉成し、正常（非警報）信号として、地気から前記
警報出力端子に前記切替手段を通じて地気電圧を出力す
るよう構成したことを特徴とする請求項１記載の異常検
出回路。 - 【請求項３】 前記異常検出回路は、バイアス電流値が
規定値より低下したことを検出する電流低下検出手段お
よびバイアス電流値が規定値より増加したことを検出す
る電流増加検出手段を有することを特徴とする請求項１
または請求項２に記載の異常検出回路。 - 【請求項４】 前記異常検出回路は、バイアス電流値が
規定値より低下したことを検出した場合に警報信号を出
力する電流低下警報出力端子と、バイアス電流値が規定
値より増加したことを検出した場合に警報信号を出力す
る電流増加警報出力端子とを有することを特徴とする請
求項３記載の異常検出回路。 - 【請求項５】 前記異常検出回路は、ＦＥＴトランジス
タを用いた高周波電力増幅器において、該ＦＥＴトラン
ジスタのバイアス電流値の異常を検出することを特徴と
する請求項１乃至４のうち１に記載の異常検出回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP08133297A JP3147808B2 (ja) | 1997-03-31 | 1997-03-31 | 異常検出回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP08133297A JP3147808B2 (ja) | 1997-03-31 | 1997-03-31 | 異常検出回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH10284952A JPH10284952A (ja) | 1998-10-23 |
| JP3147808B2 true JP3147808B2 (ja) | 2001-03-19 |
Family
ID=13743436
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP08133297A Expired - Fee Related JP3147808B2 (ja) | 1997-03-31 | 1997-03-31 | 異常検出回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP3147808B2 (ja) |
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1997
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