JP2988815B2 - 液晶駆動装置 - Google Patents
液晶駆動装置Info
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Description
細には階調信号補正回路を内蔵し、液晶セルの特性に応
じて輝度信号のパルス幅を制御し階調特性を均等にし得
る液晶駆動装置に係る。
を示す図、図7は従来の階調基本信号を示す図である。
路、21は階調デ−タメモリ、22はラインデ−タメモ
リ、23は階調信号選択回路、24は液晶駆動回路であ
る。図6において、Nビットの階調デ−タKD0 〜KD
Nは読み込み信号1によって階調デ−タメモリ21にN
ビット単位で順次書き込まれ、1走査線分のデ−タが揃
った時点でロ−ド信号によりラインデ−タメモリ22に
転送され、次のロ−ド信号が入力されるまで1走査線分
のデ−タが保持され、この階調デ−タが階調信号選択回
路23に転送される。
ックに同期して動作するカウンタにより、図7に示すよ
うな1走査期間を階調数に応じて分割した基本階調信号
K0〜Kn を生成する。そして、階調信号選択回路23
では階調デ−タに応じた基本階調信号K0 〜Kn を選択
し、液晶駆動回路24に伝え輝度信号として出力してい
る。
的光学特性を示す図、図9は従来の階調レベルと印加電
圧との関係を示す図である。
の特性例であり、実線で示した特性1と破線で示した特
性2が環境等の変化で変動する範囲である。
性2が環境等の変化で変動した特性とすると、透過率5
0%の階調レベルにしたい場合、特性1では液晶セルに
印加する電圧を電圧Vm に、特性2では電圧VHm にし
なければならないことは図8から自明である。
期間を階調数に応じて分割したパルスを階調信号として
使用していたため、図9に示すように階調レベルに対応
した印加電圧が固定されてしまい、液晶セルの特性に応
じた電圧を印加することはできない。
により液晶セルの印加電圧に対する透過率の特性が変わ
った場合、階調レベルを均等に得ることができなかっ
た。
する透過率の特性が変化しても階調レベルを均等に得る
ことができる液晶駆動装置を提供することにある。
は、1走査期間内における選択期間と非選択期間とのパ
ルス幅の比率に関して調整自在な信号を出力する補正回
路と、補正回路から出力される信号に基づいて液晶を駆
動する手段とを具備する液晶駆動装置であって、補正回
路は、1走査期間を階調数に応じて分割し、異なったパ
ルス幅比率の信号を生成する基本階調信号生成回路と、
パルス幅比率を階段的に補正するnビットの補正データ
を記憶する補正データ記憶回路と、補正データ記憶回路
に記憶されているnビットの補正データに応じて、2 n
段階の範囲で、基本階調信号生成回路の出力信号のパル
ス幅を調整するパルス幅制御回路とを含むことを特徴と
する。
選択期間とのパルス幅の比率に関して調整自在な信号を
出力し、液晶を駆動する手段が補正回路から出力される
信号に基づいて液晶を駆動する。その際、補正回路は、
補正データ記憶回路に記憶されているnビットの補正デ
ータに応じて、2 n 段階の範囲で出力信号のパルス幅を
調整するので、液晶材料や使用環境により変わる液晶セ
ルの印加電圧に対する透過率の特性に応じて、パルス幅
比率を制御して印加電圧を補正することにより階調レベ
ルを均等に維持し得る。
間内で選択期間と非選択期間のパルス幅比率を変えるこ
とにより階調制御を行うパルス幅変調方式の液晶駆動回
路において、階調信号パルス幅を段階的に調整すること
ができる階調信号補正回路を具備することを特徴とし、
1走査期間を階調数に応じて分割し、異なるパルス幅比
率の信号を生成する基本階調信号生成回路、パルス幅比
率を段階的に補正するためのデ−タを記憶する補正デ−
タ記憶回路、該基本階調信号生成回路の出力信号パルス
幅を該補正デ−タ記憶回路の内容に応じて制御するパル
ス幅制御回路を含む階調信号補正回路を具備することを
特徴とし、電源遮断時においても補正デ−タを保持して
おく記憶手段として、不揮発性のメモリから構成される
補正デ−タ記憶回路を具備することを特徴としている。
する。
成を示す図、図2は本実施例により補正した階調基本信
号を示す図、図3は補正デ−タと読み込みクロックとの
関係を示す図、図4は本実施例により補正した階調レベ
ルと印加電圧との関係を示す図、図5は図8の電気的光
学特性例に対して、階調レベルが均等に得られるように
本実施例により、印加電圧を補正した階調レベルと印加
電圧との関係を示す図である。
ットの補正デ−タHD0 〜HDn 及び読み込み信号2が
供給され、補正デ−タに基づき補正された基本階調信号
HK0 〜HKn を出力する階調信号補正回路である。該
階調信号補正回路10は、基本クロックが入力され、基
本階調信号を生成する基本階調信号生成回路11、補正
デ−タHD0 〜HDn 及び読み込み信号2が供給され、
読み込み信号2に応答して補正デ−タを記憶する補正デ
−タ記憶回路12及びこれらの出力が供給され補正デ−
タに基づき補正された基本階調信号HK0 〜HKn を外
部に出力するパルス幅制御回路13からなる。14は外
部からのNビットの階調デ−タKD0 〜KDN 及び読み
込み信号1が供給される1走査線分の階調デ−タが順次
書き込まれる階調データメモリである。15は階調デ−
タメモリからの出力及びロード信号が供給され、ロード
信号に応答して一括で1走査線分の階調データ(階調デ
−タメモリからの出力)が転送されるラインデ−タメモ
リである。16は前記階調信号補正回路10からの補正
された基本階調信号及びラインデ−タメモリからの出力
が入力され、ラインデ−タメモリからのデータに基づき
基本階調信号のいずれかを選択し出力する一走査線分の
階調信号選択回路である。17は階調信号選択回路16
からの出力に基づき一走査線分の液晶駆動出力を出力す
る液晶駆動回路である。階調デ−タメモリ14、ライン
デ−タメモリ15、階調信号選択回路16、および液晶
駆動回路17が液晶を駆動する手段を構成する。
−タKD0 〜KDNが読み込み信号1によって階調デ−
タメモリ14にNビット単位で順次書き込まれる。1走
査線分の階調デ−タが階調デ−タメモリ14に揃った時
点でロ−ド信号によりラインデ−タメモリ15に転送さ
れ、次のロ−ド信号が入力されるまでの間1走査線分の
デ−タが保持される。この階調デ−タが階調信号選択回
路16に伝えられる。nビットの補正デ−タに応じて階
調信号補正回路10で2n 段階の範囲内(例えばn=8
ビットの場合、階調信号パルス幅を256段階の範囲内
で微調整できることになる)で補正された図2の基本階
調信号HK0 〜HKn が階調デ−タに応じて階調信号選
択回路16で選択され、液晶駆動回路17に伝えられ、
輝度信号として出力される。
0では、図3に示すタイミングで基本階調信号HK0 〜
HKn に対応するnビットの補正デ−タHD0 〜HDn
が階調レベルごとに設けられた補正デ−タ記憶回路12
にnビット単位で順次書き込まれる。即ち、読み込み信
号2の第1クロックで基本階調信号HK0 に対応した補
正デ−タが、対応する階調レベルの補正デ−タ記憶回路
12に書き込まれ、読み込み信号2の第2クロックで基
本階調信号HK1 に対応した補正デ−タが、対応する階
調レベルの補正デ−タ記憶回路12に書き込まれ、以降
同様に第lクロックまでで基本階調信号HKn までに対
応した補正デ−タが階調レベルごとに設けられた補正デ
−タ記憶回路12にそれぞれnビット単位で順次書き込
まれる。このようにして書き込まれた補正デ−タはパル
ス幅補正回路13に伝えられる。
ル毎の基本階調信号を従来例と同様、基本クロックに同
期して動作するカウンタにより生成する。この各階調レ
ベル毎の基本階調信号のパルス幅をパルス幅制御回路1
3で、補正デ−タ記憶回路12からの補正デ−タに応じ
て、1〜2n まで段階的に制御することにより階調信号
を補正し、階調信号選択回路16に伝える。
レベル毎の基本階調信号のパルス幅を1(最小補正)に
したときの階調レベルと印加電圧との関係、パルス幅を
2n(最大補正)にしたときの階調レベルと印加電圧と
の関係であり、その範囲内で各階調レベル毎の印加電圧
を補正できることを示している。
り変化した液晶セルの印加電圧に対する透過率の特性
を、本実施例を用いて階調レベルが均等に得られるよう
基本階調信号のパルス幅を制御し、印加電圧を補正した
ことを示したものである。
記憶回路12は、フラッシュメモリ、OTP、EERO
M等の不揮発性のメモリから構成され、一度記憶した補
正デ−タは電源が遮断されても保持する。
使用環境により変わる液晶セルの印加電圧に対する透過
率の特性に応じて、パルス幅比率を制御することにより
印加電圧を補正できる液晶駆動装置を提供することがで
きる。
ば、補正デ−タのビット数に応じた補正デ−タ記憶回路
を備えることにより、各階調レベル毎の基本階調信号を
夫々段階的にしかも微妙に補正することができ、各階調
レベルに最適な印加電圧を供給することができる。
液晶表示装置の製造時等において、電気的光学特性のば
らつきを階調信号補正により補正する場合、電源遮断時
においてもデ−タを保持することができるので、補正デ
−タを再設定する必要がなくなる。
間と非選択期間とのパルス幅の比率に関して調整自在な
信号を出力し、液晶を駆動する手段が補正回路から出力
される信号に基づいて液晶を駆動する。その際、補正回
路は、補正データ記憶回路に記憶されているnビットの
補正データに応じて、2 n 段階の範囲で出力信号のパル
ス幅を調整するので、液晶材料や使用環境により変わる
液晶セルの印加電圧に対する透過率の特性に応じて、パ
ルス幅比率を制御して印加電圧を補正することにより階
調レベルを均等に維持し得る。
である。
示す図である。
図である。
加電圧との関係を示す図である。
関係を示す図である。
る。
である。
Claims (2)
- 【請求項1】 1走査期間内における選択期間と非選択
期間とのパルス幅の比率に関して調整自在な信号を出力
する補正回路と、前記補正回路から出力される信号に基
づいて液晶を駆動する手段とを具備する液晶駆動装置で
あって、前記補正回路は、1走査期間を階調数に応じて
分割し、異なったパルス幅比率の信号を生成する基本階
調信号生成回路と、パルス幅比率を階段的に補正するn
ビットの補正データを記憶する補正データ記憶回路と、
前記補正データ記憶回路に記憶されているnビットの補
正データに応じて、2 n 段階の範囲で、前記基本階調信
号生成回路の出力信号のパルス幅を調整するパルス幅制
御回路とを含むすることを特徴とする液晶駆動装置。 - 【請求項2】 前記補正データ記憶回路は、不揮発性メ
モリを具備することを特徴とする請求項1に記載の液晶
駆動装置。
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Application Number | Title | Priority Date | Filing Date |
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-
1993
- 1993-11-12 JP JP28328893A patent/JP2988815B2/ja not_active Expired - Fee Related
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