JP2968847B2 - 雑音発生装置 - Google Patents
雑音発生装置Info
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Description
【０００１】
【産業上の利用分野】本発明は、電子楽器や効果装置に
おいて使用する雑音発生装置に関する。
おいて使用する雑音発生装置に関する。
【０００２】
【従来の技術】従来、例えば電子楽器においては、シン
バルやスネアドラムの音源として雑音発生装置を使用す
ることがあり、普通の楽音を発生させる音源とは別に、
雑音発生装置として、乱数発生装置を設けるものがあっ
た。また、楽音の音源として楽音波形を記憶装置に記憶
させる方式の電子楽器では、雑音波形も記憶装置に記憶
させるものがあった。なお、雑音波形を記憶させる場
合、この雑音波形を読みだした際に、周期性を聴者に感
じさせないようにするため、少し長い区間に渡って雑音
波形を記憶させている。
バルやスネアドラムの音源として雑音発生装置を使用す
ることがあり、普通の楽音を発生させる音源とは別に、
雑音発生装置として、乱数発生装置を設けるものがあっ
た。また、楽音の音源として楽音波形を記憶装置に記憶
させる方式の電子楽器では、雑音波形も記憶装置に記憶
させるものがあった。なお、雑音波形を記憶させる場
合、この雑音波形を読みだした際に、周期性を聴者に感
じさせないようにするため、少し長い区間に渡って雑音
波形を記憶させている。
【０００３】
【発明が解決しようとする課題】しかし、乱数発生装置
を雑音発生装置として用いたものでは、雑音を発生させ
るためだけに、通常の音源とは別に乱数発生装置を設け
なければならず、構成が複雑になるという問題点があっ
た。また、雑音波形を記憶装置に記憶させるものでは、
少し長い区間だけ雑音波形を記憶装置に記憶させねばな
らないので、記憶装置の容量が多く必要なり、コストが
高くなるという問題点があった。
を雑音発生装置として用いたものでは、雑音を発生させ
るためだけに、通常の音源とは別に乱数発生装置を設け
なければならず、構成が複雑になるという問題点があっ
た。また、雑音波形を記憶装置に記憶させるものでは、
少し長い区間だけ雑音波形を記憶装置に記憶させねばな
らないので、記憶装置の容量が多く必要なり、コストが
高くなるという問題点があった。
【０００４】本発明は、例えば電子楽器の音源として使
用する信号発生装置と、この信号発生装置の出力が供給
される演算手段とを用いて、雑音を発生させることによ
って、構成が簡単で、低コストの雑音発生装置を提供す
ることを目的とする。
用する信号発生装置と、この信号発生装置の出力が供給
される演算手段とを用いて、雑音を発生させることによ
って、構成が簡単で、低コストの雑音発生装置を提供す
ることを目的とする。
【０００５】
【課題を解決するための手段】上記の目的を達成するた
めに、本発明は、周期信号または非周期信号を発生する
信号発生手段と、この信号発生手段の出力信号が入力さ
れ、その信号に演算を施す演算手段とを、具備してい
る。前記演算手段には、演算によって信号がオーバーフ
ローすることを防止するクリップ手段と、雑音信号を発
生させる場合、前記クリップ手段を解除する解除手段と
が、さらに備えられている。
めに、本発明は、周期信号または非周期信号を発生する
信号発生手段と、この信号発生手段の出力信号が入力さ
れ、その信号に演算を施す演算手段とを、具備してい
る。前記演算手段には、演算によって信号がオーバーフ
ローすることを防止するクリップ手段と、雑音信号を発
生させる場合、前記クリップ手段を解除する解除手段と
が、さらに備えられている。
【０００６】具体的には、演算手段は、ディジタルフィ
ルタ手段とすることができる。さらに、信号発生手段
は、ディジタル可聴周波数信号を発生するものとするこ
とができる。また、上記ディジタルフィルタ手段は、帰
還ループと、そのループ内に加算手段を有するものとす
ることができる。上記クリップ手段は、上記加算手段の
出力のオーバーフローを検出したとき、加算手段の出力
を所定値にクリップするものとできる。
ルタ手段とすることができる。さらに、信号発生手段
は、ディジタル可聴周波数信号を発生するものとするこ
とができる。また、上記ディジタルフィルタ手段は、帰
還ループと、そのループ内に加算手段を有するものとす
ることができる。上記クリップ手段は、上記加算手段の
出力のオーバーフローを検出したとき、加算手段の出力
を所定値にクリップするものとできる。
【０００７】
【作用】本発明によれば、クリップ手段が作動している
状態では、信号発生手段からの信号は、オーバーフロー
することなく演算手段によって演算が施されて、出力さ
れる。例えば、ディジタルフィルタ手段によってフィル
タ処理されて、出力される。また、クリップ手段が解除
された状態では、演算によってオーバーフローするの
で、雑音を発生する。
状態では、信号発生手段からの信号は、オーバーフロー
することなく演算手段によって演算が施されて、出力さ
れる。例えば、ディジタルフィルタ手段によってフィル
タ処理されて、出力される。また、クリップ手段が解除
された状態では、演算によってオーバーフローするの
で、雑音を発生する。
【０００８】
【実施例】第１の実施例は、本発明を電子楽器に実施し
たもので、この電子楽器は、図２に示すように、キース
イッチ回路２を有し、このキースイッチ回路２は、多数
のスイッチを備えるもので、図示していない鍵盤のいず
れかの鍵を押鍵すると、この押鍵された鍵に対応するス
イッチが動作する。この動作したスイッチをキーアサイ
ナー４が検出し、押鍵された鍵に対応する音高情報Ｐ
と、キーオン信号ＫＯＮとを、楽音形成装置６内の最大
同時発音数に相当する複数の楽音形成手段８のうち適当
なものに割当てる。この割り当てられた楽音形成手段８
は、音高情報Ｐと、キーオン信号ＫＯＮとに基づいて楽
音信号を発生する。
たもので、この電子楽器は、図２に示すように、キース
イッチ回路２を有し、このキースイッチ回路２は、多数
のスイッチを備えるもので、図示していない鍵盤のいず
れかの鍵を押鍵すると、この押鍵された鍵に対応するス
イッチが動作する。この動作したスイッチをキーアサイ
ナー４が検出し、押鍵された鍵に対応する音高情報Ｐ
と、キーオン信号ＫＯＮとを、楽音形成装置６内の最大
同時発音数に相当する複数の楽音形成手段８のうち適当
なものに割当てる。この割り当てられた楽音形成手段８
は、音高情報Ｐと、キーオン信号ＫＯＮとに基づいて楽
音信号を発生する。
【０００９】図３に示すように、楽音形成装置６の楽音
形成手段８は、楽音形成装置６の最大発音数に対応した
数だけ設けられている。各楽音形成手段８は、キーアサ
イナー４によって割り当てられた音高情報Ｐに対応した
音高のデジタル楽音信号を発生する楽音発生装置１０を
有している。この楽音発生装置１０が発生したデジタル
楽音信号は、デジタルフィルタ１２に供給され、適当な
音色が形成される。この音色の形成された楽音信号は、
乗算器１４に供給される。この乗算器１４には、エンベ
ロープ発生装置１６からのエンベロープ信号も供給され
ており、乗算器１４は、音色の形成された楽音信号と、
エンベロープ信号とを乗算して、音色の形成された楽音
信号にエンベロープを付加する。なお、エンベロープ発
生装置１６は、キーアサイナー４によって割り当てられ
たキーオン信号ＫＯＮに基づいてエンベロープ信号を発
生する。これら各楽音形成手段８からの出力信号、即ち
各乗算器１４からの出力信号は、混合用加算器１８によ
って混合され、図示しないデジタルアナログ変換器によ
ってアナログ楽音信号に変換される。
形成手段８は、楽音形成装置６の最大発音数に対応した
数だけ設けられている。各楽音形成手段８は、キーアサ
イナー４によって割り当てられた音高情報Ｐに対応した
音高のデジタル楽音信号を発生する楽音発生装置１０を
有している。この楽音発生装置１０が発生したデジタル
楽音信号は、デジタルフィルタ１２に供給され、適当な
音色が形成される。この音色の形成された楽音信号は、
乗算器１４に供給される。この乗算器１４には、エンベ
ロープ発生装置１６からのエンベロープ信号も供給され
ており、乗算器１４は、音色の形成された楽音信号と、
エンベロープ信号とを乗算して、音色の形成された楽音
信号にエンベロープを付加する。なお、エンベロープ発
生装置１６は、キーアサイナー４によって割り当てられ
たキーオン信号ＫＯＮに基づいてエンベロープ信号を発
生する。これら各楽音形成手段８からの出力信号、即ち
各乗算器１４からの出力信号は、混合用加算器１８によ
って混合され、図示しないデジタルアナログ変換器によ
ってアナログ楽音信号に変換される。
【００１０】フィルタ１２は、図１に示すように、例え
ば加算器２０と、１サンプリング遅延部２２と、乗算器
２４とからなる巡回型のデジタルローパスフィルタによ
って構成されており、加算器２０は、楽音発生装置１０
からのデジタル信号と、乗算器２４の出力とを加算する
もので、この加算器２０の出力は遅延部２２で１サンプ
リング遅延されて出力されると共に、乗算器２４に供給
され、係数Ｗが乗算される。この係数Ｗを変更すること
によってローパスフィルタ１２の周波数特性が変更され
る。、なお、この係数Ｗは図示しないＣＰＵから供給さ
れる。
ば加算器２０と、１サンプリング遅延部２２と、乗算器
２４とからなる巡回型のデジタルローパスフィルタによ
って構成されており、加算器２０は、楽音発生装置１０
からのデジタル信号と、乗算器２４の出力とを加算する
もので、この加算器２０の出力は遅延部２２で１サンプ
リング遅延されて出力されると共に、乗算器２４に供給
され、係数Ｗが乗算される。この係数Ｗを変更すること
によってローパスフィルタ１２の周波数特性が変更され
る。、なお、この係数Ｗは図示しないＣＰＵから供給さ
れる。
【００１１】加算器２０は、例えば加算回路２６の出力
側にオーバフローチェック回路２８を備えたもので、加
算回路２６には、図４に示すように、楽音発生装置１０
と乗算器２４とから１６ビットのデジタル信号ＤＡ15乃
至ＤＡ0 、ＤＢ15乃至ＤＢ0 が供給される。これらデジ
タル信号ＤＡ15乃至ＤＡ0 、ＤＢ15乃至ＤＢ0 は、次の
ように１０進数と対応しているものである。
側にオーバフローチェック回路２８を備えたもので、加
算回路２６には、図４に示すように、楽音発生装置１０
と乗算器２４とから１６ビットのデジタル信号ＤＡ15乃
至ＤＡ0 、ＤＢ15乃至ＤＢ0 が供給される。これらデジ
タル信号ＤＡ15乃至ＤＡ0 、ＤＢ15乃至ＤＢ0 は、次の
ように１０進数と対応しているものである。
【００１２】
【００１３】加算回路２６は１７ビットの２つの入力Ａ
16乃至Ａ0 、Ｂ16乃至Ｂ0 を有し、デジタル信号ＤＡ15
乃至ＤＡ0 は、加算回路２６の入力側Ａ15乃至Ａ0 に入
力され、さらにデジタル信号ＤＡ15は、入力Ａ16にも供
給されている。同様にデジタル信号ＤＢ15乃至ＤＢ
0 は、加算回路２６の入力側Ｂ15乃至Ｂ0 に入力され、
さらにデジタル信号ＤＢ15は、入力Ｂ16にも供給されて
いる。このように１７ビットの加算回路２６を用いてい
るのは、１６ビットと１６ビットの加算を行うと、加算
結果の最大値が１７ビットとなるからである。従って、
加算回路２６の出力Ｏ16乃至Ｏ0 は次の表のような結果
となる。
16乃至Ａ0 、Ｂ16乃至Ｂ0 を有し、デジタル信号ＤＡ15
乃至ＤＡ0 は、加算回路２６の入力側Ａ15乃至Ａ0 に入
力され、さらにデジタル信号ＤＡ15は、入力Ａ16にも供
給されている。同様にデジタル信号ＤＢ15乃至ＤＢ
0 は、加算回路２６の入力側Ｂ15乃至Ｂ0 に入力され、
さらにデジタル信号ＤＢ15は、入力Ｂ16にも供給されて
いる。このように１７ビットの加算回路２６を用いてい
るのは、１６ビットと１６ビットの加算を行うと、加算
結果の最大値が１７ビットとなるからである。従って、
加算回路２６の出力Ｏ16乃至Ｏ0 は次の表のような結果
となる。
【００１４】
【００１５】このように加算回路２６の出力信号が１７
ビットとなるとき、即ち１０進数で32768 以上、-32769
以下のとき、出力を32767(0111111111111111) 、-32768
(1000000000000000)にクリップするために、オーバフロ
ーチェック回路２８が設けられている。このオーバフロ
ーチェック回路２８は、図示しないＣＰＵ等からＨレベ
ルの信号ＥＮがＡＮＤ回路３０、３２に供給されたと
き、オバーフローチェックを行うもので、ＣＰＵからＬ
レベルの信号ＥＮがＡＮＤ回路３０、３２に供給されて
いるときには、オーバフローチェックは行わない。
ビットとなるとき、即ち１０進数で32768 以上、-32769
以下のとき、出力を32767(0111111111111111) 、-32768
(1000000000000000)にクリップするために、オーバフロ
ーチェック回路２８が設けられている。このオーバフロ
ーチェック回路２８は、図示しないＣＰＵ等からＨレベ
ルの信号ＥＮがＡＮＤ回路３０、３２に供給されたと
き、オバーフローチェックを行うもので、ＣＰＵからＬ
レベルの信号ＥＮがＡＮＤ回路３０、３２に供給されて
いるときには、オーバフローチェックは行わない。
【００１６】即ち、Ｌレベルの信号ＥＮがＡＮＤゲート
３０、３２に供給されていると、これらＡＮＤゲート３
０、３２の出力信号は共にＬレベルとなり、ＡＮＤゲー
ト３０のＬレベルの信号はインバータ３４で反転され
て、ＡＮＤゲート３６を開くので、出力Ｏ15がＯＲゲー
ト３８に供給される。このとき、ＯＲゲート３８にはＡ
ＮＤゲート３２のＬレベルの信号がインバータ４０、４
２を介して供給されているので、ＯＲゲート３８の出力
は出力Ｏ15となる。また、出力Ｏ14乃至Ｏ0 の出力はそ
れぞれＯＲゲート４２14乃至４２0 に供給されるが、こ
れらＯＲゲート４２14乃至４２0 にはＡＮＤゲート３０
のＬレベルの信号が供給されているので、ＯＲゲート４
２14乃至４２0 の出力は、出力Ｏ14乃至Ｏ0 の出力と同
じになる。これらＯＲゲート４２14乃至４２0 の出力は
ＡＮＤゲート４４14乃至４４0 に供給されるが、ＡＮＤ
ゲート４４14乃至４４0 にはＬレベルであるＡＮＤゲー
ト３２の出力をインバータ４０で反転させたＨレベルの
信号が供給されているので、ＡＮＤゲート４４14乃至４
４0 から出力Ｏ14乃至Ｏ0 の出力がそのまま得られる。
即ち、各ＯＲゲート３８、ＡＮＤゲート４４14乃至４４
0 の各出力であるＤ15乃至Ｄ0 は、加算回路２６の出力
Ｏ15乃至Ｏ0 と等しくなり、オーバフローチェックは行
われていない。
３０、３２に供給されていると、これらＡＮＤゲート３
０、３２の出力信号は共にＬレベルとなり、ＡＮＤゲー
ト３０のＬレベルの信号はインバータ３４で反転され
て、ＡＮＤゲート３６を開くので、出力Ｏ15がＯＲゲー
ト３８に供給される。このとき、ＯＲゲート３８にはＡ
ＮＤゲート３２のＬレベルの信号がインバータ４０、４
２を介して供給されているので、ＯＲゲート３８の出力
は出力Ｏ15となる。また、出力Ｏ14乃至Ｏ0 の出力はそ
れぞれＯＲゲート４２14乃至４２0 に供給されるが、こ
れらＯＲゲート４２14乃至４２0 にはＡＮＤゲート３０
のＬレベルの信号が供給されているので、ＯＲゲート４
２14乃至４２0 の出力は、出力Ｏ14乃至Ｏ0 の出力と同
じになる。これらＯＲゲート４２14乃至４２0 の出力は
ＡＮＤゲート４４14乃至４４0 に供給されるが、ＡＮＤ
ゲート４４14乃至４４0 にはＬレベルであるＡＮＤゲー
ト３２の出力をインバータ４０で反転させたＨレベルの
信号が供給されているので、ＡＮＤゲート４４14乃至４
４0 から出力Ｏ14乃至Ｏ0 の出力がそのまま得られる。
即ち、各ＯＲゲート３８、ＡＮＤゲート４４14乃至４４
0 の各出力であるＤ15乃至Ｄ0 は、加算回路２６の出力
Ｏ15乃至Ｏ0 と等しくなり、オーバフローチェックは行
われていない。
【００１７】また、ＡＮＤゲート３０、３２にＨレベル
の信号が供給されていると、次のようにしてオーバフロ
ーチェックを行う。即ち、ＡＮＤゲート３０には出力Ｏ
16をインバータ４６で反転させた反転出力と、出力Ｏ15
とが供給され、ＡＮＤゲート３２には出力Ｏ16と、出力
Ｏ15をインバータ４８で反転させた反転出力とが供給さ
れているので、出力Ｏ16がＬ（０）レベル、出力Ｏ15が
Ｈ（１）レベルのとき、即ち加算回路２６の出力が１０
進数の32768 以上のとき、ＡＮＤゲート３０の出力がＨ
レベル、ＡＮＤゲート３２の出力がＬレベルとなる。こ
のとき、ＡＮＤゲート３０のＨレベルの出力信号をイン
バータ３４で反転させた反転出力がＡＮＤゲート３６に
供給されているので、この出力はＬレベルとなり、これ
はＯＲゲート３８に供給される。このＯＲゲート３８に
はＡＮＤゲート３２のＬレベルの信号がインバータ４
０、４２を介して供給されているので、ＯＲゲート３８
の出力はＬ（０）レベルとなる。また、ＡＮＤゲート３
０のＨレベルの信号が各ＯＲゲート４２14乃至４２0 が
供給されているので、各ＯＲゲート４２14乃至４２0 の
出力はＨレベルとなり、これらは各ＡＮＤゲート４４14
乃至４４0 に供給される。これら各ＡＮＤゲート４４14
乃至４４0 には、ＡＮＤゲート３２のＬレベルの信号を
インバータ４０で反転させた反転出力が供給されている
ので、これらＡＮＤゲート４４14乃至４４0 の出力は全
てＨ（１）レベルとなる。従って、Ｄ15乃至Ｄ0 は0111
111111111111にクリップされる。
の信号が供給されていると、次のようにしてオーバフロ
ーチェックを行う。即ち、ＡＮＤゲート３０には出力Ｏ
16をインバータ４６で反転させた反転出力と、出力Ｏ15
とが供給され、ＡＮＤゲート３２には出力Ｏ16と、出力
Ｏ15をインバータ４８で反転させた反転出力とが供給さ
れているので、出力Ｏ16がＬ（０）レベル、出力Ｏ15が
Ｈ（１）レベルのとき、即ち加算回路２６の出力が１０
進数の32768 以上のとき、ＡＮＤゲート３０の出力がＨ
レベル、ＡＮＤゲート３２の出力がＬレベルとなる。こ
のとき、ＡＮＤゲート３０のＨレベルの出力信号をイン
バータ３４で反転させた反転出力がＡＮＤゲート３６に
供給されているので、この出力はＬレベルとなり、これ
はＯＲゲート３８に供給される。このＯＲゲート３８に
はＡＮＤゲート３２のＬレベルの信号がインバータ４
０、４２を介して供給されているので、ＯＲゲート３８
の出力はＬ（０）レベルとなる。また、ＡＮＤゲート３
０のＨレベルの信号が各ＯＲゲート４２14乃至４２0 が
供給されているので、各ＯＲゲート４２14乃至４２0 の
出力はＨレベルとなり、これらは各ＡＮＤゲート４４14
乃至４４0 に供給される。これら各ＡＮＤゲート４４14
乃至４４0 には、ＡＮＤゲート３２のＬレベルの信号を
インバータ４０で反転させた反転出力が供給されている
ので、これらＡＮＤゲート４４14乃至４４0 の出力は全
てＨ（１）レベルとなる。従って、Ｄ15乃至Ｄ0 は0111
111111111111にクリップされる。
【００１８】加算回路２６の出力Ｏ16、Ｏ15が共にＬレ
ベルのとき、即ち１０進数で32767 乃至０のときと、加
算回路２６の出力Ｏ16、Ｏ15が共にＨレベルのとき、即
ち１０進数で-1乃至-32768のとき、ＡＮＤゲート３０、
３２の出力は共にＬレベルであるので、上述したオーバ
フローチェックが解除されている場合と同様に、加算回
路２６の各出力Ｏ15乃至Ｏ0 がそのままＤ15乃至Ｄ0 に
出力される。
ベルのとき、即ち１０進数で32767 乃至０のときと、加
算回路２６の出力Ｏ16、Ｏ15が共にＨレベルのとき、即
ち１０進数で-1乃至-32768のとき、ＡＮＤゲート３０、
３２の出力は共にＬレベルであるので、上述したオーバ
フローチェックが解除されている場合と同様に、加算回
路２６の各出力Ｏ15乃至Ｏ0 がそのままＤ15乃至Ｄ0 に
出力される。
【００１９】加算回路２６の出力Ｏ16がＨレベルで、加
算回路２６の出力Ｏ15がＬレベルのとき、即ち１０進数
で-32769乃至-65536のとき、ＡＮＤゲート３０の出力が
Ｌレベル、ＡＮＤゲート３２の出力がＨレベルとなる。
このとき、ＨレベルであるＡＮＤゲート３２の出力がイ
ンバータ４０、４２を介して供給されるので、ＯＲゲー
ト３８の出力はＨレベルとなる。また、Ｈレベルである
ＡＮＤゲート３２の出力がインバータ４０によってＬレ
ベルに反転されて、各ＡＮＤゲート４４14乃至４４0 に
供給されるので、これらＡＮＤゲート４４14乃至４４0
の出力はすべてＬレベルとなる。即ち、Ｄ15乃至Ｄ0 は
1000000000000000、即ち-32768にクリップされる。
算回路２６の出力Ｏ15がＬレベルのとき、即ち１０進数
で-32769乃至-65536のとき、ＡＮＤゲート３０の出力が
Ｌレベル、ＡＮＤゲート３２の出力がＨレベルとなる。
このとき、ＨレベルであるＡＮＤゲート３２の出力がイ
ンバータ４０、４２を介して供給されるので、ＯＲゲー
ト３８の出力はＨレベルとなる。また、Ｈレベルである
ＡＮＤゲート３２の出力がインバータ４０によってＬレ
ベルに反転されて、各ＡＮＤゲート４４14乃至４４0 に
供給されるので、これらＡＮＤゲート４４14乃至４４0
の出力はすべてＬレベルとなる。即ち、Ｄ15乃至Ｄ0 は
1000000000000000、即ち-32768にクリップされる。
【００２０】従って、ＣＰＵからＨレベルの信号ＥＮを
供給すると、加算器２０はオーバフローチェック回路２
８が作動し、フィルタ１２は通常のフィルタとして機能
する。従って、楽音発生装置１０からのデジタル楽音信
号に音色を形成して、出力する。
供給すると、加算器２０はオーバフローチェック回路２
８が作動し、フィルタ１２は通常のフィルタとして機能
する。従って、楽音発生装置１０からのデジタル楽音信
号に音色を形成して、出力する。
【００２１】また、ＣＰＵからＬレベルの信号ＥＮを供
給すると、加算器２０のオーバフローチェック回路２８
が動作しないので、フィルタ１２の内部演算でオーバフ
ローが発生し、雑音が発生する。このとき、乗算器２４
の係数Ｗを調整することによって希望する雑音を発生さ
せる。なお、この場合、フィルタ１２を安定した発振状
態とし、安定した雑音を得るのが望ましいので、楽音発
生装置１０からは鋸歯状波信号や一定値等の周期信号や
非周期信号を入力しておくのがよい。
給すると、加算器２０のオーバフローチェック回路２８
が動作しないので、フィルタ１２の内部演算でオーバフ
ローが発生し、雑音が発生する。このとき、乗算器２４
の係数Ｗを調整することによって希望する雑音を発生さ
せる。なお、この場合、フィルタ１２を安定した発振状
態とし、安定した雑音を得るのが望ましいので、楽音発
生装置１０からは鋸歯状波信号や一定値等の周期信号や
非周期信号を入力しておくのがよい。
【００２２】第２の実施例は、図５に示すようにフィル
タ１２１の構成が異なる以外、第１の実施例と同様に構
成されている。このフィルタ１２１は、状態変数型のデ
ジタルフィルタで、加算器２０ａ、２０ｂ、２０ｃ、遅
延部２２ａ、２２ｂ、乗算器２４ａ、２４ｂ、２４ｃを
備え、スイッチ５０の接触子５０ａを接点５０ｂに接触
させると、ハイパスフィルタとして機能し、接触子５０
ａを接点５０ｃに接触させると、バンドパスフィルタと
して機能し、接触子５０ａを接点５０ｄに接触させる
と、ローパスフィルタとして機能するものである。そし
て、係数Ｗａ、Ｗｂを変更することによってカットオフ
周波数を変更することができ、係数Ｗｃを変更すること
によってＱを変更することができるものである。
タ１２１の構成が異なる以外、第１の実施例と同様に構
成されている。このフィルタ１２１は、状態変数型のデ
ジタルフィルタで、加算器２０ａ、２０ｂ、２０ｃ、遅
延部２２ａ、２２ｂ、乗算器２４ａ、２４ｂ、２４ｃを
備え、スイッチ５０の接触子５０ａを接点５０ｂに接触
させると、ハイパスフィルタとして機能し、接触子５０
ａを接点５０ｃに接触させると、バンドパスフィルタと
して機能し、接触子５０ａを接点５０ｄに接触させる
と、ローパスフィルタとして機能するものである。そし
て、係数Ｗａ、Ｗｂを変更することによってカットオフ
周波数を変更することができ、係数Ｗｃを変更すること
によってＱを変更することができるものである。
【００２３】そして、加算器２０ａ、２０ｂ、２０ｃ
は、第１の実施例と同様にオーバフローチェック回路を
備えたものである。従って、これら加算器２０ａ、２０
ｂ、２０ｃのオーバフローチェック回路を作動させた状
態では、楽音発生装置１０からのデジタル楽音信号に音
色を形成する。そして、オーバフロ−チェック回路の作
動を解除した状態では、オーバフローが発生することに
よって雑音を発生し、係数Ｗａ、Ｗｂ、Ｗｃを調整する
ことによって、所望の雑音を発生させる。この場合も、
第１の実施例と同様に楽音発生装置１０からデジタル鋸
歯状波信号や一定値等の周期信号や非周期信号をフィル
タ１２１に供給するのが望ましい。
は、第１の実施例と同様にオーバフローチェック回路を
備えたものである。従って、これら加算器２０ａ、２０
ｂ、２０ｃのオーバフローチェック回路を作動させた状
態では、楽音発生装置１０からのデジタル楽音信号に音
色を形成する。そして、オーバフロ−チェック回路の作
動を解除した状態では、オーバフローが発生することに
よって雑音を発生し、係数Ｗａ、Ｗｂ、Ｗｃを調整する
ことによって、所望の雑音を発生させる。この場合も、
第１の実施例と同様に楽音発生装置１０からデジタル鋸
歯状波信号や一定値等の周期信号や非周期信号をフィル
タ１２１に供給するのが望ましい。
【００２４】第１及び第２の実施例では、雑音を発生さ
せるとき、フィルタ１２、１２１を発振状態としたが、
必ずしも発振状態としなくても所望の雑音を発生するこ
とができる。また、第２の実施例では、雑音を発生させ
る場合、全ての加算器２０ａ、２０ｂ、２０ｃのオーバ
フローチェック回路を解除したが、必要とする雑音の音
色に応じてオーバフローチェック回路を解除する加算器
の台数を変更してもよい。また、第１及び第２の実施例
では、説明を容易にするために、回路構成をハードウエ
アで説明したが、デジタル信号処理装置やマイクロコン
ピュータを用いて、ソフトウエアによって本発明を実施
してもよい。
せるとき、フィルタ１２、１２１を発振状態としたが、
必ずしも発振状態としなくても所望の雑音を発生するこ
とができる。また、第２の実施例では、雑音を発生させ
る場合、全ての加算器２０ａ、２０ｂ、２０ｃのオーバ
フローチェック回路を解除したが、必要とする雑音の音
色に応じてオーバフローチェック回路を解除する加算器
の台数を変更してもよい。また、第１及び第２の実施例
では、説明を容易にするために、回路構成をハードウエ
アで説明したが、デジタル信号処理装置やマイクロコン
ピュータを用いて、ソフトウエアによって本発明を実施
してもよい。
【００２５】
【発明の効果】以上のように、本発明によれば、オーバ
ーフローする状態にした演算手段と、信号発生装置とを
用いて、雑音を発生するように構成しているので、特別
に雑音発生装置を設ける必要がなく、回路構成を簡略化
することができる上に、雑音波形を記憶させる必要もな
いので、コストを低減させることができる。
ーフローする状態にした演算手段と、信号発生装置とを
用いて、雑音を発生するように構成しているので、特別
に雑音発生装置を設ける必要がなく、回路構成を簡略化
することができる上に、雑音波形を記憶させる必要もな
いので、コストを低減させることができる。
【図１】本発明による雑音発生装置の第１の実施例のブ
ロック図である。
ロック図である。
【図２】第１の実施例の雑音発生装置を備えた電子楽器
のブロック図である。
のブロック図である。
【図３】図２に示す楽音形成装置のブロック図である。
【図４】図１に示す加算器の詳細なブロック図である。
【図５】本発明による雑音発生装置の第２の実施例のブ
ロック図である。
ロック図である。
１０ 楽音発生装置（信号発生手段） １２、１２１ フィルタ ２８ オーバフローチェック回路（クリップ回路）
Claims (3)
- 【請求項１】 周期信号または非周期信号を発生する信
号発生手段と、この信号発生手段の出力信号が入力され
その信号に演算を施す演算手段とを、具備し、前記演算
手段は、演算によって信号がオーバーフローすることを
防止するクリップ手段と、雑音信号を発生させる場合、
前記クリップ手段を解除する解除手段とを、さらに備え
たことを特徴とする雑音発生装置。 - 【請求項２】 請求項１記載の雑音発生装置において、
前記演算手段がディジタルフィルタ手段であることを特
徴とする雑音発生装置。 - 【請求項３】 請求項２記載の雑音発生装置において、
前記信号発生手段がディジタル可聴周波数信号を発生
し、前記ディジタルフィルタ手段が帰還ループとそのル
ープ内に加算手段とを有するものであり、前記クリップ
手段は、前記加算手段の出力のオーバーフローを検出し
たとき、前記加算手段の出力を所定値にクリップするも
のである雑音発生装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2413160A JP2968847B2 (ja) | 1990-12-21 | 1990-12-21 | 雑音発生装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2413160A JP2968847B2 (ja) | 1990-12-21 | 1990-12-21 | 雑音発生装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH04220698A JPH04220698A (ja) | 1992-08-11 |
| JP2968847B2 true JP2968847B2 (ja) | 1999-11-02 |
Family
ID=18521848
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2413160A Expired - Fee Related JP2968847B2 (ja) | 1990-12-21 | 1990-12-21 | 雑音発生装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2968847B2 (ja) |
-
1990
- 1990-12-21 JP JP2413160A patent/JP2968847B2/ja not_active Expired - Fee Related
Also Published As
| Publication number | Publication date |
|---|---|
| JPH04220698A (ja) | 1992-08-11 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 19990810 |
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