JP2682850B2 - プラズマディスプレイパネルの表示駆動回路 - Google Patents
プラズマディスプレイパネルの表示駆動回路Info
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- Control Of Indicators Other Than Cathode Ray Tubes (AREA)
- Control Of Gas Discharge Display Tubes (AREA)
Description
という。)の表示駆動回路に係り、特にX−Yマトリク
ス形AC形PDPの階調表示駆動回路に関し、 PDPに階調表示を行う場合の各放電セルに対するアド
レス動作の高速化を図りうるプラズマディスプレイパネ
ルの表示駆動回路を提供することを目的とし、 m×nマトリクス形プラズマディスプレイパネルの各
放電セルの発光回数を水平同期信号に同期して制御する
ことにより階調表示駆動を行なうプラズマディスプレイ
パネルの表示駆動回路において、前記放電セルの1水平
走査期間内に複数の水平走査ライン分のアドレスデータ
を更新可能に格納し、かつ、前記水平同期信号に同期し
て出力するアドレスデータ格納手段を備えて構成する。
路に係り、特にX−Yマトリクス形AC形PDPの階調表示
駆動回路に関する。
であったが、最近では情報化社会の進展に伴なう表示装
置の多様化により平面形表示装置の開発が進められてい
る。現在のところ、平面形表示装置としては、エレクト
ロルミネセンス(EL)、発光ダイオード(LED)、PDP等
の能動素子を用いたものや、液晶(LCD)、エレクトロ
クロミック(ECD)等の受動素子を用いたものが知られ
ている。
形PDP(間接放電形)とDC形PDP(直接放電形)とに分類
される。また、構造形式によってX−Yマトリクス形と
セグメント形に分類される。本発明は、このうちのX−
Yマトリクス電極構造をもつAC形PDPに関するものであ
る。かかるAC形PDPは、ワードプロセッサ、パーソナル
コンピュータ等の文字、図形表示装置として普及しつつ
ある。そして、最近では、機能の向上が求められ、いわ
ゆる2値画像表示の域を脱して階調表示の段階に進みつ
つある。
るX駆動回路3,4と、Y電極5を駆動するY駆動回路6,7
が接続されている。
のX−Yマトリクス構造を有するAC形PDPであり、メモ
リ機能を有している。X電極2はn(400)本であり、
Y電極5はm(640)本互いに直交して交叉配置されて
いる。それらの交点に放電セル8がm×nドット分形成
される。
奇数(ODD)番目のX電極2を駆動し、X駆動回路4は
偶数(EVEN)番目のX電極2を駆動する。2分割されて
いるのは、X電極2の数が多数であり、かつ隣接するX
電極2相互の間隔が極めて狭いため端子の導出が困難だ
からである。X駆動回路3,4は、放電セル8を選択する
ためのアドレスデータDATAを水平同期信号から生成され
たクロックCLKに同期して格納するシフトレジスタ9,10
と、シフトレジスタ9,10の格納データをパラレルシフト
するラッチ11,12と、ラッチデータを各X電極2に印加
する出力バッファ13,14とを備える。
みパルスVWを水平同期信号および垂直同期信号に同期し
たクロックCLKにより格納するシフトレジスタ15,16と、
シフトレジスタ15,16の格納データをパラレルシフトす
るラッチ17,18と、ラッチデータを各Y電極5に印加す
る出力バッファ20とを備える。
トローブ信号STBとPDP1への各印加パルスとの対応を示
す。
〜50kHzの周波数で維持パルス発生器21から出力され、P
DP1の全面の放電セル8に同期的に印加される。維持パ
ルスVSはY電極5に180゜位相差の反転パルスを加える
か、Y電極5とX電極2に交互に同極性のパルスを加え
るか、いずれかの方法でもよい。
1本ずつ書込みパルスVWを印加し、一旦当該意Y電極5
上の全放電セル8を放電させる。これによりY電極5上
の全放電セル8は発光する。次いで、次のタイミングで
消去パルスVEを印加して発光すべき放電セル8の選択を
行う。このようにして、Y電極5に対し1本ずつ書き込
みと消去を繰り返し、全Y電極5を走査して1フレーム
画面を形成する。この方式によりPDP1上には2値画像が
形成される。次いで、垂直同期信号により次のフレーム
が始まり、以下同様にして数Hz〜200Hzのフレーム周波
数で画面が更新されてゆく。
の画面上の画像をより正確にかつ細かな表示を行うため
には階調表示が必要となる。階調表示とは、各放電セル
8ごとに輝度レベルを異ならせることにより濃淡をつけ
て表示する方法である。階調表示を行う方法には、第一
の壁電圧の相対差を利用する方法(W.D.Petty,H.G.Slot
tow,“Multiple states and variable intensity in th
e plasma displayplasma",IEEE Trans.ED−18,654−658
(1971))、第二の壁電圧の相対差で発光回数を制御す
る方法(H.De Jule et al.,Digest of Symps of SID(1
971))、第三のフィールド毎時間分割法(倉橋浩一
郎、他:“プラズマディスプレイにおける中間調表示",
第8回TV学会画像表示システム研究会資料(1972))等
が知られている。現在のところ、AC形PDPで階調表示を
実現するには各放電セルの発光回数を制御することによ
り多階調表示とするのが一般的である。
旦書込みパルスVWを印加したのち、アドレスデータDATA
により消去パルスVEをキャンセルすることにより行う。
このためのパルスをキャンセルパルスVCといい、X電極
2に印加する。このキャンセルパルスVCを印加するか否
かにより消去パルスVEの印加が左右され、したがって、
放電セル8の発光回数を制御できる。因みに階調レベル
は2nで与えられ、4階調ならばn=2でフレーム中に2
回書替え動作が行われ、8階調ならばn=3、16階調な
らばn=4…というように書替え動作の回数は指数nに
比例する。第9図の例は4階調n=2の場合を示す。
ラッチ信号LTHと、ストローブ信号STBによって制御され
る。すなわち、アドレスデータDATAがシフトレジスタ9,
10に転送されると、各アドレスデータDATAはクロックCL
Kに同期して順次シフトレジスタ9,10内にシリアルシフ
トされ、格納終了と同時にラッチ信号LTHにより今度は
パラレルデータの形でラッチ11,12にシフトされる。
チデータが出力バッファ13,14にパラレルで転送され
る。出力バッファ13,14はアドレスデータDATAで指示さ
れる放電セル8を選択して消去パルスVE、キャンセルパ
ルスVCを印加する。このとき、Y駆動回路6側では同様
にクロックCLKにより書込みパルスVWのアドレスデータD
ATAをシリアル入力してシフトレジスタ15,16に格納し、
次いでラッチ信号LTHによりラッチ17,18にパラレルシフ
トし、ストローブ信号STBにより出力バッファ19,20を介
してX電極2を駆動する。
ば、階調数に応じた数の書き込み動作と消去動作が必要
となる。その結果、従来の駆動方法においては書き込み
パルスVWと消去パルスVEとは同一のY電極に印加される
にしても異なるタイミングで印加されているのであり、
多階調表示を行おうとすると書き込み動作と消去動作を
必然的に高速化することが必要となる。つまり、各放電
セルに対する高速アドレス動作が必要となる。しかしな
がら、PDPの駆動の高速化には限界があり、これが多階
調表示のための障害となる。
セルに対するアドレス動作の高速化を図りうるプラズマ
ディスプレイパネルの表示駆動回路を提供することを目
的とする。
発明は、m×nマトリクス形プラズマディスプレイパネ
ル1の各放電セル8の発生回数を水平同期信号に同期し
て制御することにより階調表示駆動を行なうプラズマデ
ィスプレイパネルの表示駆動回路において、前記放電セ
ル8の1水平走査期間内に複数の水平走査ライン分のア
ドレスデータDATA1,DATA2を更新可能に格納し、かつ、
前記水平同期信号に同期して出力するアドレスデータ格
納手段22,24を備えて構成する。
数の水平走査ライン分のアドレスデータDATA1,DATA2を
格納し、順次これを更新しつつ水平同期信号に同期して
PDPを駆動する。
TA1,DATA2を転送してPDPの表示画面の書き替え、すなわ
ち発光制御できることは、発行回数を制御して行う多階
調表示駆動に際してアドレスデータの更新動作の高速化
を招来し、したがって多階調表示を容易に実現しうるこ
とになる。
る。
図において第9図、第10図と同一もしくは該当する部分
には同一の符号を付して以下説明する。
すように、X駆動回路3,4に2段構成のラッチすなわ
ち、第1ラッチ22,23および第2ラッチ24,25を設けた点
である。その他は同様なので説明を省略する。
動回路4はX駆動回路3と同様なので図示ならびに説明
は省略する。第3図に示すように、X駆動回路3にはシ
フトレジスタ9に対して並列に接続された第1ラッチ2
2,23が設けられている。第1ラッチ22、第2ラッチ24は
各ラッチデータの出力を制御するストローブ信号STB1,S
TB2との論理積をとるANDゲートおよび第1ラッチ22、第
2ラッチ24のラッチデータを出力バッファ13に出力する
たのORゲートからなるゲート回路25を介して出力バッフ
ァ13に接続されている。シフトレジスタ9にはアドレス
データDATA1,DATA2がクロックCLKに同期して入力され、
格納データはラッチ信号LTH1により第1ラッチ22へ、ラ
ッチ信号LTH2により第2ラッチ24へとそれぞれ振り分け
られてラッチされる。第1ラッチ22のラッチデータはス
トローブ信号STB1により、第1ラッチ23のラッチデータ
はストローブ信号STB2によりそれぞれ1H期間内でゲート
回路25を介して出力バッファ13に出力される。
間内に1水平走査ライン分のアドレスデータDATA1とア
ドレスデータDATA2がシリアルで2つ転送され、シフト
レジスタ9内にシリアルシフトにて格納される。アドレ
スデータDATA1はラッチ信号LTH1のタイミングで第1ラ
ッチ22にパラレルシフトされて格納され、アドレスデー
タDATA2はラッチ信号LTH1により1/2Hだけ遅れたラッチ
信号LTH2のタイミングで第2ラッチ24にパラレルシフト
されて格納される。
チ22のラッチデータDATA1が出力バッファ13に出力され
る。これを受けて、出力バッファ13はストローブSTB1と
同じタイミングでキャンセルパルスVCをY電極5(第4
図、Xi)に印加する。次いで、ストローブ信号STB2のタ
イミングで第2ラッチ24のラッチデータDATA2が出力バ
ッファ13に出力される。これを受けて、出力バッファ13
はストローブ信号STB2と同じタイミングでキャンセルパ
ルスVCをY電極5(第4図、Xi)につづけて印加する。
これらのキャンセルパルスVCによりX電極2のYj,Yj+N
に印加される消去パルスVEはキャンセルされる。
TA1とアドレスデータDATA2とが転送され、X電極2に印
加されるので高速アドレスが可能となり、4階調表示が
可能となる。さらに多階調表示を実現するには、3系統
以上のアドレスデータおよびラッチを設けることにな
る。
階調表示の例である。なお、この実施例において第1実
施例、従来例と重複する部分にはひきつづき同一符号を
使用する。
第5図に示すように、アドレスデータ格納手段としての
シフトレジスタを第1シフトレジスタ26,27と、第2シ
フトレジスタ28,29の2段構成とした点である。したが
って、シフトレジスタ、ラッチ共に2段となっている。
その他は従来と同様なので説明を省略する。
4は第1実施例で述べた理由と同様なので省略する。第
6図に示すように、アドレスデータDATA1がクロックCLK
1に同期して第1シフトレジスタ26にシリアルで転送さ
れ格納される。一方、アドレスデータDATA2がクロックC
LK2に同期して第2シフトレジスタ28に同様に格納され
るようになっている。第1シフトレジスタ26と第1ラッ
チ22が一対で第2ラッチ25の一方のANDゲートに、第2
シフトレジスタ28と第2ラッチ24とが一対で第2ラッチ
25の他方のANDゲートにそれぞれ接続されている。
1水平期間内にそれぞれ第1シフトレジスタ26、第2シ
フトレジスタ28にシリアル転送されて格納される。次い
でアドレスデータDATA1はラッチ信号LTH1のタイミング
で第1ラッチ22にパラレルシフトされて格納され、アド
レスデータDATA2は同じタイミングでラッチ信号LTH2に
より第2ラッチ24に格納される。次いで、ストローブ信
号STB1のタイミングで第1ラッチ22のラッチデータが出
力バッファ13に与えられ、ストローブ信号STB2のタイミ
ングで第2ラッチ24のラッチデータが出力バッファ13に
与えられる。出力バッファ13はアドレスデータDATA1,DA
TA2で与えられるアドレスの放電セル8に対応するX電
極2(第7図、Xi)にキャンセルパルスVCを印加する。
このキャンセルパルスVCにより消去パルスVEがそれぞれ
キャンセルされる。
スデータの本数およびシフトレジスタ対の本数を増やす
ことになる。
TA1とアドレスデータDATA2によるアドレスが可能となる
ので階調表示に必要な高速アドレスが可能となる。
複数のアドレスデータを転送して駆動することができる
ため、高速アドレス化が可能となり、多階調表示におい
て必要とされる発光回数制御を高速化することができ
る。
Claims (1)
- 【請求項1】放電セルの発光回数を制御することにより
階調表示駆動を行うプラズマディスプレイパネルの表示
駆動回路であって、 1水平走査期間内に複数の水平走査ライン分のアドレス
データを更新し、1水平走査期間内に複数の水平走査ラ
イン分のアドレスデータを出力する、アドレスデータ格
納手段、 を備えたことを特徴とするプラズマディスプレイパネル
の表示駆動回路。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP63226917A JP2682850B2 (ja) | 1988-09-09 | 1988-09-09 | プラズマディスプレイパネルの表示駆動回路 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP63226917A JP2682850B2 (ja) | 1988-09-09 | 1988-09-09 | プラズマディスプレイパネルの表示駆動回路 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPH0273396A JPH0273396A (ja) | 1990-03-13 |
JP2682850B2 true JP2682850B2 (ja) | 1997-11-26 |
Family
ID=16852625
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP63226917A Expired - Lifetime JP2682850B2 (ja) | 1988-09-09 | 1988-09-09 | プラズマディスプレイパネルの表示駆動回路 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP2682850B2 (ja) |
Family Cites Families (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS63161495A (ja) * | 1986-12-24 | 1988-07-05 | ホシデン株式会社 | 液晶駆動装置 |
-
1988
- 1988-09-09 JP JP63226917A patent/JP2682850B2/ja not_active Expired - Lifetime
Also Published As
Publication number | Publication date |
---|---|
JPH0273396A (ja) | 1990-03-13 |
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