JP2008176865A - 記憶装置、制御装置 - Google Patents
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Abstract
【解決手段】DSP21と、DSP22と、記憶媒体に対するヘッドの位置の制御を行うServo MPU12とを備え、Servo MPU12は、DSP21及びDSP22への指示を行い、DSP21は、Servo MPU12からの指示に基づいて、サーボ情報の復調に関する演算である復調演算とデジタルフィルタ演算との少なくともいずれかの演算を行い、DSP22は、Servo MPUからの指示に基づいて、位置の補正に関する演算である補正演算を行い、Servo MPU12は、DSP21及びDSP22による演算結果に基づいて、位置の制御を行うことを特徴とする。
【選択図】図1
Description
Yn=PES×sin(nω)
Where n=1,2,3,…8
第2デジタルシグナルプロセッサと、
記憶媒体に対するヘッドの位置の制御を行う第1制御部とを備え、
前記第1制御部は、前記第1デジタルシグナルプロセッサ及び前記第2デジタルシグナルプロセッサへの指示を行い、
前記第1デジタルシグナルプロセッサは、前記第1制御部からの指示に基づいて、サーボ情報の復調に関する演算である復調演算とデジタルフィルタ演算との少なくともいずれかの演算を行い、
前記第2デジタルシグナルプロセッサは、前記第1制御部からの指示に基づいて、前記位置の補正に関する演算である補正演算を行い、
前記第1制御部は、前記第1デジタルシグナルプロセッサ及び前記第2デジタルシグナルプロセッサによる演算結果に基づいて、前記位置の制御を行うことを特徴とする記憶装置。
(付記2) 付記1に記載の記憶装置において、
前記復調演算は、前記ヘッドにより前記記憶媒体から読み取られた前記サーボ情報を復調することにより、前記ヘッドの位置情報を算出することを特徴とする記憶装置。
(付記3) 付記1または付記2に記載の記憶装置において、
前記第2デジタルシグナルプロセッサは、前記第1デジタルシグナルプロセッサにより算出された位置情報に基づいて前記補正演算を行うことを特徴とする記憶装置。
(付記4) 付記1乃至付記3のいずれかに記載の記憶装置において、
前記補正演算は、前記記憶媒体におけるトラックが前記記憶媒体の回転中心を中心とする円になるように前記ヘッドの位置を補正するための仮想円補正係数を算出する仮想円補正係数演算を含むことを特徴とする記憶装置。
(付記5) 付記4に記載の記憶装置において、
前記補正演算は、前記仮想円補正係数に基づいて前記位置情報を補正する仮想円補正演算を含むことを特徴とする記憶装置。
(付記6) 付記1乃至付記5のいずれかに記載の記憶装置において、
前記補正演算は、前記ヘッドの位置が前記記憶媒体におけるトラック上になるように、前記ヘッドの位置を補正するための偏心補正値を算出する偏心補正演算を含むことを特徴とする記憶装置。
(付記7) 付記6に記載の記憶装置において、
前記第1制御部は、前記位置情報と前記偏心補正値に基づいて、ヘッド位置の制御を行うことを特徴とする記憶装置。
(付記8) 付記1乃至付記7のいずれかに記載の記憶装置において、
前記第2デジタルシグナルプロセッサは、サーボフレーム数個の角度に対するsin関数及びcos関数の値を格納したテーブルを有し、該テーブルを用いたフーリエ変換により前記補正演算を行うことを特徴とする記憶装置。
(付記9) 付記1乃至付記8のいずれかに記載の記憶装置において、
前記第1デジタルシグナルプロセッサは、2のn乗(nは整数)個の角度に対するsin関数及びcos関数の値を格納したテーブルを有し、該テーブルに基づいて前記復調演算を行うことを特徴とする記憶装置。
(付記10) 付記1乃至付記9のいずれかに記載の記憶装置において、
前記サーボ情報は、前記位相変調されていることを特徴とする記憶装置。
(付記11) 付記1乃至付記10のいずれかに記載の記憶装置において、
第1制御部は、MPUであることを特徴とする記憶装置。
(付記12) 付記1乃至付記11のいずれかに記載の記憶装置において、
第1制御部は、デジタルシグナルプロセッサであることを特徴とする記憶装置。
(付記13) 付記1乃至付記12のいずれかに記載の記憶装置において、
更に、ホストインターフェースの制御を行い、ホストインターフェースが受け取ったホストからの命令に基づいて、前記第1制御部への指示を行う第2制御部を備えることを特徴とする記憶装置。
(付記14) 付記13に記載の記憶装置において、
第2制御部は、MPUであることを特徴とする記憶装置。
(付記15) 第1デジタルシグナルプロセッサと、
第2デジタルシグナルプロセッサと、
記憶媒体に対するヘッドの位置の制御を行う第1制御部とを備え、
前記第1制御部は、前記第1デジタルシグナルプロセッサ及び前記第2デジタルシグナルプロセッサへの指示を行い、
前記第1デジタルシグナルプロセッサは、前記第1制御部からの指示に基づいて、サーボ情報の復調に関する演算である復調演算とデジタルフィルタ演算との少なくともいずれかの演算を行い、
前記第2デジタルシグナルプロセッサは、前記第1制御部からの指示に基づいて、前記位置の補正に関する演算である補正演算を行い、
前記第1制御部は、前記第1デジタルシグナルプロセッサ及び前記第2デジタルシグナルプロセッサによる演算結果に基づいて、前記位置の制御を行うことを特徴とする制御装置。
(付記16) 付記15に記載の制御装置において、
前記復調演算は、前記ヘッドにより前記記憶媒体から読み取られた前記サーボ情報を復調することにより、前記ヘッドの位置情報を算出することを特徴とする制御装置。
(付記17) 付記1または付記16に記載の制御装置において、
前記第2デジタルシグナルプロセッサは、前記第1デジタルシグナルプロセッサにより算出された位置情報に基づいて前記補正演算を行うことを特徴とする制御装置。
(付記18) 付記15乃至付記17のいずれかに記載の制御装置において、
前記補正演算は、前記記憶媒体におけるトラックが前記記憶媒体の回転中心を中心とする円になるように前記ヘッドの位置を補正するための仮想円補正係数を算出する仮想円補正係数演算を含むことを特徴とする制御装置。
(付記19) 付記18に記載の制御装置において、
前記補正演算は、前記仮想円補正係数に基づいて前記位置情報を補正する仮想円補正演算を含むことを特徴とする制御装置。
(付記20) 付記15乃至付記19のいずれかに記載の制御装置において、
前記補正演算は、前記ヘッドの位置が前記記憶媒体におけるトラック上になるように、前記ヘッドの位置を補正するための偏心補正値を算出する偏心補正演算を含むことを特徴とする制御装置。
Claims (6)
- 第1デジタルシグナルプロセッサと、
第2デジタルシグナルプロセッサと、
記憶媒体に対するヘッドの位置の制御を行う第1制御部とを備え、
前記第1制御部は、前記第1デジタルシグナルプロセッサ及び前記第2デジタルシグナルプロセッサへの指示を行い、
前記第1デジタルシグナルプロセッサは、前記第1制御部からの指示に基づいて、サーボ情報の復調に関する演算である復調演算とデジタルフィルタ演算との少なくともいずれかの演算を行い、
前記第2デジタルシグナルプロセッサは、前記第1制御部からの指示に基づいて、前記位置の補正に関する演算である補正演算を行い、
前記第1制御部は、前記第1デジタルシグナルプロセッサ及び前記第2デジタルシグナルプロセッサによる演算結果に基づいて、前記位置の制御を行うことを特徴とする記憶装置。 - 請求項1に記載の記憶装置において、
前記復調演算は、前記ヘッドにより前記記憶媒体から読み取られた前記サーボ情報を復調することにより、前記ヘッドの位置情報を算出することを特徴とする記憶装置。 - 請求項1または請求項2に記載の記憶装置において、
前記補正演算は、前記記憶媒体におけるトラックが前記記憶媒体の回転中心を中心とする円になるように前記ヘッドの位置を補正するための仮想円補正係数を算出する仮想円補正係数演算を含むことを特徴とする記憶装置。 - 請求項3に記載の記憶装置において、
前記補正演算は、前記仮想円補正係数に基づいて前記位置情報を補正する仮想円補正演算を含むことを特徴とする記憶装置。 - 請求項1乃至請求項4のいずれかに記載の記憶装置において、
前記補正演算は、前記ヘッドの位置が前記記憶媒体におけるトラック上になるように、前記ヘッドの位置を補正するための偏心補正値を算出する偏心補正演算を含むことを特徴とする記憶装置。 - 第1デジタルシグナルプロセッサと、
第2デジタルシグナルプロセッサと、
記憶媒体に対するヘッドの位置の制御を行う第1制御部とを備え、
前記第1制御部は、前記第1デジタルシグナルプロセッサ及び前記第2デジタルシグナルプロセッサへの指示を行い、
前記第1デジタルシグナルプロセッサは、前記第1制御部からの指示に基づいて、サーボ情報の復調に関する演算である復調演算とデジタルフィルタ演算との少なくともいずれかの演算を行い、
前記第2デジタルシグナルプロセッサは、前記第1制御部からの指示に基づいて、前記位置の補正に関する演算である補正演算を行い、
前記第1制御部は、前記第1デジタルシグナルプロセッサ及び前記第2デジタルシグナルプロセッサによる演算結果に基づいて、前記位置の制御を行うことを特徴とする制御装置。
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