JP2007199441A - 画像表示装置 - Google Patents
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Abstract
【解決手段】画素回路に含まれる第1トランジスタ15のドレイン電極はスタティック・メモリの記憶状態をセットするための入力に、第2トランジスタ18のドレイン電極はリセットするための入力に、第1トランジスタのソース電極はデータ線に各々接続され、ゲート線と平行方向に一列に配置された複数の画素回路に含まれる第1トランジスタのゲート電極は複数のゲート線のいずれか1本のゲート線に接続され、前記一列に配置された複数の画素回路に対して隣接して一列に配列された複数の画素回路に含まれる第2トランジスタのゲート電極が前記1本のゲート線に接続される構成とする。
【選択図】図1
Description
すなわち、本発明に係る画像表示装置は、基板上にマトリクス状に配置され、それぞれ少なくとも1つのスタティック・メモリを具備する複数の画素回路を含み、前記画素回路は、前記複数の画素回路へ画像信号を伝えるためのデータ線と、前記データ線と交差し、前記複数の画素回路へ走査パルスを伝えるための複数のゲート線と、前記複数のゲート線に走査パルスを順次供給する走査回路を具備する画像表示装置であって、
前記スタティック・メモリの記憶状態をセットするための第1トランジスタと、リセットするための第2トランジスタとを具備し、前記第1トランジスタのドレイン電極は前記スタティック・メモリの記憶状態セットするための入力に接続され、前記第2トランジスタのドレイン電極は前記スタティック・メモリの記憶状態をリセットするための入力に接続され、前記第1トランジスタのソース電極は前記データ線のいずれか1本に接続され、前記ゲート線と平行方向に一列に配置された複数の前記画素回路に含まれる前記第1トランジスタのゲート電極は複数の前記ゲート線のいずれか1本のゲート線に接続され、前記一列に配置された複数の前記画素回路に対して隣接して一列に配列された複数の前記画素回路に含まれる前記第2トランジスタのゲート電極は前記1本のゲート線に接続されることを特徴とするものである。
Claims (7)
- 基板上にマトリクス状に配置され、それぞれ少なくとも1つのスタティック・メモリを具備する複数の画素回路を含み、
前記画素回路は、前記複数の画素回路へ画像信号を伝えるためのデータ線と、前記データ線と交差し、前記複数の画素回路へ走査パルスを伝えるための複数のゲート線と、前記複数のゲート線に走査パルスを順次供給する走査回路を具備する画像表示装置であって、
前記スタティック・メモリの記憶状態をセットするための第1トランジスタと、リセットするための第2トランジスタとを具備し、
前記第1トランジスタのドレイン電極は前記スタティック・メモリの記憶状態をセットするための入力に接続され、
前記第2トランジスタのドレイン電極は前記スタティック・メモリの記憶状態をリセットするための入力に接続され、
前記第1トランジスタのソース電極は前記データ線のいずれか1本に接続され、
前記ゲート線と平行方向に一列に配置された複数の前記画素回路に含まれる前記第1トランジスタのゲート電極は複数の前記ゲート線のいずれか1本のゲート線に接続され、
前記一列に配置された複数の前記画素回路に対して隣接して一列に配列された複数の前記画素回路に含まれる前記第2トランジスタのゲート電極は前記1本のゲート線に接続されることを特徴とする画像表示装置。 - 請求項1記載の画像表示装置において、
前記第1及び第2のトランジスタは共にnチャネル型またはpチャネル型の同一極性であることを特徴とする画像表示装置。 - 請求項1記載の画像表示装置において、
複数の前記画素回路を構成するトランジスタはポリシリコン薄膜トランジスタを用いて形成されていることを特徴とする画像表示装置。 - 請求項1記載の画像表示装置において、
前記基板上に複数の前記画素回路に接続された表示電極が形成され、透明電極を有する透明基板との間に液晶が挟持されることを特徴とする画像表示装置。 - 請求項1記載の画像表示装置において、
前記第2トランジスタのソース電極は電源電位または接地電位が供給される配線に接続されることを特徴とする画像表示装置。 - 請求項5記載の画像表示装置において、
前記スタティック・メモリの電源配線として、ポリシリコン薄膜で形成された共通の電源配線が使用されることを特徴とする画像表示装置。 - 請求項5記載の画像表示装置において、
前記スタティック・メモリの電源配線は前記第2トランジスタのソース電極に接続されることを特徴とする画像表示装置。
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A912 | Removal of reconsideration by examiner before appeal (zenchi) |
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