JP2007108379A - 画素回路、表示装置および表示装置の駆動方法 - Google Patents
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Abstract
【解決手段】駆動TFT32、サンプリングTFT33およびスイッチングTFT34,35の4個のトランジスタと1個のキャパシタ36という少ない構成素子数で、有機EL素子31の特性変動に対する補償機能と、駆動TFT32のVth変動に対する補償機能とを実現する。
【選択図】図1
Description
Ids=1/2・μ(W/L)Cox(Vgs−|Vth|)2 …(1)
ここで、Vthは駆動TFT202の閾値電圧、μはキャリアの移動度、Wはチャネル幅、Lはチャネル長、Coxは単位面積当たりのゲート容量、Vgsはゲート・ソース間電圧である。
ΔV={C2/(C1+C2+C3)}・(Vin−Vofs)…(2)
画素回路11は、有機EL素子31に加えて、駆動トランジスタ32、サンプリングトランジスタ33、スイッチングトランジスタ34,35およびキャパシタ(保持容量)36を回路の構成素子として有する構成となっている。すなわち、本実施形態に係る画素回路11は、4個のトランジスタ32〜35と1個のキャパシタ36とからなり、図11の従来例に係る画素回路101に比べて、トランジスタの個数が2個少なく、キャパシタの個数が1個少ない回路構成となっている。
通常の発光状態では、書き込み走査回路18から出力される書き込み信号WSおよびオートゼロ回路20から出力されるオートゼロ信号AZが“L”レベルにあり、駆動走査回路19から出力される駆動信号DSが“H”レベルにあるために、図3に示すように、サンプリングTFT33およびスイッチングTFT35はオフ状態導通状態)にあり、スイッチングTFT34がオン状態(導通状態)にある。
次に、時刻t1で駆動信号DSが“L”レベルになることで、図4に示すように、スイッチングTFT34がオフする。これにより、駆動TFT32を流れる一定電流Idsの電流路が遮断されるために、有機EL素子31には電流が流れず、当該有機EL素子31は消光する(非発光状態となる)。このとき、ノードN11の電位、即ち駆動TFT32のソース電圧は、有機EL素子31のカソード電圧Vcatと当該有機EL素子31の閾値電圧Vthelの和、即ちVcat+Vthelになる。
・(Vofg−Vg1) …(3)
また、駆動TFT32のソース電圧Vgsは、下記の式(4)のように決定される。
Vgs={(C1+C2)/(Cel+C1+C2)}
・(Vofg−Vg1)+Vss …(4)
次に、サンプリングTFT33がオンした状態において、時点t7で駆動信号DSが“H”レベルになることで、図7に示すように、スイッチングTFT34がオンする。このとき、上記カップリング量Vcoを加味した上で、スイッチングTFT34がオンしたときの駆動TFT32のゲート・ソース間電圧Vgsが当該駆動TFT32の閾値電圧Vthよりも大ならば、駆動TFT32がオン状態になるために、電源線16→スイッチングTFT34→駆動TFT32→ノードN11→キャパシタ36の経路(図7に一点鎖線で示す経路)で電流が流れる。
次に、時点t9でデータ線駆動回路22からデータ線17に対して所定の電位Vofsに代えて、階調に応じた所望の電圧値の入力信号電圧Vsigが供給されることで、当該信号電圧Vsigの書き込み期間に入る。この書き込み期間では、図8に示すように、入力信号電圧VsigがサンプリングTFT33によってサンプリングされ、キャパシタ37に書き込まれる。
Vgs={Cel/(Cel+C1+C2)}
・(Vsig−Vofs)+Vth …(5)
この書き込み期間の終了後、サンプリングTFT33およびスイッチングTFT35がオフした状態において、時刻t11で駆動信号DSが“H”レベルになることで、図9に示すように、スイッチングTFT34がオン状態となり、発光期間に入る。
Claims (3)
- 一端が第1の電源電位に接続された電気光学素子と、
前記電気光学素子の他端にソースが接続されたNチャネル型の薄膜トランジスタからなる駆動トランジスタと、
データ線から供給される輝度情報に応じた入力信号と所定の電位とを選択的に取り込んで前記駆動トランジスタのゲートに与えるサンプリングトランジスタと、
第2の電源電位と当該第2の電源電位よりも低い第3の電源電位とが選択的に供給される電源線と前記駆動トランジスタのドレインとの間に接続された第1サンプリングトランジスタと、
前記駆動トランジスタのソースと前記電源線との間に接続された第2サンプリングトランジスタと、
前記駆動トランジスタのゲートとソースとの間に接続されたキャパシタと
を有することを特徴とする画素回路。 - 一端が第1の電源電位に接続された電気光学素子と、
前記電気光学素子の他端にソースが接続されたNチャネル型の薄膜トランジスタからなる駆動トランジスタと、
データ線と前記駆動トランジスタとの間に接続されたサンプリングトランジスタと、
電源線と前記駆動トランジスタのドレインとの間に接続された第1サンプリングトランジスタと、
前記駆動トランジスタのソースと前記電源線との間に接続された第2サンプリングトランジスタと、
前記駆動トランジスタのゲートとソースとの間に接続されたキャパシタと
を有する画素回路が行列状に配置されてなる画素アレイ部と、
前記画素回路への入力信号の書き込み時には当該入力信号を、それ以外では所定の電位を前記データ線に供給するデータ線駆動手段と、
前記電気光学素子の非発光期間の一定期間以外で第2の電源電位を、当該一定期間では前記第2の電源電位よりも低い第3の電源電位を前記電源線に供給する電源供給手段と、
前記非発光期間において前記電源線に前記第2の電源電位が供給されている期間に前記サンプリングトランジスタを導通状態にする第1の駆動手段と、
前記データ線に前記所定の電位が供給されている期間でかつ前記サンプリングトランジスタが導通状態にある期間に前記第1サンプリングトランジスタを導通状態にする第2の駆動手段と、
前記電源線に前記第3の電源電位が供給されている期間に前記第2サンプリングトランジスタを導通状態にする第3の駆動手段と
具備することを特徴する表示装置。 - 一端が第1の電源電位に接続された電気光学素子と、
前記電気光学素子の他端にソースが接続されたNチャネル型の薄膜トランジスタからなる駆動トランジスタと、
データ線と前記駆動トランジスタとの間に接続されたサンプリングトランジスタと、
電源線と前記駆動トランジスタのドレインとの間に接続された第1サンプリングトランジスタと、
前記駆動トランジスタのソースと前記電源線との間に接続された第2サンプリングトランジスタと、
前記駆動トランジスタのゲートとソースとの間に接続されたキャパシタと
を有する画素回路が行列状に配置されてなり、
前記データ線に対して前記画素回路への入力信号の書き込み時には当該入力信号を、それ以外では所定の電位を選択的に供給する表示装置の駆動方法であって、
前記第1サンプリングトランジスタを非導通状態にして前記電気光学素子の発光期間から非発光期間に移行させる第1ステップと、
前記非発光期間に入った後に前記電源線の電位を第2の電源電位から当該第2の電源電位よりも低い第3の電源電位へ切り替える第2ステップと、
前記電源線の電位が前記第3の電源電位のときに一定の期間だけ前記第2サンプリングトランジスタを導通状態にする第3ステップと、
前記第2サンプリングトランジスタが非導通状態になった後に前記電源線の電位を前記第3の電源電位から前記第2の電源電位へ切り替える第4ステップと、
前記電源線の電位が前記第2の電源電位のときに一定の期間だけ前記サンプリングトランジスタを導通状態にする第5ステップと、
前記サンプリングトランジスタが導通状態にある一定の期間に前記第1サンプリングトランジスタを導通状態にする第6ステップと、
前記第1サンプリングトランジスタが非導通状態になった後に前記データ線への供給を前記所定の電位から前記入力信号に切り替える第7ステップと
を有することを特徴とする表示装置の駆動方法。
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