JP2006276641A - 表示パネル駆動装置 - Google Patents
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Abstract
【解決手段】 表示パネル駆動装置の出力段回路270は、インバータ232,233およびバッファ回路234を直列に接続してなるローサイドセレクタ回路235と、nチャネル型のIGBT236,237と、IGBT236のゲート・エミッタ間にそれぞれ接続されたツェナーダイオード244および抵抗245と、バッファ回路251と、インバータ254からなるハイサイドセレクタ回路255とから構成される。このバッファ回路251は、ハイサイドセレクタ回路255からのロジック信号で動作するハイサイド側のPch−MOS252と、ローサイドセレクタ回路235のロジック信号で動作するローサイド側のNch−MOS253とから構成される。
【選択図】 図1
Description
図9は、PDP駆動装置の概略構成を示すブロック図である。
PDP100の駆動装置は、複数のスキャンドライバIC(Integrated Circuit)200−1,200−2,200−3,…200−kと、データ(アドレス)ドライバIC300−1,300−2,300−3,…300−mなどから構成される(ここで、k,mは任意の整数である。)。
図10は、従来の表示装置駆動回路の構成を示す図である。
出力回路230は、レベルシフト回路231、インバータ232,233とバッファ回路234からなるセレクタ回路235、および単位面積当たりで多くの電流を流せる素子、たとえば2つのnチャネル型のIGBT(Insulated Gate Bipolar Transistor)236,237を有している。
ローサイド電源VDLから0〜5Vのロジック信号がセレクタ回路235に送られ、ローサイド出力を制御するIGBT237のゲート端子にそのまま出力され、ハイサイド出力を制御するIGBT236のゲート端子には、レベルシフト回路231で0〜100Vのロジック信号に変換されて供給される。これらの出力回路230では、ハイサイド(電源側)もローサイド(接地側)もnチャネル型のIGBT236,237によって、図10に示すようにトーテムポール型の出力回路を構成しているが、MOSFETによって同様の回路構成も可能である。
[実施の形態1]
図1は、実施の形態1に係る表示パネル駆動装置の出力段回路を示す回路図である。
図2では、64ビットの表示装置駆動回路201について示しており、図1の出力段回路270にシフトレジスタ240−1,240−2,240−3,…240−64とシフトレジスタ210−1,210−2,210−3,…210−64が追加されている。シフトレジスタ240−1,240−2,240−3,…240−64とハイサイドセレクタ255−1,255−2,255−3,…255−64とがハイサイド駆動用ロジック回路であり、シフトシフトレジスタ210−1,210−2,210−3,…210−64とローサイドセレクタ235−1,235−2,235−3,…235−64とがローサイド駆動用ロジック回路である。ここでは、図10の従来回路比較して、ハイサイド駆動用ロジック回路が追加されている。しかし、このことによって表示装置駆動回路201に使用される出力段回路270からレベルシフト回路231(図11)を削減できるようにした点に、実施の形態1の特徴がある。したがって、この表示装置駆動回路201を集積回路として構成する場合には回路面積が縮小できるという利点がある。
図3は、実施の形態2に係る表示パネル駆動装置の出力段回路を示す回路図である。
出力段回路280は、出力回路をnチャネル型のIGBT237とpチャネル型のIGBT260とからなるプッシュプル回路として構成している。この場合には、実施の形態1の出力段回路270で必要としていたバッファ回路251を削減することができる。ここでは、ローサイドセレクタ回路262がローサイド用のドライブ回路となり、ハイサイドセレクタ回路255がハイサイド用ドライブ回路となる。
この表示装置駆動回路202は、図3の出力段回路280と、ローサイド電源のロジック電圧によって駆動されるローサイド駆動用ロジック回路と、ハイサイド電源のロジック電圧によって駆動されるハイサイド駆動用ロジック回路とから構成されている。このうち、ローサイド駆動用ロジック回路がシフトシフトレジスタ210−1,210−2,210−3,…210−64とローサイドセレクタ235−1,235−2,235−3,…235−64とを備え、ハイサイド駆動用ロジック回路がシフトレジスタ240−1,240−2,240−3,…240−64とハイサイドセレクタ255−1,255−2,255−3,…255−64とを備えている。そして、これらのローサイド駆動用ロジック回路とハイサイド駆動用ロジック回路には、それぞれ同じデータ信号DATAとクロック信号CLKが入力され、それぞれ振幅5Vのロジック信号で動作する。この表示装置駆動回路202では、実施の形態1のバッファ回路251が不要となって、集積回路として構成する場合には回路面積が縮小できるという利点がある。
図5は、ローサイドロジック信号をハイサイドロジック信号に変換するためのレベルシフト回路を示す回路構成図である。
ロジック信号が「H」の場合、高耐圧MOSFET11がオンし、高耐圧MOSFET12がオフする。すると、高耐圧MOSFET13のドレイン電圧が下がるが、この高耐圧MOSFET13のゲートは、ツェナーダイオードD1,D2によって過電圧が印加されないように保護されている。高耐圧MOSFET14のゲートについても、同様に過電圧が生じないように、ツェナーダイオードD1,D3によって保護されている。また、これらのツェナーダイオードD1,D2,D3によって、低耐圧MOSFET15,16のゲートやドレインへの過電圧が印加されないように保護されている。
この表示装置駆動回路203は、図3の出力段回路280と、ローサイド電源のロジック電圧によって駆動されるローサイド駆動用ロジック回路と、ハイサイド電源のロジック電圧によって駆動されるハイサイド駆動用ロジック回路と、図5に示したレベルシフト回路10−1,10−2とから構成されている。
図7は、実施の形態4に係る表示装置駆動回路の構成を示すブロック図である。
この表示装置駆動回路204は、図5に示すレベルシフト回路10とハイサイド駆動用のロジック回路20を用いて、ローサイド用のクロック信号CLKに同期してロジック回路20の出力のうち、奇数ビット(20−1,20−3,…20−63)と偶数ビット(20−2,20−4,…20−64)とが交互に「H」、あるいは「L」になるように構成されている。
同図(a)、(b)に示すタイミングでクロック信号CLKとデータ信号DATAがシフトレジスタ210−1に入力されるとき、同図(c)、(e)のようにローサイドロジック信号Sb−1,Sb−2が生成される。また、クロック信号CLKとデータ信号DATAがハイサイド駆動用ロジック回路20を介してレベルシフト回路10に供給されて、それぞれ同図(d)、(f)に示すようなハイサイドロジック信号Sa−1,Sa−2に変換される。
11,12 Nチャネル型の高耐圧MOSFET
13,14 Pチャネル型の高耐圧MOSFET
15,16 Pチャネル型の低耐圧MOSFET
17 入力端子
18,19 インバータ
201〜204 表示装置駆動回路
232,233 インバータ
234 バッファ回路
235 ローサイドセレクタ回路
236,237 nチャネル型のIGBT
240−1,240−2,240−3,…240−n シフトレジスタ
244 ツェナーダイオード
245 抵抗
251 バッファ回路
254 インバータ
255,255−1,255−2,255−3,…255−n ハイサイドセレクタ回路
270,280 出力段回路
Claims (9)
- 表示パネルを駆動する表示パネル駆動装置において、
前記表示パネルの走査電極に接続された出力回路、およびこの出力回路を制御するシフトレジスタとセレクタとを含むドライブ回路からなる出力段回路を備え、
前記出力段回路はローサイド電源のロジック電圧とハイサイド電源のロジック電圧とによって駆動されることを特徴とする表示パネル駆動装置。 - 前記ドライブ回路は、前記出力回路のローサイドおよびハイサイドをそれぞれ制御するローサイド用のドライブ回路とハイサイド用のドライブ回路とから構成され、
ローサイド用のドライブ回路はローサイド電源のロジック電圧によって駆動され、ハイサイド用のドライブ回路はハイサイド電源のロジック電圧によって駆動されることを特徴とする請求項1記載の表示パネル駆動装置。 - 前記各ドライブ回路は、それぞれ等しい大きさのロジック電圧によって駆動されることを特徴とする請求項2記載の表示パネル駆動装置。
- 前記ドライブ回路は、0Vないし5Vのロジック電圧によって駆動される集積回路であることを特徴とする請求項2記載の表示パネル駆動装置。
- 前記ドライブ回路のいずれかは、ハイサイドロジック信号とローサイドロジック信号のいずれかを共通化するためのレベルシフト回路を備え、
前記各ドライブ回路に外部から入力されるロジック信号を削減したことを特徴とする請求項1記載の表示パネル駆動装置。 - 前記レベルシフト回路は、前記ロジック電圧によりゲート制御される複数のPチャネル型、およびNチャネル型のMOSFETによって構成されていることを特徴とする請求項5記載の表示パネル駆動装置。
- 前記レベルシフト回路は、2個のPチャネル型MOSFETと2個のNチャネル型MOSFETによって構成され、
前記Pチャネル型MOSFETのソースと基板をハイサイド電源に接続し、そのドレイン出力を別の前記Pチャネル型MOSFETのソースと基板に接続し、そのドレイン出力を2個の前記Nチャネル型MOSFETのドレインに接続したことを特徴とする請求項5記載の表示パネル駆動装置。 - 前記レベルシフト回路は、前記ハイサイド電源とハイサイドの接地電位との間に第1のツェナーダイオードが挿入され、
基板とソースが前記ハイサイド電源に接続されている前記2個のPチャネル型MOSFETのドレイン・ソース間には、それぞれ第2、第3のツェナーダイオードが挿入されていることを特徴とする請求項7記載の表示パネル駆動装置。 - 前記レベルシフト回路により、前記ローサイドロジック信号のクロックに同期して、奇数ビットあるいは偶数ビットごとに交互にオンオフするハイサイドロジック信号を生成するようにして、ハイサイド側のシフトレジスタを不要としたことを特徴とする請求項5記載の表示パネル駆動装置。
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