JP2005311337A - 高周波パッケージ、送受信モジュールおよび無線装置 - Google Patents
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Abstract
【解決手段】多層誘電体基板23に、高周波半導体43のバイアス/制御信号用端子に接続され、電磁シールド部材24,25の内側に配設される信号ビア65と、電磁シールド部材24,25の外側に配設され、バイアス/制御信号用の外部端子51に接続される信号ビア65と、信号ビア間を接続する内層信号線路60と、信号ビア65および内層信号線路60の周囲に配される内層接地導体70と、内層接地導体70上であって、前記信号ビア65および内層信号線路60の周囲に配される複数のグランドビア75とを備えるとともに、内層信号線路60に、高周波半導体43で使用する高周波信号の実効波長の略1/4の長さを有する先端開放線路83を設ける。
【選択図】 図6
Description
図1〜図18に従って本発明の実施の形態1について説明する。図1は本発明を適用する無線装置を構成するレーダ装置1の機能ブロック図を示すものである。まず図1に従って、レーダ装置1の機能的な内部構成について説明する。
図14は図11の構成の変形態様1を示すものである。図14においては、複数の側壁グランドビア81は、縦に半割りしたような形状を呈し、キャビティ40を構成する側壁55に接して配置されている。
図15は図10の構成の変形態様2を示すものである。この図15の構成においては、キャビティ40を構成する側壁55をグランドパターン85で全面メタライズするようにしている。また、このグランドパターン85とグランドビア列84との間隔を、上記実効波長λgの1/2未満の値として設定し、かつ各グランドビア列84における隣接するグランドビアの間隔tをλg/2未満の値として設定している。したがって、この図15に示す構成においては、キャビティ40の側壁55への不要波の進入を完全に抑圧することができる。また、バイアス/制御信号用パッド50の周囲の誘電体56などを介して不要波が多層誘電体基板23内に進入したとしても信号ビア65あるいは内層信号線路60への高周波信号の結合量を抑圧でき、これら信号ビア65、内層信号線路60、外部端子51を経由して不要波が高周波パッケージ2の外部に放射されることを抑圧することができる。
この発明の実施の形態2を図19にしたがって説明する。実施の形態2においては、実施の形態1で用いた先端開放線路83を、複数の先端開放線路の組み合わせから成る低域通過フィルタ(ローパスフィルタ)86に変更している。図20は、この低域通過フィルタ86の通過特性を示すものであり、この低域通過フィルタ86によれば、高周波信号の実効波長λgに対応する周波数f0より低い所定の周波数f1以上の周波数成分をカットするようにしている。この低域通過フィルタ86は、実効波長λgに近い値の複数の波長成分が多く存在する場合に有効である。
この発明の実施の形態3を図21および図22にしたがって説明する。図21は実施の形態3の高周波パッケージ2´を示すものであり、この高周波パッケージ2´においては、先の図6に示した高周波パッケージ2の構成要素と同じ機能を達成する構成要素に関しては、同一符号を付しており、重複する説明は省略する。
この発明の実施の形態4を図23にしたがって説明する。この実施の形態4は、先の実施の形態3の変形であり、多層誘電体基板23のキャビティ側縁部71の上面に形成した側縁部表層グランドパターン57の一部を抜き、このグランド抜き部分87では誘電体を露出するようにした点のみが実施の形態3と異なる。誘電体が露出された側壁55とグランドビア列84との間隔Lbは、実効波長λgの1/4未満として設定されている。
この発明の実施の形態5を図24、図25−1〜図25−4にしたがって説明する。実施の形態5は、フリップチップ実装の高周波半導体(MMIC)90を搭載する高周波パッケージ91に、実施の形態1で説明した特徴的な構成(b)の発明を適用するようにしている。
2,2´,91 高周波パッケージ
3 制御回路
4 変調回路
6 送受信モジュール
7 アンテナ
8 信号処理基板
10 ケーシング
12 レドーム
13 ケーブル
14 コネクタ
16 導波管
17 導波管プレート
19 電子回路
21 モジュール制御基板
22 キャリア
23 多層誘電体基板
24 シールリング
25 カバー
30 発振器
32 電力分配器
33 逓倍器
35 送信導波管端子
36 受信導波管端子
37 MMIC
39 ミクサ
40 キャビティ
42 フィードスルー
43,66,90 高周波半導体
41,44 ワイヤ
45 マイクロストリップ線路
50 バイアス/制御信号用パッド
51,52 外部端子
53 グランド面
55 側壁
56,61 誘電体
57 側縁部表層グランドパターン
60 内層信号線路
65 信号ビア
70 内層接地導体
71,71a キャビティ側縁部
75,75a,75b,75c グランドビア
80 抵抗膜
81 側壁グランドビア
82 側壁グランドビア列
83 先端開放線路
84 グランドビア列(シールドビア列)
85 グランドパターン
86 低域通過フィルタ
87 グランド抜き部分
92 バンプ
92a 信号バンプ
92b グランドバンプ
93 表層接地導体
94 導体パッド
λg 実効波長
Claims (13)
- 高周波半導体と、この高周波半導体を表層接地導体に載置する多層誘電体基板と、この多層誘電体基板の表層の一部および前記高周波半導体を覆う電磁シールド部材とを備える高周波パッケージにおいて、
前記多層誘電体基板に、
前記高周波半導体のバイアス/制御信号用端子に接続され、前記電磁シールド部材の内側に配設される第1の信号ビアと、
前記電磁シールド部材の外側に配設され、バイアス/制御信号用の外部端子に接続される第2の信号ビアと、
第1の信号ビアと第2の信号ビアを接続する内層信号線路と、
前記第1の信号ビア、第2の信号ビアおよび内層信号線路の周囲に配される内層接地導体と、
前記内層接地導体上であって、前記第1の信号ビア、第2の信号ビアおよび内層信号線路の周囲に配される複数のグランドビアと、
を備えるとともに、
前記内層信号線路に、前記高周波半導体で使用する高周波信号の実効波長の略1/4の長さを有する先端開放線路を設けるようにしたことを特徴とする高周波パッケージ。 - 高周波半導体と、この高周波半導体を表層接地導体に載置する多層誘電体基板と、この多層誘電体基板の表層の一部および前記高周波半導体を覆う電磁シールド部材とを備える高周波パッケージにおいて、
前記多層誘電体基板に、
前記高周波半導体のバイアス/制御信号用端子に接続され、前記電磁シールド部材の内側に配設される第1の信号ビアと、
前記電磁シールド部材の外側に配設され、バイアス/制御信号用の外部端子に接続される第2の信号ビアと、
第1の信号ビアと第2の信号ビアを接続する内層信号線路と、
前記第1の信号ビア、第2の信号ビアおよび内層信号線路の周囲に配される内層接地導体と、
前記内層接地導体上であって、前記第1の信号ビア、第2の信号ビアおよび内層信号線路の周囲に配される複数のグランドビアと、
を備えるとともに、
前記内層信号線路に、前記高周波半導体で使用する高周波信号の通過を抑えるローパスフィルタを設けるようにしたことを特徴とする高周波パッケージ。 - 高周波半導体と、この高周波半導体を表層接地導体に載置するとともに前記表層接地導体に接続される内層接地導体を有する多層誘電体基板と、この多層誘電体基板の表層の一部および前記高周波半導体を覆う電磁シールド部材とを備える高周波パッケージにおいて、
前記多層誘電体基板に、
前記高周波半導体のバイアス/制御信号用端子に接続され、前記電磁シールド部材の内側に配設される第1の信号ビアと、
前記電磁シールド部材の外側に配設され、バイアス/制御信号用の外部端子に接続される第2の信号ビアと、
第1の信号ビアと第2の信号ビアを接続する内層信号線路と、
前記第1の信号ビアよりも高周波半導体に近い側に配設され、前記内層接地導体に接続される複数のグランドビアからなる第1のグランドビア列と、
前記第1の信号ビアと前記第2の信号ビアとの間に配設され、前記内層接地導体に接続される複数のグランドビアからなる第2のグランドビア列と、
を備え、
前記第1のグランドビア列と第2のグランドビア列との間隔を、前記高周波半導体で使用する高周波信号の実効波長の1/2未満とするとともに、
前記第1および第2のグランドビア列における各グランドビアの隣接間隔を、前記高周波半導体で使用する高周波信号の実効波長の1/2未満とすることを特徴とする高周波パッケージ。 - 高周波半導体と、キャビティが形成され、前記高周波半導体をキャビティの底面に形成された表層接地導体に載置するとともにこの表層接地導体に接続された内層接地導体を有し、前記キャビティを形成する側壁が非接地である多層誘電体基板と、この多層誘電体基板の表層の一部および前記高周波半導体を覆う電磁シールド部材とを備える高周波パッケージにおいて、
前記多層誘電体基板に、
前記高周波半導体のバイアス/制御信号用端子に接続され、前記電磁シールド部材の内側に配設される第1の信号ビアと、
前記電磁シールド部材の外側に配設され、バイアス/制御信号用の外部端子に接続される第2の信号ビアと、
第1の信号ビアと第2の信号ビアを接続する内層信号線路と、
前記第1の信号ビアよりも高周波半導体に近い側であってかつ前記キャビティを形成する前記多層誘電体基板の側壁近傍に配設され、前記内層接地導体に接続される複数のグランドビアからなる第1のグランドビア列と、
前記第1の信号ビアと前記第2の信号ビアとの間に配設され、前記内層接地導体に接続される複数のグランドビアからなる第2のグランドビア列と、
を備え、
前記第1のグランドビア列と第2のグランドビア列との間隔を、前記高周波半導体で使用する高周波信号の実効波長の1/2未満とするとともに、
前記第1および第2のグランドビア列における各グランドビアの隣接間隔を、前記高周波半導体で使用する高周波信号の実効波長の1/2未満とすることを特徴とする高周波パッケージ。 - 前記第1のグランドビア列の各グランドビアは、ビアの一部が多層誘電体基板の側壁に露出していることを特徴とする請求項4に記載の高周波パッケージ。
- 高周波半導体と、キャビティが形成され、前記高周波半導体をキャビティの底面に形成された表層接地導体に載置するとともにこの表層接地導体に接続された内層接地導体を有する多層誘電体基板と、この多層誘電体基板の表層の一部および前記高周波半導体を覆う電磁シールド部材とを備える高周波パッケージにおいて、
前記多層誘電体基板に、
前記高周波半導体のバイアス/制御信号用端子に接続され、前記電磁シールド部材の内側に配設される第1の信号ビアと、
前記電磁シールド部材の外側に配設され、バイアス/制御信号用の外部端子に接続される第2の信号ビアと、
第1の信号ビアと第2の信号ビアを接続する内層信号線路と、
前記キャビティを形成する多層誘電体基板の側壁に形成される側壁グランドパターンと、
前記第1の信号ビアと前記第2の信号ビアとの間に配設され、前記内層接地導体に接続される複数のグランドビアからなるグランドビア列と、
を備え、
前記側壁グランドパターンとグランドビア列との間隔を、前記高周波半導体で使用する高周波信号の実効波長の1/2未満とするとともに、
前記グランドビア列における各グランドビアの隣接間隔を、前記高周波半導体で使用する高周波信号の実効波長の1/2未満とすることを特徴とする高周波パッケージ。 - 高周波半導体と、キャビティが形成され、前記高周波半導体をキャビティの底面に形成された表層接地導体に載置するとともにこの表層接地導体に接続された内層接地導体を有し、前記キャビティを形成する側壁が非接地である多層誘電体基板と、この多層誘電体基板の表層の一部および前記高周波半導体を覆う電磁シールド部材とを備える高周波パッケージにおいて、
前記高周波半導体のバイアス/制御信号用端子に接続され、前記電磁シールド部材の内側に配設される第1の信号ビアと、
前記電磁シールド部材の外側に配設され、バイアス/制御信号用の外部端子に接続される第2の信号ビアと、
第1の信号ビアと第2の信号ビアを接続する内層信号線路と、
前記第1の信号ビアと前記第2の信号ビアとの間に配設され、前記内層接地導体に接続される複数のグランドビアからなるグランドビア列と、
を備え、
前記側壁とグランドビア列との間隔を、前記高周波半導体で使用する高周波信号の実効波長の1/4未満とするとともに、
前記グランドビア列における各グランドビアの隣接間隔を、前記高周波半導体で使用する高周波信号の実効波長の1/2未満とすることを特徴とする高周波パッケージ。 - 前記多層誘電体基板の表面における前記電磁シールド部材から前記側壁までの部分に、誘電体が露出された領域を形成したことを特徴とする請求項4〜7のいずれか一つに記載の高周波パッケージ。
- 前記第2のグランドビア列またはグランドビア列は、前記電磁シールド部材が前記多層誘電体基板と当接する箇所の直下に配置されることを特徴とする請求項3〜8のいずれか一つに記載の高周波パッケージ。
- 前記第1の信号ビアは、多層誘電体基板の表層に形成された導体パッドに接続され、導体パッドは、誘電体が露出された領域を挟んで周囲の一部または全てを表層接地導体で囲まれることを特徴とする請求項1〜9のいずれか一つに記載の高周波パッケージ。
- 裏面にグランド端子およびバイアス/制御信号用端子を有する高周波半導体と、この高周波半導体が表層にフリップチップ実装される複数の導体パッド、前記グランド端子が接続される内層接地導体を有する多層誘電体基板と、この多層誘電体基板の表層の一部および前記高周波半導体を覆う電磁シールド部材とを備える高周波パッケージにおいて、
前記多層誘電体基板に、
前記高周波半導体のバイアス/制御信号用端子に接続される複数の信号ビアと、
前記複数の信号ビア間を接続する内層信号線路と、
前記内層接地導体に接続され、前記信号ビアを囲む複数のグランドビア列と、
を備え、
信号ビアを挟むグランドビア列間の間隔を、前記高周波半導体で使用する高周波信号の実効波長の1/2未満とすることを特徴とする高周波パッケージ。 - 請求項1〜11のいずれか一つに記載の高周波パッケージであって、前記高周波半導体は、周波数変調された高周波信号を目標に向けて照射する送信系回路および目標から反射した受信信号を受信する受信系回路を備える高周波パッケージと、
高周波パッケージとの前記高周波半導体との間で送信信号および受信信号を入出力する導波管端子と、
高周波パッケージの高周波半導体にバイアス信号を供給し、高周波半導体との間で制御信号を授受し、高周波半導体から出力される送信波を変調制御する制御回路と、
を備えることを特徴とする送受信モジュール。 - 請求項12に記載の送受信モジュールと、
前記送受信モジュールの導波管端子を介して入出力される高周波信号を送受信するアンテナと、
前記高周波パッケージの受信系回路の出力を低周波信号に変換する電子回路と、
該電子回路で変換された低周波信号に基づいて目標までの距離、相対速度を演算する信号処理基板と、
を備えることを特徴とする無線装置。
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Cited By (12)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2007287916A (ja) * | 2006-04-17 | 2007-11-01 | Fujitsu Ltd | 電子部品パッケージ |
WO2008129923A1 (ja) * | 2007-04-13 | 2008-10-30 | Kyocera Corporation | 高周波回路基板、高周波回路モジュールおよびレーダ装置 |
WO2009123233A1 (ja) * | 2008-03-31 | 2009-10-08 | 京セラ株式会社 | 高周波モジュールおよびその製造方法ならびに該高周波モジュールを備えた送信器、受信器、送受信器およびレーダ装置 |
WO2009123234A1 (ja) * | 2008-03-31 | 2009-10-08 | 京セラ株式会社 | 高周波モジュールおよびその製造方法ならびに該高周波モジュールを備えた送信器、受信器、送受信器およびレーダ装置 |
WO2009139210A1 (ja) * | 2008-05-12 | 2009-11-19 | 三菱電機株式会社 | 高周波収納ケースおよび高周波モジュール |
JP2012109832A (ja) * | 2010-11-18 | 2012-06-07 | Nippon Dempa Kogyo Co Ltd | 圧電発振器 |
EP3598484A1 (en) * | 2008-09-05 | 2020-01-22 | Mitsubishi Electric Corporation | High-frequency circuit package and sensor module |
WO2021034009A1 (en) * | 2019-08-16 | 2021-02-25 | Samsung Electronics Co., Ltd. | Apparatus and printed circuit board including pcb embedded filter having via group patterns |
CN112838366A (zh) * | 2020-12-31 | 2021-05-25 | 中国电子科技集团公司第四十三研究所 | 一种多通道表贴式t/r组件 |
CN114158256A (zh) * | 2020-06-17 | 2022-03-08 | 株式会社藤仓 | 无线模块 |
CN115642148A (zh) * | 2022-12-22 | 2023-01-24 | 北京智芯微电子科技有限公司 | 磁屏蔽装置、磁屏蔽装置的制备方法以及mram芯片 |
JP7245947B1 (ja) | 2022-08-15 | 2023-03-24 | Fcnt株式会社 | 印刷配線基板及び無線通信端末 |
Citations (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH05299906A (ja) * | 1992-04-21 | 1993-11-12 | Matsushita Electric Ind Co Ltd | 高周波多層集積回路 |
JP2003133471A (ja) * | 2001-10-26 | 2003-05-09 | Sumitomo Metal Ind Ltd | 高周波信号用の配線基板 |
JP2003133801A (ja) * | 2001-10-25 | 2003-05-09 | Hitachi Ltd | 高周波回路モジュール |
-
2005
- 2005-03-23 JP JP2005083810A patent/JP4634836B2/ja not_active Expired - Fee Related
Patent Citations (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH05299906A (ja) * | 1992-04-21 | 1993-11-12 | Matsushita Electric Ind Co Ltd | 高周波多層集積回路 |
JP2003133801A (ja) * | 2001-10-25 | 2003-05-09 | Hitachi Ltd | 高周波回路モジュール |
JP2003133471A (ja) * | 2001-10-26 | 2003-05-09 | Sumitomo Metal Ind Ltd | 高周波信号用の配線基板 |
Cited By (24)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP4653005B2 (ja) * | 2006-04-17 | 2011-03-16 | 富士通株式会社 | 電子部品パッケージ |
JP2007287916A (ja) * | 2006-04-17 | 2007-11-01 | Fujitsu Ltd | 電子部品パッケージ |
WO2008129923A1 (ja) * | 2007-04-13 | 2008-10-30 | Kyocera Corporation | 高周波回路基板、高周波回路モジュールおよびレーダ装置 |
US8179306B2 (en) | 2007-04-13 | 2012-05-15 | Kyocera Corporation | High-frequency circuit board, high-frequency circuit module, and radar apparatus |
JP5209610B2 (ja) * | 2007-04-13 | 2013-06-12 | 京セラ株式会社 | 高周波回路基板、高周波回路モジュールおよびレーダ装置 |
US8564478B2 (en) | 2008-03-31 | 2013-10-22 | Kyocera Corporation | High-frequency module and method of manufacturing the same, and transmitter, receiver, transceiver, and radar apparatus comprising the high-frequency module |
WO2009123233A1 (ja) * | 2008-03-31 | 2009-10-08 | 京セラ株式会社 | 高周波モジュールおよびその製造方法ならびに該高周波モジュールを備えた送信器、受信器、送受信器およびレーダ装置 |
WO2009123234A1 (ja) * | 2008-03-31 | 2009-10-08 | 京セラ株式会社 | 高周波モジュールおよびその製造方法ならびに該高周波モジュールを備えた送信器、受信器、送受信器およびレーダ装置 |
US8564477B2 (en) | 2008-03-31 | 2013-10-22 | Kyocera Corporation | High-frequency module and method of manufacturing the same, and transmitter, receiver, transceiver, and radar apparatus comprising the high-frequency module |
WO2009139210A1 (ja) * | 2008-05-12 | 2009-11-19 | 三菱電機株式会社 | 高周波収納ケースおよび高周波モジュール |
US8035994B2 (en) | 2008-05-12 | 2011-10-11 | Mitsubishi Electric Corporation | High frequency storing case and high frequency module |
EP3598484A1 (en) * | 2008-09-05 | 2020-01-22 | Mitsubishi Electric Corporation | High-frequency circuit package and sensor module |
JP2012109832A (ja) * | 2010-11-18 | 2012-06-07 | Nippon Dempa Kogyo Co Ltd | 圧電発振器 |
WO2021034009A1 (en) * | 2019-08-16 | 2021-02-25 | Samsung Electronics Co., Ltd. | Apparatus and printed circuit board including pcb embedded filter having via group patterns |
US11284513B2 (en) | 2019-08-16 | 2022-03-22 | Samsung Electronics Co., Ltd. | Apparatus and printed circuit board including PCB embedded filter having via group patterns |
CN114158256A (zh) * | 2020-06-17 | 2022-03-08 | 株式会社藤仓 | 无线模块 |
US11901317B2 (en) | 2020-06-17 | 2024-02-13 | Fujikura Ltd. | Wireless module |
CN112838366A (zh) * | 2020-12-31 | 2021-05-25 | 中国电子科技集团公司第四十三研究所 | 一种多通道表贴式t/r组件 |
CN112838366B (zh) * | 2020-12-31 | 2024-02-20 | 中国电子科技集团公司第四十三研究所 | 一种多通道表贴式t/r组件 |
JP7245947B1 (ja) | 2022-08-15 | 2023-03-24 | Fcnt株式会社 | 印刷配線基板及び無線通信端末 |
US11778730B1 (en) | 2022-08-15 | 2023-10-03 | Fcnt Limited | Printed circuit board and wireless communication terminal |
JP2024025972A (ja) * | 2022-08-15 | 2024-02-28 | 大和管財株式会社 | 印刷配線基板及び無線通信端末 |
CN115642148A (zh) * | 2022-12-22 | 2023-01-24 | 北京智芯微电子科技有限公司 | 磁屏蔽装置、磁屏蔽装置的制备方法以及mram芯片 |
CN115642148B (zh) * | 2022-12-22 | 2024-04-12 | 北京智芯微电子科技有限公司 | 磁屏蔽装置、磁屏蔽装置的制备方法以及mram芯片 |
Also Published As
Publication number | Publication date |
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