JP2003007885A - 半導体素子収納用パッケージ - Google Patents
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Abstract
作動時に発する熱を外部に効率よく放出することができ
ない。 【解決手段】半導体素子4が載置される載置部1aを有
する基体1と、半導体素子載置部1aを囲繞するように
して取着され、半導体素子4の各電極が接続される配線
層6を有する枠状絶縁体2と、枠状絶縁体2上に取着さ
れる蓋体3とから成る半導体素子収納用パッケージであ
って、前記枠状絶縁体2は比誘電率が7以下、熱膨張係
数が4ppm/℃〜8ppm/℃のガラスセラミックス
焼結体で、配線層6は比電気抵抗が2.5μΩ・cm以
下の金属材料で、基体1は平均粒径が50μm乃至10
0μmで、粒径25μm以下の粒子を含有しないタング
ステン粉末から成る焼結多孔体に銅を含浸させて形成さ
れているとともにタングステンから成る焼結多孔体が7
0乃至95重量%、銅が5乃至30重量%である。
Description
回路素子)や光半導体素子等の半導体素子を収容するた
めの半導体素子収納用パッケージに関するものである。 【0002】 【従来の技術】従来、半導体素子を収容するための半導
体素子収納用パッケージは、上面に半導体素子が載置さ
れる載置部を有する銅−タングステン合金等の金属材料
からなる基体と、該基体の上面に前記載置部を囲繞する
ようにして取着された酸化アルミニウム質焼結体等の電
気絶縁材料からなる枠状絶縁体と、該枠状絶縁体の内周
部から外周部にかけて被着導出されているタングステ
ン、モリブデン、マンガン等の高融点金属からなる複数
個の配線層と、前記枠状絶縁体の上面に取着され、枠状
絶縁体の内側の穴を塞ぐ蓋体とから構成されており、基
体の半導体素子載置部に半導体素子を接着剤を介して接
着固定するとともに該半導体素子の各電極をボンディン
グワイヤを介して枠状絶縁体に形成した配線層に電気的
に接続し、しかる後、枠状絶縁体に蓋体を該枠状絶縁体
の内側の穴を塞ぐようにしてガラス、樹脂、ロウ材等か
ら封止材を介して接合させ、基体と枠状絶縁体と蓋体と
からなる容器内部に半導体素子を気密に収容することに
よって製品としての半導体装置となる。 【0003】なお上述の半導体素子収納用パッケージに
おいては、半導体素子が載置される基体が銅−タングス
テン合金等の金属材料で形成されており、該銅−タング
ステン合金等は熱伝導率が高く、熱伝導性に優れている
ことから基体は半導体素子の作動時に発する熱を良好に
吸収するとともに大気中に良好に放散させることがで
き、これによって半導体素子を常に適温とし半導体素子
に熱破壊が発生したり、特性に熱劣化が発生したりする
のを有効に防止している。 【0004】また上述の半導体素子収納用パッケージの
基体として使用されている銅−タングステン合金は銅と
タングステンの比率を制御することによって線熱膨張係
数が決定され、例えば、線熱膨張係数が約6ppm/℃
の銅−タングステン合金からなる基体を作成する場合に
は、銅を10重量%、タングステンを90重量%とし、
また線熱膨張係数が約7.5ppm/℃の銅−タングス
テン合金からなる基体を作成する場合には、銅を25重
量%、タングステンを75重量%とすればよい。 【0005】更に前記銅−タングステン合金は一般に平
均粒径が1μm乃至40μmのタングステン粉末を焼成
して焼結多孔体を得、次に前記タングステンから成る焼
結多孔体の空孔内に溶融させた銅を含浸させることによ
って製作されている(特公平5−38457号公報参
照)。 【0006】 【発明が解決しようとする課題】しかしながら、この従
来の半導体素子収納用パッケージにおいては、基体が平
均粒径1μm乃至40μmのタングステン粉末を焼成し
て焼結多孔体を得るとともに該焼結多孔体の空孔内に溶
融させた銅を含浸させることによって形成されており、
平均粒径の1/2以下の粒径の粒子が10%程度含まれ
ているためにこの粒径の小さな粉末が粒径の大きな粉末
間に入り込んで得られるタングステンから成る焼結多孔
体の空孔は細く狭いものとなり、その結果、空孔内に含
浸される熱伝導が良好な銅もその線幅が細く狭いものと
なって基体の熱伝導率は線熱膨張係数が約6ppm/℃
の銅−タングステン合金からなる基体(銅:10重量
%、タングステン:90重量%)の場合は約200W/
m・K、線熱膨張係数が約7.5ppm/℃の銅−タン
グステン合金からなる基体(銅:25重量%、タングス
テン:75重量%)の場合は約285W/m・K程度で
あった。 【0007】そのためこの従来の半導体素子収納用パッ
ケージ内に近時の高密度化、高集積化が大きく進み、作
動時に多量の熱を発する半導体素子を収容した場合、半
導体素子が作動時に発する熱は基体を介して外部に完全
に放出させることができなくなり、その結果、半導体素
子が該素子自身の発する熱によって高温となり、半導体
素子に熱破壊を招来させたり、特性にばらつきを生じ安
定に作動させることができないという欠点を有してい
た。 【0008】またこの従来の半導体素子収納用パッケー
ジにおいては、枠状絶縁体を形成する酸化アルミニウム
質焼結体の比誘電率が9〜10(室温、1MHz)と高
いことから枠状絶縁体に設けた配線層を伝わる電気信号
の伝搬速度が遅く、そのため信号の高速伝搬を要求する
半導体素子は収容が不可となる欠点を有していた。 【0009】更にこの従来の半導体素子収納用パッケー
ジにおいては、枠状絶縁体に形成されている配線層はタ
ングステンやモリブデン、マンガン等の高融点金属材料
により形成されており、該タングステン等はその比電気
抵抗が5.4μΩ・cm(20℃)以上と高いことから
配線層に電気信号を伝搬させた場合、電気信号に大きな
減衰が生じ、電気信号を正確、かつ確実に伝搬させるこ
とができないという欠点も有していた。 【0010】本発明は上記欠点に鑑み案出されたもの
で、その目的は内部に高速駆動を行う半導体素子を収容
することができ、かつ収容する半導体素子を長期間にわ
たり正常、かつ安定に作動させることができる半導体素
子収納用パッケージを提供することにある。 【0011】 【課題を解決するための手段】本発明は、上面に半導体
素子が載置される載置部を有する基体と、前記基体上に
半導体素子載置部を囲繞するようにして取着され、半導
体素子の各電極が接続される配線層を有する枠状絶縁体
と、前記枠状絶縁体上に取着され、枠状絶縁体の内側を
気密に封止する蓋体とから成る半導体素子収納用パッケ
ージであって、前記枠状絶縁体は比誘電率が7以下、熱
膨張係数が4ppm/℃〜8ppm/℃のガラスセラミ
ックス焼結体で、配線層は比電気抵抗が2.5μΩ・c
m以下の金属材料で、基体は平均粒径が50μm乃至1
00μmで、粒径25μm以下の粒子を含有しないタン
グステン粉末から成る焼結多孔体に銅を含浸させて形成
されているとともにタングステンから成る焼結多孔体が
70乃至95重量%、銅が5乃至30重量%であること
を特徴とするものである。 【0012】本発明の半導体素子収納用パッケージによ
れば、枠状絶縁体を比誘電率が7以下のガラスセラミッ
クス焼結体で形成したことから枠状絶縁体に設けた配線
層を伝わる電気信号の伝搬速度を速いものとして信号の
高速伝搬を要求する半導体素子の収容が可能となる。 【0013】また本発明の半導体素子収納用パッケージ
によれば、枠状絶縁体を低温焼成(約800℃〜900
℃)が可能なガラスセラミックス焼結体で形成したこと
から枠状絶縁体と同時焼成により形成される配線層を比
電気抵抗が2.5μΩ・cm以下と低い銅や銀、金で形
成することができ、その結果、配線層に電気信号を伝搬
させた場合、電気信号に大きな減衰が生じることはな
く、電気信号を正確、かつ確実に伝搬させることが可能
となる。更に本発明の半導体素子収納用パッケージによ
れば、基体を平均粒径が50μm乃至100μmで、2
5μm以下の粒子を含有しないタングステン粉末を焼成
して焼結多孔体を得るとともに該タングステンから成る
焼結多孔体の空孔内に銅を含浸させて製作したことから
基体の熱伝導率を従来品に比べ15%以上改善した高い
ものとなすことができ、その結果、基体上に載置される
半導体素子が作動時に多量の熱を発したとしてもその熱
は基体を介して外部に効率よく放散され、これによって
半導体素子は常に適温となり、半導体素子を長期間にわ
たり安定かつ正常に作動させることが可能となる。 【0014】また更に本発明の半導体素子収納用パッケ
ージによれば、基体を構成するタングステンから成る焼
結多孔体を70乃至95重量%、銅を5乃至30重量%
の範囲としたことから基体の線熱膨張係数をガラスセラ
ミックス焼結体から成る枠状絶縁体の線熱膨張係数に近
似させることができ、その結果、基体上に枠状絶縁体を
取着させる際や半導体素子が作動した際等において基体
と枠状絶縁体の両者に熱が作用したとしても基体と枠状
絶縁体との間には両者の線熱膨張係数の相違に起因する
大きな熱応力が発生することはなく、これによって半導
体素子を収容する空所の気密封止が常に完全となり、半
導体素子を安定かつ正常に作動させることが可能とな
る。 【0015】 【発明の実施の形態】次に、本発明を添付図面に示す実
施例に基づき詳細に説明する。 【0016】図1は、本発明の半導体素子収納用パッケ
ージの一実施例を示す断面図であり、図1において、1
は基体、2は枠状絶縁体、3は蓋体である。この基体1
と枠状絶縁体2と蓋体3とにより内部に半導体素子4を
気密に収容する容器5が構成される。 【0017】前記基体1はその上面に半導体素子4が載
置される載置部1aを有するとともに上面外周部に該基
体1の上面に設けた半導体素子4が載置される載置部1
aを囲繞するようにして枠状絶縁体2がロウ材やガラ
ス、樹脂等の接着剤を介して取着されている。 【0018】前記基体1は半導体素子4を支持する支持
部材として作用するとともに半導体素子4が作動時に発
する熱を良好に吸収するとともに大気中に効率よく放散
させ、半導体素子4を常に適温とする作用をなし、枠状
絶縁体2に囲まれた基体1の載置部1a上に半導体素子
4がガラス、樹脂、ロウ材等の接着剤を介して固定され
る。 【0019】なお前記基体1はタングステンと銅とから
成り、タングステン粉末を焼成して得られる焼結多孔体
の空孔内に溶融させた銅を含浸させることによって製作
されている。 【0020】また前記基体1の上面外周部には該基体1
の上面に設けた半導体素子4が載置される載置部1aを
囲繞するようにして枠状絶縁体2がロウ材やガラス、樹
脂等の接着剤を介して取着されており、基体1と枠状絶
縁体2とで半導体素子4を収容するための空所が内部に
形成される。 【0021】前記基体1に取着される枠状絶縁体2はガ
ラスセラミックス焼結体から成り、具体的には、 1)硼珪酸ガラスにアルミナもしくはムライトを添加し
てなる原料粉末より製作されるガラスセラミックス焼結
体(比誘電率5〜6) 2)コージライト系結晶化ガラスにアルミナもしくはム
ライトを添加して成る原料粉末より製作されるガラスセ
ラミックス焼結体(比誘電率5〜6) 3)ムライト系結晶化ガラスにアルミナもしくはムライ
トを添加して成る原料粉末より製作されるガラスセラミ
ックス焼結体(比誘電率5〜6)等で形成されている。 【0022】前記枠状絶縁体2は、例えば、硼珪酸ガラ
スにアルミナもしくはムライトを添加してなる原料粉末
より製作されるガラスセラミックス焼結体から成る場
合、原料粉末の組成が重量比で72〜76%のシリカ、
15〜17%の酸化硼素、2〜4%の酸化アルミニウ
ム、1.5%以下の酸化マグネシウム、1.1〜1.4
%の酸化ジルコニウム、酸化ナトリウム、酸化カリウム
及び酸化リチウムの合計量2.0〜3.0%から成る硼
珪酸ガラス粉末にアルミナ、石英及びコージェライトの
各粉末とアクリル樹脂を主成分とするバインダー及び分
散剤、可塑剤、有機溶媒を加えて泥漿物を作るとともに
該泥漿物をドクターブレード法やカレンダーロール法を
採用することによってグリーンシート(生シート)とな
し、しかる後、前記グリーンシートに適当な打ち抜き加
工を施すとともにこれを複数枚積層し、約800℃〜9
00℃の温度で焼成することによって製作される。 【0023】また前記枠状絶縁体2はその内周部から上
部にかけて導出する複数の配線層6が被着形成されてお
り、枠状絶縁体2の内周部に露出する配線層6の一端に
は半導体素子4の各電極がボンディングワイヤ7を介し
て電気的に接続され、また枠状絶縁体2の上面に導出さ
れた部位には外部電気回路と接続される外部リードピン
8が銀ロウ等のロウ材を介してロウ付け取着されてい
る。 【0024】前記配線層6は半導体素子4の各電極を外
部電気回路に接続する際の導電路として作用し、銅、
銀、金等の金属粉末により形成されている。 【0025】前記配線層6は銅、銀、金等の金属粉末に
適当な有機バインダー、溶剤等を添加混合して得られた
金属ペーストを枠状絶縁体2となるグリーンシートに予
め従来周知のスクリーン印刷法等の印刷法を用いること
により所定パターンに印刷塗布しておくことによって枠
状絶縁体2の内周部から上面にかけて被着形成される。 【0026】前記配線層6を形成する銅、銀、金等はそ
の融点が約1000℃と低いものの枠状絶縁体2を構成
するガラスセラミックス焼結体の焼成温度が低いことか
ら枠状絶縁体2に所定パターンに被着形成することが可
能となる。 【0027】また前記配線層6を形成する銅や銀、金等
はその比電気抵抗が2.5μΩ・cm以下と低いことか
ら配線層6を介して容器内部に収容する半導体素子4と
外部電気回路との間に電気信号の出し入れをしたとして
も配線層6において電気信号が大きく減衰することはな
く、その結果、半導体素子4に正確、かつ確実な駆動を
行わせることができる。 【0028】更に前記配線層6は、該配線層6の被着さ
れている枠状絶縁体2の比誘電率が7以下(室温、1M
Hz)、好適には5.5〜6と低いことから配線層6を
伝わる電気信号の伝搬速度が速いものとなり、その結
果、配線層6を介して容器内部に収容する半導体素子4
と外部電気回路との間に電気信号の出し入れをしたとし
ても、電気信号の伝搬に遅延を生じることなく、半導体
素子4に正確、かつ確実に電気信号を出し入れすること
ができる。 【0029】なお、前記配線層6は銅や銀からなる場
合、その露出表面に耐蝕性に優れる金属をメッキ法によ
り1μm〜20μmの厚みに被着させておくと、配線層
6の酸化腐蝕を有効に防止することができるとともに配
線層6とボンディングワイヤ7との接続及び配線層6へ
の外部リードピン8の取着を強固となすことができる。
従って、前記配線層6は銅や銀からなる場合、配線層6
の酸化腐蝕を防止し、配線層6とボンディングワイヤ7
及び外部リードピン8との取着を強固とするには配線層
6の露出表面に金等の耐蝕性に優れる金属を1μm〜2
0μmの厚みに被着させておくことが好ましい。 【0030】また前記枠状絶縁体2に被着した配線層6
にロウ付けされる外部リードピン8は鉄−ニッケル−コ
バルト合金や鉄−ニッケル合金等の金属材料から成り、
半導体素子の各電極を外部電気回路に電気的に接続する
作用をなす。 【0031】前記外部リードピン8は、例えば、鉄−ニ
ッケル−コバルト合金等の金属から成るインゴット
(塊)に圧延加工法や打ち抜き加工法等、従来周知の金
属加工法を施すことによって所定形状に形成される。 【0032】かくして上述の半導体素子収納用パッケー
ジによれば、基体1の半導体素子載置部1a上に半導体
素子4をガラス、樹脂、ロウ材等の接着剤を介して接着
固定するとともに該半導体素子4の各電極をボンディン
グワイヤ7を介して所定の配線層6に接続させ、しかる
後、前記枠状絶縁体2の上面に蓋体3をガラス、樹脂、
ロウ材等から成る封止材を介して接合させ、基体1、枠
状絶縁体2及び蓋体3とから成る容器5内部に半導体素
子4を気密に収容することによって製品としての半導体
装置となる。 【0033】本発明の半導体素子収納用パッケージにお
いては、基体1を平均粒径が50μm乃至100μm
で、粒径25μm以下の粒子を含有しないタングステン
粉末を焼成して得られる焼結多孔体の空孔内に溶融させ
た銅を含浸させることによって製作しておくことが重要
である。 【0034】このように平均粒径が50μm乃至100
μmで、粒径25μm以下の粒子を含有しないタングス
テン粉末を焼成して得られる焼結多孔体は粒径の小さい
粉末が粒径の大きな粉末間に入り込んで空孔を小さくす
ることはなく、その結果、タングステンから成る焼結多
孔体の空孔を大きなものとするとともに該空孔内に含浸
される熱伝導が良好な銅の線幅も広いものとなり、これ
によって基体1の熱伝導率を極めて高い値となすことが
可能となる。 【0035】なお、前記タングステン粉末を焼成して得
られる焼結多孔体はタングステン粉末の平均粒径が50
μm未満となると形成される空孔が細く、狭いものとな
って基体1の熱伝導率を大幅に向上させることができ
ず、また100μmを越えると基体1の表面に大きな凹
凸が形成され半導体素子4を基体1の載置部1aに強固
に取着固定する事ができなくなってしまう。従って、前
記タングステンから成る焼結多孔体は平均粒径が50μ
m乃至100μmのタングステン粉末を焼成することに
よって形成されたものに限定される。 【0036】また前記平均粒径が50μm乃至100μ
mのタングステン粉末を焼成して得られる焼結多孔体は
粒径が25μm以下のものが含有されているとこの粒径
の小さなタングステン粉末が粒径の大きなタングステン
粉末間に入り込んで空孔を細く狭いものにしてしまい基
体1の熱伝導率を小さいものとなしてしまう。従って、
前記タングステンから成る焼結多孔体は平均粒径が50
μm乃至100μmのタングステン粉末を焼成して形成
する際、その中に含まれている粒径25μm以下の粉末
を除去しておく必要がある。この粒径25μm以下の粉
末が含有されないようにするにはタングステン粉末を粗
さの異なる複数のメッシュを用いて調整し、粒径25μ
m以下のものを除去することによって行われる。 【0037】更に本発明の半導体素子収納用パッケージ
においては、基体1を構成するタングステンから成る焼
結多孔体を70乃至95重量%、銅を5乃至30重量%
の範囲としておくことが重要である。 【0038】前記タングステンからなる焼結多孔体を7
0乃至95重量%、銅を5乃至30重量%の範囲として
おくと基体1の線熱膨張係数を5ppm/℃乃至8pp
m/℃(室温〜800℃)の任意の値として、ガラスセ
ラミックス焼結体から成る枠状絶縁体2の線熱膨張係数
(4ppm/℃〜8ppm/℃)に近似させることが可
能となり、その結果、基体1上に枠状絶縁体2を取着さ
せる際や半導体素子4が作動した際において基体1と枠
状絶縁体2の両者に熱が作用したとしても基体1と枠状
絶縁体2との間には両者の線熱膨張係数差に起因する大
きな熱応力が発生することはなく、これによって半導体
素子4と収容する容器5の気密封止が常に完全となり、
半導体素子4を安定かつ正常に作動させることが可能と
なる。 【0039】なお前記基体1はタングステンから成る焼
結多孔体が70重量%未満、銅が30重量%を超えた場
合、或いはタングステンから成る焼結多孔体が95重量
%を超え、銅が5重量%未満である場合、基体1の線熱
膨張係数が枠状絶縁体2の線熱膨張係数に対して大きく
相違することとなり、その結果、基体1に枠状絶縁体2
を強固に取着させておくことができなくなってしまう。
従って、前記基体1はそれを形成するタングステンから
成る焼結多孔体の量は70乃至95重量%の範囲に、銅
は5乃至30重量%の範囲にそれぞれ特定される。次に
本発明の作用効果を下記に示す実験例に基づき説明す
る。 【0040】[実験例]まず、銅と、平均粒径が50μ
m、75μm、100μmで粒径25μm以下のものを
含有しないタングステン粉末と、平均粒径が5μmで
2.5μm以下の粒子を10重量%含有するタングステ
ン粉末とを準備する。 【0041】次に上記銅およびタングステン粉末を表1
に示す値に秤量するとともに1t/cm3の圧力で成形
し、該成形体を1500℃の温度で焼成して各種の焼結
多孔体を得る。 【0042】次に前記タングステンから成る各種の焼結
多孔体の空孔内に1200℃の温度で溶融させた銅を含
浸させ、これによって銅−タングステン合金から成る評
価用基体を製作する。 【0043】最後に前記各種の評価用基体をJIS R
1611に規定のファインセラミックスのレーザフラッ
シュ法による熱拡散率・比熱容量・熱伝導率試験方法に
基づき評価用基体の熱拡散率と熱容量を求め、これらの
値に評価基体の密度を積算することによって熱伝導率
(W/m・K)を、またTMA法(Thermomec
hanical Analysis)により評価用基体
を昇温させながら各温度に対する評価基体の伸び量を測
定し、その値を温度上昇幅値で除算することによって線
熱膨張係数(ppm/℃)を測定する。 【0044】その結果を表1および図2に示す。 【0045】 【表1】【0046】表1および図2から判るようにいずれの評
価用基体においても銅とタングステンの比率が同じもの
は線熱膨張係数が略同じ値を示しているのに対し、熱伝
導率は平均粒径が50μm、75μm、100μmで粒
径25μm以下のものを含有しないタングステン粉末を
用いた評価用基体(試料No.1〜18:本発明品)のも
のは平均粒径が5μmで2.5μm以下の粒子を10重
量%含有するタングステン粉末を用いた評価用基体(試
料No.19〜24:従来品)よりも15%以上高い値を
示し熱伝導率が大きく改善されていることが判る。 【0047】よって本発明品では、半導体素子が作動時
に多量の熱を発した際、その熱を基体を介して外部に効
率よく放散させることができ、半導体素子を常に適温と
して長期間にわたり安定かつ正常に作動させることが可
能となる。 【0048】なお、本発明は上述の実施例、実験例に限
定されるものではなく、本発明の要旨を逸脱しない範囲
であれば種々の変更は可能である。 【0049】 【発明の効果】本発明の半導体素子収納用パッケージに
よれば、枠状絶縁体を比誘電率が7以下のガラスセラミ
ックス焼結体で形成したことから枠状絶縁体に設けた配
線層を伝わる電気信号の伝搬速度を速いものとして信号
の高速伝搬を要求する半導体素子の収容が可能となる。 【0050】また本発明の半導体素子収納用パッケージ
によれば、枠状絶縁体を低温焼成(約800℃〜900
℃)が可能なガラスセラミックス焼結体で形成したこと
から枠状絶縁体と同時焼成により形成される配線層を比
電気抵抗が2.5μΩ・cm以下と低い銅や銀、金で形
成することができ、その結果、配線層に電気信号を伝搬
させた場合、電気信号に大きな減衰が生じることはな
く、電気信号を正確、かつ確実に伝搬させることが可能
となる。 【0051】更に本発明の半導体素子収納用パッケージ
によれば、基体を平均粒径が50μm乃至100μm
で、粒径25μm以下の粒子を含有しないタングステン
粉末を焼成して焼結多孔体を得るとともに該タングステ
ンから成る焼結多孔体の空孔内に銅を含浸させて製作し
たことから基体の熱伝導率を従来品に比べ15%以上改
善した高いものとなすことができ、その結果、基体上に
載置される半導体素子が作動時に多量の熱を発したとし
てもその熱は基体を介して外部に効率よく放散され、こ
れによって半導体素子は常に適温となり、半導体素子を
長期間にわたり安定かつ正常に作動させることが可能と
なる。 【0052】また更に本発明の半導体素子収納用パッケ
ージによれば、基体を構成するタングステンから成る焼
結多孔体を70乃至95重量%、銅を5乃至30重量%
の範囲としたことから基体の線熱膨張係数をガラスセラ
ミックス焼結体から成る枠状絶縁体の線熱膨張係数に近
似させることができ、その結果、基体上に枠状絶縁体を
取着させる際や半導体素子が作動した際等において基体
と枠状絶縁体の両者に熱が作用したとしても基体と枠状
絶縁体との間には両者の線熱膨張係数の相違に起因する
大きな熱応力が発生することはなく、これによって半導
体素子を収容する空所の気密封止が常に完全となり、半
導体素子を安定かつ正常に作動させることが可能とな
る。
例を示す断面図である。 【図2】本発明の半導体素子収納用パッケージに用いる
基体の特性図である。 【符号の説明】 1・・・・基体 1a・・・載置部 2・・・・枠状絶縁体 3・・・・蓋体 4・・・・半導体素子 5・・・・容器 6・・・・配線層
3) 【手続補正1】 【補正対象書類名】明細書 【補正対象項目名】0022 【補正方法】変更 【補正内容】 【0022】前記枠状絶縁体2は、例えば、硼珪酸ガラ
スにアルミナもしくはムライトを添加してなる原料粉末
より製作されるガラスセラミックス焼結体から成る場
合、原料粉末の組成が重量比で72〜76%のシリカ、
15〜17%の酸化硼素、2〜4%の酸化アルミニウ
ム、1.5%以下の酸化マグネシウム、1.1〜1.4
%の酸化ジルコニウム、酸化ナトリウム、酸化カリウム
及び酸化リチウムの合計量2.0〜3.0%から成る硼
珪酸ガラス粉末にアルミナもしくはムライトの各粉末と
アクリル樹脂を主成分とするバインダー及び分散剤、可
塑剤、有機溶媒を加えて泥漿物を作るとともに該泥漿物
をドクターブレード法やカレンダーロール法を採用する
ことによってグリーンシート(生シート)となし、しか
る後、前記グリーンシートに適当な打ち抜き加工を施す
とともにこれを複数枚積層し、約800℃〜900℃の
温度で焼成することによって製作される。
Claims (1)
- 【特許請求の範囲】 【請求項1】上面に半導体素子が載置される載置部を有
する基体と、前記基体上に半導体素子載置部を囲繞する
ようにして取着され、半導体素子の各電極が接続される
配線層を有する枠状絶縁体と、前記枠状絶縁体上に取着
され、枠状絶縁体の内側を気密に封止する蓋体とから成
る半導体素子収納用パッケージであって、前記枠状絶縁
体は比誘電率が7以下、熱膨張係数が4ppm/℃〜8
ppm/℃のガラスセラミックス焼結体で、配線層は電
気抵抗率が2.5μΩ・cm以下の金属材料で、基体は
平均粒径が50μm乃至100μmで、粒径25μm以
下の粒子を含有しないタングステン粉末から成る焼結多
孔体に銅を含浸させて形成されているとともにタングス
テンから成る焼結多孔体が70乃至95重量%、銅が5
乃至30重量%であることを特徴とする半導体素子収納
用パッケージ。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2001193760A JP2003007885A (ja) | 2001-06-26 | 2001-06-26 | 半導体素子収納用パッケージ |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
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JP2001193760A JP2003007885A (ja) | 2001-06-26 | 2001-06-26 | 半導体素子収納用パッケージ |
Publications (1)
Publication Number | Publication Date |
---|---|
JP2003007885A true JP2003007885A (ja) | 2003-01-10 |
Family
ID=19031983
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2001193760A Pending JP2003007885A (ja) | 2001-06-26 | 2001-06-26 | 半導体素子収納用パッケージ |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP2003007885A (ja) |
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2016122723A (ja) * | 2014-12-25 | 2016-07-07 | 京セラ株式会社 | 電子素子実装用基板および電子装置 |
DE102008002620B4 (de) | 2007-06-25 | 2018-06-14 | Denso Corporation | Kraftstoffeinspritzsteuereinrichtung einer Dieselmaschine |
Citations (7)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH0363939U (ja) * | 1989-10-26 | 1991-06-21 | ||
JPH06181267A (ja) * | 1992-12-15 | 1994-06-28 | Kyocera Corp | 半導体素子収納用パッケージ |
JPH06181265A (ja) * | 1992-12-15 | 1994-06-28 | Kyocera Corp | 半導体素子収納用パッケージ |
JPH10209313A (ja) * | 1997-01-21 | 1998-08-07 | Kyocera Corp | 電子部品収納用パッケージ |
JPH10209336A (ja) * | 1997-01-21 | 1998-08-07 | Kyocera Corp | 半導体素子収納用パッケージ |
JPH11284112A (ja) * | 1998-01-29 | 1999-10-15 | New Japan Radio Co Ltd | ヒートシンク及びその製造方法 |
JP2000252385A (ja) * | 1999-02-26 | 2000-09-14 | Kyocera Corp | 半導体素子収納用パッケ−ジ |
-
2001
- 2001-06-26 JP JP2001193760A patent/JP2003007885A/ja active Pending
Patent Citations (7)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH0363939U (ja) * | 1989-10-26 | 1991-06-21 | ||
JPH06181267A (ja) * | 1992-12-15 | 1994-06-28 | Kyocera Corp | 半導体素子収納用パッケージ |
JPH06181265A (ja) * | 1992-12-15 | 1994-06-28 | Kyocera Corp | 半導体素子収納用パッケージ |
JPH10209313A (ja) * | 1997-01-21 | 1998-08-07 | Kyocera Corp | 電子部品収納用パッケージ |
JPH10209336A (ja) * | 1997-01-21 | 1998-08-07 | Kyocera Corp | 半導体素子収納用パッケージ |
JPH11284112A (ja) * | 1998-01-29 | 1999-10-15 | New Japan Radio Co Ltd | ヒートシンク及びその製造方法 |
JP2000252385A (ja) * | 1999-02-26 | 2000-09-14 | Kyocera Corp | 半導体素子収納用パッケ−ジ |
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
DE102008002620B4 (de) | 2007-06-25 | 2018-06-14 | Denso Corporation | Kraftstoffeinspritzsteuereinrichtung einer Dieselmaschine |
JP2016122723A (ja) * | 2014-12-25 | 2016-07-07 | 京セラ株式会社 | 電子素子実装用基板および電子装置 |
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