JP2002353427A - イメージセンサのスタックパッケージ構造 - Google Patents
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Landscapes
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Abstract
提供。 【解決手段】第1基板10は信号入力端子が形成された
第1表面12を有する。第1基板10の第2表面14に
はプリント基板に電気的に連結される信号出力端子18
が形成されている。第2基板22は上表面24と該上表
面と反対の下表面26を有する。該第2基板22の該下
表面が第1基板10の第1表面に接合され、第1基板1
0と第2基板22の間にキャビティー28が形成され
る。集積回路30は第1基板10の第1表面に取り付け
られ、キャビティー内に配置され、該集積回路は第1基
板10の第1表面の信号入力端子16に電気的に連結さ
れる。該イメージセンシングチップ34は第2基板22
の上表面に配置される。該透明層はイメージセンシング
チップ34の上方を被覆し、イメージセンシングチップ
34が該透明層を介してイメージ信号を受け取り、第1
基板10に伝送される電気信号に変換する。
Description
タックパッケージ構造に係り、特に、そのうち異なる機
能を有する集積回路及びイメージセンシングチップがパ
ッケージボデー中にパッケージされて、パッケージ基板
の数を減少でき、及び異なる機能を有する集積回路及び
イメージセンシングチップを一体にパッケージした構造
に関する。
それは光学或いはオーディオ信号とされうる。本発明の
センサはイメージ信号を受け取り、及びイメージ信号を
プリント基板に伝送する電気信号に変換する。
け取りイメージ信号ををプリント基板に伝送する電気信
号に変換する。イメージセンサはそれから電気的に他の
集積回路に連結されて必要な機能を有する。例えば、イ
メージセンサはイメージセンサの発生した信号を処理す
るディジタル信号プロセッサに電気的に連接される。さ
らに、イメージセンサはまた、マイクロコントローラ、
中央処理装置、或いはその他の回路に連結されて、必要
な機能を有する。
ージされ、イメージセンサに対応する集積回路はイメー
ジセンサとは別にパッケージされる必要がある。そし
て、パッケージされたイメージセンサ及び各種の信号処
理ユニットは電気的にプリント基板に連結される。その
後、イメージセンサが電気的に信号処理ユニットに、複
数の配線によりそれぞれ連結される。ゆえに、個別に各
信号処理ユニットとイメージセンサをパッケージするた
めには、複数の基板とパッケージボデーを使用する必要
があり、このため製造コストが増した。さらに、プリン
ト基板の必要エリアは各信号処理ユニットをプリント基
板上に取り付ける時に信号処理ユニットより大きくなけ
ればならず、このため製品を小型化、薄型化、及び軽量
化することができなかった。
メージセンサのスタックパッケージ構造を提供して従来
のイメージセンサによりもたらされる欠点を解決する。
な目的は、イメージセンサのスタックパッケージ構造を
提供し、パッケージ素子の数とパッケージコストを減少
することにある。
タックパッケージ構造を提供し、製造プロセスを簡素化
及び容易とすることにある。
サのスタックパッケージ構造を提供し、イメージセンシ
ング製品のエリアを減少することにある。
センサのスタックパッケージ構造を提供し、イメージセ
ンシング製品のパッケージコスト及び試験コストを減少
することにある。
ージセンサをプリント基板に電気的に連結するスタック
パッケージ構造において、第1表面と該第1表面の反対
に位置する第2表面を具え、該第1表面に信号入力端子
が形成され、第2表面にプリント基板と電気的に連結さ
れる信号出力端子が形成された、第1基板と、上表面と
該上表面の反対に位置する下表面を具え、該下表面が第
1基板の第2表面に接着され、第1基板との間にキャビ
ティーを形成する、第2基板と、該第1基板の第1表面
上に取り付けられてキャビティー内に位置し、第1基板
の第1表面の信号入力端子に電気的に連結された、集積
回路と、該第2基板の上表面に配置されて第1基板と電
気的に連結された、イメージセンシングチップと、透明
層とされ、イメージセンシングチップを被覆し、該イメ
ージセンシングチップが該透明層を介してイメージ信号
を受け取り、第1基板に伝送する電気信号に変換する、
上記透明層と、を具えたことを特徴とする、イメージセ
ンサのスタックパッケージ構造としている。請求項2の
発明は、前記集積回路が信号処理ユニットとされたこと
を特徴とする、請求項1に記載のイメージセンサのスタ
ックパッケージ構造としている。請求項3の発明は、前
記第2基板の上表面の周囲に投射構造が配置され、透明
層が投射構造の上に配置されたことを特徴とする、請求
項1に記載のイメージセンサのスタックパッケージ構造
としている。請求項4の発明は、前記透明層が透明接着
剤とされたことを特徴とする、請求項1に記載のイメー
ジセンサのスタックパッケージ構造としている。
電気的に連結するためのイメージセンサのスタックパッ
ケージ構造は、第1基板と、第2基板と、集積回路と、
イメージセンシングチップと、透明層とを具えている。
該第1基板は信号入力端子が形成された第1表面を有す
る。第1基板の第2表面にはプリント基板に電気的に連
結される信号出力端子が形成されている。第2基板は上
表面と該上表面と反対の下表面を有する。該第2基板の
該下表面が第1基板の第1表面に接合され、第1基板と
第2基板の間にキャビティーが形成される。該集積回路
は第1基板の第1表面に取り付けられ、キャビティー内
に配置され、該集積回路は第1基板の第1表面の信号入
力端子に電気的に連結される。該イメージセンシングチ
ップは第2基板の上表面に配置される。該透明層はイメ
ージセンシングチップの上方を被覆し、イメージセンシ
ングチップが該透明層を介してイメージ信号を受け取
り、第1基板に伝送される電気信号に変換する。
ージセンシングチップと集積回路が一体にパッケージさ
れる。
ンサのスタックパッケージ構造は、第1基板10と、第
2基板22と、集積回路30と、イメージセンシングチ
ップ34と、投射構造38と、透明層40とを具えてい
る。
面12の反対に位置する第2表面14とを具えている。
第1基板10の第1表面12に信号入力端子16が形成
されている。第1基板10の第2表面14には信号出力
端子18が形成され、該信号出力端子18はBGA形式
に配置された金属ボールとされて、第1基板10からの
信号をプリント基板20に伝送する。
反対に位置する下表面26を具えている。第2基板22
の下表面26は第1基板10の第1表面12に接着さ
れ、これにより第1基板10と第2基板22の間にキャ
ビティー28が形成される。
例えばディジタル信号プロセッサ、マイクロプロセッ
サ、CPU或いはそれらに類似のものとされる。該集積
回路30は第1基板10の第1表面12に配置されキャ
ビティー28内に位置する。集積回路30はワイヤボン
ディングにより第1基板10の第1表面12に形成され
た信号入力端子16に複数のワイヤ32を介して電気的
に連結される。これにより集積回路30が第1基板10
に電気的に連結される。もし集積回路30がディジタル
信号プロセッサとされるなら、イメージセンシングチッ
プ34からの信号は前もって処理されてからプリント基
板20に伝送される。
22の上表面24に配置されて第1基板10の第1表面
12に形成された信号入力端子16に電気的に連結され
る。これによりイメージセンシングチップ34からの信
号が第1基板10に伝送される。
10の第1表面12に取り付けられて集積回路30とイ
メージセンシングチップ34を包囲する。
造38を被覆して集積回路30とイメージセンシングチ
ップ34をシールする。イメージセンシングチップ34
は透明層40を介してイメージ信号を受け取り、該イメ
ージ信号を第1基板10に伝送する電気信号に変換す
る。
パッケージ構造の第2実施例の断面図である。第2基板
22の上表面24に信号入力端子42が形成されてい
る。第2基板22の下表面26は第1基板10の第1表
面12に固定される。こうして、キャビティー28が第
1基板10と第2基板22の間に形成される。集積回路
30が第1表面12に配置されキャビティー28内に位
置する。そして、集積回路30は第1基板10の第1表
面12に形成された信号入力端子42にワイヤボンディ
ングされたワイヤ32を介して電気的に連結される。
22の上表面24に配置され、該イメージセンシングチ
ップ34は第2基板22の上表面24に形成された信号
入力端子42に電気的に連結される。
2に固定されて集積回路30とイメージセンシングチッ
プ34を包囲する。
38の上に位置して集積回路30とイメージセンシング
チップ34をシールする。該イメージセンシングチップ
34は透明層40を介してイメージ信号を受け取り、そ
れを第1基板10に伝送する電気信号に変換する。
パッケージ構造の第3実施例の断面図である。この実施
例では透明層40が透明樹脂とされ、それが第2基板2
2の上表面24を被覆し、ゆえに、集積回路30とイメ
ージセンシングチップ34が透明層40によりシールさ
れる。それから、イメージセンシングチップ34が透明
層40を介してイメージ信号を受け取り、それを第1基
板10に伝送する電気信号に変換する。
パッケージ構造の第4実施例の断面図である。この実施
例では支持柱46を具え、該支持柱46が第2基板22
の上表面24に固定されている。逆U形の透明層40が
射出或いは加圧モールディングにより形成される。こう
してイメージセンシングチップ34及び集積回路30が
透明層40に被覆され、イメージ信号が透明層40を介
してイメージセンシングチップ34に受け取られる。
れによりイメージセンサのスタックパッケージ構造が良
好な透過品質を提供する。
た点を有する。 1.イメージセンシングチップと集積回路が一体にパッ
ケージされているため、基板形成材料を減らすことがで
き、ゆえにイメージセンシング製品の製造コストを削減
できる。 2.イメージセンシングチップと集積回路が一体にパッ
ケージされているため、イメージセンシング製品の区域
を減少できる。 3.イメージセンシングチップと集積回路が一体にパッ
ケージされているため、ただ一つのパッケージボデーし
かない。ゆえにただ一つの試験設備しか使用する必要が
なく、試験コストも減少できる。 4.イメージセンシングチップと集積回路が一体にパッ
ケージされているため、二つのチップがたった一つのパ
ッケージプロセスによりパッケージされる。ゆえにパッ
ケージコストを有効に減少できる。
あり、本発明の請求範囲を限定するものではなく、本発
明に基づきなしうる細部の修飾或いは改変は、いずれも
本発明の請求範囲に属するものとする。
タックパッケージ構造表示図である。
タックパッケージ構造表示図である。
タックパッケージ構造表示図である。
タックパッケージ構造表示図である。
Claims (4)
- 【請求項1】 イメージセンサをプリント基板に電気的
に連結するスタックパッケージ構造において、 第1表面と該第1表面の反対に位置する第2表面を具
え、該第1表面に信号入力端子が形成され、第2表面に
プリント基板と電気的に連結される信号出力端子が形成
された、第1基板と、 上表面と該上表面の反対に位置する下表面を具え、該下
表面が第1基板の第2表面に接着され、第1基板との間
にキャビティーを形成する、第2基板と、 該第1基板の第1表面上に取り付けられてキャビティー
内に位置し、第1基板の第1表面の信号入力端子に電気
的に連結された、集積回路と、 該第2基板の上表面に配置されて第1基板と電気的に連
結された、イメージセンシングチップと、 透明層とされ、イメージセンシングチップを被覆し、該
イメージセンシングチップが該透明層を介してイメージ
信号を受け取り、第1基板に伝送する電気信号に変換す
る、上記透明層と、 を具えたことを特徴とする、イメージセンサのスタック
パッケージ構造。 - 【請求項2】 前記集積回路が信号処理ユニットとされ
たことを特徴とする、請求項1に記載のイメージセンサ
のスタックパッケージ構造。 - 【請求項3】 前記第2基板の上表面の周囲に投射構造
が配置され、透明層が投射構造の上に配置されたことを
特徴とする、請求項1に記載のイメージセンサのスタッ
クパッケージ構造。 - 【請求項4】 前記透明層が透明接着剤とされたことを
特徴とする、請求項1に記載のイメージセンサのスタッ
クパッケージ構造。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2001153598A JP3645833B2 (ja) | 2001-05-23 | 2001-05-23 | イメージセンサのスタックパッケージ構造 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
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JP2001153598A JP3645833B2 (ja) | 2001-05-23 | 2001-05-23 | イメージセンサのスタックパッケージ構造 |
Publications (2)
Publication Number | Publication Date |
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JP2002353427A true JP2002353427A (ja) | 2002-12-06 |
JP3645833B2 JP3645833B2 (ja) | 2005-05-11 |
Family
ID=18998090
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
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JP2001153598A Expired - Lifetime JP3645833B2 (ja) | 2001-05-23 | 2001-05-23 | イメージセンサのスタックパッケージ構造 |
Country Status (1)
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