DE60037168T2 - Dünne Struktur mit integriertem Widerstand/Kondensator/Induktor und Verfahren zu deren Herstellung - Google Patents
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Description
- Die vorliegende Erfindung ist auf einen dünnen elektronischen Schaltkreis, der Widerstände, Kondensatoren, Verbindungsschaltkreise und optionale Induktoren bereitstellt, und auf ein Verfahren zur Herstellung solcher Strukturen gerichtet.
- Hintergrund der Erfindung
- Es besteht nach wie vor Interesse an der Verkleinerung gedruckter Schaltkreise. In den meisten derzeit genutzten Leiterplatten werden Schaltkreisspuren durch herkömmliche Verfahren, insbesondere Photoresisttechniken, gedruckt. Akzessorische Komponenten wie Kondensatoren und Widerstände werden häufig als einzelne Komponenten bereitgestellt und auf den gedruckten Schaltkreis gelötet, entweder manuell oder mit Robotern. Diese Komponenten nehmen ein „Grundstück" auf der Leiterplatte ein und sind nur schwer oder mit hohen Kosten auf die Platte aufzutragen.
- Demgemäß sind Strukturen vorgeschlagen worden, in denen neben Schaltkreisspuren Komponenten wie Kondensatoren und/oder Widerstände durch Schaltkreisbildungsverfahren bereitgestellt werden. Beispiele für solche Strukturen sind in den
US-Patenten Nr. 5,079,069 ;5,155,655 ;5,161,086 ;5,261,153 ;5,347,258 und5,466,892 zu finden. Typischerweise werden mehrere dieser Strukturen zusammen mit einem dielektrischen Material laminiert, um so Mehrschicht-Leiterplatten zu bilden. -
US-A-5 172 304 zeigt eine Struktur, umfassend eine erste und eine zweite Schaltkreis-gebildete Schicht aus einem elektrisch leitfähigen Material und eine Schicht aus dielektrischem Material dazwischen, wobei auf einer der elektrisch leitfähigen Schichten von der anderen der Schaltkreis-gebildeten Schichten Abstandsstellen von mit Widerstand behaftetem Material bereitgestellt sind, wobei die Schaltkreis-gebildeten Schichten Kondensatoren bilden und eine der Schaltkreis-gebildeten Schichten Widerstandsverbindungen bildet. - Die vorliegende Erfindung ist auf ein Verfahren zur Bildung einer dünnen Schaltkreis-gebildeten Laminatstruktur, die Kondensatoren, Widerstände und leitfähige Elemente liefert, die Schaltkreisspuren und optionale Induktoren umfassen, und auf eine daraus gebildete dünne, Schaltkreis-gebildete Laminatstruktur gerichtet.
- Zusammenfassung der Erfindung
- Gemäß dem Verfahren der Erfindung, definiert in Anspruch 1, wird eine erste leitfähige Metallfolie, auf die eine Schicht von einbettbarem dielektrischem Material laminiert ist, und eine zweite leitfähige Metallfolie, die auf einer Seite mit einer Schicht von mit Widerstand behaftetem Material beschichtet ist, bereitgestellt, wobei die Schicht von mit Widerstand behaftetem Material auf der zweiten Folie eine Dicke von weniger als der der Schicht von einbettbarem dielektrischem Material auf der ersten Folie hat. Die Schicht von mit Widerstand behaftetem Material wird Schaltkreis-gebildet, um so diskrete Stellen von mit Widerstand behaftetem Material zu bilden. Dann werden die beiden Strukturen zusammen mit den Schichten von mit Widerstand behaftetem Material, die in die Schicht von einbettbarem dielektrischem Material eingebettet sind, laminiert, ohne dass die Stellen von mit Widerstand behaftetem Material die erste Folie kontaktieren. Zu diesem Zeitpunkt wird entweder die erste oder die zweite Folie Schaltkreis-gebildet, wodurch Verbindungsschaltkreisspuren und optionale elektrische Komponenten wie Induktoren bereitgestellt werden. Zum Abstützen der Struktur wird die Schaltkreis-gebildete Folie in dielektrisches Material wie glasfaserverstärktes Epoxid, auch bekannt als „Prepreg", eingebettet, wobei dieses Material die Struktur während der nachfolgenden Verarbeitung trägt. Mit der so getragenen Struktur wird dann die andere Folie Schaltkreis-gebildet, und auch diese Seite kann in dielektrisches Material eingebettet werden. Zur Bildung einer Mehrschicht-Leiterplatte können mehrere dieser Strukturen zusammen laminiert werden, wobei die vielen Schichten durch Kontaktlöcher auf herkömmliche Art und Weise elektrisch verbunden werden.
- Die elektronische Schaltkreisstruktur der vorliegenden Erfindung ist in Anspruch 9 definiert.
- Kurze Beschreibung der Zeichnungen
-
1 veranschaulicht einen Querschnitt einer ersten Folie mit einer darauf laminierten dünnen Schicht von eingebettetem dielektrischem Material. -
2 veranschaulicht einen Querschnitt einer zweiten Folie mit einer darauf abgeschiedenen dünnen Schicht von mit Widerstand behaftetem Material. -
3 veranschaulicht einen Querschnitt der Struktur aus2 , worin das mit Widerstand behaftete Material auf der zweiten Folie zur Bildung diskreter mit Widerstand behafteter Stellen Schaltkreis-gebildet worden ist. -
4 veranschaulicht einen Querschnitt der Struktur aus1 , laminiert auf die Struktur aus3 , wobei die Stellen von mit Widerstand behaftetem Material in die Schicht von einbettbarem dielektrischem Material eingebettet sind. -
5 veranschaulicht einen Querschnitt der Struktur aus4 , worin die zweite Folienschicht Schaltkreis-gebildet worden ist. -
6 veranschaulicht einen Querschnitt einer Struktur, worin die Schaltkreis-gebildete zweite Folienschicht in ein dielektrisches Material eingebettet und anschließend die erste Folienschicht Schaltkreis-gebildet worden ist. - Ausführliche Beschreibung bestimmter bevorzugter Ausführungsformen
- In
1 wird eine Struktur10 dargestellt, umfassend eine Folienschicht11 , auf die eine dünne Schicht von dielektrischem Material12 laminiert ist. In2 wird eine Struktur13 dargestellt, umfassend eine Folienschicht14 , auf die eine dünne Schicht von mit Widerstand behaftetem Material abgeschieden ist. Die Folienschichten11 ,14 können aus einer Vielzahl von Metallen und Metallegierungen ausgewählt sein, obgleich Kupferfolie am häufigsten verwendet wird. Typischerweise sind die Folien11 ,14 zwischen etwa 3 und etwa 50 Mikrometer dick. Die Schicht von dielektrischem Material12 ist zwischen etwa 3 und etwa 50 Mikrometer dick. Die Schicht von mit Widerstand behaftetem Material15 ist zwischen etwa 0,1 und etwa 0,5 Mikrometer dick, auf jeden Fall aber dünner, typischerweise zwischen etwa 2,9 und etwa 49,5 Mikrometer dünner als die Schicht von dielektrischem Material12 . - Ein derzeit bevorzugtes Material, das als die Schicht von dielektrischem Material
12 verwendet wird, ist Epoxidharz wie das, das unter dem Markennamen Dynavin verkauft wird. - Als ein erster Schritt wird die Schicht von mit Widerstand behaftetem Material
15 Schaltkreis-gebildet, um so diskrete Stellen einer mit Widerstand behafteten Schicht15a auf der zweiten Folie14 zu bilden, was zu der Struktur13a aus3 führt. (Für eine einfachere Veranschaulichung ist nur eine solche mit Widerstand behaftete Stelle15a gezeigt.) Das Schaltkreisbilden der mit Widerstand behafteten Schicht15 ist stark analog zu herkömmlichem Schaltkreisbilden von Leitern zur Bildung gedruckter Schaltkreisspuren. Die mit Widerstand behaftete Schicht15 wird mit einem Photoresist (hierin als ein negativ-wirkender Photoresist beschrieben) bedeckt; der Photoresist wird durch eine Druckvorlage aktinischer Strahlung ausgesetzt; die unbestrahlten Abschnitte des Photoresists werden entwickelt und die bestrahlten Abschnitte der darunterliegenden Schicht von mit Widerstand behaftetem Material15 weggeätzt. - Die US-Patentanmeldung Nr. 09/198,954 lehrt ein bevorzugtes mit Widerstand behaftetes Material zur Bildung der Schicht
15 . Diese Patentanmeldung lehrt, daß Platin, das relativ kleine Mengen eines Dielektrikums, wie Siliciumdioxid, enthält, über einen beträchtlichen elektrischen Widerstand verfügt, was von der Menge des Dielektrikums abhängt, die typischerweise im Bereich von etwa 0,5 Gew.-% bis etwa 5,0 Gew.-% liegt. Üblicherweise wird eine dünne Schicht von Silicium-dotiertem Platin durch chemische Gasphasenabscheidung mittels Verbrennung (Combustion Chemical Vapor Deposition (CCVD)), einem Verfahren, das inUS-Patent Nr. 5,652,021 beschrieben wird, abgeschieden. CCVD-abgeschiedenes Pt/SiO2 verfügt über beträchtliche Porosität, wodurch ausgewählte Abschnitte von Pt/SiO2 in einem Verfahren, das in der oben angegebenen US-Patentanmeldung Nr. 09/198,954 beschrieben wird, wie ablatives Ätzen, von Kupferfolie entfernt werden kann. Die bestrahlten Abschnitte der Pt/SiO2-Schicht werden einem Kupferätzmittel wie Eisen(III)-chlorid ausgesetzt. Das Ätzmittel sickert durch die Pt/SiO2-Schicht, was das Kupfer an der Grenzfläche zwischen den beiden Schichten angreift. Es ist herausgefunden worden, daß die Pt/SiO2-Schicht abgetragen wird, wenn die Haftung verloren geht, bevor die darunterliegende Kupferschicht signifikant abgebaut wird. Auf diese Weise kann eine Pt/SiO2-Schicht auf Kupfer (oder anderen Folien) Schaltkreis-gebildet werden. Als eine Weiterentwicklung dieses Verfahrens kann eine sehr dünne Ätzmittel-empfindliche Schicht, z. B. Nickel, (nicht gezeigt) entweder durch CCVD oder durch Galvanisieren auf die Kupferfolie abgeschieden werden, bevor die Pt/SiO2-Schicht abgeschieden wird. Wenn ein Ätzmittel durch die Pt/SiO2-Schicht sickert, erodiert es schnell die Ätzmittel-empfindliche Schicht, was das ablative Ätzverfahren erleichtert. - Zu diesem Zeitpunkt wird die Struktur
10 mit der Schicht von dielektrischem Material12 auf der ersten Folie11 durch Pressen der Seite mit Stellen von mit Widerstand behaftetem Material15a in das dielektrische Material12 auf die Struktur13a laminiert, wodurch die Stellen15a unter Bildung der Struktur16 aus4 in das dielektrische Material eingebettet werden. Da die Schicht von dielektrischem Material12 etwas dicker ist als die mit Widerstand behafteten Stellen15a , bleiben die Stellen15a durch einen dünneren Abschnitt der Schicht von dielektrischem Material12 von der ersten Folie11 elektrisch isoliert. - Als nächstes wird die zweite Folienschicht
14 durch herkömmliche Photoresist-Schaltkreisbildungstechniken unter Bildung der Struktur19 mit Schaltkreiselementen20 ,21 und22 , gezeigt in5 , Schaltkreis-gebildet. (Das Verfahren kann ähnlich praktiziert werden, indem zunächst die erste Folieschicht11 und zuletzt die zweite Folienschicht14 Schaltkreis-gebildet werden). Die Elemente20 stellen leitfähige Verbindungsspuren an gegenüberliegenden Enden einer mit Widerstand behafteten Stelle15a dar. So wird eine mit Widerstand behaftete elektrische Leitung zwischen den Verbindungsspuren20 durch eine mit Widerstand behaftete Stelle15a gebildet; wobei15a /20 als eine Einheit als ein Widerstand agieren. Element21 stellt eine leit fähige Platte eines Kondensators dar, wobei Kapazität zwischen Element21 und einer ähnlichen Platte, die später durch Schaltkreisbilden der ersten Folienschicht11 gebildet werden soll, aufgebaut werden soll. Die Elemente22 stellen gedruckte elektrische Spulen dar, die als elektrische Induktoren dienen. - Die dünne Schicht von dielektrischem Material
12 hat weitestgehend keine mechanische Festigkeit. Demgemäß wird, bevor Struktur19 weiter verarbeitet werden kann, die Schaltkreis-gebildete Seite von Struktur19 in eine Schicht von Laminatdielektrikum26 , die die Struktur mechanisch trägt, eingebettet, wie in6 zu sehen ist. Dann wird die erste Folienschicht Schaltkreis-gebildet, um so Schaltkreisspuren, Kondensatorplatten21 und Induktionsspulen22 zu bilden. Diese Schaltkreis-gebildete Seite wird dann in eine weitere Schicht von Laminatdielektrikum (nicht gezeigt) eingebettet. Zur Bildung einer Mehrschicht-Leiterplatte, in der Kontaktlöcher gebildet sind, können viele solcher Strukturen zusammen laminiert werden und zur Bildung elektrischer Verbindungen zwischen den mehreren Schichten auf herkömmliche Art und Weise plattiert werden. - Die Erfindung wird nur anhand spezieller Beispiele ausführlicher beschrieben.
- Beispiel 1
- Bildung von Struktur
10 nach1 . - Eine 50 Mikrometer dicke Kupferfolie wurde auf eine 50-Mikrometer-Schicht von Dynavin, die als eine Schicht von einbettbarem dielektrischem Material
12 dient, laminiert. - Beispiel 2
- Bildung von Struktur
13 nach2 . - Auf eine 50 Mikrometer dicke Kupferfolie wurde durch Galvanisieren eine 3,5-Mikrometer-Schicht von Nickel abgeschieden. Eine 0–15 Mikrometer dicke Pt/SiO2-Schicht (97,5 : 2,5 Gew.-%) wurde durch CCVD unter den folgenden Abscheidungsbedingungen abgeschieden:
Lösungspräparat 1,23 g Pt(COD)* 250 ml Toluol 0,43 g TEOS** (1,5 Gew.-% Si in Toluol) 150 g Propan Abscheidungsbedingungen Lösungsfluß 3 ml/min Abscheidungszeit: 1 Stunde Abscheidungstemp.: 500°C Variac 3,0 A Spitzensauerstofffluß 2900 ml/min - *Diphenyl-(1,5-cyclooctadien)platin II
- **Tetraethoxysilan
- Beispiel 3
- Bildung des gedruckten Schaltkreises
- Die in Beispiel 2 erzeugte Struktur wurde auf beiden Seiten mit Laminar®5000-Photoresist abgedeckt. Die Pt/SiO2-Seite wurde strukturerzeugender aktinischer Strahlung ausgesetzt und die Folienseite vollständig aktinischer Strahlung ausgesetzt. Die Struktur wurde dann in 2%igem Natriumcarbonat bei 80°C entwickelt, um so die nicht bestrahlten Resistbereiche von der Seite von mit Widerstand behaftetem Material zu entfernen. Mit dem bestrahlten Resist, der die Kupferfolie schützt, wurde die Struktur einer Kupfer(II)-chlorid-Lösung für einen Zeitraum ausgesetzt, der ausreicht, daß die Lösung in Pt/SiO2 eindringt, und die Nickelschicht ausreichend abgebaut wird, daß die bestrahlten Abschnitte von Pt/SiO2 abgetragen werden können. Dann wurde der Resist mit NaOH-Lösung abgelöst. Die geätzte Struktur wurde dann auf die Struktur aus
1 laminiert, wodurch die verbleibenden Pt/SiO2-Abschnitte in das dielektrische Material eingebettet wurden. - Beide Folienschichten wurden dann mit Photoresist beschichtet. Die Folienschicht mit dem Pt/SiO2 wurde strukturerzeugender aktinischer Strahlung ausgesetzt; die andere Folienschicht vollständig ausgesetzt, um selbige während der Verarbeitung zu schützen. Die Struktur wurde in Natriumcarbonat wie oben entwickelt, und die bestrahlten Abschnitte der einen Folienschicht mit einer Eisen(III)-chlorid-Lösung geätzt, um so Schaltkreisspuren, Kondensatorplatten, Widerstandsverbindungen und Induktionsspulen zu bilden. Dann wurde der Resist von beiden Seiten der Struktur abgelöst.
- Die Schaltkreis-gebildete Folienschicht wurde in Laminatdielektrikum eingebettet.
- Die andere Folienschicht wurde dann wie zuvor Schaltkreis-gebildet, wodurch Schaltkreisspuren, Kondensatorplatten und Induktionsspulen gebildet wurden.
Claims (14)
- Verfahren zum Bilden eines elektronischen Schaltkreises, enthaltend Schaltkreisspuren, integrale Widerstände und integrale Kondensatoren, wobei das Verfahren umfaßt: das Bereitstellen einer ersten Laminatstruktur (
10 ), umfassend eine erste leitfähige Metallfolie (11 ) und eine Schicht (12 ) eines einbettbaren dielektrischen Material darauf laminiert, das Bereitstellen einer zweiten Laminatstruktur (13 ), umfassend eine zweite leitfähige Metallfolie (14 ) mit einer Schicht (15 ) von mit Widerstand behaftetem Material auf einer Seite davon, wobei die Schicht von mit Widerstand behaftetem Material eine geringere Dicke als diejenige der Schicht von einbettbarem dielektrischen Material aufweist, das Schaltkreisbilden der Schicht von mit Widerstand behaftetem Material, unter Erzeugung diskreter Stellen von mit Widerstand behaftetem Material, auf der zweiten Folie, das Laminieren der ersten und zweiten Struktur, so daß die Stellen von mit Widerstand behaftetem Material in der Schicht von einbettbarem dielektrischen Material eingebettet werden, das Schaltkreisbilden von einer oder der anderen der Folien unter Bildung von Kondensatorplatten, Schaltkreisspuren, gegebenfalls Induktionsspulen, und in dem Fall der zweiten Folie von Widerstandsverbindungen, das Einbetten der Schaltkreis-gebildeten Folie in dielektrisches Laminat (26 ), um die Struktur zum Weiterverarbeiten zu stützen, und das Schaltkreisbilden der anderen der Folien unter Bildung von Kondensatorplatten, Schaltkreisspuren, gegebenenfalls Induktionsspulen, und in dem Fall der zweiten Metallfolie von Widerstandsverbindungen. - Verfahren gemäß Anspruch 1, weiter das Einbetten der anderen der Schalt kreis-gebildeten Folien in dielektrisches Laminat.
- Laminieren einer Vielzahl des elektrischen Schaltkreises, hergestellt durch das Verfahren von Anspruch 1, zusammen unter Bildung einer Mehrschicht-Leiterplatte.
- Verfahren gemäß Anspruch 1, wobei jede der Folienschichten zwischen 3 und 50 μm dick ist.
- Verfahren gemäß Anspruch 1, wobei die mit Widerstand behaftete Schicht zwischen etwa 0,1 und 0,5 Mikrometer dick ist, die Schicht von einbettbarem Material zwischen etwa 3 und 50 Mikrometer dick ist und die Schicht von einbettbarem Material zwischen 2,9 und 49,5 Mikrometer dicker als die Schicht von mit elektrischem Widerstand behaftetem Material ist.
- Verfahren gemäß Anspruch 1, wobei die Folien Kupfer sind.
- Verfahren gemäß Anspruch 1, wobei das einbettbare dielektrische Material Epoxy ist.
- Verfahren gemäß Anspruch 1, wobei die Schicht von mit Widerstand behaftetem Material Platin dotiert mit einem dielektrischen Material ist.
- Eingebettete elektronische Schaltkreisstruktur, umfassend in der Reihenfolge, eine erste Schaltkreis-gebildete Schicht (
11 ) von elektrisch leitfähigem Material, eine zweite Schaltkreis-gebildete Schicht (14 ) von elektronisch leitfähigem Material, eine gemusterte Schicht (15 ) von mit elektrischem Widerstand behaftetem Material mit Stellen (15a ) von mit Widerstand behaftetem Material in Kontakt mit der zweiten Schaltkreis-gebildeten leitfähigen Schicht derart, daß elektrische Widerstandsstrecken durch die Stellen des mit Widerstand behafteten Materials gebildet werden, eine Schicht von dielektrischem Material (12 ), wobei die Stellen von mit Wi derstand behaftetem Material die Stellen von mit Widerstand behaftetem Material einbetten, wobei die Schicht von dielektrischem Material die Stellen von mit Widerstand behaftetem Material von der ersten Schaltkreis-gebildeten Schicht beabstandet und kapazitive elektrische Strecken (21 ) zwischen der ersten und zweiten Schaltkreis-gebildeten Schicht über die Schicht von dielektrischem Material definiert werden. - Struktur gemäß Anspruch 9, wobei die zweite Schaltkreis-gebildete Schicht in einer Epoxyschicht eingebettet ist.
- Struktur gemäß Anspruch 9, wobei die Schicht von dielektrischem Material ein Epoxyharz ist.
- Struktur gemäß Anspruch 9, wobei die Schicht von mit Widerstand behaftetem Material Platin dotiert mit einem dielektrischen Material ist.
- Struktur gemäß Anspruch 9, wobei jede der Folienschichten zwischen 3 und 50 Mikrometer dick ist.
- Struktur gemäß Anspruch 9, wobei die mit Widerstand behaftete Schicht zwischen 0,1 und 0,5 Mikrometer dick ist, die Schicht von einbettbarem Material zwischen 3 und 50 Mikrometer dick ist, und die Schicht von einbettbarem Material zwischen 2,9 und 49,5 Mikrometer dicker als die Schicht von mit elektrischem Widerstand behaftetem Material ist.
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
US404496 | 1999-09-23 | ||
US09/404,496 US6356455B1 (en) | 1999-09-23 | 1999-09-23 | Thin integral resistor/capacitor/inductor package, method of manufacture |
Publications (2)
Publication Number | Publication Date |
---|---|
DE60037168D1 DE60037168D1 (de) | 2008-01-03 |
DE60037168T2 true DE60037168T2 (de) | 2008-10-09 |
Family
ID=23599840
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
DE60037168T Expired - Fee Related DE60037168T2 (de) | 1999-09-23 | 2000-09-22 | Dünne Struktur mit integriertem Widerstand/Kondensator/Induktor und Verfahren zu deren Herstellung |
Country Status (8)
Country | Link |
---|---|
US (1) | US6356455B1 (de) |
EP (1) | EP1087647B1 (de) |
JP (1) | JP2001189541A (de) |
KR (1) | KR100811498B1 (de) |
CN (1) | CN1254162C (de) |
DE (1) | DE60037168T2 (de) |
SG (1) | SG90170A1 (de) |
TW (1) | TW478301B (de) |
Families Citing this family (35)
Publication number | Priority date | Publication date | Assignee | Title |
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-
1999
- 1999-09-23 US US09/404,496 patent/US6356455B1/en not_active Expired - Fee Related
-
2000
- 2000-09-22 TW TW089119575A patent/TW478301B/zh not_active IP Right Cessation
- 2000-09-22 CN CNB001318721A patent/CN1254162C/zh not_active Expired - Fee Related
- 2000-09-22 DE DE60037168T patent/DE60037168T2/de not_active Expired - Fee Related
- 2000-09-22 EP EP00308360A patent/EP1087647B1/de not_active Expired - Lifetime
- 2000-09-23 SG SG200005427A patent/SG90170A1/en unknown
- 2000-09-23 KR KR1020000055962A patent/KR100811498B1/ko not_active IP Right Cessation
- 2000-09-25 JP JP2000290620A patent/JP2001189541A/ja active Pending
Also Published As
Publication number | Publication date |
---|---|
KR100811498B1 (ko) | 2008-03-07 |
EP1087647A2 (de) | 2001-03-28 |
US6356455B1 (en) | 2002-03-12 |
KR20010050609A (ko) | 2001-06-15 |
TW478301B (en) | 2002-03-01 |
DE60037168D1 (de) | 2008-01-03 |
CN1303229A (zh) | 2001-07-11 |
SG90170A1 (en) | 2002-07-23 |
CN1254162C (zh) | 2006-04-26 |
EP1087647B1 (de) | 2007-11-21 |
JP2001189541A (ja) | 2001-07-10 |
EP1087647A3 (de) | 2002-07-10 |
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Legal Events
Date | Code | Title | Description |
---|---|---|---|
8364 | No opposition during term of opposition | ||
8339 | Ceased/non-payment of the annual fee |