DE3783963T2 - Treiberschaltung mit einstellbarer impedanz. - Google Patents
Treiberschaltung mit einstellbarer impedanz.Info
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Description
- Die vorliegende Erfindung betrifft ein Testgerät zur Erzeugung von Testsignalen für die Anregung einer zu testenden Anordnung.
- In in einer automatischen Testanlage verwendeten Treiberschaltungen ist es oft vorteilhaft, zur Bildung der Treiber, die zur Erzeugung der für die Anregung einer zu testenden Anordnung verwendeten Testsignalimpulse erforderlich sind, integrierte CMOS-Schaltkreise zu verwenden, weil solche Schaltkreise relativ billig und kompakt aufgebaut sind. Die zu testende Anordnung ist gewöhnlich über eine Übertragungsleitung mit fester Impedanz mit dem Treiberausgang verbunden. Um die gewünschte Form der Testimpulse zu erhalten, ist es daher nötig, die Ausgangsimpedanz der Treiberschaltung an die Impedanz der Übertragungsleitung anzupassen.
- Ein Problem bei derartigen Treibern besteht jedoch darin, daß sich die Impedanzen derartiger Treiber aufgrund von Funktionsänderungen in den CMOS-Schaltkreisen beträchtlich ändern können. Es ist nicht ungewöhnlich, daß die Impedanzen gleichartiger durch den gleichen Herstellungsprozeß hergestellter CMOS-Schaltkreise um bis zu 100% variieren. In einem Testgerät mit CMOS-Übertragungsgattern als Ausgangstreibern ist daher eine Maßnahme erforderlich, die Impedanz der Treiber an die mit der zu testenden Anordnung zu verbindenden Übertragungsleitung anzupassen.
- Aus der US-A-3 646 329 ist eine adaptive Logikschaltung bekannt, welche eine Auswahl von in ihr enthaltenen Wichtungskonstanten ermöglicht. Die Logikschaltung umfaßt einen Spannungsteiler mit einer Vielzahl von Parallelwiderständen sowie einem dazu in Serie geschalteten gemeinsamen Widerstand. Der Spannungsteiler ergibt Wichtungskonstanten, von denen eine durch Einspeisung von Ausgangssignalen entsprechender Stufen eines Schieberegisters in zwischen den entsprechenden Widerständen und dem gemeinsamen Widerstand liegende Gatter auszuwählen ist. Die Ausgangsimpedanz ist durch die Widerstände des Spannungsteilers festgelegt.
- Aus der DE-A-32 44 843 ist eine einstellbare Last für Testspannungsquellen bekannt. Die Last umfaßt eine Vielzahl von zum Ausgang der Spannungsquelle parallel zu schaltenden Lastwiderständen. Die Lastwiderstände sind so dimensioniert, daß sie bei Einschaltung jeweils einen vorgegebenen Strom aus einem Satz von binär gestuften Strömen führen.
- Der Erfindung liegt die prinzipielle Aufgabe zugrunde, ein Testgerät mit einem kompakten billigen Treiber anzugeben, der die Impedanz einer Übertragungsleitung oder einer anderen Verbindungsanordnung an eine zu testende Impedanz anpaßt.
- Die Erfindung basiert auf einem Testgerät mit einer Treiberschaltung, die in Abhängigkeit von einem Betätigungssignal ein Testsignal erzeugt, und mit einer mit der Treiberschaltung verbundenen Übertragungsleitung zur Kopplung des Testsignals auf eine zu testende Anordnung und ist dadurch gekennzeichnet, daß die Treiberschaltung ein Treibernetzwerk mit einstellbarer Impedanz und mit folgenden Komponenten ist:
- eine Spannungsquelle,
- eine Vielzahl von zwischen der Spannungsquelle und der Übertragungsleitung parallelgeschalteten Übertragungsgattern, die jeweils eine vorgegebene Nenn-Impedanz im eingeschalteten Zustand und eine im wesentlichen unendlich große Impedanz im ausgeschalteten Zustand besitzen, und
- eine an jeweils eine Steuerelektrode der Übertragungsgatter angekoppelte und sowohl vom Betätigungssignal und einem vorgegebenen Digitalcode angesteuerte Logikschaltung zur gleichzeitigen Einschaltung mehrerer Übertragungsgatter, wobei der Digitalcode so festgelegt ist, daß er eine an die Impedanz der Übertragungsleitung angepaßte Impedanz der Spannungsquelle erzeugt.
- Die Erfindung ermöglicht also die Anpassung der Impedanz des Treibernetzwerkes an die Impedanz einer Übertragungsleitung oder einer anderen Verbindungsanordnung zwischen einem Testgerät und der zu testenden Anordnung. Da die Übertragungsgatter parallelgeschaltet sind und durch Steuersignale gemäß dem vorgegebenen Digitalcode selektiv betätigt werden können, können ausgewählte Gatter aus- oder eingeschaltet werden, um eine gewünschte Gesamtimpedanz für das Netzwerk zu realisieren.
- Die Gatter können Übertragungsgatter unter Verwendung eines Paars von CMOS-Feldeffekttransistoren mit einem N-Kanalelement und einem P-Kanalelement in Parallelschaltung sein. Die Gatter besitzen jeweils eine vorgegebene Nenn-Impedanz und in einem Binärsinn so aufeinander bezogen sein, daß für jede gegebene Vielzahl von parallelgeschalteten Gattern die Impedanz R, 2R, . . ., 2nR sein kann. Die Übertragungsgatter können jeweils durch eine mit einer Logikschaltung verbundene Steuerleitung gesteuert werden, wobei die Logikschaltung selektiv eines oder mehrere Gatter parallel betätigt. Durch Einschaltung bestimmter Gatter und Abschaltung anderer Gatter kann die Impedanz des eine Spannungsquelle mit einer Übertragungsleitung koppelnden Netzwerkes gesteuert werden.
- Die Erfindung wird im folgenden anhand der Figuren der Zeichnung näher erläutert. Es zeigt:
- Fig. 1 ein Blockschaltbild eines erfindungsgemäßen Treibernetzwerkes mit variabler Impedanz,
- Fig. 2 ein Schaltbild eines Übertragungsgatters von mehreren Übertragungsgattern nach Fig. 1.
- Ein Treibernetzwerk 10 umfaßt eine Vielzahl von CMOS-Übertragungsgattern 12, 14, 16, 18, 20 und 22. Aus Fig. 2, welche das Übertragungsgatter 12 zeigt, ist ersichtlich, daß die Gatter 12, 14, 16, 18, 20 und 22 einen mit einem N-Kanaltransistor parallelgeschalteten P-Kanaltransistor umfassen. Beide Transistoren besitzen daher eine gemeinsame Source 24 und eine gemeinsame Drain 26. Das Gate des P-Kanaltransistors 28 ist über einen invertierenden Verstärker 32 mit einer Steuerleitung 30 verbunden. Die Übertragungsgatter 12, 14, 16, 18, 20 und 22 werden jeweils durch eine Steuerleitung 30, 34, 36, 38, 40 bzw. 42 gesteuert. Der Zustand der Steuerleitungen 30, 34, 36, 38, 40 und 42 wird durch codierte Eingangsleitungen C1, C2, C3, C4, C5 und C6 in Verbindung mit Leitungen A1 und A2 gesteuert, welche den Zustand des Treibers 10 steuern, d. h. sie steuern, ob er sich in einem Zustand mit hohem oder niedrigem logischen Pegel befindet.
- Der Ausgang des Treibers 10 ist mit einer Übertragungsleitung 44 verbunden, welche ihrerseits mit einer zu testenden Anordnung 46 verbunden ist. Durch Steuerung verschiedener Gatter, beispielsweise der Übertragungsgatter 12, 14 und 16 auf einen hohen logischen Pegel kann die Ausgangsimpedanz der Treiberschaltung 10 gewählt werden. Dies ergibt sich daraus, daß die Übertragungsgatter 12, 14 und 16 im eingeschalteten Zustand eine vorgegebene Nenn-Impedanz und im ausgeschalteten Zustand eine nahezu unendlich große Impedanz besitzen. Durch selektives Ein- und Ausschalten bestimmter Übertragungsgatter kann daher die nach dem Ohmschen Gesetz zu berechnende Gesamtimpedanz eingestellt werden.
- Eine feinere Einstellung ist realisierbar, wenn die Einzelimpedanzen der Übertragungsgatter im "eingeschalteten" Zustand binär aufeinander bezogen sind. Das bedeutet, daß das Gatter 14 einen Widerstand 2R und das Gatter 16 einen Widerstand 4R besitzt, wenn das Gatter 12 einen Widerstand R besitzt. Für den hohen bzw. logischen Pegel können mehr als drei Gatter vorhanden sein; in einem solchen Fall sind die Werte der Widerstände R, 2R, . . ., 2nR. Damit steuert also die hochpegelige Steuerleitung A1 oder die niederpegelige Steuerleitung A2, ob sich der Treiber auf einem hohen oder einem tiefen logischen Pegel befindet; Kombinationen der Steuerleitungen C1 bis C3 für den hohen Spannungspegel sowie C4 bis C6 für den tiefen Spannungspegel steuern die Ausgangsimpedanz des Treibers 10 in Abhängigkeit von einem digitalen Code, welcher selektiv verschiedene Gatter der Übertragungsgatter 12, 14, 16, 18, 20 und 22 freigibt.
- Die in der vorstehenden Beschreibung verwendeten Ausdrücke und Begriffe sind lediglich beschreibend nicht aber beschränkend zu verstehen. Die Verwendung derartiger Ausdrücke und Begriffe schließt Äquivalente von dargestellten und beschriebenen Merkmalen oder Teilen davon nicht aus. Der Erfindungsgedanke ist lediglich durch die folgenden Ansprüche definiert und begrenzt.
Claims (7)
1. Testgerät mit
einer Treiberschaltung (12 bis 22), die in
Abhängigkeit von einem Betätigungssignal (A1, A2) ein
Testsignal erzeugt, und mit einer mit der Treiberschaltung
(12 bis 22) verbundenen Übertragungsleitung (44) zur
Kopplung des Testsignals auf eine zu testende
Anordnung,
dadurch gekennzeichnet, daß
die Treiberschaltung (12 bis 22) ein Treibernetzwerk
mit einstellbarer Impedanz und mit folgenden
Komponenten ist:
eine Spannungsquelle,
eine Vielzahl von zwischen der Spannungsquelle und der
Übertragungsleitung (44) parallelgeschalteten
Übertragungsgattern (12 bis 22), die jeweils eine vorgegebene
Nenn-Impedanz im eingeschalteten Zustand und eine im
wesentlichen unendlich große Impedanz im
ausgeschalteten Zustand besitzen, und
eine an jeweils eine Steuerelektrode (30, 34 bis 42)
der Übertragungsgatter (12 bis 22) angekoppelte und
sowohl vom Betätigungssignal (A1, A2) und einem
vorgegebenen Digitalcode angesteuerte Logikschaltung zur
gleichzeitigen Einschaltung mehrerer
Übertragungsgatter,
wobei der Digitalcode so festgelegt ist, daß er
eine an die Impedanz der Übertragungsleitung (44)
angepaßte Impedanz für die Spannungsquelle erzeugt.
2. Testgerät nach Anspruch 1, dadurch gekennzeichnet, daß
die Logikschaltung ein UND-Gatterfeld umfaßt, in dem
die UND-Gatter jeweils einen an eine entsprechende
Steuerelektrode (30, 32 bis 42) gekoppelten Ausgang
und jeweils das Betätigungssignal (A1, A2) und ein Bit
des digitalen Codes (C1 bis C6) aufnehmende Eingänge
besitzen.
3. Testgerät nach Anspruch 1, dadurch gekennzeichnet, daß
die Nenn-Impedanzen der Übertragungsgatter (12 bis 22)
gleich R, 2R, . . ., bzw. 2nR sind, worin n die
Gesamtanzahl der Übertragungsgatter (12 bis 22) minus Eins
ist.
4. Testgerät nach Anspruch 1, dadurch gekennzeichnet, daß
die Spannungsquelle eine Hochspannungsquelle und eine
Niederspannungsquelle enthält und daß die erste Hälfte
(12 bis 16) der Übertragungsgatter zwischen die
Hochspannungsquelle und die Übertragungsleitung (44) und
die zweite Hälfte (18 bis 22) der Übertragungsgatter
zwischen die Niederspannungsquelle und die
Übertragungsleitung (44) geschaltet ist.
5. Testgerät nach Anspruch 1 oder 4, dadurch
gekennzeichnet, daß die Übertragungsgatter jeweils durch ein Paar
von parallelgeschalteten CMOS-Feldeffekttransistoren
entgegengesetzten Leitungstyps gebildet sind, deren
Source (24) mit der Spannungsquelle und deren Drain
(26) mit der Übertragungsleitung (44) verbunden sind,
und daß das Steuersignal (A1, A2) sowie ein
invertiertes Steuersignal von der Logikschaltung auf die
Steuergates (28) des jeweiligen Paars von
CMOS-Feldeffekttransistoren gekoppelt sind.
6. Testgerät nach Anspruch 4, dadurch gekennzeichnet, daß
die Logikschaltung ein UND-Gatterfeld mit einem ersten
und einem zweiten Teil umfaßt, daß die UND-Gatter des
ersten Teils jeweils mit einem Ausgang an eine
entsprechende Steuerelektrode (30, 34, 36) der ersten
Hälfte (12 bis 16) der Übertragungsgatter gekoppelt
sind, das Eingangssignals für die UND-Gatter des
ersten Teils ein erstes Bit (A1) des
Betätigungssignals zur Auswahl der Hochspannungsquelle und ein Bit
des Digitalcodes (C1 bis C3) umfassen und daß die
UND-Gatter des zweiten Teils mit ihrem Ausgang jeweils an
eine entsprechende Steuerelektrode (38 bis 42) der
zweiten Hälfte (18 bis 22) der Übertragungsgatter
gekoppelt sind und Eingangssignale für die UND-Gatter
des zweiten Teils ein zweites Bit (A2) des
Betätigungssignals und ein Bit des Digitalcodes (C4 bis C6)
umfassen.
7. Testgerät nach Anspruch 4, dadurch gekennzeichnet, daß
die Nenn-Impedanzen für jede Hälfte der
Übertragungsgatter (12 bis 22) gleich R, 2R, . . ., bzw. 2nR sind,
worin n die Gesamtzahl der Übertragungsgatter (12 bis
22) pro Hälfte minus Eins ist.
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---|---|---|---|
US06/887,314 US4707620A (en) | 1986-07-22 | 1986-07-22 | Adjustable impedance driver network |
Publications (2)
Publication Number | Publication Date |
---|---|
DE3783963D1 DE3783963D1 (de) | 1993-03-18 |
DE3783963T2 true DE3783963T2 (de) | 1993-05-27 |
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DE (1) | DE3783963T2 (de) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US7124325B2 (en) | 2002-10-07 | 2006-10-17 | Infineon Technologies Ag | Method and apparatus for internally trimming output drivers and terminations in semiconductor devices |
Families Citing this family (56)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS62200804A (ja) * | 1986-02-27 | 1987-09-04 | Ricoh Co Ltd | プログラム可能なアナログ量素子をもつ半導体集積回路装置 |
US4761565A (en) * | 1987-06-29 | 1988-08-02 | Eastman Kodak Company | CCD clock driver circuit |
JP2656537B2 (ja) * | 1988-04-13 | 1997-09-24 | 株式会社日立製作所 | 電力用半導体装置 |
US5182479A (en) * | 1988-06-24 | 1993-01-26 | U.S. Philips Corp. | Gate circuit having increased voltage handling capability |
ATE98077T1 (de) * | 1988-08-08 | 1993-12-15 | Siemens Ag | Breitbandsignal-koppeleinrichtung. |
US4918333A (en) * | 1988-10-31 | 1990-04-17 | Anderson Floyd E | Microprocessor having high current drive |
GB8830282D0 (en) * | 1988-12-28 | 1989-02-22 | Astec Int Ltd | The setting of electronic circuits |
DE4007978A1 (de) * | 1989-03-17 | 1990-09-20 | Tektronix Inc | Ausgangstreiber-schaltungsanordnung zur minimierung von uebergangsimpedanzschwankungen und verfahren zur minimierung von impedanzfehlanpassungen |
US5165046A (en) * | 1989-11-06 | 1992-11-17 | Micron Technology, Inc. | High speed CMOS driver circuit |
US5086271A (en) * | 1990-01-12 | 1992-02-04 | Reliability Incorporated | Driver system and distributed transmission line network for driving devices under test |
US5276912A (en) * | 1990-02-06 | 1994-01-04 | Motorola, Inc. | Radio frequency power amplifier having variable output power |
WO1991012671A1 (en) * | 1990-02-06 | 1991-08-22 | Motorola, Inc. | Radio-frequency power amplifier with variable impedance and variable output power |
JP2647730B2 (ja) * | 1990-06-01 | 1997-08-27 | ソニー株式会社 | 移動電話装置 |
US5134311A (en) * | 1990-06-07 | 1992-07-28 | International Business Machines Corporation | Self-adjusting impedance matching driver |
DE4034043A1 (de) * | 1990-10-26 | 1992-04-30 | Standard Elektrik Lorenz Ag | Schaltungsanordnung zur bereitstellung eines ausgangsstromes fuer einen datentreiber |
DE4034571A1 (de) * | 1990-10-31 | 1992-05-07 | Vdo Schindling | Als baustein ausgebildete schaltungsanordnung mit mindestens einem halbleiterschalter zum schalten einer last |
US5243229A (en) * | 1991-06-28 | 1993-09-07 | At&T Bell Laboratories | Digitally controlled element sizing |
US5585741B1 (en) * | 1994-04-22 | 2000-05-02 | Unitrode Corp | Impedance emulator |
US5448182A (en) * | 1994-05-02 | 1995-09-05 | Motorola Inc. | Driver circuit with self-adjusting impedance matching |
US5592394A (en) * | 1995-01-31 | 1997-01-07 | Dell U.S.A., L.P. | FET current sensor for active balancing or regulating circuits |
FR2730365A1 (fr) * | 1995-02-08 | 1996-08-09 | Bull Sa | Circuit integre avec conductance reglable a partir d'un signal numerique de consigne |
US5493240A (en) * | 1995-03-01 | 1996-02-20 | International Business Machines Corporation | Static combinatorial logic circuits for reversible computation |
US5955894A (en) * | 1997-06-25 | 1999-09-21 | Sun Microsystems, Inc. | Method for controlling the impedance of a driver circuit |
US6281714B1 (en) | 1997-06-25 | 2001-08-28 | Sun Microsystems, Inc. | Differential receiver |
US6411131B1 (en) | 1997-06-25 | 2002-06-25 | Sun Microsystems, Inc. | Method for differentiating a differential voltage signal using current based differentiation |
US5982191A (en) * | 1997-06-25 | 1999-11-09 | Sun Microsystems, Inc. | Broadly distributed termination for buses using switched terminator logic |
US5990701A (en) * | 1997-06-25 | 1999-11-23 | Sun Microsystems, Inc. | Method of broadly distributing termination for buses using switched terminators |
US6094075A (en) | 1997-08-29 | 2000-07-25 | Rambus Incorporated | Current control technique |
US6870419B1 (en) | 1997-08-29 | 2005-03-22 | Rambus Inc. | Memory system including a memory device having a controlled output driver characteristic |
US6425097B1 (en) * | 1999-05-27 | 2002-07-23 | Sun Microsystems, Inc. | Method and apparatus for testing an impedance-controlled input/output (I/O) buffer in a highly efficient manner |
US6339351B1 (en) | 1999-06-07 | 2002-01-15 | Sun Microsystems, Inc. | Output driver with improved impedance control |
US6281729B1 (en) | 1999-06-07 | 2001-08-28 | Sun Microsystems, Inc. | Output driver with improved slew rate control |
US6278306B1 (en) | 1999-06-07 | 2001-08-21 | Sun Microsystems, Inc. | Method for an output driver with improved slew rate control |
US6366139B1 (en) | 1999-06-07 | 2002-04-02 | Sun Microsystems, Inc. | Method for an output driver with improved impedance control |
US6297677B1 (en) | 1999-09-20 | 2001-10-02 | Sun Microsystems, Inc. | Method for a dynamic termination logic driver with improved slew rate control |
US6294924B1 (en) | 1999-09-20 | 2001-09-25 | Sun Microsystems, Inc. | Dynamic termination logic driver with improved slew rate control |
US6420913B1 (en) | 1999-09-20 | 2002-07-16 | Sun Microsystems, Inc. | Dynamic termination logic driver with improved impedance control |
US6316957B1 (en) | 1999-09-20 | 2001-11-13 | Sun Microsystems, Inc. | Method for a dynamic termination logic driver with improved impedance control |
US6321282B1 (en) | 1999-10-19 | 2001-11-20 | Rambus Inc. | Apparatus and method for topography dependent signaling |
US6646953B1 (en) | 2000-07-06 | 2003-11-11 | Rambus Inc. | Single-clock, strobeless signaling system |
US7051130B1 (en) | 1999-10-19 | 2006-05-23 | Rambus Inc. | Integrated circuit device that stores a value representative of a drive strength setting |
US6484293B1 (en) | 2000-07-14 | 2002-11-19 | Sun Microsystems, Inc. | Method for determining optimal configuration for multinode bus |
US7079775B2 (en) | 2001-02-05 | 2006-07-18 | Finisar Corporation | Integrated memory mapped controller circuit for fiber optics transceiver |
US7119549B2 (en) * | 2003-02-25 | 2006-10-10 | Rambus Inc. | Output calibrator with dynamic precision |
US6933746B1 (en) | 2003-05-21 | 2005-08-23 | Planet Ate, Inc. | Method and apparatus for coupling an input node to an output node |
US6924660B2 (en) | 2003-09-08 | 2005-08-02 | Rambus Inc. | Calibration methods and circuits for optimized on-die termination |
KR100542695B1 (ko) * | 2003-11-13 | 2006-01-11 | 주식회사 하이닉스반도체 | 반도체 소자의 테스트 모드 회로 |
US6980020B2 (en) * | 2003-12-19 | 2005-12-27 | Rambus Inc. | Calibration methods and circuits for optimized on-die termination |
US7152012B2 (en) * | 2004-09-28 | 2006-12-19 | Lsi Logic Corporation | Four point measurement technique for programmable impedance drivers RapidChip and ASIC devices |
US7389194B2 (en) | 2005-07-06 | 2008-06-17 | Rambus Inc. | Driver calibration methods and circuits |
US7307863B2 (en) * | 2005-08-02 | 2007-12-11 | Inphi Corporation | Programmable strength output buffer for RDIMM address register |
US7479799B2 (en) * | 2006-03-14 | 2009-01-20 | Inphi Corporation | Output buffer with switchable output impedance |
WO2008126603A1 (ja) * | 2007-03-13 | 2008-10-23 | Advantest Corporation | ドライバ回路および半導体試験装置 |
US7999530B2 (en) | 2008-03-21 | 2011-08-16 | Intersil Americas Inc. | Device under test power supply |
DE102009006332B4 (de) | 2009-01-27 | 2014-08-21 | Oliver Bartels | Leitungstreiber oder Verstärker mit frequenzabhängig variabler Schein-Impedanz |
JP2013130427A (ja) * | 2011-12-20 | 2013-07-04 | Tokyo Electron Ltd | 半導体デバイスの検査装置 |
Family Cites Families (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS5039976B1 (de) * | 1968-11-20 | 1975-12-20 | ||
JPS51132940A (en) * | 1975-05-14 | 1976-11-18 | Sharp Corp | Electric source apparatus |
US4329600A (en) * | 1979-10-15 | 1982-05-11 | Rca Corporation | Overload protection circuit for output driver |
JPS59101931A (ja) * | 1982-12-01 | 1984-06-12 | Nec Ic Microcomput Syst Ltd | 電子回路 |
DE3244843C2 (de) * | 1982-12-03 | 1984-11-29 | Siemens AG, 1000 Berlin und 8000 München | Prüflingsbelastungsgerät |
-
1986
- 1986-07-22 US US06/887,314 patent/US4707620A/en not_active Expired - Lifetime
-
1987
- 1987-06-11 DE DE8787108416T patent/DE3783963T2/de not_active Expired - Fee Related
- 1987-06-11 EP EP87108416A patent/EP0254011B1/de not_active Expired - Lifetime
- 1987-06-25 CA CA000540566A patent/CA1273063A/en not_active Expired - Fee Related
- 1987-07-16 JP JP62178149A patent/JPS6331311A/ja active Granted
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US7124325B2 (en) | 2002-10-07 | 2006-10-17 | Infineon Technologies Ag | Method and apparatus for internally trimming output drivers and terminations in semiconductor devices |
Also Published As
Publication number | Publication date |
---|---|
EP0254011A3 (en) | 1989-07-19 |
JPH0573290B2 (de) | 1993-10-14 |
CA1273063A (en) | 1990-08-21 |
JPS6331311A (ja) | 1988-02-10 |
US4707620A (en) | 1987-11-17 |
EP0254011B1 (de) | 1993-02-03 |
EP0254011A2 (de) | 1988-01-27 |
DE3783963D1 (de) | 1993-03-18 |
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