DE19800919B4 - Dünnfilmtransistor und Verfahren zu seiner Herstellung - Google Patents
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Abstract
Dünnfilmtransistor (TFT) mit:
– einem Substrat (31), in welchem sich ein Graben mit ersten und zweiten Seitenwänden sowie mit einem dazwischenliegenden Boden befindet;
– einer Gate-Elektrode (33) an einer der Seitenwände des Grabens;
– einer Gate-Isolationsschicht (35) auf der gesamten Oberfläche des Substrats einschließlich der Gate-Elektrode (33);
– einer aktiven Schicht (36) auf der Gate-Isolationsschicht (35); und
– Source- und Drainbereichen (S, D) in der aktiven Schicht (36) oberhalb des Substrats, die mit der aktiven Schicht (36) innerhalb des Grabens verbunden ist.
– einem Substrat (31), in welchem sich ein Graben mit ersten und zweiten Seitenwänden sowie mit einem dazwischenliegenden Boden befindet;
– einer Gate-Elektrode (33) an einer der Seitenwände des Grabens;
– einer Gate-Isolationsschicht (35) auf der gesamten Oberfläche des Substrats einschließlich der Gate-Elektrode (33);
– einer aktiven Schicht (36) auf der Gate-Isolationsschicht (35); und
– Source- und Drainbereichen (S, D) in der aktiven Schicht (36) oberhalb des Substrats, die mit der aktiven Schicht (36) innerhalb des Grabens verbunden ist.
Description
- Die Erfindung bezieht sich auf auf einen Dünnfilmtransistor gemäß den nebengeordneten Patentansprüchen 1 und 7 sowie auf ein Verfahren zur Herstellung eines Dünnefilmtransistors gemäß dem Anspruch 12.
- Sowohl aus der
DE 44 09 367 A1 als auch aus derUS 5,407,846 sind bereits Dünnfilmtransistoren mit in einem Graben ausgebildeter Gate-Elektrode bekannt. Dort ist jedoch die Gate-Elektrode auf beiden Seitenwänden und dem Boden des Grabens ausgebildet. - Ein Dünnfilmtransistor (TFT) kann zum Beispiel anstelle eines Lasttransistors oder eines CMOS-Lasttransistors in einem SRAM der Klasse größer als 1M zum Einsatz kommen. Auch kann ein Dünnfilmtransistor als Schalteinrichtung verwendet werden, um Bilddatensignale in Pixelbereichen einer Flüssigkristallanzeigeeinrichtung zu schalten. Wird in einer SRAM-Zelle ein PMOS-TFT als Lasttransistor verwendet, so lassen sich der Ausschaltstrom des PMOS-TFT's reduzieren und der Einschaltstrom vergrößern. Dies führt zu einer Verminderung des Leistungsverbrauchs und zu einem verbesserten Speicherbetriebsverhalten.
- Der Offset-Bereich beeinflußt als signifikanter Faktor das Stabilitätsverhalten einer SRAM-Zelle. Es ist daher wünschenswert, Offset-Bereiche so exakt wie möglich auszubilden.
- Ein konventioneller TFT und ein Verfahren zu seiner Herstellung werden nachfolgend unter Bezugnahme auf die
1 und2 näher beschrieben. - Die
1 zeigt einen Querschnitt durch einen konventionellen TFT, der eine Isolationsschicht11 , eine Gate-Elektrode13 , eine Gate-Isolationsschicht15 , Source- und Drainelektroden S bzw. D, einen Offset-Bereich I und einen Kanalbereich II aufweist. - Die Gate-Elektrode
13 befindet sich in einem vorbestimmten Bereich auf der Isolationsschicht11 . Die Gate-Isolationsschicht15 liegt auf der Isolationsschicht11 sowie auf der Gate-Elektrode13 . Die Source-Elektrode S befindet sich auf der Gate-Isolationsschicht15 und überlappt eine Kante der Gate-Elektrode13 . Die Drainelektrode D befindet sich wie die Source-Elektrode S auf der Gate-Isolationsschicht15 , liegt jedoch in einem Ab stand von der Gate-Elektrode13 . Der Kanalbereich II erstreckt sich von dem Ende der Source-Elektrode S, das auf der Gate-Elektrode13 zu liegen kommt, bis zum gegenüberliegenden Ende der Gate-Elektrode13 . Dagegen erstreckt sich der Offset-Bereich I vom zuletzt genannten Ende der Gate-Elektrode13 bis zum Beginn der Drainelektrode D. - Ein Verfahren zur Herstellung des zuvor erwähnten konventionellen TFT's wird nachfolgend unter Bezugnahme auf die
2A bis2E erläutert. Sie stellen Querschnittsansichten in verschiedenen Herstellungsschritten des TFT's dar. - Entsprechend der
2A wird zunächst auf einer Isolationsschicht11 eine erste Polysiliziumschicht12 aufgebracht. Sodann wird ein nicht dargestellter Photoresistfilm auf die erste Polysiliziumschicht12 aufgetragen und durch Belichtung und Entwicklung strukturiert, um ein Gatemuster zu erhalten. In einem nächsten Schritt dient das Gatemuster als Maske. um die erste Polysiliziumschicht12 selektiv zu ätzen. Auf diese Weise wird eine Gate-Elektrode13 gemäß2B erhalten. - Sodann wird eine Gate-Isolationsschicht
15 auf die gesamte so erhaltene Struktur aufgebracht, also auf die Isolationsschicht11 und die Gate-Elektrode13 , wie die2C erkennen läßt. Danach wird eine zweite Polysiliziumschicht17 auf der Gate-Isolationsschicht15 gebildet. Die zweite Polysiliziumschicht17 dient zur Bildung von Source- und Drainelektroden S bzw. D sowie zur Bildung eines Kanalbereichs II und eines Offset-Bereichs I. - In einem weiteren Verfahrensschritt gemäß
2D wird ein Photoresistfilm19 auf die zweite Polysiliziumschicht17 aufgebracht und strukturiert, und zwar durch einen Belichtungs- und Entwicklungsprozeß, um ein Muster für einen Kanalbereich und einen Offset-Bereich zu erhalten. Unter Verwendung des Photoresistmusters19 als Maske werden dann Verunreinigungsionen in die zweite Polysiliziumschicht17 implantiert, um auf diese Weise eine Source-Elektrode S und eine Drainelektrode D zu erhal ten. - Schließlich wird der verbleibende Photoresistfilm
19 gemäß2E entfernt, so daß das konventionelle Verfahren zur Herstellung eines TFT's seinen Abschluß findet. Dabei wird der Offset-Bereich I durch die zweite Polysiliziumschicht17 im Bereich zwischen der Drainelektrode D und der Gate-Elektrode13 gebildet, während der Kanalbereich II durch die zweite Polysiliziumschicht17 gebildet wird, die sich unmittelbar auf der Gate-Elektrode13 befindet. - Beim zuvor beschriebenen konventionellen TFT treten jedoch einige Probleme auf. Um den Kanalbereich und den Offset-Bereich zu bilden, müssen Masken bei der Herstellung verwendet werden. Dies führt letztlich dazu, daß die Offset-Bereiche nicht präzise genug hergestellt werden können, da die Masken nicht genau genug ausgerichtet werden können. Dies führt zu einer Verschlechterung der Stabilität der Zellen.
- Der Erfindung liegt die Aufgabe zugrunde, die oben beschriebenen Nachteile zu überwinden und einen Dünnfilmtransistor sowie ein Verfahren zu dessen Herstellung anzugeben, um zu einer genaueren Ausrichtung der Kanalbereiche und der Offset-Bereiche zu kommen, und zwar in selbstausrichtender Weise. Der gesamte Herstellungsprozeß soll vereinfacht werden, und zwar bei gleichzeitig präziser Ausrichtung der Offset-Bereiche, um dadurch zu einer besseren Stabilität der Zellen zu kommen.
- Ein Dünnfilmtransistor (TFT) nach der vorliegenden Erfindung zeichnet sich aus durch ein Substrat, in welchem sich ein Graben mit ersten und zweiten Seitenwänden und einem dazwischenliegenden Boden befindet; eine Gate-Elektrode an einer Seite des Grabens; eine Gate-Isolationsschicht auf der gesamten Oberfläche von Substrat und Gate-Elektrode; eine aktive Schicht auf der Gate-Isolationsschicht; sowie durch Source- und Drainbereiche auf der aktiven Schicht oberhalb des Substrats, die mit der aktiven Schicht im Graben verbunden ist.
- Ein weiterer Dünnfilmtransistor (TFT) nach der vorliegenden Erfindung zeichnet sich aus durch ein Substrat, in welchem sich ein Graben mit ersten und zweiten Seitenwänden und dazwischenliegendem Boden befindet; eine Gate-Elektrode auf dem Boden und der ersten Seitenwand des Grabens sowie auf dem Substrat benachbart zur ersten Seitenwand des Grabens; eine Gate-Isolationsschicht auf der gesamten Oberfläche des Substrats einschließlich der Gate-Elektrode; eine aktive Schicht auf der Gate-Isolationsschicht; Source- und Drainbereiche in der aktiven Schicht oberhalb des Substrats, die mit der aktiven Schicht innerhalb des Grabens verbunden ist; und eine Isolationsschicht auf der aktiven Schicht zwischen den Source- und Drainbereichen.
- Ein erfindungsgemßes Verfahren zur Herstellung eines TFT's umfaßt folgende Schritte: Bildung eines Grabens mit ersten und zweiten Seitenwänden und einem dazwischenliegenden Boden innerhalb eines Substrats; Bildung einer Gate-Elektrode am Boden und der ersten Seite des Grabens; Bildung einer Gate-Isolationsschicht auf dem Substrat einschließlich der Gate-Elektrode; Bildung einer aktiven Schicht auf der Gate-Isolationsschicht; und Bildung von Source- und Drainbereichen in der aktiven Schicht oberhalb des Substrats, wobei dieser Teil der aktiven Schicht, in welchem sich die Source- und Drainbereiche befinden, mit demjenigen Teil der aktiven Schicht in Verbindung steht, der sich innerhalb des Grabens befindet.
- Ein Ausführungsbeispiel der Erfindung wird nachfolgend unter Bezugnahme auf die Zeichnung im einzelnen beschrieben. Es zeigen:
1 einen Querschnitt durch einen konventionellen TFT; -
2A bis2E Querschnittsansichten zur Erläuterung der Herstellung des konventionellen TFT's nach1 ; -
3 eine Querschnittsansicht eines TFT's nach der vorliegenden Erfindung; und -
4A bis4E Querschnittsansichten zur Erläuterung der Herstellung eines TFT's nach einem bevorzugten Ausführungsbeispiel der Erfindung. - Die
3 zeigt eine Querschnittsansicht durch ein Ausführungsbeispiel eines erfindungsgemäßen TFT's. Er enthält ein Substrat31 mit einem Graben, der erste und zweite Seitenwände und einen Boden aufweist, eine Gate-Elektrode33 auf einem vorbestimmten Bereich des Grabens, eine Gate-Isolationsschicht35 auf der gesamten Oberfläche des Substrats31 einschließlich der Gate-Elektrode33 , eine aktive Schicht36 auf der Gate-Isolationsschicht35 , sowie Source- und Drainbereiche in demjenigen Teil der aktiven Schicht36 , die oberhalb des Substrats31 liegt, und die mit der aktiven Schicht36 innerhalb des Grabens verbunden ist. - Das Substrat
31 besteht aus einem isolierenden Material. Ein Offset-Be reich I befindet sich an der zweiten Seite des Grabens, während sich ein Kanalbereich II am Boden des Grabens und an der ersten Seitenwand rechts in3 befindet, also dem Verlauf der Gate-Elektrode33 folgt bzw, dieser gegenüberliegt. Die Gate-Elektrode33 überlappt sich mit dem Source-Bereich S und kommt noch mit einem Teil auf der Oberfläche des Substrats31 zu liegen. Der Offset-Bereich I verläuft senkrecht zu den Source- und Drainbereichen S bzw. D und liegt zwischen dem horizontalen Drainbereich D und dem horizontalen Bereich der am Boden des Grabens liegenden aktiven Schicht36 . - Nachfolgend wird ein Verfahren nach der Erfindung zur Herstellung der zuvor erwähnten TFT-Struktur unter Bezugnahme auf die
4A bis4E näher erläutert. - Entsprechend der
4A wird zunächst in einem vorbestimmten Bereich eines Substrats31 ein Graben zum Beispiel durch einen Ätzvorgang gebildet. Das Substrat31 besteht dabei aus einem isolierenden Material. Alternativ kann das Substrat auch aus einem Halbleitermaterial mit einer darauf liegenden Isolationsschicht bestehen. - Sodann wird auf die gesamte Oberfläche des Substrats
31 einschließlich des Grabens eine Polysiliziumschicht32 niedergeschlagen. Die Polysiliziumschicht32 besteht aus Polysilizium, das nicht mit Verunreinigungsionen dotiert ist. Dabei liegt die Polysiliziumschicht32 auf der Oberfläche des Substrats31 , am Boden des Grabens und an den Seitenwänden des Grabens. Anschließend wird ein nicht dargestellter Photoresistfilm auf die gesamte Oberfläche der Polysiliziumschicht32 aufgebracht und strukturiert, und zwar durch einen Belichtungs- und Entwicklungsprozeß. - Danach wird gemäß
4B das Photoresistmuster als Maske verwendet, um die Polysiliziumschicht32 selektiv zu ätzen, so daß auf diese Weise eine Gate-Elektrode33 erhalten wird, und zwar in einem vorbestimmten Bereich des Grabens sowie auf dem Substrat31 benachbart zum vorbestimmten Bereich auf dem Graben. Mit anderen Worten bildet jetzt die Gate-Elektrode33 eine Art Treppe. Dabei kommt die Gate-Elektrode33 auf dem Boden des Grabens zu liegen, ohne jedoch die erste bzw. linke Seitenwand zu erreichen, während sie andererseits an der rechten bzw. zweiten Seitenwand in4B anliegt, an dieser entlangläuft und sich noch zum Teil auf der benachbarten Oberfläche des Substrats31 erstreckt. - Gemäß
4B wird auf die gesamte Oberfläche der so erhaltenen Struktur eine Gate-Isolationsschicht35 aufgebracht, also auf das Substrat31 , die Gate-Elektrode33 , auf den verbleibenden Bereich des Bodens des Grabens sowie auf die erste bzw, linke Seitenwand des Grabens in4C . Sodann wird auf die gesamte Gate-Isolationsschicht35 eine aktive Schicht36 aufgebracht. Diese aktive Schicht36 besteht aus einer Halbleiterschicht, die Silizium enthält, das nicht mit Verunreinigungsionen dotiert ist. - In einem weiteren Schritt gemäß
4D wird eine dicke Isolationsschicht37 auf die aktive Schicht36 aufgebracht und anschließend einem Rückätzprozeß unterzogen. Im Ergebnis verbleibt die dicke Isolationsschicht37 nur noch innerhalb des Grabens und füllt diesen aus. Die außerhalb des Grabens liegende Oberfläche der aktiven Schicht36 kommt dabei frei. - Sodann werden gemäß
4E Verunreinigungsionen in die gesamte Oberfläche der so erhaltenen Struktur implantiert, um Source- und Drainelektroden zu erhalten. Die Energie der Verunreinigungsionen wird dabei so eingestellt, daß keine Ionen in denjenigen Teil der aktiven Schicht36 implantiert werden, der innerhalb des Grabens liegt. - Wie oben beschrieben, werden bei der Ionenimplantation keine Masken zur Bildung der Source-Elektroden und der Drainelektroden verwendet, so daß die Sourcebereiche S und die Drainbereiche D in selbstausrichtender Weise innerhalb der aktiven Schicht
36 zu beiden Seiten der begrabenen Isolationsschicht37 entstehen. Dabei wird darauf geachtet, daß keine Verunreinigungsionen in denjenigen Teil der aktiven Schicht36 implan tiert werden, der innerhalb des Grabens liegt. - Im oben genannten Fall stimmt der Kanalbereich II mit demjenigen Teil der aktiven Schicht
36 überein, der der Gate-Elektrode 33 im Bereich des Grabens gegenüberliegt. Dagegen befindet sich der Offset-Bereich I im Bereich der aktiven Schicht36 , der der ersten Seitenwand des Grabens gegenüberliegt, also der linken Seitenwand in4E . Bei diesem Prozeß ist es ebenfalls nicht erforderlich, Masken zur Herstellung von Offset-Bereich I und Kanalbereich II zu verwenden. - Für den erfindungsgemäßen TFT und sein Herstellungsverfahren ergibt sich damit der Vorteil, daß der Kanalbereich und der Offset-Bereich durch einen selbstausrichtenden Prozeß ohne Anwendung von Masken hergestellt werden können, was den Gesamtherstellungsprozeß vereinfacht und zu weniger Änderungen im Offset-Bereich führt.
Claims (17)
- Dünnfilmtransistor (TFT) mit: – einem Substrat (
31 ), in welchem sich ein Graben mit ersten und zweiten Seitenwänden sowie mit einem dazwischenliegenden Boden befindet; – einer Gate-Elektrode (33 ) an einer der Seitenwände des Grabens; – einer Gate-Isolationsschicht (35 ) auf der gesamten Oberfläche des Substrats einschließlich der Gate-Elektrode (33 ); – einer aktiven Schicht (36 ) auf der Gate-Isolationsschicht (35 ); und – Source- und Drainbereichen (S, D) in der aktiven Schicht (36 ) oberhalb des Substrats, die mit der aktiven Schicht (36 ) innerhalb des Grabens verbunden ist. - Dünnfilmtransistor nach Anspruch 1, dadurch gekennzeichnet, daß das Substrat (
31 ) aus einem isolierenden Material besteht. - Dünnfilmtransistor nach Anspruch 1, dadurch gekennzeichnet, daß sich die Gate-Elektrode (
33 ) mit dem Source-Bereich (S) überlappt. - Dünnfilmtransistor nach Anspruch 1, dadurch gekennzeichnet, daß die aktive Schicht (
36 ), die der Gate-Elektrode (33 ) gegenüberliegt, einen Kanalbereich (II) bildet. - Dünnfilmtransistor nach Anspruch 1, dadurch gekennzeichnet, daß die aktive Schicht (
36 ) aus einer Halbleiterschicht besteht oder eine solche enthält. - Dünnfilmtransistor nach Anspruch 5, dadurch gekennzeichnet, daß die Halbleiterschicht eine Polysiliziumschicht ist oder enthält.
- Dünnfilmtransistor (TFT) mit: – einem Substrat (
31 ), in welchem sich ein Graben mit ersten und zweiten Seitenwänden und dazwischenliegendem Boden befindet; – einer Gate-Elektrode (33 ) auf dem Boden und der ersten Seitenwand des Grabens sowie auf dem Substrat (31 ) benachbart zur ersten Seitenwand des Grabens: – einer Gate-Isolationsschicht (35 ) auf der gesamten Oberfläche des Substrats (31 ) einschließlich der Gate-Elektrode (33 ); – einer aktiven Schicht (36 ) auf der Gate-Isolationsschicht (35 ); – Source- und Drainbereichen (S, D) in der aktiven Schicht (36 ) oberhalb des Substrats (31 ), die mit der aktiven Schicht (36 ) innerhalb des Grabens verbunden ist; und – einer Isolationsschicht (37 ) auf der aktiven Schicht (36 ) zwischen den Source- und Drainbereichen (S, D). - Dünnfilmtransistor nach Anspruch 7, dadurch gekennzeichnet, daß das Substrat (
31 ) aus einem isolierenden Material besteht. - Dünnfilmtransistor nach Anspruch 7, dadurch gekennzeichnet, daß die aktive Schicht (
36 ) an der zweiten Seitenwand des Grabens einen Offset-Bereich (I) bildet. - Dünnfilmtransistor nach Anspruch 9, dadurch gekennzeichnet, daß der Offset-Bereich (I) senkrecht zum Drainbereich (D) verläuft.
- Dünnfilmtransistor nach Anspruch 7, dadurch gekennzeichnet, daß sich die Gate-Elektrode (
33 ) und der Source-Bereich (S) überlappen. - Verfahren zur Herstellung eines Dünnfilmtransistors (TFT) mit folgenden Schritten: – Bildung eines Grabens mit ersten und zweiten Seitenwänden und dazwischenliegendem Boden in einem Substrat (
31 ); – Bildung einer Gate-Elektrode (33 ) auf dem Boden und der ersten Seitenwand des Grabens; – Bildung einer Gate-Isolationsschicht (35 ) auf dem Substrat (31 ) einschließlich der Gate-Elektrode (33 ); – Bildung einer aktiven Schicht (36 ) auf der Gate-Isolationsschicht (35 ); und – Bildung von Source- und Drainbereichen (5 , D) in der aktiven Schicht (36 ) oberhalb des Substrats (31 ), wobei die Source- und Drainbereiche (S. D) mit der im Graben liegenden aktiven Schicht verbunden sind. - Verfahren nach Anspruch 12, dadurch gekennzeichnet, daß die aktive Schicht (
36 ) Polysilizium enthält. - Verfahren nach Anspruch 12, dadurch gekennzeichnet, daß eine Isolationsschicht (
37 ) auf der aktiven Schicht (36 ) im Bereich des Grabens gebildet wird. - Verfahren nach Anspruch 12, dadurch gekennzeichnet, daß der Schritt zur Bildung von Source- und Drainbereichen (S, D) folgende Schritte aufweist: – Bildung der Isolationsschicht (
37 ) auf der aktiven Schicht (36 ) im Bereich des Grabens; und – Implantation von Verunreinigungsionen in die aktive Schicht (36 ) durch Verwendung der Isolationsschicht (37 ) als Maske, um auf diese Weise den Source- und Drainbereich (S, D) zu erhalten. - Verfahren nach Anspruch 12, dadurch gekennzeichnet, daß das Substrat (
31 ) eine Halbleiterschicht sowie eine Isolationsschicht auf der Halbleiterschicht aufweist. - Verfahren nach Anspruch 14, dadurch gekennzeichnet, daß der Schritt zur Bildung der Isolationsschicht (
37 ) folgende Schritte umfaßt: – Bildung der Isolationsschicht (37 ) auf der aktiven Schicht (36 ); und – Rückätzen der Isolationsschicht (37 ), derart, daß sie nur noch im Graben verbleibt.
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