DE1903961B2 - Integrierte Halbleiterschaltung und Verfahren zu ihrer Herstellung - Google Patents
Integrierte Halbleiterschaltung und Verfahren zu ihrer HerstellungInfo
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- 239000004065 semiconductor Substances 0.000 title claims description 46
- 238000000034 method Methods 0.000 title claims description 18
- 238000004519 manufacturing process Methods 0.000 title claims description 9
- 229910021420 polycrystalline silicon Inorganic materials 0.000 claims description 45
- XUIMIQQOPSSXEZ-UHFFFAOYSA-N Silicon Chemical compound [Si] XUIMIQQOPSSXEZ-UHFFFAOYSA-N 0.000 claims description 16
- 229910052710 silicon Inorganic materials 0.000 claims description 16
- 239000010703 silicon Substances 0.000 claims description 16
- 239000003990 capacitor Substances 0.000 claims description 15
- 239000004020 conductor Substances 0.000 claims description 12
- 229910052751 metal Inorganic materials 0.000 claims description 11
- 239000002184 metal Substances 0.000 claims description 11
- 229910021421 monocrystalline silicon Inorganic materials 0.000 claims description 10
- 230000007704 transition Effects 0.000 claims description 7
- 239000003989 dielectric material Substances 0.000 claims description 5
- 239000011248 coating agent Substances 0.000 claims description 4
- 238000000576 coating method Methods 0.000 claims description 4
- 230000005669 field effect Effects 0.000 claims description 4
- 239000000758 substrate Substances 0.000 claims description 3
- 229910052799 carbon Inorganic materials 0.000 claims description 2
- 239000002245 particle Substances 0.000 claims 1
- VYPSYNLAJGMNEJ-UHFFFAOYSA-N Silicium dioxide Chemical compound O=[Si]=O VYPSYNLAJGMNEJ-UHFFFAOYSA-N 0.000 description 17
- 239000000463 material Substances 0.000 description 14
- 239000000377 silicon dioxide Substances 0.000 description 7
- 235000012239 silicon dioxide Nutrition 0.000 description 7
- 229910052782 aluminium Inorganic materials 0.000 description 6
- XAGFODPZIPBFFR-UHFFFAOYSA-N aluminium Chemical compound [Al] XAGFODPZIPBFFR-UHFFFAOYSA-N 0.000 description 6
- ZOXJGFHDIHLPTG-UHFFFAOYSA-N Boron Chemical compound [B] ZOXJGFHDIHLPTG-UHFFFAOYSA-N 0.000 description 5
- 229910052796 boron Inorganic materials 0.000 description 5
- 238000000151 deposition Methods 0.000 description 5
- 239000002019 doping agent Substances 0.000 description 5
- 229910052698 phosphorus Inorganic materials 0.000 description 5
- 239000000126 substance Substances 0.000 description 5
- BLRPTPMANUNPDV-UHFFFAOYSA-N Silane Chemical compound [SiH4] BLRPTPMANUNPDV-UHFFFAOYSA-N 0.000 description 4
- 239000012159 carrier gas Substances 0.000 description 4
- 230000008021 deposition Effects 0.000 description 4
- 238000001556 precipitation Methods 0.000 description 4
- 229910000077 silane Inorganic materials 0.000 description 4
- YMWUJEATGCHHMB-UHFFFAOYSA-N Dichloromethane Chemical compound ClCCl YMWUJEATGCHHMB-UHFFFAOYSA-N 0.000 description 3
- UFHFLCQGNIYNRP-UHFFFAOYSA-N Hydrogen Chemical compound [H][H] UFHFLCQGNIYNRP-UHFFFAOYSA-N 0.000 description 3
- XYFCBTPGUUZFHI-UHFFFAOYSA-N Phosphine Chemical compound P XYFCBTPGUUZFHI-UHFFFAOYSA-N 0.000 description 3
- OAICVXFJPJFONN-UHFFFAOYSA-N Phosphorus Chemical compound [P] OAICVXFJPJFONN-UHFFFAOYSA-N 0.000 description 3
- 238000011161 development Methods 0.000 description 3
- 230000018109 developmental process Effects 0.000 description 3
- 238000005530 etching Methods 0.000 description 3
- 239000001257 hydrogen Substances 0.000 description 3
- 229910052739 hydrogen Inorganic materials 0.000 description 3
- 229910052756 noble gas Inorganic materials 0.000 description 3
- 239000011574 phosphorus Substances 0.000 description 3
- 229910052814 silicon oxide Inorganic materials 0.000 description 3
- QGZKDVFQNNGYKY-UHFFFAOYSA-N Ammonia Chemical compound N QGZKDVFQNNGYKY-UHFFFAOYSA-N 0.000 description 2
- XKRFYHLGVUSROY-UHFFFAOYSA-N Argon Chemical compound [Ar] XKRFYHLGVUSROY-UHFFFAOYSA-N 0.000 description 2
- GYHNNYVSQQEPJS-UHFFFAOYSA-N Gallium Chemical compound [Ga] GYHNNYVSQQEPJS-UHFFFAOYSA-N 0.000 description 2
- VEXZGXHMUGYJMC-UHFFFAOYSA-N Hydrochloric acid Chemical compound Cl VEXZGXHMUGYJMC-UHFFFAOYSA-N 0.000 description 2
- ZOKXTWBITQBERF-UHFFFAOYSA-N Molybdenum Chemical compound [Mo] ZOKXTWBITQBERF-UHFFFAOYSA-N 0.000 description 2
- PXHVJJICTQNCMI-UHFFFAOYSA-N Nickel Chemical compound [Ni] PXHVJJICTQNCMI-UHFFFAOYSA-N 0.000 description 2
- 229910052581 Si3N4 Inorganic materials 0.000 description 2
- QVGXLLKOCUKJST-UHFFFAOYSA-N atomic oxygen Chemical compound [O] QVGXLLKOCUKJST-UHFFFAOYSA-N 0.000 description 2
- ILAHWRKJUDSMFH-UHFFFAOYSA-N boron tribromide Chemical compound BrB(Br)Br ILAHWRKJUDSMFH-UHFFFAOYSA-N 0.000 description 2
- 229910052733 gallium Inorganic materials 0.000 description 2
- 239000012535 impurity Substances 0.000 description 2
- 230000000873 masking effect Effects 0.000 description 2
- 230000008018 melting Effects 0.000 description 2
- 238000002844 melting Methods 0.000 description 2
- 229910052750 molybdenum Inorganic materials 0.000 description 2
- 239000011733 molybdenum Substances 0.000 description 2
- 229910052757 nitrogen Inorganic materials 0.000 description 2
- 239000001301 oxygen Substances 0.000 description 2
- 229910052760 oxygen Inorganic materials 0.000 description 2
- 238000001259 photo etching Methods 0.000 description 2
- 230000005855 radiation Effects 0.000 description 2
- HQVNEWCFYHHQES-UHFFFAOYSA-N silicon nitride Chemical compound N12[Si]34N5[Si]62N3[Si]51N64 HQVNEWCFYHHQES-UHFFFAOYSA-N 0.000 description 2
- 238000007740 vapor deposition Methods 0.000 description 2
- OKTJSMMVPCPJKN-UHFFFAOYSA-N Carbon Chemical compound [C] OKTJSMMVPCPJKN-UHFFFAOYSA-N 0.000 description 1
- VYZAMTAEIAYCRO-UHFFFAOYSA-N Chromium Chemical compound [Cr] VYZAMTAEIAYCRO-UHFFFAOYSA-N 0.000 description 1
- 241000589614 Pseudomonas stutzeri Species 0.000 description 1
- XSTXAVWGXDQKEL-UHFFFAOYSA-N Trichloroethylene Chemical group ClC=C(Cl)Cl XSTXAVWGXDQKEL-UHFFFAOYSA-N 0.000 description 1
- 229910045601 alloy Inorganic materials 0.000 description 1
- 239000000956 alloy Substances 0.000 description 1
- 229910021529 ammonia Inorganic materials 0.000 description 1
- 229910052787 antimony Inorganic materials 0.000 description 1
- WATWJIUSRGPENY-UHFFFAOYSA-N antimony atom Chemical compound [Sb] WATWJIUSRGPENY-UHFFFAOYSA-N 0.000 description 1
- VMPVEPPRYRXYNP-UHFFFAOYSA-I antimony(5+);pentachloride Chemical compound Cl[Sb](Cl)(Cl)(Cl)Cl VMPVEPPRYRXYNP-UHFFFAOYSA-I 0.000 description 1
- 229910052786 argon Inorganic materials 0.000 description 1
- RBFQJDQYXXHULB-UHFFFAOYSA-N arsane Chemical compound [AsH3] RBFQJDQYXXHULB-UHFFFAOYSA-N 0.000 description 1
- 229910052785 arsenic Inorganic materials 0.000 description 1
- RQNWIZPPADIBDY-UHFFFAOYSA-N arsenic atom Chemical compound [As] RQNWIZPPADIBDY-UHFFFAOYSA-N 0.000 description 1
- 230000015572 biosynthetic process Effects 0.000 description 1
- 239000012876 carrier material Substances 0.000 description 1
- 238000006243 chemical reaction Methods 0.000 description 1
- 229910052804 chromium Inorganic materials 0.000 description 1
- 239000011651 chromium Substances 0.000 description 1
- 238000004891 communication Methods 0.000 description 1
- 150000001875 compounds Chemical class 0.000 description 1
- 229910021419 crystalline silicon Inorganic materials 0.000 description 1
- 230000007547 defect Effects 0.000 description 1
- 230000001419 dependent effect Effects 0.000 description 1
- 238000013461 design Methods 0.000 description 1
- 238000009792 diffusion process Methods 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
- 238000005516 engineering process Methods 0.000 description 1
- 238000009415 formwork Methods 0.000 description 1
- PCHJSUWPFVWCPO-UHFFFAOYSA-N gold Chemical compound [Au] PCHJSUWPFVWCPO-UHFFFAOYSA-N 0.000 description 1
- 229910052737 gold Inorganic materials 0.000 description 1
- 239000010931 gold Substances 0.000 description 1
- 239000001307 helium Substances 0.000 description 1
- 229910052734 helium Inorganic materials 0.000 description 1
- SWQJXJOGLNCZEY-UHFFFAOYSA-N helium atom Chemical compound [He] SWQJXJOGLNCZEY-UHFFFAOYSA-N 0.000 description 1
- 238000011835 investigation Methods 0.000 description 1
- 239000007788 liquid Substances 0.000 description 1
- 229910001092 metal group alloy Inorganic materials 0.000 description 1
- 238000001465 metallisation Methods 0.000 description 1
- 150000002739 metals Chemical class 0.000 description 1
- 229910052754 neon Inorganic materials 0.000 description 1
- GKAOGPIIYCISHV-UHFFFAOYSA-N neon atom Chemical compound [Ne] GKAOGPIIYCISHV-UHFFFAOYSA-N 0.000 description 1
- 229910052759 nickel Inorganic materials 0.000 description 1
- 229910000073 phosphorus hydride Inorganic materials 0.000 description 1
- 238000012545 processing Methods 0.000 description 1
- 239000002210 silicon-based material Substances 0.000 description 1
- 239000007787 solid Substances 0.000 description 1
- 239000002904 solvent Substances 0.000 description 1
- 238000004544 sputter deposition Methods 0.000 description 1
- 229910052715 tantalum Inorganic materials 0.000 description 1
- GUVRBAGPIYLISA-UHFFFAOYSA-N tantalum atom Chemical compound [Ta] GUVRBAGPIYLISA-UHFFFAOYSA-N 0.000 description 1
- WFKWXMTUELFFGS-UHFFFAOYSA-N tungsten Chemical compound [W] WFKWXMTUELFFGS-UHFFFAOYSA-N 0.000 description 1
- 229910052721 tungsten Inorganic materials 0.000 description 1
- 239000010937 tungsten Substances 0.000 description 1
- 238000005019 vapor deposition process Methods 0.000 description 1
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-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L23/00—Details of semiconductor or other solid state devices
- H01L23/28—Encapsulations, e.g. encapsulating layers, coatings, e.g. for protection
- H01L23/29—Encapsulations, e.g. encapsulating layers, coatings, e.g. for protection characterised by the material, e.g. carbon
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- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
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- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L27/00—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate
- H01L27/02—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers
- H01L27/04—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers the substrate being a semiconductor body
- H01L27/06—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers the substrate being a semiconductor body including a plurality of individual components in a non-repetitive configuration
- H01L27/0688—Integrated circuits having a three-dimensional layout
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- H01L29/00—Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/02—Semiconductor bodies ; Multistep manufacturing processes therefor
- H01L29/04—Semiconductor bodies ; Multistep manufacturing processes therefor characterised by their crystalline structure, e.g. polycrystalline, cubic or particular orientation of crystalline planes
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- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10N—ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
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- H01—ELECTRIC ELEMENTS
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- Y—GENERAL TAGGING OF NEW TECHNOLOGICAL DEVELOPMENTS; GENERAL TAGGING OF CROSS-SECTIONAL TECHNOLOGIES SPANNING OVER SEVERAL SECTIONS OF THE IPC; TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
- Y10—TECHNICAL SUBJECTS COVERED BY FORMER USPC
- Y10S—TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
- Y10S148/00—Metal treatment
- Y10S148/055—Fuse
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- Y—GENERAL TAGGING OF NEW TECHNOLOGICAL DEVELOPMENTS; GENERAL TAGGING OF CROSS-SECTIONAL TECHNOLOGIES SPANNING OVER SEVERAL SECTIONS OF THE IPC; TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
- Y10—TECHNICAL SUBJECTS COVERED BY FORMER USPC
- Y10S—TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
- Y10S148/00—Metal treatment
- Y10S148/085—Isolated-integrated
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- Y—GENERAL TAGGING OF NEW TECHNOLOGICAL DEVELOPMENTS; GENERAL TAGGING OF CROSS-SECTIONAL TECHNOLOGIES SPANNING OVER SEVERAL SECTIONS OF THE IPC; TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
- Y10—TECHNICAL SUBJECTS COVERED BY FORMER USPC
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- Y10S148/00—Metal treatment
- Y10S148/122—Polycrystalline
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- Y10S148/00—Metal treatment
- Y10S148/123—Polycrystalline diffuse anneal
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- Y—GENERAL TAGGING OF NEW TECHNOLOGICAL DEVELOPMENTS; GENERAL TAGGING OF CROSS-SECTIONAL TECHNOLOGIES SPANNING OVER SEVERAL SECTIONS OF THE IPC; TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
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- Y10S148/00—Metal treatment
- Y10S148/124—Polycrystalline emitter
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- Y—GENERAL TAGGING OF NEW TECHNOLOGICAL DEVELOPMENTS; GENERAL TAGGING OF CROSS-SECTIONAL TECHNOLOGIES SPANNING OVER SEVERAL SECTIONS OF THE IPC; TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
- Y10—TECHNICAL SUBJECTS COVERED BY FORMER USPC
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- Y10S148/00—Metal treatment
- Y10S148/136—Resistors
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- Y—GENERAL TAGGING OF NEW TECHNOLOGICAL DEVELOPMENTS; GENERAL TAGGING OF CROSS-SECTIONAL TECHNOLOGIES SPANNING OVER SEVERAL SECTIONS OF THE IPC; TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
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Description
Die Erfindung bezieht sich auf eine integrierte Halbleiterschaltung mit einem Träger aus monokristallinem Silizium, einem in einem Oberflächenbebr>
reich des Trägers gebildeten Schaltungselement, einer diesen Oberflächenbereich bedeckenden Isolierschicht, die wenigstens eine öffnung über einem ausgewählten Bereich des Schaltunselements aufweist,
einem in einer zweiten Ebene über der Isolierschicht gebildeten weiteren Schaltungselement und einer
elektrischen Anschlußverbindung, die durch die öffnung
der Isolierschicht hindurch den ausgewählten Bereich des in dem Träger gebildeten Schaltungselements
mit dem in der zweiten Ebene Hegenden Schaltungselement verbindet. Ferner bezieht sie sich auf
ein Verfahen zur Herstellung einer solchen integrierten Halbleiterschaltung.
Eine integrierte Schaltungsanordnung der eingangs angegebenen Art ist bereits im SCP and SOLID
STATETECHNOLOGY, Mai 1966, S. 43 bis 47 bekannt. Bei dieser bekannten Halbleiterschaltung ist
in einem Träger aus Silizium ein Transistor gebildet, und über dem Träger ist dann eine Siliziumdoxidschicht
aufgebracht. Als Zugang zu den Transistorzonen sind in der Siliziumdioxidschicht öffnungen gebildet,
in die anschließend während eines Aufdampfvorgangs Aluminium eindringt und die Kontaktverbindung
mit den Zonen des Transistors herstellt. Das aufgedampfte Aluminium wird auch zur Herstellung
von Verbindungen zu Widerständen und Kondensatoren benutzt, die auf der Siliziumdioxidschicht unter
Verwendung einer Legierung aus Nickel und Chrom hergestellt werden. Auf Grund der Verwendung einer
Metallegierung zur Herstellung der in der zweiten Ebene liegenden Schaltungselemente sind die Auswahlmöglichkeiten
hinsichtlich der Art der in der zweiten Ebene herstellbaren Schaltungselemente sehr
begrenzt; auch die Bereiche der erzielbaren Parameter dieser Schaltungselemente sind nicht sehr groß.
Es ist auch bereits ein Verfahren bekannt (FR-PS 1464157), mit dessen Hilfe in einer Siliziumdioxidschicht
ein ohmscher Widerstand gebildet werden kann. Dabei wird auf einem Träger eine Siliziumdioxidschicht
gebildet, über der dann eine Aluminiumschicht aufgebracht wird. Durch Temperaturerhöhung
wird eine Reaktion zwischen dem Aluminium und dem Siliziumdioxid herbeigeführt, damit aus der Siliziumdioxids-hicht
unter der Aluminiumschicht ein Leiter mit einem bestimmten spezifischen Widerstand
entsteht. In dem bei diesem bekannten Verfahren angewendeten Träger befindet sich jedoch kein Schaltungselement;
es ist nur eine Ebene von Schaltungselementen vorhanden, die praktisch die Ebene der
Siliziumdk)xidschic!it ist.
Der Erfindung liegt die Aufgabe zugrunde, eine integrierte Halbleiterschaltung der eingangs angegebenen
Art so auszugestalten, daß in der zweiten Ebene beliebige Arten von Schalungselementen mit großen
Parameterbereichen gebildet werden können. Ferner soll ein einfach ausführbares Verfahren zur Herstellung
einer solchen Halbleiterschaltung geschaffen werden.
Nach der Erfindung wird diese Aufgabe dadurch gelöst, daß mindestens eine Schicht des in der zweiten
Ebene liegenden Schaltungselements und die mit dieser Schicht einstückig ausgebildete Anschlußverbindung
aus Silizium bestehen, wobei das Silizium der Schicht des in der zweiten Ebene liegenden Schaltungselements
polykristallin ist und eine gleichmäßig verteilte Korngröße mit einem effektiven mittleren
Durchmesser von weniger als 0,25 μπι aufweist.
Bei der erfindungsgemäßen Halbleiterschaltung bestehen sowohl das über der Isolierschicht gebildete
Schaltungselement als auch die Anschlußverbindungen zwischen diesem Schaltungselement und den im
Trägermaterial gebildeten Schaltungselement aus Si-
Ijzium. Durch Einhalten der oben angegebenen mittleren Korngröße bei der Bildung der Siliziumschicht
in der zweiten Ebene ergibt sich eine glatte Oberfläche, so daß vor der eigentlichen Bildung des Schaltungselements
in der zweiten Ebene keine besondere Bearbeitung der Siliziumoberfläche erforderlich ist.
Außerdem ermöglicht die Verwendung des Materials Silizium für die Schicht der zweiten Ebene die Herstellung
sowohl passiver als auch aktiver Schaltungselemente. Wenn beispielsweise das Schaltungselement
in der zweiten Ebene ein Widerstand ist, dann lassen sich auf Grund der Verwendung von Silizium
Widerstandswerte in der Größenordnung von 100 000 Ohm/Quadrat erreichen. Die Verwendung polykristallinen
Siliziums mit einer Korngröße von weniger als 0,25 μπι ist zwar bereits aus einem Halbleiterherstellungsverfahren
bekannt (GB-PS 1073555), doch werden bei diesem Verfahren keine Halbleiterschaltungen
mi*. Bauelementen in zwei Ebenen erzeugt.
Vorteilhafte Weiterbildungen de virfindungsgemäßen
Halbleiterschaltung sind in den Unieransprüchen
2 bis 9 gekennzeichnet. Die im Unteranspruch 6 gekennzeichnete Weiterbildung geht bereits aus einem
älteren Vorschlag (DE-OS 1901819) hervor, wonach bereits PN-Ubergänge in polykristallinem
Halbleitermaterial gebildet wurden.
Das erfindungsgemäße Verfahren, bei dem in einem Oberflächenbereich eines Halbleiterträgers aus
monokristallinem Silizium ein Schaltungselement gebildetwird, über diesem Oberflächenbereich eine Isolierschicht
aufgebracht wird, in die Isolierschicht eine öffnung zum Freilegen eines ausgewählten Bereichs
des Schaltungselemente angebracht und ein weiteres Schaltungselement in einer zweiten Ebene gebildet
wird, das durch die öffnung in der Isolierschicht mit dem im Halbleiterträger liegenden Schaltungselement
in elektrischer Verbindung steht, ist dadurch gekennzeichnet, daß über der Isolierschicht bei einer Temperatur
von weniger als 900° C und bei einer Wachstumsgeschwindigkeit von weniger als 1 μπι/niin eine
Sch'cht aus polykristallinem Silizium mit einer gleichmäßig verteilten Korngröße von weniger als 0,25 μπι
und mit einer im wesentlichen glatten Oberfläche aufgebracht wird, und daß die Schicht aus polykristallinem
Silizium zumindest als Teil des weiteren Schaltungselements verwendet wird.
Vorteilhafte Weiterbildungen des erfindungsgemäßen Verfahrens sind in den Unteransprüchen 11 bis
13 gekennzeichnet.
Die Erfindung wird nun an Hand der Zeichnung beispielshalber erläutert. Es zeigt
Fig. 1 einen Schnitt durch eine integrierte Halbleiterschaltung,
Fig. 1 eine Draufsicht auf die Halbleiterschaltung von Fig. 1,
Fig. 3 einen Schnitt durch eine weitere Ausführungsform, bei der im Siliziummaterial der zweiten
Ebene ein Kondensator gebildet ist,
Fig. 4 einen Schnitt durch eine entsprechende Ausführungsform, bei der Kondensatorbiläge in aufeinanderfolgenden
Schichten aus polykristallinen! Silizium gebildet sind,
Fig. 5 einen Schnitt durch eine weitere Ausführungsform, bei der in der polykristallinen Siliziumschicht
ein PN-Übu-gang gebildet ist, und
Fig. 6 einen Schnitt durch eine weitere Ausführungsform, bei der in der Schicht aus polykristallinem
Silizium ein PN-Übergang als Gate-Elektrode eines
In Fig. 1 ist eine integrierte Halbleiterschaltung dargestellt, bei der in einem Träger 11 aus monokristallinem Silizium ein Schaltungselement 12 gebildet
ist. Das Schaltungselement 12 kann irgendein Schaltungselement sein, das herkömmlicherweise in einem
monokristallinen Halbleitermaterial aufgebaut wird. Bei der in Fig. 1 dargestellten AusfUhrungsform ist
das Schaltungselement ein Transistor.
Der Träger 11 und das Schaltungselement 12 werden mit einer Isolierschicht 14 überzogen, die z. B.
bei einer niederen Temperatur mit Hilfe einer Hf-Kathodenzerstäubung aufgebracht wird. Als hierfür besonders geeignetes Verfahren wurde das Niederschlagen von Silan bei einer Temperatur zwischen 300 bis
500c C ermittelt. Für dieses Aufdampfen kann Siliziumnitrid bei der Anwesenheit von Ammoniak in einem Edelgas wie z. B. Helium, Neon oder Argon verwendet werden. Durch das Niederschlagen bei der
Anwesenheit von Sauerstoff in einer Edelgasatmosphäre kann auch Siliziumoxyd als Isolierschicht 14
aufgebracht werden. Mit Hilfe eines photolitographischen Maskier- und Ätzverfahrens kann eine Öffnung
16 in der Isolierschicht 14 geschaffen werden. Dabei wird ein lichtundurchlässiges Deckmaterial über der
Oxydmaske angebracht und entsprechend belichtet. Mit einer geeigneten Entwicklerlösung wie z. B.
Trichloräthylen werden die belichteten Teile gefestigt und die nicht belichteten Teile der Deckschicht entfernt, so daß Offnungen entstehen. Durch diese öffnungen werden in die Isolierschicht 14 öffnungen 16
mit Hilfe einer Ätzflüssigkeit wie z. B. Chlorwasserstoffsäure eingeätzt. Die noch vorhandenen Teile der
lichtundurchlässigen Deckschicht werden z. B. mechanisch oder mit Hilfe eines geeigneten Lösungsmittels wie Dichlormethan entfernt.
Die Halbleiterscheibe wird anschließend gereinigt und auf einer aus Kohlenstoff oder Molybdän bestehenden Halterung in einem temperaturgeregelten
Ofen angeordnet. Danach wird zusammen mit einem Trägergas Silan (SiH4) in den Ofen eingeführt und
daraus polykristallines Silizium niedergeschlagen.
Es. wurde festgestellt, daß bei einer Temperatur von weniger als 900° C und einer Geschwindigkeit für das
Niederschlagen von weniger als 1 μΐη/niin ein extrem
feinkörniges polykristallines Silizium entsteht, das ungewöhnlich gute Eigenschaften zeigt, die denjenigen
des monokristallinen Siliziums sehr ähnlich sind. Die polykristalline Siliziumschicht besitzt eine spiegelartige Oberfläche, auf der keine Körnigkeit wahrnehmbar ist. Mit Hilfe üiner elektronenmikroskopischen
Untersuchung läßt sich feststellen, daß der Hauptdurchmesser der Korngröße kleiner ist als 0,25 μπι.
In der Regel liegt die Korngröße bei 0,1 um, bezogen auf den Hauptdurchmesser. Es wurden sogar Schichten aus polykristallinem Silizium hergestellt, deren
Korngröße bezüglich des Hauptdurchmessers bei einigen Tausendstel eines um lag.
Besonders gute Ergebnisse wurden beim Niederschlagen von Silan bei einer Temperatur von ungefähr
750° C bis ungefähr 900° C für das Herstellen des polykristallinen Siliziums erzielt.
Das in der öffnung 16 abgelagerte Silizium kann sowohl monokristallines oder polykristallines Silizium
sein. Auf jeden Fall entsteht polykristallines Silizium, wenn es beim Niederschlagen über die öffnung 16
hinauswächst. Das Aufbringen des polykristallinen Siliziums wird so lange fortgesetzt, bis die gewünschte
Nachdem das polykristalline Silizium auf der Isolierschicht 14 angebracht ist, wird mit Hilfe des herkömmlichen photolithographischen Maskierungsund Atzverfahrens das polykristalline Material in bestimmten Bereichen wieder entfernt. In Fig. 1 wurde
durch entsprechendes Entfernen des polykristallinen Siliziums ein Widerstand 20 gebildet. Der Verlauf des
Widerstands ist in Fig. 2 dargestellt, die eine Draufsicht auf die Halbleiterschaltung von Fig. 1 zeigt. Der
Widerstand 20 erstreckt sich entsprechend der Darstellung vom Emitter 22 des Schaltungselements 12
bis zu den Kontaktflächen 24.
Der Kollektor des Transistors wird mit einem anderen, nicht dargestellten Teil der Schaltung über die
Leitung 26 verbunden. In gleicher Weise wird auch die Basis des Transistors mit einem anderen nicht dargestellten Teil der Schaltung durch die Leitung 28 verbunden. Die Leitungen 26 und 28 werden durch eine
auf das Niederschlagen des kristallinen Siliziums folgende Metallisierung in einer ersten Ebene gebildet.
Die elektrische Verbindung von den Leitungen 26 und 28 mit den entsprechenden Bereichen des Transistors
erfolgt durch öffnungen in der Isolierschicht 14. Diese öffnungen werden mit Hilfe der herkömmlichen Fotoätztechnik hergestellt. Für die Leitungen 26 und 28
werden normalerweise Metalleitungen aus Gold oder Aluminium verwendet.
Wenn eine sehr komplizierte Leitungsführung über der Isolierschicht 14 benötigt wird, kann ein mit hohem Schmelzpunkt schmelzendes Metall wie Molybdän, Tantal oder Wolfram als Leitermaterial über der
ersten Isolierschicht angebracht und durch eine zweite Isolierschicht abgedeckt werden, bevor darauf das polykristalline Silizium angebracht wird.
In jedem Fall wird das gewünschte elektrische Leitungsmuster in der ersten Metallschicht mit Hilfe der
Fotoätztechnik hergestellt, bei der in bestimmten Bereichen die Metallschicht weggeätzt wird, so daß nur
die gewünschten Leitungsverbindungen zu den entsprechenden Bereichen bestehen bleiben.
Unabhängig von der Reihenfolge, in welcher die Leitungen in den Schaltungselementen aus polykristallinem Material hergestellt werden, zeigte sich, daß
die ohmschen Kontaktanschlüsse direkt durch das Anbringen von Metalleitern an dem polykristallinen
Silizium geschaffen werden können, ohne daß ein Eindiffundieren einer Dotierungssubstanz in den
Kontaktbereich notwendig ist. Die Leitung 30 kann z. B. direkt mit der Kontaktfläche 24 des Widerstandes 20 verbunden werden. Diese Eigenschaft, aaß
Metalleitungen direkt mit dem polykristallinen Silizium verbunden werden können, erleichtert das Herstellen von Leitungsverbindungen in einem vielschichtigen Aufbau.
Normalerweise kann der Widerstandswert des aufgebrachten polykristallinen Siliziums durch die Dicke
und Breite des Halbleitermaterials festgelegt werden,
welches nach dem Wegätzen der übrigen Teile zurückbleibt. Zusätzlich kann jedoch auch der Widerstandswert durch das Zusetzen einer Dotierungssubstanz zu dem polykristallinen Halbleitermaterial
geändert werden. Wenn der Widerstandswert des polykristallinen Siliziums z. B. verkleinert werden soll,
kann Gallium, Phosphor oder Bor als Dotierungssubstanz verwendet werden. Die Dotierung kann leicht
durchgeführt werden. Bei dem vorausgehend beschriebenen Beispiel, bei welchem Silan mit einem
Wasserstoffträgergas zugeführt wird, kann Phosphorwasserstoff beigesetzt werden, um ein Niederschlagen
von Phosphor gleichzeitig mit dem Silizium und damit eine Verringerung des Widerstandswertes zu bewirken.
In Fig. 3 ist eine weitere Ausführungsform einer Halbleiterschaltung dargestellt, bei welcher über der
Isolierschicht 14 eine polykristalline Siliziumschicht 40 als ein Belag eines Kondensators gebildet ist. Wie
beim Widerstand 20 gemäß Fig. 1 kann die polykristalline Siliziumschicht 40 eine Dotier ungssubstanz
enthalten. Die Konzentration der Dotierungssubstanz ändert die Kapazität des endgültigen Kondensatoraufbaus.
Als zweiter Belag des Kondensators findet eine Metallschicht 42 Verwendung, die auf der Oberfläche
einer über der polykristallinen Siliziumschicht 40 angeordneten Schicht 44 aus dielektrischem Material
angebracht wird. Die Änschiußieitung 46 besteht der Einfachheit halber aus einer von außen her zugeführten
und an der Metallschicht befestigten Leitung. Selbstverständlich kann der Kondensatorbelag 42
auch mit einem anderen Schaltungselement über eine auf der dielektrischen Schicht 44 geführten Leitung
verbunden sein. Die dielektrische Schicht 44 kann aus Siliziumoxyd oder Siliziumnitrid bestehen. Die übrigen
Schaltungselemente und Leitungen 26 und 28 gemäß Fig. 3 sind aus Metallen mit hohen Schmelzpunkten
hergestellt, die zwischen isolierenden Schichten gemäß Fig. 1 und 2 ausgebildet sind.
Eine weitere Ausführungsform der Halbleiterschaltung
ist in Fig. 4 dargestellt, bei der eine Vielzahl von Schichten 40 und 48 abwechselnd mte einer Vielzahl
von Schichten 50 und 52 aus polykristallinem Silizium übereinander gestapelt sind, um eine Kondensatoreinheit
mit größerer Kapazität pro Flächeneinheit in einem vielschichtigen Aufbau zu schaffen.
Wechselweise aufeinanderfolgende Platten sind hierfür miteinander verbunden. Dazu werden die Schichten
40 und 48 durch eine Öffnung durch ein Leiterelement 54 aus polykristallinem Silizium miteinander
verbunden, das gegen die Kondensatorbeläge 50 und 52 isoliert ist. In gleicher Weise sind die Schichten
50 und 52 über eine Öffnung durch ein metallisches Leiterelement 56 verbunden, das durch die Öffnung
auf die Platte 50 und die Platte 52 niedergeschlagen wird, wobei jedoch dieses metallische Leiterelement
gegen die Schichten 40 und 48 isoliert ist. Das Leiterelement 46 ist als ausgedehnter Flächenkontakt dargestellt,
der elektrisch mit einem anderen nicht dargestellten Schaltungselement verbunden sein kann, oder
aber auch elektrisch freiliegt. Der übrige Teil der Anordnung gemäß Fig. 4 ist in derselben Weise wie.bereits
anhand von Fig. 1 besenrieben aufgebaut.
In Fig. S ist eine weitere Ausführungsform einer Halbleiterschaltung dargestellt, bei der die Kapazität
der polykristallinen, in der zweiten Ebene angeordneten Siliziumschicht 40 durch einen darin ausgebildeten
Bereich 60 verbessert wird, der eine P- oder N-Leitung entsprechend dem verwendeten Dotierungsmaterial
besitzt. Normalerweise wird der Bereich 60 derart dotiert, daß eine gegenüber der Schicht 40
entgegengesetzte Leitfähigkeit erhalten wird. Auf diese Weise bildet sich ein Übergang aus, und es entsteht
ein Kondensator mit einem verbesserten Gütefaktor Q. Da das gemäß der obigen Erläuterungen
ausgebildete polykristalline Silizium sehr feinkörnig ist, besteht die Möglichkeit, eine P- oder N-Leitung
durch die Verwendung entsprechender Dotierungssubstanzen, d. h. entsprechender Akzeptor-Störstellen
oder Donator-Störstellen zu schaffen. Für eine P-Leitung werden z. B. als Dotierungssubstanz Bor oder
Gallium verwendet, wogegen für eine N-Leitung als Dotierungssubstanz Phosphor, Arsen oder Antimon
Verwendung finden. Obwohl das gleichzeitige Niederschlagen der Dotierungssubstanz mit dem Silizium
in Verbindung mit der Herstellung eines Widerstands mit unterschiedlichem Widerstandswert beschrieben
wurde, wird dieses Verfahren in der Regel nur für die Erzeugung einer N-Leitung verwendet. Insbesondere
wird als chemische Substanz Phosphin, Arsin oder Antimonpentachlorid mit Hilfe eines Wasserstoffträgergases
eingeführt und thermisch aufbereitet, um das Niederschlagen der die N-Leitung bewirkenden
Donator-Störstellen zu bewirken. Das gleiche Verfahren kann auch für die Herstellung einer P-Leitung
verwendet werden, wenn Diboran oder üalliumtrichlorid mit einem Wasserstoffträgergas vereinigt
und thermisch zersetzt wird, um das gleichzeitige Niederschlagen der Akzeptor-Störstellen mit dem vielkristallinen
Halbleiter zu bewirken. In der Regel wird jedoch der Bereich mit P-Leitungdurch eine Diffusion
hergestellt. Bei einer solchen Diffusion wird zunächst eine Verbindung wie z. B. Bortribromid in einem
Edelgas, z. B. Stickstoff, mit einem kleinen Anteil von Sauerstoff thermisch in einer temperaturgeregelten
Umgebung zersetzt, um das Niederschlagen einer Borglasur zu bewirken. Sodann wird aus der Borglasur
Bor in den vielkristallinen Halbleiter eindiffundiert und die N-Leitung an allen freiliegenden Stellen des
polykristallinen Siliziums in eine P-Leitung umgewandelt.
In Fig. 5 ist die dielektrische Schicht 44 über der polykristallinen Siliziumschicht 40 und deren entgegengesetzt
dotierten Bereich 60 angeordnet. Auf der dielektrischen Schicht 44 ist der zweite Belag 62 des
Kondensators in Form einer Metallschicht angeordnet. Auf diese Weise erhält man einen Kondensate*
mit einem verbesserten Gütefaktor Q und einer erhöhten Kapazität pro Flächeneinheit. Die Leitungen
46 und 61 sind der Einfachheit halber als Kontaktanschlüsse dargestellt.
Fig. 6 zeigt eine weitere Ausführungsform einer Halbleiterschaltung, bei der die polykristalline Siliziumschicht
40 mit einem PN-Übergang 66 versehen wird, indem wahlweise Akzeptor- oder Donator-Störstellen,
wie bereits beschrieben, eingeführt werden. In den Öffnungen 69 und 71 in der Isolierschicht
14 ist ein Halbleitermaterial 68, 70 vorgesehen, das
als Quelle und Senke für einen Feldeffekttransistor oder in einem anderen Fall als Basisanschlüsse für einen
PN-FIächentransistor Verwendung findet. Über dem polykristallinen Silizium ist eine Isolierschicht 72
vorgesehen, in der eine Öffnung 73 eingeätzt ist. Durch diese Öffnung in der Isolierschicht 72 stellt ein
durch Aufdampfen aufgebrachter metallischer Leiter 74 einen ohmschen Kontakt mit dem Bereich 78 innerhalb
des Übergangs 66 her. Der Leiter 74 steht steht mit weiteren nicht dargestellten Schaltungsteilen
in Verbindung und spannt den Übergang 66 in Sperrichtung vor; er stellt somit die Gate-Elektrode
des Feldeffekttransistors dar, mit der der Kanal zwischen der Quelle 68 und der Senke 70 und somit der
Strom zwischen diesen beiden gesteuert werden kann. Der Leiter 74 kann jedoch auch als Emitter eines
PN-FIächentransistors Verwendung finden, um den
Übergang 66 abwechselnd in Durchlaßrichtung und Sperrichtung vorzuspannen, wodurch das Ein- und
Ausschalten des zwischen den Basisanschlüssen 68 und 70 fließenden Stroms für den gewünschten Anwendungsfall bewirkt wird.
In dem polykristallinen Silizium können weitere Schaltungselemente gebildet werden, ohne daß überschüssiges Halbleitermaterial niedergeschlagen und
anschließend die Halbleiterscheibe geläppt, poliert oder gereinigt werden muß. Das feinkörnige polykristalline Halbleitermaterial besitzt nicht nur eine
Korngröße mit einem Hauptdurchmesser von weniger als 0,5 μπι, sondern enthält auch keine Korngröße,
die über V2 μπι hinausgeht. Diese begrenzte maximale
Größe wird im Hinblick auf die erzielten Vorteile als sehr bedeutend angesehen. Unter Verwendung des
beschriebenen Verfahrens können eine zweite und nachfolgend weitere Schichten eines feinkörnigen polykristallinen Siliziums geschaffen werden, indem
Temperaturen von etwa 800 bis 885° C bei einer Wachstumsgeschwindigkeit von 0,25 bis 0,75 μηι/min
verwendet werden, wobei Widerstandswerte von 1000, 5000, 10000 und 100000 Ohm/Quadrat erzielbar sind. Es läßt sich eine polykristalline Siliziumschicht mit 10~3 mm Dicke über einer Isolier-Schicht
mit 0,2 · 10~3 mm bis 4 · ΙΟ"1 mm Dicke bei Siliziumdioxyd herstellen. Dabei können Übergänge in dem
polykristallinen Silizium ausgebildet werden.
Das Verfahren gemäß der obigen Ausführungen kann zum dichteren Aufbau von Halbleiterelementen
pro Oberflächeneinheit verwendet werden. Wenn überdies Widerstände aus polykristallinem Silizium in
der zweiten Ebene anstelle der ersten, aus einem monokristallinen Silizium bestehenden Ebene angeordnet werden, besitzt die Halbleiterschaltung eine größere Widerstandsfähigkeit gegen Strahlung und
insbesondere gegen das Auslösen einer Fehlfiinktinn
bei einer hohen Strahlendosis.
Claims (13)
1. Integrierte Halbleiterschaltung mit einem
Träger aus monokristalünem Silizium, einem in einem Oberflächenbereich des Trägers gebildeten
Schaltungselement, einer diesen Oberflächenbereich bedeckenden Isolierschicht, die wenigstens
eine öffnung über einem ausgewählten Bereich des Schaltungselements aufweist, einem in einer
zweiten Ebene über der Isolierschicht gebildeten weiteren Schaltungselement und einer elektrischen Anschlußverbindung, die durch die öffnung
der Isolierschicht hindurch den ausgewählten Bereich des in dem Träger gebildeten Schaltungselements mit dem in der zweiten Ebene liegenden
Schaltungselement verbindet, dadurch gekennzeichnet, daß mindestens eine Schicht (20;
40; 40, 48, 50, 52) des in der zweiten Ebene Hegenden Schaltungselemente und die mit dieser
Schicht einstückig ausgebildete Anschlußverbindung (18) aus Silizium bestehen, wobei das Silizium der Schicht (20; 40) des in der zweiten Ebene
liegenden Schaltungselements polykristallin ist und eine gleichmäßig verteilt Korngröße mit einem effektiven mittleren Durchmesser von weniger als 0,25 um aufweist.
2. Integrierte Halbleiterschaltung nach Anspruch 1, dadurch gekennzeichnet, daß das in der
zweiten Ebene liegende Schaltungselement ein passives Schaltungselement ist.
3. Integrierte Halbleiterschaltung nach Anspruch 2, dadurch gekennzeichnet, daß das passive
Schaltungselement ein ohmscher Widerstand ist, bei dem die Schicht (20) aus polykristallinen! Silizium an beiden Enden jeweils mit einem ohmschen. Kontaktanschluß versehen ist.
4. Integrierte Halbleiterschaltung nach Anspruch 2, dadurch gekennzeichnet, daß das passive
Schaltungselement ein Kondensator ist, bei dem der eine leitende Belag aus der Schicht (40) aus
polykristallinem Silizium gebildet ist und der eine diese Schicht (40) bedeckende Schicht (44) aus
dielektrischem Material sowie einen über der Schicht aus dielektrischem Material liegenden
zweiten leitenden Belag (42) aufweist.
5. Integrierte Halbleiterschaltung nach Anspruch 4, dadurch gekennzeichnet, daß der Kondensator mehr als eine Schicht aus dielektrischem
Material und mehr als eine Schicht (40, 48, 50, 52) aus polykristallinem Silizium zur Bildung
mehrerer Kondensatorbeläge aufweist, wobei die Schichten aus dielektrischem Material und aus polykristallinem Silizium abwechselnd übereinander
gestapelt sind, und daß elektrische Leiterelemente (54,56) abwechselnde Schichten (40,48; 50, 52)
aus polykristallinem Silizium zur Erzielung der gewünschten Kapazität miteinander verbinden.
6. Integrierte Halbleiterschaltung nach Anspruch 1, dadurch gekennzeichnet, daß die Schicht
(40) aus polykristallinem Silizium Zonen des entgegengesetzten Leitungstyps (40; 60; 70, 78) mit
einem dazwischenliegenden PN-Übergang ent* hält.
7. Integrierte Halbleiterschaltung nach Anspruch 6, dadurch gekennzeichnet, daß das in der
zweiten Ebene liegende Schaltungselement ein Kondensator (40, 44, 62) ist, bei dem der PN-
Übergang zur Verbesserung des Gütefaktors Q dient,
8. Integrierte Halbleiterschaltung nach Anspruch 6, dadurch gekennzeichnet, daß das in der
zweiten Ebene liegende Schaltungselement ein Feldeffekttransistor ist,
9. Integrierte Halbleiterschaltung nach Anspruch 6, dadurch gekennzeichnet, daß das in der
zweiten Ebene liegende Schaltungselement ein Doppelbasis-Transistor ist,
10. Verfahren zur Herstellung einer integrierten Halbleiterschaltung nach einem der vorhergehenden Ansprüche, bei dem in einem Oberflächenbereich eines Halbleiterträgers aus monokristallinem Silizium ein Schaltungselement gebildet
wird, über diesem Oberflächenbereich eine Isolierschicht aufgebracht wird, in der Isolierschicht
eine öffnung zum Freilegen eines ausgewählten Bereichs des Schaltungselements angebracht und
ein weiteres Schaltungselement in einer zweiten Ebene gebildet wird, das durch die öffnung in der
Isolierschicht mit dem im Halbleiterträger liegenden Schaltungselement in elektrischer Verbindung
steht, dadurch gekennzeichnet, daß über der Isolierschicht bei einer Temperatur von weniger als
900° C und bei einer Wachstumsgeschwindigkeit von weniger ah 1 μΐη/min eine Schicht aus polykristallinem Silizium mit einer gleichmäßig verteilten Korngröße von weniger als 0,25 μπι und
mit einer im wesentlichen glatten Oberfläche aufgebracht wird und daß die Schicht aus polykristallinem Silizium zumindest als Teil des weiteren
Schaltungselements verwendet wird.
11. Verfahren nach Anspruch 10, dadurch gekennzeichnet, daß die elektrische Verbindung
zwischen dem Schaltungselement in der zweiten Ebene und dem Schaltungselement in dem Oberflächenbereich des Halbleiterträgers durch Einbringen von monokristallinem "ilizium in die öffnung in der Isolierschicht gebildet wird, wobei das
die elektrische Verbindung bildende monokristalline Silizium einstückig mit der über der Isolierschicht aufgebrachten Schicht aus polykristallinem Silizium verbunden ist.
12. Verfahren nach Anspruch 10 oder 11, dadurch gekennzeichnet, daß mit der Schicht aus polykristallinem Silizium des in der zweiten Ebene
liegenden Schaltungselements ein Metalleiter zur Erzielung eines ohmschen Kontaktanschlusses direkt verbunden wird.
13. Verfahren nach Anspruch 10, dadurch gekennzeichnet, daß in der Schicht aus polykristallinem Silizium Zonen unterschiedlichen Leitungstyps zur Bildung eines in dem Schaltungselement
der zweiten Ebene verwendeten PN-Ubergangs erzeugt werden.
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FR (1) | FR1597169A (de) |
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Date | Code | Title | Description |
---|---|---|---|
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