DE10143790A1 - Elektronisches Bauteil mit wenigstens einem Halbleiterchip - Google Patents
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Abstract
Die Erfindung betrifft ein elektronisches Bauteil mit wenigstens einem Halbleiterchip (1), mit einer mit dem Halbleiterchip verbundenen Umverdrahtungsschicht (2) und mit einer der Umverdrahtungsschicht zugeordneten Leiterplatte (18), wobei die Umverdrahtungsschicht mit flexiblen Kontakten (10) versehen ist, die mit Kontaktflächen (20) der Leiterplatte korrespondieren, und wobei die Umverdrahtungsschicht über eine flache Zwischenschicht (12; 22) mit der Leiterplatte fest verbunden ist. Die Erfindung betrifft zudem ein Verfahren zur Herstellung des erfindungsgemäßen elektronischen Bauteils.
Description
- Die Erfindung betrifft ein elektronisches Bauteil mit wenigstens einem Halbleiterchip und ein Verfahren zu seiner Herstellung gemäß den unabhängigen Ansprüchen.
- Elektronische Halbleiterchips können mit Umverdrahtungsplatten bzw. -schichten und Leiterplatten zu sogenannten CSP (Chip Size Packages) verbunden werden. Die elektrischen und mechanischen Verbindungen zwischen den Einzelbauteilen können aus gelöteten Drahtverbindungen bestehen. Die Lötverbindungen, die inzwischen mit bleifreiem Lot hergestellt werden, müssen dabei auf Temperaturen von mindestens 240°C erhitzt werden. Dies bedeutet eine erhebliche Temperaturbelastung insbesondere für die empfindlichen Halbleiterbausteine. Nach der Herstellung der CSP sind Testroutinen für die Funktionstests der Halbleiterchips zu durchlaufen, die bei negativem Ergebnis einen Austausch der bereits verlöteten Halbleiterchips erforderlich machen. Dies bedeutet neben dem kostenintensiven und die Produktion verlangsamenden Handlingaufwand erneut eine hohe Temperaturbelastung für die Bauteile.
- Aufgabe der Erfindung ist es daher, eine schnell und kostengünstig herstellbare Bauteilverbindung zwischen Halbleiterchip, Umverdrahtungsschicht und Leiterplatte zur Verfügung zu stellen, die zudem einen schnellen Austausch eines bereits montierten Halbleiterchips ermöglicht.
- Diese Aufgabe wird mit dem Gegenstand der unabhängigen Ansprüche gelöst. Merkmale vorteilhafter Weiterbildungen der Erfindung ergeben sich aus den Unteransprüchen.
- Erfindungsgemäß weist das elektronische Bauteil wenigstens einen Halbleiterchip, eine mit diesem verbundene Umverdrahtungsschicht sowie eine der Umverdrahtungsschicht zugeordnete Leiterplatte auf. Es ist vorgesehen, dass die Umverdrahtungsschicht über flexible Kontakte verfügt, die mit Kontaktflächen der Leiterplatte korrespondieren und dass die Umverdrahtungsschicht über eine flache Zwischenschicht mit der Leiterplatte fest verbunden ist.
- Dieses erfindungsgemäße elektronische Bauteil hat den Vorteil einer schnellen und kostengünstigen Herstellbarkeit einer lösbaren Bauteilverbindung zwischen Umverdrahtungsschicht mit darauf montiertem wenigstens einen Halbleiterchip und Leiterplatte. Die Montage kann zudem mit einem sehr hohen Durchsatz erfolgen, ohne dass Lötverbindungen hergestellt werden müssen, die eine erhebliche Temperaturbelastung sowie einen unumgänglichen Zeitaufwand bei der Verarbeitung der Bauteile bedeuten würden. Auf einer Umverdrahtungsschicht kann dabei ein einzelner Halbleiterchip angebracht sein. Es sind aber auch elektronische Bauteile mit einer Vielzahl von Halbleiterchips auf, einer einzigen Umverdrahtungsschicht möglich. Ebenso können auf einer Leiterplatte ein oder auch mehrere Umverdrahtungsschichten montiert sein, so dass ggf. sehr hoch integrierte elektronische Bauteile realisierbar sind.
- Gemäß einer ersten Ausführungsform der Erfindung sind die Umverdrahtungsschicht mit dem wenigstens einen Halbleiterchip und die Leiterplatte in einem definierten Abstand zueinander montiert. Damit ist der Vorteil verbunden, dass die flexiblen Kontakte der Umverdrahtungsschicht in einer definierten Anlage zu den Kontaktflächen der Leiterplatte gebracht werden und für einen sicheren elektrischen Kontakt der beiden Bauteile sorgen. Der definierte Abstand kann je nach Größe der flexiblen Kontakte vorteilhaft in einem Bereich von ca. 50 µm bis 200 µm liegen, womit extrem kompakte Aufbauhöhen der CSP (Chip Size Packages) realisierbar werden.
- Bei einer weiteren erfindungsgemäßen Ausführungsform stehen die flexiblen Kontakte der Umverdrahtungsschicht bei auf der Leiterplatte montierter Umverdrahtungsschicht unter einer Vorspannung. Dies hat den Vorteil einer definierten Anlagekraft der flexiblen Kontakte, womit ein sicherer elektrischer Kontakt zwischen den metallischen Berührflächen gewährleistet ist. Die senkrecht zur Bauteiloberfläche liegende Elastizität der flexiblen Kontakte sorgt zudem für einen gewissen Ausgleich von Unebenheiten und Erhöhungen der Umverdrahtungsschicht bzw. der Leiterplatte zueinander.
- Eine erfindungsgemäße Ausführungsform sieht vor, dass die flexiblen Kontakte die flache Zwischenschicht zwischen der Umverdrahtungsschicht und der Leiterplatte im entspannten Zustand geringfügig überragen. Diese Ausführungsform hat den Vorteil einer jederzeit zuverlässigen Verbindung zwischen den flexiblen Kontakten und den Kontaktflächen der Leiterplatte, da die flexiblen Kontakte zunächst bis zum mechanischen Anschlag der flachen Zwischenschicht elastisch verformt werden und damit einen zuverlässigen elektrischen Kontakt bilden.
- Bei einer weiteren erfindungsgemäßen Ausführungsform besteht die flache Zwischenschicht aus einem Kunststoff, womit der Vorteil der einfachen und kostengünstigen Verarbeitbarkeit - bspw. in einem Spritzgussverfahren - verbunden ist. Zudem wirkt Kunststoff als elektrischer und thermischer Isolator, so dass er vorteilhaft als Berührschicht auch von Strom führenden Bereichen des Halbleiterchips bzw. der Umverdrahtungsschicht geeignet ist.
- Bei einer weiteren erfindungsgemäßen Ausführungsform ist die flache Zwischenschicht mehrteilig ausgeführt und nur an Zwischenräumen zwischen benachbarten flexiblen Kontakten und/ oder Gruppen von flexiblen Kontakten aufgebracht. Damit ist der Vorteil verbunden, dass die flexiblen Kontakte jederzeit ausreichend Spielraum zur Verformung haben, ohne bei ihrer elastischen Verbiegung an die Zwischenschicht zu stoßen.
- Eine Ausführungsform der Erfindung sieht vor, dass die flache Zwischenschicht perforiert ist und dass in den Zwischenräumen flexible Kontakte angeordnet sind. Diese Ausführungsform hat den Vorteil einer besonderen Stabilität aufgrund der dadurch gebildeten gitternetzartigen Struktur. Auch die Verarbeitbarkeit in einem einzigen kurzen Spritzgussprozess kann dadurch vereinfacht werden.
- Gemäß einer erfindungsgemäßen Ausführungsform ist die flache Zwischenschicht eine beidseitig klebende Folie, was den Vorteil einer besonders einfachen und äußerst schnellen Verarbeitbarkeit hat. Die Folie kann in einem Schritt aufgebracht werden, wonach unmittelbar die Umverdrahtungsschicht auf die Leiterplatte gedrückt werden kann. Dies sorgt für sehr schnelle Taktzeiten und dadurch für einen sehr hohen Durchsatz bei der Herstellung der erfindungsgemäßen elektronischen Bauteile.
- Gemäß einer weiteren erfindungsgemäßen Ausführungsform ist die flache Zwischenschicht als einteilig perforierter oder mehrteiliger Sockel an der Umverdrahtungsschicht ausgeführt, auf dem eine dünne klebende Folie befestigt ist. Dieser Sockel kann auf einfache Weise bspw. mittels einer Drucktechnik aufgebracht werden und weist eine definierte Dicke auf. Die darauf aufgebrachte dünne Klebefolie sorgt dann für eine feste Verbindung zwischen dem bereits fest mit der Umverdrahtungsschicht verbunden Sockel und der Leiterplatte. Der Sockel kann vorteilhaft bspw. aus einem Polymermaterial bestehen und ist dadurch besonders einfach zu verarbeiten. Je nach Bedarf kann der Sockel mehrteilig und jeweils in Zwischenräumen zwischen flexiblen Kontakten angeordnet sein. Ebenso möglich ist auch eine einteilige Ausführung in einer gitternetzartigen Struktur.
- Eine alternative Ausführungsform der Erfindung sieht vor, dass die flache Zwischenschicht als einteilig perforierter oder mehrteiliger Sockel an der Leiterplatte ausgeführt ist, auf dem eine dünne klebende Folie befestigt ist. Damit ist der Vorteil verbunden, dass gegenüber der zuvor beschriebenen Ausführungsform ein defekter Halbleiterchip besonders leicht wieder von der Leiterplatte gelöst und gegen einen fehlerfreien ausgetauscht werden kann.
- Eine Ausführungsform der Erfindung sieht vor, dass die Klebeverbindung an der Leiterplatte stärker haftet als an der Umverdrahtungsschicht, was den Vorteil einer definierten Trennstelle beim Ablösen eines fehlerhaften Halbleiterchips hat. Dadurch wird vermieden, dass sich die Klebefolie vom Sockel löst, bevor die Umverdrahtungsschicht von der Folie getrennt ist.
- Bei einer weiteren erfindungsgemäßen Ausführungsform ist die Klebeverbindung an der Umverdrahtungsschicht lösbar ausgeführt, was insbesondere den Vorteil einer schnellen und einfachen Entfernbarkeit eines als fehlerhaft getesteten Halbleiterchips hat.
- Bei einer weiteren erfindungsgemäßen Ausführungsform ist die Klebeverbindung an der Umverdrahtungsschicht nach dem Ablösen einer bereits montierten Umverdrahtungsschicht wiederholt verwendbar, was den besonderen Vorteil hat, dass ein als fehlerhaft getesteter Halbleiterchip leicht gegen einen fehlerfreien ausgetauscht werden kann. Dafür sind keinerlei weitere Applizierungsschritte notwendig, wie bspw. das Aufbringen einer neuen Klebestelle oder dergleichen.
- Eine erfindungsgemäße Ausführungsform sieht vor, dass die flexiblen Kontakte in Form eines Kontakthöckers ausgebildet sind. Damit ist der Vorteil einer gleichmäßigen elastischen Verformung beim Aufbringen der Umverdrahtungsschichten auf die Leiterplatten verbunden. Eine bogenförmige Kontur sorgt dabei für eine gleichmäßige Verteilung der Federkraft über den ganzen Verlauf des Kontakthöckers.
- Eine Ausführungsform der Erfindung sieht vor, dass die flexiblen Kontakte mit den jeweils korrespondierenden Kontaktflächen der Leiterplatte in Berührkontakt stehen. Diese Ausführungsform hat den Vorteil einer einfach und sehr schnell herstellbaren elektrischen Verbindung zwischen Halbleiterchip, Umverdrahtungsschicht und Leiterplatte, ohne dass weitergehende Verarbeitungsschritte - bspw. Löten oder dergl. - notwendig sind. Zudem kann in einem solchen Fall ein defekter Halbleiterchip besonders einfach gegen ein neues Bauteil ausgetauscht werden, ohne dass zuvor die elektrischen Verbindungsstellen gelöst werden müssen.
- Eine alternative Ausführungsform der Erfindung sieht vor, dass die flexiblen Kontakte mit den jeweils korrespondierenden Kontaktflächen der Leiterplatte verlötet und/oder verklebt sind. Diese alternative Ausführungsform hat den Vorteil einer besonders stabilen und widerstandsfähigen mechanischen und elektrischen Verbindung zwischen den Kontaktstellen.
- Bei einem erfindungsgemäßen Verfahren zur Herstellung eines elektronischen Bauteils mit wenigstens einem Halbleiterchip, einer mit dem wenigstens einen Halbleiterchip verbundenen Umverdrahtungsschicht und mit einer der Umverdrahtungsschicht zugeordneten Leiterplatte ist vorgesehen, dass die Umverdrahtungsschicht mit flexiblen Kontakten versehen ist, die mit Kontaktflächen der Leiterplatte korrespondieren. Es ist weiterhin vorgesehen, dass die Umverdrahtungsschicht über eine flache Zwischenschicht mit der Leiterplatte fest verbunden ist. Erfindungsgemäß ist das Verfahren durch folgende Verfahrensschritte gekennzeichnet. Nach dem Bereitstellen eines Halbleiterwafers mit in Zeilen und Spalten angeordneten Halbleiterchips und dazwischen vorgesehenen Sägespurbereichen werden diese jeweils mit Umverdrahtungsschichten verbunden. Auf der der aktiven Seite des Halbleiterchips abgewandten Oberfläche der Umverdrahtungsschicht werden flexible Kontakte aufgebracht. Danach werden flache Zwischenschichten an den Umverdrahtungsschichten aufgebracht, wonach ein Verkleben der Umverdrahtungsschichten mit Leiterplatten erfolgt. Dabei können wahlweise nur ein oder auch mehrere Halbleiterchips auf einer Umverdrahtungsschicht angebracht sein. Ebenso können wahlweise nur eine oder auch mehrere Umverdrahtungsschichten auf einer Leiterplatte aufgebracht sein.
- Dieses erfindungsgemäße Herstellungsverfahren hat den besonderen Vorteil einer schnellen und kostengünstigen Herstellbarkeit von sog. CSP (Chip Size Packages), bei denen zudem ein für die Bauteile belastendes Löten entfallen kann. Das Verkleben der Umverdrahtungsschichten auf den Leiterplatten sorgt für eine feste und stabile mechanische Verbindung, wogegen die elektrische Verbindung mittels federnder Kontakte zustande kommt, die von jeder mechanischen Trägerfunktion völlig entlastet sind. Die flexiblen Kontakte gleiten vielmehr auf Kontaktflächen der Leiterplatte und werden leicht gegen diese gedrückt, bis die Umverdrahtungsschicht auf der Zwischenschicht zur Anlage kommt. Somit können in extrem kurzen Taktzyklen integrierte elektronische Bauteile hergestellt werden, die durch eine hohe Integrationsdichte sowie eine hohe mechanische Stabilität ausgezeichnet sind.
- Gemäß einem ersten Ausführungsbeispiel des erfindungsgemäßen Verfahrens werden die Halbleiterwafer nach dem Aufbringen der flexiblen Kontakte und vor dem Anbringen der Umverdrahtungsschichten zu Halbleiterchips vereinzelt. Damit ist der Vorteil verbunden, dass eine flexible Fertigung von unterschiedlichen elektronischen Bauteilen auf einer Fertigungslinie ermöglicht ist. Wenn die Halbleiterchips zuvor vereinzelt und erst danach mit Umverdrahtungsschichten verbunden werden, können ggf. auf einer Linie unterschiedliche Bauteile gruppiert und zusammen gefügt werden.
- Gemäß einem alternativen Ausführungsbeispiel des Verfahrens werden die Halbleiterwafer nach der Montage der Umverdrahtungsschichten auf den Halbleiterchips zu elektronischen Bauteilen vereinzelt. Damit ist der Vorteil einer besonders schnellen Verarbeitung in größeren Chargen verbunden. Bei einer Verbindung der Umverdrahtungsschichten bereits am Halbleiterwafer können in einem Arbeitsgang eine Vielzahl von elektronischen Bauteilen hergestellt werden, die erst in einem folgenden Verarbeitungsschritt zu einzelnen Bausteinen getrennt werden. Die Umverdrahtungsschichten können dabei wahlweise zusammen mit dem Wafer zersägt werden oder bereits als einzelne Teile mit den zu vereinzelnden Halbleiterchips verbunden werden.
- Eine Ausführungsform des erfindungsgemäßen Verfahrens sieht vor, dass als flache Zwischenschicht eine zweiseitig klebende Folie zwischen Umverdrahtungsschicht und Leiterplatte aufgebracht wird, was den Vorteil einer leicht handhabbaren und stabilen Bauteilverbindung zwischen Umverdrahtungsschicht und Leiterplatte hat.
- Eine weitere Ausführungsform des erfindungsgemäßen Verfahrens ist dadurch gekennzeichnet, dass als flache Zwischenschicht ein Sockel an der Umverdrahtungsschicht oder an der Leiterplatte aufgebracht wird, auf den eine dünne Klebefolie aufgebracht wird. Diese Ausführungsform hat den Vorteil, dass der stabile Sockel auf einfache Weise sehr exakt maßhaltig ausgeführt werden kann, wogegen als dünne klebende Folie eine handelsübliche Folie Verwendung finden kann. Als Sockel kommt bspw. ein thermoplastischer Kunststoff oder dergl. in Frage, der sich im Spritzgussverfahren verarbeiten lässt.
- Gemäß einer Ausführungsform des erfindungsgemäßen Verfahrens haftet die Klebeverbindung an der Leiterplatte stärker als an der Umverdrahtungsschicht, was den Vorteil hat, dass ein als defekt getesteter Halbleiterchip auf einfache Weise wieder von Leiterplatte gelöst werden kann, ohne dass dabei die Gefahr einer Ablösung der Klebefolie besteht.
- Schließlich sieht eine Ausführungsform des erfindungsgemäßen Verfahrens ein Verkleben und/oder Verlöten der flexiblen Kontakte mit den korrespondierenden Kontaktflächen der Leiterplatte vor. Damit ist der Vorteil einer noch stabileren mechanischen Verbindung zwischen Leiterplatte und Umverdrahtungsschicht verbunden. Zudem kann auf diese Weise noch sicherer gewährleistet werden, dass alle flexiblen Kontakte den elektrischen Strom leiten und nicht bspw. aufgrund eines schlechten Kontaktes eine fehlerhafte Verbindung entsteht.
- Ein letztes erfindungsgemäßes Ausführungsbeispiel sieht vor, dass die Halbleiterchips nach der Montage der Umverdrahtungsschicht auf der Leiterplatte getestet werden und dass nach der Feststellung eines defekten Halbleiterchips die Klebeverbindung lösbar und wieder verwendbar ist. Dieses Ausführungsbeispiel hat den besonderen Vorteil einer schnellen und unkomplizierten Austauschbarkeit von defekten Teilen. Dieser Austausch kann in sehr kurzen Taktzyklen erfolgen; zudem kann auf die zuvor gelöste Klebestelle problemlos ein neuer Halbleiterchip gesetzt werden, ohne dass irgend welche weiteren Verarbeitungsschritte notwendig wären.
- Zusammenfassend ergeben sich die folgenden Aspekte der vorliegenden Erfindung. Der Basisgedanke besteht in der Gestaltung einer sog. CSP (Chip Size Package) mit in vertikaler Richtung elastischen sog. Interconnect-Elementen und im Anheften eines solchen Chips auf einem handelsüblichen Board bzw. Leiterplatte unter einer geeigneten Vorspannung der elastischen Interconnect-Elemente, so dass federnde elektrische Kontakte zwischen Umverdrahtungsschicht mit darauf montiertem Halbleiterchip und Leiterplatte entstehen. Die technische Realisierung kann bspw. folgendermaßen aussehen. Ein Chip wird mittels Chip-Bonder direkt vom Wafer auf das Board positioniert und dabei so stark angedrückt, dass eine zwischen Chip und Board befindliche Kleber- bzw. Haftschicht das Anheften des Chips auf dem Board bewirkt. Aufgrund der geringeren Dicke der Kleberschicht als die Höhe der entspannten elastischen Interconnect-Elemente drückt der Chipbonder die elastischen Kontakte während der Positionierung soweit durch, bis der mechanische Anschlag durch die Kleberschicht erreicht ist. Die auf diese Weise vorgespannten elastischen Interconnect-Elemente bilden einen zuverlässigen elektrischen Kontakt zwischen Chip und Board bzw. Umverdrahtungsschicht.
- Die Taktzeit für die Herstellung dieser Verbindungen ist sehr kurz und kann weniger als eine Sekunde betragen. Wird zudem die Klebekraft so bemessen, dass der Halbleiterchip bei einer definierten senkrechten Zugbelastung wieder vom Board gelöst werden kann, ist ein leichter Austausch eines defekten Chips auf dem Board möglich. Auf der gleichen Position kann dann problemlos ein neuer Halbleiterchip angebracht werden. Genügt die elektrische Verbindung der Druckkontakte nicht den gewünschten Anforderungen, so kann durch einen anschließenden thermischen Prozess wie bspw. Löten, Kleben oder Erzeugung von intermetallischen Phasen eine weitere mechanische Verstärkung der Verbindung und/oder eine Verbesserung der elektrischen Kontakteigenschaften erreicht werden. Hierbei ist allerdings eine Präparierung der Kontaktelemente vor der Montage erforderlich.
- Die haftende Zwischenschicht zur Verbindung von Halbleiterchip und Board kann in einer ersten Variante als beidseitig haftende Klebefolie ausgebildet sein, die in ihrer Dicke geringfügig kleiner als die Höhe der entspannten elastischen Interconnect-Elemente ist. Die Klebekraft auf der Boardseite ist zweckmäßigerweise deutlich größer als auf der Chipseite, damit der Halbleiterchip ggf. leicht wieder vom Board gelöst und ein neuer Chip aufgesetzt werden kann. Die Klebefolie kann mehrteilig oder perforiert ausgeführt sein, wobei in den Lücken die Interconnect-Elemente angeordnet sind.
- Bei einer weiteren Variante kann auf dem Wafer mit den bereits aufgebrachten elastischen Interconnect-Elementen zusätzlich ein einteilig durchbrochener oder mehrteiliger Sockel aufgebracht werden, bspw. mittels kostensparender Drucktechnik. Die Sockelschicht ist wiederum geringfügig niedriger als die elastischen Kontakte und stellt damit beim Aufsetzen des Boards einen vertikalen Anschlag dar. Das Aufbringen einer sehr dünnen Klebeschicht kann sowohl auf dem Board wie auch auf dem Wafer erfolgen. Wird sie auf dem Wafer aufgetragen, kann sie in einer weiteren Funktion auch bei Testläufen sowie beim sog. Burn-in als Klebe-/Haftverbindung dienen, was die Nutzung von herkömmlichen Sockeln mit mechanischen Schnappverschlüssen entbehrlich macht.
- Die Erfindung wird nun anhand von Ausführungsformen mit Bezug auf die beiliegenden Figuren näher erläutert.
- Fig. 1 bis 5 zeigen in fünf aufeinander folgenden schematischen Querschnittdarstellungen eine erste Variante der Prozessschritte beim Zusammenfügen eines Halbleiterchips mit einer Umverdrahtungsschicht und einer Leiterplatte.
- Fig. 6 bis 9 zeigen in vier aufeinander folgenden schematischen Querschnittdarstellungen eine zweite Variante der Prozessschritte beim Fügen des Halbleiterchips mit der Umverdrahtungsschicht und der Leiterplatte.
- Die Fig. 1 bis 5 zeigen in fünf aufeinander folgenden schematischen Querschnittdarstellungen eine erste Variante der Prozessschritte beim Zusammenfügen eines Halbleiterchips 1 mit einer Umverdrahtungsschicht 2 und mit einer Leiterplatte 18. Wie in Fig. 1 erkennbar ist, weist der Halbleiterchip 1 eine aktive Vorderseite 4 mit aufgebrachten Halbleiterstrukturen und eine passive Rückseite 6 ohne Halbleiterstrukturen auf. Mit der aktiven Vorderseite 4 ist der Halbleiterchip 1 mit einer Umverdrahtungsschicht 2 verbunden, auf der eine Anzahl von Leiterbahnen 8 aufgebracht sind, die jeweils in einem bogen- bzw. höckerförmigen flexiblen Kontakt 10 enden. Jeder dieser flexiblen Kontakte 10 besteht aus einem flachen Leiterbahnabschnitt, der auf senkrechten Druck elastisch nachgibt. Ein zur Oberfläche der Umverdrahtungsschicht 2 abschnittsweise paralleler Bogenabschnitt 11 ist so verrundet, dass der federnde Kontakt 10 beim Aufsetzen auf eine Kontaktfläche leicht auf dieser entlang gleiten kann. An seinem der aktiven Vorderseite 4 zugewandten inneren Bogenabschnitt kann jeder federnde Kontakt 10 mit einer elastischen Stütz- bzw. Zwischenschicht 9 versehen sein, die ein Verbiegen der Kontakte 10 bei versehentlicher Berührung oder dergl. verhindern kann. Zudem wirkt die elastische Zwischenschicht 9 als progressive Feder bei stärkerer Eindrückung der Kontakte 10, der sie einen zunehmenden Widerstand entgegen setzt. An der der Umverdrahtungsschicht 2 abgewandten passiven Rückseite 6 des Halbleiterchips 1 ist dieser sowie die Umverdrahtungsschicht 2 von einem Gehäuse 7 bedeckt, das bspw. aus einem gespritzten Kunststoff, einem Keramikmaterial oder dergl. bestehen kann.
- In Fig. 2 ist eine Zwischenschicht 12 gezeigt, die mehrere Aussparungen aufweist. In den Aussparungen befinden sich bei auf der Umverdrahtungsschicht 2 aufgebrachter Zwischenschicht 12 die flexiblen Kontakte 10. Die Zwischenschicht 12 hat somit im gezeigten Ausführungsbeispiel eine gitternetzartige Struktur. Auf der dem Halbleiterchip 1 und der Umverdrahtungsschicht 2 zugewandten Seite ist die Zwischenschicht 12 mit einer ersten Klebeschicht 14 bedeckt, die für eine feste Haftung an der Umverdrahtungsschicht 2 sorgt. An ihrer gegenüberliegenden Oberfläche ist die Zwischenschicht 12 mit einer zweiten Klebeschicht 16 bedeckt, die ebenfalls für eine feste Haftung auf einer in Fig. 3 gezeigten Leiterplatte 18 sorgt.
- Fig. 3 zeigt eine Leiterplatte 18, die mit Kontaktflächen 20 versehen ist, welche mit den Bogenabschnitten 11 der flexiblen Kontakte 10 korrespondieren und bei aufgesetzter Umverdrahtungsschicht 2 einen elektrischen Kontakt mit dieser und somit mit dem Halbleiterchip 1 herstellen.
- In Fig. 4 ist die Zwischenschicht 12 mit ihrer zweiten Klebeschicht 16 auf die Leiterplatte 18 aufgeklebt, wobei die Aussparungen der Zwischenschicht 12 die Kontaktflächen 20frei lassen, damit in diese Zwischenräume anschließend die flexiblen Kontakte 10 eingesetzt werden können.
- Fig. 5 zeigt das zusammengefügte elektronische Bauteil aus Halbleiterchip 1, Umverdrahtungsschicht 2, Zwischenschicht 12 und Leiterplatte 18. Es kann vorteilhaft sein, wenn die zweite Klebeschicht 16 stärker haftet als die erste Klebeschicht 14, weil dann eine Umverdrahtungsschicht 2 mit Halbleiterchip 1 problemlos wieder von der Zwischenschicht 12 senkrecht abgezogen werden kann, wenn bspw. ein Defekt am Halbleiterchip 1 festgestellt wurde. Da die Klebeschicht 14 mehrfach verwendbar ist, kann in diesem Fall ein neuer Halbleiterchip 1 mit Umverdrahtungsschicht 2 auf die Zwischenschicht 12 aufgesetzt werden, wobei dessen flexible Kontakte 10 erneut auf den Kontaktflächen 20 aufsetzen und für eine elektrische Verbindung zwischen Leiterplatte 18 und Halbleiterchip 1 mit Umverdrahtungsschicht 2 sorgen.
- Die Fig. 6 bis 9 zeigen in vier aufeinander folgenden schematischen Querschnittdarstellungen eine alternative Variante der Prozessschritte beim Fügen des Halbleiterchips 1 mit der Umverdrahtungsschicht 2 sowie mit der Leiterplatte 18.
- Fig. 6 entspricht dabei im wesentlichen der bereits zuvor beschriebenen Fig. 1.
- Fig. 7 zeigt im Unterschied zur oben beschriebenen Variante einen mit der Umverdrahtungsschicht 2 fest verbundenen Sockel 22, der bspw. aus Kunststoff besteht und fest mit der Umverdrahtungsschicht 2 verbunden ist.
- Fig. 8 verdeutlicht, dass die entspannten flexiblen Kontakte 10 mit ihren Bogenabschnitten 11 leicht über die äußere Begrenzung des Sockels 22 sowie der darauf aufgebrachten dritten Klebeschicht 24 hinaus ragen.
- Fig. 9 zeigt die flexiblen Kontakte 10 im auf der Leiterplatte 18 aufgesetzten Zustand. Dabei werden die flexiblen Kontakte 10 elastisch verformt, bis der Sockel 22 mit seiner dritten Klebeschicht 24 voll auf der Leiterplatte 18 aufliegt und einen mechanischen Anschlag bildet.
- Anhand der Fig. 1 bis 9 wird im folgenden das erfindungsgemäße Verfahren zur Herstellung des zuvor beschriebenen elektronischen Bauteils dargestellt. Dabei werden nach dem Bereitstellen eines Halbleiterwafers mit in Zeilen und Spalten angeordneten Halbleiterchips und dazwischen vorgesehenen Sägespurbereichen auf den aktiven Seiten 4 der Halbleiterchips 1 Umverdrahtungsschichten 2 montiert, die an ihren den Halbleiterchips 1 abgewandten Oberflächen mit flexiblen Kontakten 10 versehen werden. Danach werden flache Zwischenschichten 12 bzw. Sockel 22 an den Unterseiten jeder Umverdrahtungsschicht 2 aufgebracht, wonach ein Verkleben der Umverdrahtungsschicht 2 mit Leiterplatten 18 erfolgt. Dabei können wahlweise nur ein oder auch mehrere Halbleiterchips 1 auf einer Umverdrahtungsschicht 2 angebracht sein. Ebenso können nur ein oder auch mehrere Umverdrahtungsschichten 2 mit einer Leiterplatte 18 verbunden sein.
- Die Vereinzelung der Halbleiterwafer zu Halbleiterchips 1 kann entweder nach dem Aufbringen der Leiterplatten 18 oder bereits zuvor erfolgen. Im zweiten Fall werden die vereinzelten Halbleiterchips 1 wie oben beschrieben mit den Leiterplatten 18 verbunden.
- Die Herstellung der Umverdrahtungsschichten 2 kann in vorteilhafter Weise durch Aufbringen eines dünnen Dielektrikums (bspw. ca. 5 µm) auf einen Halbleiterwafer erfolgen, auf dem eine metallische Schicht aufgebracht oder abgeschieden wird. Die metallische Schicht weist bspw. Kupfer oder Aluminium auf und kann bspw. mittels Sputtern oder in Dünnfilmtechnik aufgebracht werden. Nach Aufbringen eines Fotolackes, Belichten und Entwickeln dieser fotoempfindlichen Schicht werden die Leiterbahnen 8 durch Ätzen freigelegt. Durch Strukturierung von Leiterbahnenden auf den Höckern der elastischen Zwischenschicht 9 werden die flexiblen Kontakte 10 hergestellt. Die elastische Zwischenschicht 9 kann bspw. aus Silikon bestehen. Bezugszeichenliste 1 Halbleiterchip
2 Umverdrahtungsschicht
4 aktive Vorderseite
6 passive Rückseite
7 Gehäuse
8 Leiterbahn
9 elastische Zwischenschicht
10 flexibler Kontakt
11 Bogenabschnitt
12 Zwischenschicht
14 erste Klebeschicht
16 zweite Klebeschicht
18 Leiterplatte
20 Kontaktfläche
22 Sockel
24 dritte Klebeschicht
Claims (24)
1. Elektronisches Bauteil mit wenigstens einem
Halbleiterchip (1), mit einer mit dem wenigstens einen
Halbleiterchip (1) verbundenen Umverdrahtungsschicht (2) und mit
einer der Umverdrahtungsschicht (2) zugeordneten
Leiterplatte (18), wobei die Umverdrahtungsschicht (2) an
ihrer dem wenigstens einen Halbleiterchip (1) abgewandten
Oberfläche mit flexiblen Kontakten (10) versehen ist,
die mit Kontaktflächen (20) der Leiterplatte (18)
korrespondieren, und wobei die Umverdrahtungsschicht (2) über
eine flache Zwischenschicht (12; 22) mit der
Leiterplatte (18) fest verbunden ist.
2. Elektronisches Bauteil nach Anspruch 1,
dadurch gekennzeichnet, dass
die Umverdrahtungsschicht (2) mit dem wenigstens einen
Halbleiterchip (1) und die Leiterplatte (18) in einem
definierten Abstand zueinander montiert sind.
3. Elektronisches Bauteil nach Anspruch 1 oder 2,
dadurch gekennzeichnet, dass
die flexiblen Kontakte (10) der Umverdrahtungsschicht
(2) bei montierter Umverdrahtungsschicht (2) unter einer
Vorspannung stehen.
4. Elektronisches Bauteil nach einem der Ansprüche 1 bis 3,
dadurch gekennzeichnet, dass
die flexiblen Kontakte (10) die flache Zwischenschicht
(12; 22) zwischen der Umverdrahtungsschicht (2) und der
Leiterplatte (18) im entspannten Zustand geringfügig
überragen.
5. Elektronisches Bauteil nach einem der vorstehenden
Ansprüche,
dadurch gekennzeichnet, dass
die flache Zwischenschicht (12; 22) aus einem Kunststoff
besteht.
6. Elektronisches Bauteil nach einem der vorstehenden
Ansprüche,
dadurch gekennzeichnet, dass
die flache Zwischenschicht (12; 22) mehrteilig
ausgeführt ist und nur in Zwischenräumen zwischen
benachbarten flexiblen Kontakten (10) und/oder Gruppen von
flexiblen Kontakten (10) aufgebracht ist.
7. Elektronisches Bauteil nach einem der vorstehenden
Ansprüche,
dadurch gekennzeichnet, dass
die flache Zwischenschicht (12; 22) perforiert ist und
dass in den Zwischenräumen flexible Kontakte (10)
angeordnet sind.
8. Elektronisches Bauteil nach einem der vorstehenden
Ansprüche,
dadurch gekennzeichnet, dass
die flache Zwischenschicht (12) eine beidseitig klebende
Folie ist.
9. Elektronisches Bauteil nach einem der vorstehenden
Ansprüche,
dadurch gekennzeichnet, dass
die flache Zwischenschicht als einteilig perforierter
oder mehrteiliger Sockel (22) an der
Umverdrahtungsschicht (2) ausgeführt ist, auf dem eine dünne klebende
Folie (26) befestigt ist.
10. Elektronisches Bauteil nach einem der Ansprüche 1 bis 8,
dadurch gekennzeichnet, dass
die flache Zwischenschicht als einteilig perforierter
oder mehrteiliger Sockel (22) an der Leiterplatte (18)
ausgeführt ist, auf dem eine dünne klebende Folie (26)
befestigt ist.
11. Elektronisches Bauteil nach einem der vorstehenden
Ansprüche,
dadurch gekennzeichnet, dass
die Klebeverbindung an der Leiterplatte (18) stärker
haftet als an der Umverdrahtungsschicht (2).
12. Elektronisches Bauteil nach einem der vorstehenden
Ansprüche,
dadurch gekennzeichnet, dass
die Klebeverbindung an der Umverdrahtungsschicht (2)
lösbar ausgeführt ist.
13. Elektronisches Bauteil nach einem der vorstehenden
Ansprüche,
dadurch gekennzeichnet, dass
die Klebeverbindung an der Umverdrahtungsschicht (2)
nach dem Ablösen einer montierten Umverdrahtungsschicht
(2) wiederholt verwendbar ist.
14. Elektronisches Bauteil nach einem der vorstehenden
Ansprüche,
dadurch gekennzeichnet, dass
die flexiblen Kontakte (10) jeweils in Form eines
Kontakthöckers ausgebildet sind.
15. Elektronisches Bauteil nach einem der vorstehenden
Ansprüche,
dadurch gekennzeichnet, dass
die flexiblen Kontakte (10) mit den jeweils
korrespondierenden Kontaktflächen (20) der Leiterplatte (18) in
Berührkontakt stehen.
16. Elektronisches Bauteil nach einem der Ansprüche 1 bis
14,
dadurch gekennzeichnet, dass
die flexiblen Kontakte (10) mit den jeweils
korrespondierenden Kontaktflächen (20) der Leiterplatte (18)
verlötet und/oder verklebt sind.
17. Verfahren zur Herstellung eines elektronischen Bauteils,
mit wenigstens einem Halbleiterchip (1), der auf einer
Umverdrahtungsschicht (2) montiert ist, und mit einer
der Umverdrahtungsschicht (2) zugeordneten Leiterplatte
(18), wobei die Umverdrahtungsschicht (2) mit dem
wenigstens einen Halbleiterchip (1) mit flexiblen Kontakten
(10) versehen ist, die mit Kontaktflächen (20) der
Leiterplatte (18) korrespondieren, und wobei die
Umverdrahtungsschicht (2) über eine flache Zwischenschicht (12;
22) mit der Leiterplatte (18) fest verbunden ist, wobei
das Verfahren zumindest folgende Verfahrensschritte
aufweist:
- Bereitstellen eines Halbleiterwafers mit in Zeilen
und Spalten angeordneten Halbleiterchips (1) und
dazwischen vorgesehenen Sägespurbereichen,
- Aufbringen jeweils einer Umverdrahtungsschicht (2)
auf den aktiven Vorderseiten (4) der
Halbleiterchips (1),
- Aufbringen von flexiblen Kontakten (10) an den den
aktiven Vorderseiten (4) der Halbleiterchips (1)
abgewandten Oberflächen der Umverdrahtungsschichten
(2),
- Aufbringen einer flachen Zwischenschicht (12; 22)
an den dem Halbleiterchip (1) abgewandten Seiten
der Umverdrahtungsschichten (2),
- Verkleben der Umverdrahtungsschichten (2) mit
Leiterplatten (18).
18. Verfahren nach Anspruch 17,
dadurch gekennzeichnet, dass
die Halbleiterwafer nach dem Aufbringen der
Umverdrahtungsschichten (2) zu Halbleiterchips (1) vereinzelt
werden.
19. Verfahren nach Anspruch 17 oder 18,
dadurch gekennzeichnet, dass
als flache Zwischenschicht (12) eine zweiseitig klebende
Folie zwischen Umverdrahtungsschicht (2) und
Leiterplatte (18) aufgebracht wird.
20. Verfahren nach Anspruch 17 oder 18,
dadurch gekennzeichnet, dass
als flache Zwischenschicht ein Sockel (22) an der
Umverdrahtungsschicht (2) oder an der Leiterplatte (18)
aufgebracht wird, auf den eine dünne Klebefolie aufgebracht
wird.
21. Verfahren nach einem der Ansprüche 17 bis 20,
dadurch gekennzeichnet, dass
die Klebeverbindung an der Leiterplatte (18) stärker
haftet als an der Umverdrahtungsschicht (2).
22. Verfahren nach einem der Ansprüche 17 bis 21,
dadurch gekennzeichnet, dass
die flexiblen Kontakte (10) mit den korrespondierenden
Kontaktflächen (20) der Leiterplatte (18) verlötet und/
oder verklebt werden.
23. Verfahren nach einem der Ansprüche 17 bis 22,
dadurch gekennzeichnet, dass
die Halbleiterchips (1) mit ihrer Umverdrahtungsschicht
(2) nach der Montage auf der Leiterplatte (18) getestet
werden und dass nach der Feststellung eines defekten
Halbleiterchips (1) die Klebeverbindung lösbar und
wieder verwendbar ist.
24. Verfahren nach einem der Ansprüche 17 bis 23 zur
Herstellung eines elektronischen Bauteils nach wenigstens
einem der Ansprüche 1 bis 16.
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DE10143790A DE10143790B4 (de) | 2001-09-06 | 2001-09-06 | Elektronisches Bauteil mit wenigstens einem Halbleiterchip |
Publications (2)
Publication Number | Publication Date |
---|---|
DE10143790A1 true DE10143790A1 (de) | 2003-03-27 |
DE10143790B4 DE10143790B4 (de) | 2007-08-02 |
Family
ID=7697973
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
DE10143790A Expired - Fee Related DE10143790B4 (de) | 2001-09-06 | 2001-09-06 | Elektronisches Bauteil mit wenigstens einem Halbleiterchip |
Country Status (2)
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- 2002-09-06 US US10/236,895 patent/US6807064B2/en not_active Expired - Lifetime
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