CN115101022A - 一种像素驱动电路、显示面板及显示装置 - Google Patents

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Abstract

本发明公开了一种像素驱动电路、显示面板及显示装置，像素驱动电路包括：驱动模块、第一初始化模块、存储模块、阈值补偿模块、数据写入模块和发光模块；驱动模块、第一初始化模块和阈值补偿模块的晶体管中的至少一个采用第一双栅结构；采用第一双栅结构的晶体管包括控制端和第一底栅电极；第一底栅电极用于接入第一调制电压。通过在驱动模块、第一初始化模块和阈值补偿模块的晶体管中的至少一个采用第一双栅结构，改善像素驱动电路中晶体管的迟滞现象，进而提升显示面板的显示效果。

Description

一种像素驱动电路、显示面板及显示装置
技术领域
本发明涉及显示技术领域，尤其涉及一种像素驱动电路、显示面板及显示装置。
背景技术
薄膜晶体管(即TFT)被广泛用作显示面板(例如，液晶面板或有机发光显示面板)中的开关元件。因此，形成有薄膜晶体管的阵列基板是针对显示装置构造的显示面板的基本元件。
然而，阵列基板的显示驱动电路中，存在薄膜晶体管迟滞现象，严重影响显示装置的显示效果。
发明内容
本发明实施例提供了一种像素驱动电路、显示面板及显示装置，以改善像素驱动电路中晶体管的迟滞现象。
第一方面，本发明实施例提供了一种像素驱动电路，包括：驱动模块、第一初始化模块、存储模块、阈值补偿模块、数据写入模块和发光模块；
所述驱动模块的第一端用于输入第一电源输入的信号；所述驱动模块的第二端用于为所述发光模块提供发光驱动信号；所述存储模块连接于所述驱动模块的控制端和所述驱动模块的第一端之间；所述阈值补偿模块连接于所述驱动模块的控制端和所述驱动模块的第二端之间；
所述数据写入模块连接所述驱动模块的第一端，用于向所述驱动模块传输数据电压；所述第一初始化模块连接于第一参考电压输出端和所述驱动模块的第一端之间，用于为所述驱动模块提供第一初始化电压；
所述驱动模块、第一初始化模块和阈值补偿模块的晶体管中的至少一个采用第一双栅结构；采用第一双栅结构的所述晶体管包括控制端和第一底栅电极；所述第一底栅电极用于接入第一调制电压。
第二方面，本发明实施例还提供了一种显示面板，包括第一方面中任一项所述的像素驱动电路。
第三方面，本发明实施例还提供了一种显示装置，包括第二方面中所述的显示面板。
本发明中提供一种像素驱动电路、显示面板及显示装置，像素驱动电路包括：驱动模块、第一初始化模块、存储模块、阈值补偿模块、数据写入模块和发光模块；驱动模块的第一端用于输入第一电源输入的信号；驱动模块的第二端用于为发光模块提供发光驱动信号；存储模块连接于驱动模块的控制端和驱动模块的第一端之间；阈值补偿模块连接于驱动模块的控制端和驱动模块的第二端之间；数据写入模块连接驱动模块的第一端，用于向驱动模块传输数据电压；第一初始化模块连接于第一参考电压输出端和驱动模块的第一端之间，用于为驱动模块提供第一初始化电压；驱动模块、第一初始化模块和阈值补偿模块的晶体管中的至少一个采用第一双栅结构；采用第一双栅结构的晶体管包括控制端和第一底栅电极；第一底栅电极用于接入第一调制电压。通过在驱动模块、第一初始化模块和阈值补偿模块的晶体管中的至少一个采用第一双栅结构，改善像素驱动电路中晶体管的迟滞现象，进而提升显示面板的显示效果，并且第一底栅电极能够起到一定光线屏蔽作用，在蓝光光照可靠性试验中减缓晶体管器件的退化现象，提高显示面板可靠性。
附图说明
图1为本发明实施例提供的一种像素驱动电路的结构示意图；
图2为本发明实施例提供的另一种像素驱动电路的结构示意图；
图3为第一双栅结构的晶体管的剖面结构示意图；
图4为本发明实施例提供的另一种像素驱动电路的结构示意图；
图5本发明实施例提供的另一种像素驱动电路的结构示意图；
图6为本发明实施例提供的另一种像素驱动电路的结构示意图；
图7为本发明实施例提供的另一种像素驱动电路的结构示意图；
图8为本发明实施例提供的另一种像素驱动电路的结构示意图；
图9为本发明实施例提供的一种像素驱动电路的时序图；
图10为本发明实施例提供的另一种像素驱动电路的结构示意图；
图11为本发明实施例提供的另一种像素驱动电路的结构示意图；
图12为本发明实施例提供的另一种像素驱动电路的结构示意图；
图13为本发明实施例提供的另一种像素驱动电路的结构示意图；
图14为本发明实施例提供的另一种像素驱动电路的结构示意图；
图15为本发明实施例提供的一种显示装置的结构示意图。
具体实施方式
下面结合附图和实施例对本发明作进一步的详细说明。可以理解的是，此处所描述的具体实施例仅仅用于解释本发明，而非对本发明的限定。另外还需要说明的是，为了便于描述，附图中仅示出了与本发明相关的部分而非全部结构。
现有技术中，对于传统的像素驱动电路中，例如7T1C电路，对于像素驱动电路中的晶体管通常为单栅的P型晶体管或N型晶体管，在不同的阶段对晶体管进行打开过程中，晶体管容易出现迟滞问题，严重影响显示面板的显示效果。
本发明实施例中，通过提供一种像素驱动电路、显示面板及显示装置，像素驱动电路包括：驱动模块、第一初始化模块、存储模块、阈值补偿模块、数据写入模块和发光模块；驱动模块的第一端用于输入第一电源输入的信号；驱动模块的第二端用于为发光模块提供发光驱动信号；存储模块连接于驱动模块的控制端和驱动模块的第一端之间；阈值补偿模块连接于驱动模块的控制端和驱动模块的第二端之间；数据写入模块连接驱动模块的第一端，用于向驱动模块传输数据电压；第一初始化模块连接于第一参考电压输出端和驱动模块的控制端之间，用于为驱动模块提供第一初始化电压；驱动模块、第一初始化模块和阈值补偿模块的晶体管中的至少一个采用第一双栅结构；采用第一双栅结构的晶体管包括控制端和第一底栅电极；第一底栅电极用于接入第一调制电压。通过将像素驱动电路中的驱动模块、第一初始化模块和阈值补偿模块的晶体管中的至少一个采用第一双栅结构，并在第一双栅结构的第一底栅电极上接入第一调制电压，使其对第一双栅结构的晶体管的阈值电压进行调制，改善晶体管的迟滞现象，进而改善显示面板的拖影、残影，显示不均的现象，保证显示面板的正常显示。并且第一底栅电极能够起到一定光线屏蔽作用，在蓝光光照可靠性试验中减缓晶体管器件的退化现象，例如，对于正偏光照(PBIS)，负偏光照(NBIS)等可靠性测试，第一底栅电极可有效减缓晶体管的退化，提高显示面板可靠性。
以上是本发明的核心思想，下面将结合本发明实施例中的附图，对本发明实施例中的技术方案进行清楚、完整地描述。基于本发明中的实施例，本领域普通技术人员在没有做出创造性劳动前提下，所获得的所有其他实施例，都属于本发明保护的范围。
图1为本发明实施例提供的一种像素驱动电路的结构示意图，图2为本发明实施例提供的另一种像素驱动电路的结构示意图，如图1和图2所示，像素驱动电路包括：驱动模块101、第一初始化模块102、存储模块103、阈值补偿模块104、数据写入模块105和发光模块106；驱动模块101的第一端用于输入第一电源输入的信号；驱动模块101的第二端用于为发光模块106提供发光驱动信号；存储模块103连接于驱动模块101的控制端和驱动模块101的第一端之间；阈值补偿模块104连接于驱动模块101的控制端和驱动模块101的第二端之间；数据写入模块105连接驱动模块101的第一端，用于向驱动模块101传输数据电压；第一初始化模块102连接于第一参考电压输出端和驱动模块101的控制端之间，用于为驱动模块101提供第一初始化电压；驱动模块101、第一初始化模块102和阈值补偿模块104的晶体管中的至少一个采用第一双栅结构；采用第一双栅结构的晶体管包括控制端和第一底栅电极1001；第一底栅电极1001用于接入第一调制电压V1。
其中，发光模块106例如可以是OLED(Organic Light-Emitting Diode，有机发光二极管)，OLED为电流型器件，需要在驱动电流的作用下才能够发光，驱动模块101能够根据数据电压信号产生相应的驱动电流，以驱动发光模块106显示不同的灰阶，从而使得显示面板可以显示待显示画面。像素驱动电路的具体工作过程包括初始化阶段、数据写入阶段和发光阶段；初始化阶段包括第一初始化阶段，第一初始化模块102与驱动模块101的控制端连接，在第一初始化阶段，第一初始化模块102导通，第一初始化模块102将第一参考电压输出端输出的第一初始化电压Vref1传输至驱动模块101的控制端进行初始化，从而可以清除上一帧画面的残留电荷，以提高显示面板的显示效果；在数据写入阶段，第一初始化模块102关断，数据写入模块105和阈值补偿模块104导通，数据写入模块105连接驱动模块101的第一端，数据写入模块105将数据电压信号Vdata写入驱动模块101，阈值补偿模块104连接于驱动模块101的控制端和驱动模块101的第二端之间，阈值补偿模块104可以抓取驱动模块101的阈值电压至驱动模块101的控制端，实现阈值电压的补偿；并且存储模块103连接于驱动模块101的控制端和驱动模块101的第一端之间，存储模块103可以维持驱动模块101的控制端的电位，避免当第一初始化模块102关断时，驱动模块101的控制端的电位被耦合而变化；在发光阶段，第一初始化模块102、数据写入模块105、阈值补偿模块104均关断，驱动模块101导通，驱动模块101的第二端与发光元件连接，用于为发光模块106提供发光驱动电流，发光模块106响应发光驱动电流发光，从而显示待显示亮度。对于现有技术中驱动模块101、第一初始化模块102和阈值补偿模块104的晶体管为传统的单栅P型晶体管，在使用过程中会存在迟滞现象，进而影响显示面板的显示效果，通过将驱动模块101、第一初始化模块102和阈值补偿模块104的晶体管中的至少一个采用第一双栅结构，示例性的，如图2所示，以驱动模块101的晶体管均为第一双栅结构为例进行展示，图3为第一双栅结构的晶体管的剖面结构示意图，如图3所示，第一双栅结构的晶体管包括控制端和第一底栅电极1001，第一双栅结构的晶体管包括半导体层121、第一栅极122、源极123、漏极124以及第二栅极125，即第二栅极则为第一底栅电极1001，其中第一底栅电极1001既可以起到屏蔽光线的作用，改善晶体管的迟滞现象，进而改善显示面板的拖影、残影，显示不均的现象，保证显示面板的正常显示。第一底栅电极1001接入第一调制电压V1，上述第一调制电压V1可以单独设置，也可以为像素驱动电路中已存在信号，例如，第一调制电压V1可以选取第一电源输出的第一电源信号PVDD，也可以为栅极驱动电路的高电压信号VGH，此外，还可以为发光模块连接的第二电源输出的第二电源信号PVEE，栅极驱动电路的低电压信号VGL、或者第一参考电压输出端输出的第一参考电压VREF1。
此外，第一调制电压V1还可以对第一栅极122(控制端)的阈值电压进行调整，具体使得第一底栅电极1001接入第一调制电压V1，影响晶体管中半导体层内导电沟道的宽度，从而影响晶体管的阈值电压。第一调制电压V1可以为固定电压信号，第一调制电压V1可以为正电压信号也可以为负电压信号，当需要对晶体管的阈值电压进行调整时，可设置第一调制电压V1的具体电压值，例如，对于P型晶体管而言，当第一底栅电极1001接入第一调制电压V1为PVDD，例如为6V时，第一底栅电极1001形成正电场，使得晶体管沟道难于打开，导致阈值电压负偏，当第一底栅电极1001取值较小时，例如，取负值时，会形成负电场，让晶体管沟道开启容易，导致阈值电压正偏。
可选的，第一调制电压V1小于或等于3V。
当第一调制电压V1小于或等于3V时，一般第一调制电压V1不再负偏，而对于像素驱动电路中的关键模块，例如，驱动模块101、第一初始化模块102和阈值补偿模块104中的晶体管为关键晶体管，为了避免其打开困难，从而造成栅极驱动电路的低电压信号VGL增大从而增大整体功耗的情况，本实施例可有效控制上述各模块的晶体管不处于负偏状态，从而使得关键晶体管便于打开，其中，在晶体管开启过程中，第一调制电压V1起到减轻对晶体管中的控制端上长时间施加电压产生的阈值电压偏离现象，将为第一双栅结构的晶体管中的第一底栅电极1001接入小于或等于3V的第一调制电压V1，避免晶体管中的阈值电压发生负偏现象，保证晶体管的正常开启，有效实现像素驱动电路的驱动过程。
可选的，第一调制电压V1小于或等于0V。为了进一步提高晶体挂开启速度，本实施例可有效控制晶体管正偏，具体将为第一双栅结构的晶体管中的第一底栅电极1001接入小于或等于0V的第一调制电压V1，使得晶体管中的阈值电压发生正偏现象，降低晶体管的开启难度，缩短晶体管的开启时间，提高像素驱动电路的速度，保证显示面板的显示效果。
本发明实施例通过将像素驱动电路中的驱动模块、第一初始化模块和阈值补偿模块的晶体管中的至少一个采用第一双栅结构，并在第一双栅结构的第一底栅电极上接入第一调制电压，使得第一调制电压能够对驱动模块、第一初始化模块和阈值补偿模块中采用第一双栅结构的晶体管的阈值电压进行调制，降低晶体管的负偏现象，改善晶体管的迟滞现象，进而改善显示面板的拖影、残影，显示不均的现象，保证显示面板的正常显示。
可选的，图4为本发明实施例提供的另一种像素驱动电路的结构示意图，如图4所示，阈值补偿模块104的晶体管采用第一双栅结构。
其中，可以将阈值补偿模块104中的晶体管采用第一双栅结构，通过在第一底栅电极1001用于接入第一调制电压V1，当阈值补偿模块104中的晶体管发生负偏，使得晶体管的阈值电压被拉回正常的阈值电压，避免在阈值电压负偏条件下晶体管打开困难，需要更小的低电平信号使得阈值补偿模块104中的晶体管顺利写入电压信号，有效降低像素驱动电路的功耗。
可选的，图5本发明实施例提供的另一种像素驱动电路的结构示意图，如图5所示，第一初始化模块102的晶体管采用第一双栅结构。
其中，第一初始化模块102中晶体管在导通状态下时，栅源电压差较小，若阈值电压负偏，第一初始化模块102难以导通，从而难以保证驱动模块101的控制端的初始化复位，可以将第一初始化模块102中的晶体管采用第一双栅结构，当第一初始化模块102中的晶体管发生负偏，使得晶体管的阈值电压被拉回正常的阈值电压，避免在阈值电压负偏条件下，第一初始化模块102中的晶体管打开困难，需要绝对值更大的低电平信号使得阈值补偿模块104中的晶体管顺利写入第一初始化电压Vref1，有效降低像素驱动电路的功耗，同时第一初始化模块102中的晶体管打开后，可以及时对驱动模块101中的上一帧的电荷残留进行清除，保证显示效果，避免拖影、残影、和显示不均的问题。
可选的，图6为本发明实施例提供的另一种像素驱动电路的结构示意图，如图6所示，第一初始化电压Vref1复用为第一调制电压V1。
其中，如图6所示，驱动模块101、第一初始化模块102和阈值补偿模块104的晶体管中的均采用第一双栅结构，将像素驱动电路中的第一初始化电压Vref1复用为第一调制电压V1，避免额外设置信号线，减少信号线的设置数量，降低工艺难度。同时第一初始化电压Vref1为低电平，使得驱动模块101、第一初始化模块102或阈值补偿模块104中的为第一双栅结构的晶体管的阈值电压不会出现负偏现象，降低晶体管的打开难度，进而降低像素驱动电路的功耗，提高使用寿命。此外，可以设置栅极驱动电路的低电压信号VGL等其他负值信号为第一调制电压V1，本实施例对此不进行特殊限定。示例性的，当晶体管的阈值电压发生负向偏移时，原本-8V的阈值电压发生负向偏移，变为-9V，此时第一调制电压V1为小于0V的固定电压，阈值电压被拉负到-7V，即被修正到绝对值较小的阈值电压，从而避免了晶体管的开启困难。
可选的，图7为本发明实施例提供的另一种像素驱动电路的结构示意图，如图7所示，像素驱动电路还包括：第二初始化模块107；第二初始化模块107连接于第二参考电压输出端VREF2和发光模块106的第一端之间，用于为发光模块106提供第二初始化电压Vref2。
其中，像素驱动电路还包括第二初始化模块107；第二初始化模块107连接于第二参考电压输出端VREF2和发光模块106的第一端之间，从而为发光模块106提供第二初始化电压Vref2，可以清除上一帧画面的残留电荷，使得发光模块106可以更加准确的显示待显示亮度，从而提高显示面板的画面质量，第二初始化模块107的控制端可以接入第一扫描信号线或者第二扫描信号线，使得第二初始化模块107可以在第一初始化阶段或者数据写入阶段初始化发光模块106，可以减少信号线的数量，降低制作成本，简化像素驱动电路的复杂程度。
可选的，图8为本发明实施例提供的另一种像素驱动电路的结构示意图，如图8所示，像素驱动电路还包括：第一发光控制模块108和第二发光控制模块109；第一发光控制模块108连接于第一电源PVDD和驱动模块101的第一端之间；第二发光控制模块109连接于驱动模块101的第二端和发光模块106的第一端之间，发光模块106的第二端连接第二电源PVEE。
其中，像素驱动电路还包括第一发光控制模块108和第二发光控制模块109；第一发光控制模块108连接于第一电源PVDD和驱动模块101的第一端之间；第二发光控制模块109连接于驱动模块101的第二端和发光模块106的第一端之间，发光模106块的第二端连接第二电源PVEE，在发光阶段，第一发光控制模块108和第二发光控制模块109导通，驱动模块101的第一端和第二端之间产生电压差，进而输出发光驱动信号至发光模块106的第一端，发光模块106的第二端连接第二电源PVEE，使得第一电源PVDD、第一发光控制模块108、驱动模块101、第二发光控制模块109、发光模块106和第二电源PVEE之间形成通路，发光模块106发光，以显示待显示亮度。
可选的，图9为本发明实施例提供的一种像素驱动电路的时序图，如图6和图9，存储模块103包括第一电容Cst；第一发光控制模块108包括第一晶体管T1；数据写入模块105包括第二晶体管T2；驱动模块101包括第三晶体管T3；阈值补偿模块104包括第四晶体管T4；第一初始化模块102包括第五晶体管T5；第二发光控制模块109包括第六晶体管T6；第二初始化模块107包括第七晶体管T7；第三晶体管T3的控制端分别与第五晶体管T5的第二端以及第四晶体管T4的第一端连接；第三晶体管T3的第一端与第一晶体管T1的第二端连接；第一晶体管T1的第一端连接第一电源PVDD；第三晶体管T3的第二端分别与第四晶体管T4的第二端和第六晶体管T6的第一端连接；第六晶体管T6的第二端与发光模块106的第一端连接；第五晶体管T5的第一端与第一参考电压输出端VREF1连接；第二晶体管T2的第一端与数据信号线DATA连接；第二晶体管T2的第二端与第三晶体管T3的第一端连接；第七晶体管T7的第一端与第二参考电压输出端VREF2连接；第七晶体管T7的第二端与发光模块106的第一端连接；第三晶体管T3、第四晶体管T4和第五晶体管T5中至少一个采用第一双栅结构；第一晶体管T1和第六晶体管T6的控制端连接发光控制信号线EM；第五晶体管T5的控制端连接第一扫描信号线；第四晶体管T4的控制端、第二晶体管T2的控制端和第七晶体管T7的控制端连接第二扫描信号线。
其中，第一晶体管T1、第二晶体管T2、第三晶体管T3、第四晶体管T4、第五晶体管T5、第六晶体管T6和第七晶体管均为P型晶体管，P型晶体管低电平导通，高电平截止。示例性的以第一初始化电压Vref1为低电平信号为例，对像素驱动电路的工作原理进行说明，在初始化阶段，第一扫描信号线上的信号Sn-1为低电平，第二扫描信号线上的信号Sn和发光控制信号线EM上的信号Emit为高电平，此时第五晶体管T5导通，第一晶体管T1、第二晶体管T2、第三晶体管T3、第四晶体管T4、第六晶体管T6和第七晶体管T7截止，第一参考电压输出端上的电位经第五晶体管T5施加至第一电容Cst，也即第一节点N1的电位为第一初始化电压Vref1，此时，驱动晶体管M3的控制端的电位也为第一初始化电压Vref1。在数据写入阶段，第二扫描线上的信号Sn为低电平，第一扫描线上的信号Sn-1和发光控制信号线EM上的信号Emit为高电平，第二晶体管T2、第四晶体管T4和第七晶体管T7导通，此时数据信号Vdata写入第二晶体管T2和第四晶体管T4，驱动晶体管T3控制端的电位为第一初始化电压Vref1，也是低电位，第三晶体管T3也导通，数据信号线DATA上的数据信号Vdata写入第二晶体管T2、第三晶体管T3和第四晶体管T4，施加到第一节点N1，第一节点N1的电位逐渐被数据信号线DATA上的电位拉高。当第三晶体管T3的栅极电压被拉高到和其源极的电压差小于等于第三晶体管T3的阈值电压时，第三晶体管T3将处于截止状态。在数据写入阶段，第七晶体管T7也导通，第七晶体管M7将第二参考电压线上的第二初始化电压Vref2写入发光模块106的第一极，对发光模块106的第一极电位进行初始化，可以降低前一帧发光模块106的第一极的电压对后一帧发光模块106的第一极的电压的影响，进一步提高显示均一性。在发光阶段，发光控制信号线EM上的信号Emit为低电平，第一扫描信号线上的信号Sn-1和第二扫描信号线上的信号Sn为高电平，此时第一晶体管T1和第六晶体管T6导通，第一电源PVDD与第二电源PVEE之间形成通路，第三晶体管T3输出发光驱动信号至发光模块106，发光模块106发光。进而可以将驱动模块101中的第三晶体管T3、阈值补偿模块104中的第四晶体管T4和第一初始化模块102中的第五晶体管T5中至少一个采用第一双栅结构，示例性的以第三晶体管T3、第四晶体管T4和第五晶体管T5均为第一双栅结构为例进行展示，如图6所示，通过分别在第三晶体管T3、第四晶体管T4和第五晶体管T5的第一底栅电极1001上均接入相同的第一调制电压V1，使得在初始化阶段，第五晶体管T5正常打开，在数据写入阶段，第三晶体管T3和第四晶体管T4正常打开，减轻第三晶体管T3、第四晶体管T4和第五晶体管T5出现阈值电压的负偏现象，保证显示面板的正常显示。
可选的，图10为本发明实施例提供的另一种像素驱动电路的结构示意图，如图6和图10所示，第一初始化电压Vref1或第二初始化电压Vref2复用为第一调制电压V1。
其中，如图6所示，第三晶体管T3、第四晶体管T4或第五晶体管T5的第一底栅电极1001上可以接入第一初始化电压Vref1，也可以如图10所示，第三晶体管T3、第四晶体管T4或第五晶体管T5的第一底栅电极1001上可以接入接入第二初始化电压Vref2，第一初始化电压和第二初始化电压Vref2通常为低电平，使得第三晶体管T3、第四晶体管T4或第五晶体管T5的阈值电压不会出现负偏现象，使得阈值电压出现正偏现象，降低晶体管的打开难度，进而降低像素驱动电路的功耗，提高使用寿命。在将像素驱动电路中的第一初始化电压或第二初始化电压Vref2复用为第一调制电压，避免额外设置信号线，减少信号线的设置数量，降低工艺难度。
可选的，图11为本发明实施例提供的另一种像素驱动电路的结构示意图，图11所示，栅极驱动电路的低电压信号VGL复用为第一调制电压V1。
其中，显示面板中还包括栅极驱动电路，栅极驱动电路与栅极线连接，用于向栅极线输出栅极驱动信号，栅极驱动信号用于驱动晶体管，栅极驱动电路中包括多种栅极驱动信号，将栅极驱动电路中的低电压信号VGL复用为第一调制电压V1，使得接入低电压信号VGL的第一双栅结构的晶体管打开过程中正常开启，避免出现阈值电压的负偏现象，降低像素驱动电路的功耗，保证显示面板的正常显示，同时避免额外设置信号线，降低制作工艺难度。
可选的，图12为本发明实施例提供的另一种像素驱动电路的结构示意图，图12所示，第二晶体管T2采用第二双栅结构；第二双栅结构包括控制端和第二底栅电极1002；第二底栅电极1002用于接入第二调制电压V2，以使第二晶体管T2的阈值电压处于负偏状态。
其中，数据写入模块105包括第二晶体管T2，将第二晶体管T2设置成第二双栅结构，将第二晶体管T2的第二底栅电极1002接入第二调制电压V2，第二调制电压V2可以为固定电压信号，因为第二晶体管T2的阈值电压在热、光或电的影响下容易正偏，产生四分屏的现象，本实施例据此设置第二调制电压V2可以为正电压信号，以使第二晶体管T2的阈值电压处于负偏状态，避免第二晶体管T2的异常打开，进而改善四分屏问题，保证显示面板的显示效果。
可选的，第二调制电压V2大于3V。
其中，对于长时间处于关断状态下的第二晶体管T2，第二调制电压V2起到增加对第二晶体管T2中的阈值电压偏离现象，使得第二晶体管T2打开困难，使得将为第二双栅结构的第二晶体管T2中的第二底栅电极1002接入大于3V的第二调制电压V2，第二晶体管T2中的阈值电压发生负偏现象，避免第二晶体管T2的异常开启，进而改善四分屏现象。
可选的，图13为本发明实施例提供的另一种像素驱动电路的结构示意图，图13所示，栅极驱动电路的高电压信号VGH复用为第二调制电压V2。
其中，栅极驱动电路中包括多种栅极驱动电压信号，为保证第二晶体管T2中的阈值电压的负偏现象，可以在第二晶体管T2的第二底栅电极1002中接入栅极驱动电路中的高电压信号VGH，将高电压信号VGH复用为第二调制电压V2，进而保证第二晶体管T2中阈值电压负偏现象，改善四分屏现象，保证显示面板的正常显示，同时无需额外设置信号线，减少信号线的设置数量，降低工艺难度。此外，第二调制电压V2还可以为PVDD等信号。
可选的，图14为本发明实施例提供的另一种像素驱动电路的结构示意图，图14所示，第二晶体管T2的控制端和第二底栅电极1002均连接第二扫描信号线。
其中，第二扫描信号线上的信号Sn一般为高电平，第二晶体管T2长时间处于关断状态，即处于阈值电压的负偏状态，不易导通以引入数据信号Vdata，但是当第二晶体管T2导通的瞬间，第二晶体管T2的阈值电压不负偏，从而导致第二晶体管T2的导通不困难，进而能够改善四分屏现象，保证显示面板的显示效果。
基于同一发明构思，本发明实施例还提供一种显示面板，显示面板200包括上述实施例中任一项所述的像素驱动电路。显示面板具备与上述像素驱动电路相同或相近的有益效果，在此不做过多赘述。
图15为本发明实施例提供的一种显示装置的结构示意图，如图15所示，显示装置300包括上述实施例所述的显示面板200。
需要说明的是，由于本实施例提供的一种显示装置具备上述实施例的显示面板的相同或相应的有益效果，此处不做赘述。本发明实施例提供的显示装置300可以为图15所示的手机，也可以为任何具有显示功能的电子产品，包括但不限于以下类别：电视机、笔记本电脑、桌上型显示器、平板电脑、数码相机、智能手环、智能眼镜、车载显示器、医疗设备、工控设备、触摸交互终端等，本发明实施例对此不作特殊限定。
注意，上述仅为本发明的较佳实施例及所运用技术原理。本领域技术人员会理解，本发明不限于这里所述的特定实施例，对本领域技术人员来说能够进行各种明显的变化、重新调整和替代而不会脱离本发明的保护范围。因此，虽然通过以上实施例对本发明进行了较为详细的说明，但是本发明不仅仅限于以上实施例，在不脱离本发明构思的情况下，还可以包括更多其他等效实施例，而本发明的范围由所附的权利要求范围决定。

Claims (17)

1.一种像素驱动电路，其特征在于，包括：驱动模块、第一初始化模块、存储模块、阈值补偿模块、数据写入模块和发光模块；
所述驱动模块的第一端用于输入第一电源输入的信号；所述驱动模块的第二端用于为所述发光模块提供发光驱动信号；所述存储模块连接于所述驱动模块的控制端和所述驱动模块的第一端之间；所述阈值补偿模块连接于所述驱动模块的控制端和所述驱动模块的第二端之间；
所述数据写入模块连接所述驱动模块的第一端，用于向所述驱动模块传输数据电压；所述第一初始化模块连接于第一参考电压输出端和所述驱动模块的控制端之间，用于为所述驱动模块提供第一初始化电压；
所述驱动模块、所述第一初始化模块和所述阈值补偿模块的晶体管中的至少一个采用第一双栅结构；采用第一双栅结构的所述晶体管包括控制端和第一底栅电极；所述第一底栅电极用于接入第一调制电压。
2.根据权利要求1所述的像素驱动电路，其特征在于，所述阈值补偿模块的晶体管采用所述第一双栅结构。
3.根据权利要求1所述的像素驱动电路，其特征在于，所述第一初始化模块的晶体管采用所述第一双栅结构。
4.根据权利要求1所述的像素驱动电路，其特征在于，所述第一调制电压小于或等于3V。
5.根据权利要求4所述的像素驱动电路，其特征在于，所述第一调制电压小于或等于0V。
6.根据权利要求5所述的像素驱动电路，其特征在于，所述第一初始化电压复用为所述第一调制电压。
7.根据权利要求1所述的像素驱动电路，其特征在于，还包括：第二初始化模块；所述第二初始化模块连接于第二参考电压输出端和所述发光模块的第一端之间，用于为所述发光模块提供第二初始化电压。
8.根据权利要求7所述的像素驱动电路，其特征在于，还包括：第一发光控制模块和第二发光控制模块；
所述第一发光控制模块连接于所述第一电源和所述驱动模块的第一端之间；
所述第二发光控制模块连接于所述驱动模块的第二端和所述发光模块的第一端之间，所述发光模块的第二端连接第二电源。
9.根据权利要求8所述的像素驱动电路，其特征在于，所述存储模块包括第一电容；所述第一发光控制模块包括第一晶体管；所述数据写入模块包括第二晶体管；所述驱动模块包括第三晶体管；所述阈值补偿模块包括第四晶体管；所述第一初始化模块包括第五晶体管；所述第二发光控制模块包括第六晶体管；所述第二初始化模块包括第七晶体管；
所述第三晶体管的控制端分别与所述第五晶体管的第二端以及所述第四晶体管的第一端连接；所述第三晶体管的第一端与所述第一晶体管的第二端连接；所述第一晶体管的第一端连接所述第一电源；所述第三晶体管的第二端分别与所述第四晶体管的第二端和所述第六晶体管的第一端连接；所述第六晶体管的第二端与所述发光模块的第一端连接；
所述第五晶体管的第一端与所述第一参考电压输出端连接；所述第二晶体管的第一端与数据信号线连接；所述第二晶体管的第二端与所述第三晶体管的第一端连接；所述第七晶体管的第一端与所述第二参考电压输出端连接；所述第七晶体管的第二端与所述发光模块的第一端连接；
所述第三晶体管、第四晶体管和第五晶体管中至少一个采用第一双栅结构；所述第一晶体管和所述第六晶体管的控制端连接发光控制信号线；所述第五晶体管的控制端连接第一扫描信号线；所述第四晶体管的控制端、所述第二晶体管的控制端和所述第七晶体管的控制端连接第二扫描信号线。
10.根据权利要求7所述的像素驱动电路，其特征在于，所述第一初始化电压或所述第二初始化电压复用为所述第一调制电压。
11.根据权利要求1所述的像素驱动电路，其特征在于，栅极驱动电路的低电压信号复用为所述第一调制电压。
12.根据权利要求9所述的像素驱动电路，其特征在于，所述第二晶体管采用第二双栅结构；所述第二双栅结构包括控制端和第二底栅电极；所述第二底栅电极用于接入第二调制电压，以使所述第二晶体管的阈值电压处于负偏状态。
13.根据权利要求12所述的像素驱动电路，其特征在于，所述第二调制电压大于3V。
14.根据权利要求13所述的像素驱动电路，其特征在于，栅极驱动电路的高电压信号复用为所述第二调制电压。
15.根据权利要求12所述的像素驱动电路，其特征在于，所述第二晶体管的控制端和第二底栅电极均连接所述第二扫描信号线。
16.一种显示面板，其特征在于，包括上述权利要求1-15任一项所述的像素驱动电路。
17.一种显示装置，其特征在于，包括上述权利要求16所述的显示面板。
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