CN114170959A - 像素驱动电路及显示面板 - Google Patents

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Abstract

本发明公开了一种像素驱动电路及显示面板。像素驱动电路，其特征在于，包括：驱动模块、阈值补偿模块、数据写入模块、第一初始化模块、第一存储模块、第二存储模块和发光模块；数据写入模块用于将数据电压信号写入驱动模块；驱动模块用于产生驱动电流，发光模块用于响应驱动电流发光；阈值补偿模块用于抓取驱动模块的阈值电压至驱动模块的控制端，阈值补偿模块包括第一双栅晶体管；第一初始化模块用于初始化驱动模块，第一初始化模块包括第二双栅晶体管；第一存储模块用于维持驱动模块的控制端的电位；第二存储模块用于将第一电源信号耦合至第一双栅晶体管的双栅节点及第二双栅晶体管的双栅节点。本发明的技术方案提高了显示面板的显示效果。

Description

像素驱动电路及显示面板
技术领域
本发明实施例涉及显示技术领域，尤其涉及一种像素驱动电路及显示面板。
背景技术
随着显示技术的发展，显示面板的应用越来越广泛，相应的对显示面板的要求也越来越高。
现有的显示面板在某些模块关断时会引起驱动模块的控制端的电位不稳定，导致发光模块的显示亮度发生变化，影响显示画质。
发明内容
本发明提供一种像素驱动电路及显示面板，以提高显示面板的显示效果。
第一方面，本发明实施例提供了一种像素驱动电路，像素驱动电路包括：驱动模块、阈值补偿模块、数据写入模块、第一初始化模块、第一存储模块、第二存储模块和发光模块；
所述数据写入模块用于将数据电压信号写入所述驱动模块；
所述驱动模块用于产生驱动电流，所述发光模块用于响应所述驱动电流发光；
所述阈值补偿模块用于抓取所述驱动模块的阈值电压至所述驱动模块的控制端，所述阈值补偿模块包括第一双栅晶体管；
所述第一初始化模块用于初始化所述驱动模块，所述第一初始化模块包括第二双栅晶体管；
所述第一存储模块用于维持所述驱动模块的控制端的电位；
所述第二存储模块用于将第一电源信号耦合至所述第一双栅晶体管的双栅节点及所述第二双栅晶体管的双栅节点。
可选地，所述第一双栅晶体管包括第一子晶体管和第二子晶体管，所述第一子晶体管的控制端和所述第二子晶体管的控制端均接入第一扫描信号，所述第一子晶体管的第一端与所述驱动模块的第一端电连接，所述第一子晶体管的第二端与所述第二子晶体管的第一端电连接，所述第二子晶体管的第二端与所述驱动模块的控制端电连接；
所述第二双栅晶体管包括第三子晶体管和第四子晶体管，所述第三子晶体管的控制端和所述第四子晶体管的控制端均接入第二扫描信号，所述第三子晶体管的第一端接入初始化信号，所述第三子晶体管的第二端与所述第四子晶体管的第一端电连接，所述第四子晶体管的第二端与所述驱动模块的控制端电连接；
所述第二存储模块的第一端接入所述第一电源信号，所述第二存储模块的第二端与所述第三子晶体管的第二端电连接，所述第二存储模块的第二端还与所述第一子晶体管的第二端电连接；
所述数据写入模块的第一端接入数据电压信号，所述数据写入模块的控制端接入所述第一扫描信号，所述数据写入模块的第二端与所述驱动模块的第二端电连接；
所述驱动模块的控制端与所述第一存储模块的第一端电连接，所述第一存储模块的第二端接入所述第一电源信号，所述驱动模块的第一端与所述发光模块的第一端电连接，所述发光模块的第二端接入第二电源信号。
可选地，所述第一子晶体管的沟道宽长比小于等于0.45；
和/或，所述第三子晶体管的沟道宽长比小于等于0.45。
可选地，所述第一存储模块包括第一电容，所述第一电容的第一端为所述第一存储模块的第一端，所述第一电容的第二端为所述第一存储模块的第二端；
所述第二存储模块包括第二电容，所述第二电容的第一端为所述第二存储模块的第一端，所述第二电容的第二端为所述第二存储模块的第二端。
可选地，所述第一电容包括两个相对的第一极板；所述第二电容包括两个相对的第二极板；
所述第一极板的面积小于所述第二极板的面积。
可选地，像素驱动电路还包括第二初始化模块；
所述第二初始化模块的控制端接入第三扫描信号，所述第二初始化模块的第一端接入所述初始化信号，所述第二初始化模块的第二端与所述发光模块的第一端电连接，所述第二初始化模块用于在第二初始化阶段初始化所述发光模块。
可选地，像素驱动电路还包括第一发光控制模块和第二发光控制模块；
所述第一发光控制模块的控制端接入第一使能信号，所述第一发光控制模块的第一端接入所述第一电源信号，所述第一发光控制模块的第二端与所述驱动模块的第二端电连接；
所述驱动模块的第一端通过所述第二发光控制模块与所述发光模块的第一端电连接，所述第二发光控制模块的控制端接入所述第一使能信号，所述第一发光控制模块和所述第二发光控制模块用于在发光阶段，控制所述发光模块响应所述驱动电流发光。
可选地，像素驱动电路还包括第三初始化模块；
所述第三初始化模块的控制端接入第三扫描信号，所述第三初始化模块的第一端接入所述初始化信号，所述第三初始化模块的第二端与所述驱动模块的第二端电连接，所述第三初始化模块用于在第二初始化阶段初始化所述驱动模块的第二端。
可选地，像素驱动电路还包括第三发光控制模块和第四发光控制模块；
所述第三发光控制模块的控制端接入第二使能信号，所述第三发光控制模块的第一端接入所述第一电源信号，所述第三发光控制模块的第二端与所述驱动模块的第二端电连接；
所述驱动模块的第一端通过所述第四发光控制模块与所述发光模块的第一端电连接，所述第四发光控制模块的控制端接入第三使能信号，所述第三发光控制模块和所述第四发光控制模块用于在发光阶段，控制所述发光模块响应所述驱动电流发光，所述第二初始化模块还用于在所述第二初始化阶段，通过所述第四发光控制模块初始化所述驱动模块的第一端。
第二方面，本发明实施例还提供了一种显示面板，该显示面板包括第一方面任意所述的像素驱动电路。
本发明中像素驱动电路包括：驱动模块、阈值补偿模块、数据写入模块、第一初始化模块、第一存储模块、第二存储模块和发光模块，在阈值补偿阶段，数据写入模块将数据电压信号写入驱动模块，阈值补偿模块可以抓取驱动模块的阈值电压至驱动模块的控制端，实现阈值电压的补偿；并且第一存储模块可以维持驱动模块的控制端的电位，避免当第一初始化模块关断时，驱动模块的控制端的电位被耦合而变化，第二存储模块可以将第一电源信号耦合至第一双栅晶体管的双栅节点及第二双栅晶体管的双栅节点，从而维持第一双栅晶体管的双栅节点及第二双栅晶体管的双栅节点的电位，从而使得驱动模块的控制端与第一双栅晶体管的双栅节点之间的电位差几乎无变化，并且驱动模块的控制端与第二双栅晶体管的双栅节点之间的电位差几乎无变化，从而减小像素驱动电路中的漏电流，从而使得驱动模块的控制端可以维持稳定状态，使得显示面板的显示亮度不会发生变化，有利于提高显示面板的显示效果。本发明解决了某些模块关断时会引起驱动模块的控制端的电位不稳定，导致发光模块的显示亮度发生变化，影响显示画质的问题，提高了显示面板的画面质量，提高了显示面板的显示效果。
附图说明
图1是本发明实施例提供的一种像素驱动电路的结构示意图；
图2是本发明实施例提供的又一种像素驱动电路的结构示意图；
图3是本发明实施例提供的又一种像素驱动电路的结构示意图；
图4是本发明实施例提供的一种像素驱动电路的时序图；
图5是本发明实施例提供的又一种像素驱动电路的结构示意图；
图6是本发明实施例提供的又一种像素驱动电路的时序图；
图7是本发明实施例提供的又一种像素驱动电路的结构示意图；
图8是本发明实施例提供的又一种像素驱动电路的结构示意图；
图9为本发明实施例提供的一种显示面板的结构示意图；
图10为本发明实施例提供的一种显示装置的结构示意图。
具体实施方式
下面结合附图和实施例对本发明作进一步的详细说明。可以理解的是，此处所描述的具体实施例仅仅用于解释本发明，而非对本发明的限定。另外还需要说明的是，为了便于描述，附图中仅示出了与本发明相关的部分而非全部结构。
正如背景技术中提到的现有的显示面板存在画面质量较差的问题，申请人经过仔细研究发现，产生此技术问题的原因在于：在显示面板的像素驱动电路中，某些模块在关断时的关断电流引起驱动模块的控制端的电位不稳定，导致显示面板的显示亮度发生变化，影响显示面板的画面质量，出现屏体闪烁问题。
针对上述问题，本发明实施例提供了一种像素驱动电路，图1是本发明实施例提供的一种像素驱动电路的结构示意图，参考图1，像素驱动电路包括：驱动模块101、阈值补偿模块102、数据写入模块103、第一初始化模块104、第一存储模块105、第二存储模块106和发光模块107；数据写入模块103用于将数据电压信号Vdata写入驱动模块101；驱动模块101用于产生驱动电流，发光模块107用于响应驱动电流发光；阈值补偿模块102用于抓取驱动模块101的阈值电压至驱动模块101的控制端A，阈值补偿模块102包括第一双栅晶体管T1；第一初始化模块104用于初始化驱动模块101，第一初始化模块104包括第二双栅晶体管T2；第一存储模块105用于维持驱动模块101的控制端A的电位；第二存储模块106用于将第一电源信号VDD耦合至第一双栅晶体管T1的双栅节点B1及第二双栅晶体管T2的双栅节点B2。
其中，发光模块107例如可以是OLED(Organic Light-Emitting Diode，有机发光二极管)，OLED为电流型器件，需要在驱动电流的作用下才能够发光，驱动模块101能够根据数据电压信号Vdata产生相应的驱动电流，以驱动发光模块107显示不同的灰阶，从而使得显示面板可以显示待显示画面。
具体地，在第一初始化阶段，第一初始化模块104导通，第一初始化模块104可以对驱动模块101进行初始化，从而可以清除上一帧画面的残留电荷，以提高显示面板的显示效果；
在阈值补偿阶段，第一初始化模块104关断，数据写入模块103和阈值补偿模块102导通，数据写入模块103将数据电压信号Vdata写入驱动模块101，阈值补偿模块102可以抓取驱动模块101的阈值电压至驱动模块101的控制端A，实现阈值电压的补偿；并且第一存储模块105可以维持驱动模块101的控制端A的电位，避免当第一初始化模块104关断时，驱动模块101的控制端A的电位被耦合而变化，并且第二存储模块106可以将第一电源信号VDD耦合至第一双栅晶体管T1的双栅节点B1及第二双栅晶体管T2的双栅节点B2，从而维持第一双栅晶体管T1的双栅节点B1及第二双栅晶体管T2的双栅节点B2的电位，从而使得驱动模块101的控制端A与第一双栅晶体管T1的双栅节点B1之间的电位差几乎无变化，并且驱动模块101的控制端A与第二双栅晶体管T2的双栅节点B2之间的电位差几乎无变化，从而减小像素驱动电路中的漏电流，从而使得第一初始化模块104关断时，驱动模块101的控制端A可以维持稳定状态，使得显示面板的显示亮度不会发生变化，从而提高显示面板的显示效果；
在发光阶段，驱动模块101根据数据电压信号Vdata产生驱动电流，发光模块107响应驱动电流发光，从而显示待显示亮度。
本实施例的技术方案，像素驱动电路包括：驱动模块、阈值补偿模块、数据写入模块、第一初始化模块、第一存储模块、第二存储模块和发光模块，在阈值补偿阶段，数据写入模块将数据电压信号写入驱动模块，阈值补偿模块可以抓取驱动模块的阈值电压至驱动模块的控制端，实现阈值电压的补偿；并且第一存储模块可以维持驱动模块的控制端的电位，避免当第一初始化模块关断时，驱动模块的控制端的电位被耦合而变化，第二存储模块可以将第一电源信号耦合至第一双栅晶体管的双栅节点及第二双栅晶体管的双栅节点，从而维持第一双栅晶体管的双栅节点及第二双栅晶体管的双栅节点的电位，从而使得驱动模块的控制端与第一双栅晶体管的双栅节点之间的电位差几乎无变化，并且驱动模块的控制端与第二双栅晶体管的双栅节点之间的电位差几乎无变化，从而减小像素驱动电路中的漏电流，从而使得驱动模块的控制端可以维持稳定状态，使得显示面板的显示亮度不会发生变化，有利于提高显示面板的显示效果。本实施例的技术方案解决了某些模块关断时会引起驱动模块的控制端的电位不稳定，导致发光模块的显示亮度发生变化，影响显示画质的问题，提高了显示面板的画面质量，提高了显示面板的显示效果。
继续参考图1，第一双栅晶体管T1包括第一子晶体管T11和第二子晶体管T12，第一子晶体管T11的控制端和第二子晶体管T12的控制端均接入第一扫描信号Scan1，第一子晶体管T11的第一端与驱动模块101的第一端C电连接，第一子晶体管T11的第二端与第二子晶体管T12的第一端电连接，第二子晶体管T12的第二端与驱动模块101的控制端A电连接；第二双栅晶体管T2包括第三子晶体管T21和第四子晶体管T22，第三子晶体管T21的控制端和第四子晶体管T22的控制端均接入第二扫描信号Scan2，第三子晶体管T21的第一端接入初始化信号Vref，第三子晶体管T21的第二端与第四子晶体管T22的第一端电连接，第四子晶体管T22的第二端与驱动模块101的控制端A电连接；第二存储模块106的第一端接入第一电源信号VDD，第二存储模块106的第二端与第三子晶体管T21的第二端电连接，第二存储模块106的第二端还与第一子晶体管T11的第二端电连接；数据写入模块103的第一端接入数据电压信号Vdata，数据写入模块103的控制端接入第一扫描信号Scan1，数据写入模块103的第二端与驱动模块101的第二端电连接；驱动模块101的控制端A与第一存储模块105的第一端电连接，第一存储模块105的第二端接入第一电源信号VDD，驱动模块101的第一端C与发光模块107的第一端电连接，发光模块107的第二端接入第二电源信号VSS。
具体地，第一电源信号VDD和第二电源信号VSS为高低电平不同的电压，典型的如第一电源信号VDD为高电平，第二电源信号VSS为低电平，从而为发光模块107在发光阶段发光提供所需的电流通路。第一子晶体管T11的第二端为第一双栅晶体管T1的双栅节点B1，第三子晶体管T21的第二端为第二双栅晶体管T2的双栅节点B2，第二存储模块106可以将第一电源信号VDD耦合至第一双栅晶体管T1的双栅节点B1和第二双栅晶体管T2的双栅节点B2，以维持第一双栅晶体管T1的双栅节点B1和第二双栅晶体管T2的双栅节点B2的电位，从而维持驱动模块101的控制端A的电位，使得第一初始化模块104在关断时，第二扫描信号Scan2的电位的变化不会引起第一双栅晶体管T1的双栅节点B1、第二双栅晶体管T2的双栅节点B2和驱动模块101的控制端A的电位变化，使得第一双栅晶体管T1的双栅节点B1与驱动模块101的控制端A之间的电位差几乎不变，并使得第二双栅晶体管T2的双栅节点B2与驱动模块101的控制端A之间的电位差几乎不变，且第一双栅晶体管T1的双栅节点B1与驱动模块101的第一端C的电位差几乎不变，从而减小漏流，维持驱动模块101的稳定，从而避免画面闪烁，提高显示面板的画面质量。
可选地，第一子晶体管T11的沟道宽长比小于等于0.45；和/或，第三子晶体管T21的沟道宽长比小于等于0.45。
具体地，第一子晶体管T11的沟道的宽例如为小于等于1.8μm，第一子晶体管T11的沟道的长例如为大于等于4μm，使得第一子晶体管T11的沟道宽长比小于等于0.45，从而降低第一子晶体管T11的漏电流，从而可以维持第一双栅晶体管T1的双栅节点B1的电位，使得第一初始化模块104在关断时，第二扫描信号Scan2的电位的变化不会引起第一双栅晶体管T1的双栅节点B1和驱动模块101的控制端A的电位变化，使得第一双栅晶体管T1的双栅节点B1与驱动模块101的控制端A之间的电位差几乎不变，且第一双栅晶体管T1的双栅节点B1与驱动模块101的第一端C的电位差几乎不变，从而维持驱动模块101的控制端A的电位。
第三子晶体管T21的沟道的宽例如为小于等于1.8μm，第一子晶体管T11的沟道的长例如为大于等于4μm，使得第三子晶体管T21的沟道宽长比小于等于0.45，从而降低第三子晶体管T21的漏电流，从而可以维持第二双栅晶体管T2的双栅节点B2的电位，使得第一双栅晶体管T1的双栅节点B1与驱动模块101的控制端A之间的电位差几乎不变，从而维持驱动模块101的控制端A的电位。
图2是本发明实施例提供的又一种像素驱动电路的结构示意图，可选地，参考图2，所述第一存储模块105包括第一电容C1，第一电容C1的第一端为第一存储模块105的第一端，第一电容C1的第二端为第一存储模块105的第二端；第二存储模块106包括第二电容C2，第二电容C2的第一端为第二存储模块106的第一端，第二电容C2的第二端为第二存储模块106的第二端。
具体地，电容具有储存电荷的能力，所以第一电容C1可以维持驱动模块101的控制端A的电位，第二电容C2可以将第一电源信号VDD耦合至第一双栅晶体管T1的双栅节点B1及第二双栅晶体管T2的双栅节点B2的电位，从而使得第一初始化模块104在关断时，第二扫描信号Scan2的电位的变化不会引起第一双栅晶体管T1的双栅节点B1、第二双栅晶体管T2的双栅节点B2和驱动模块101的控制端A的电位变化，使得第一双栅晶体管T1的双栅节点B1与驱动模块101的控制端A之间的电位差几乎不变，并使得第二双栅晶体管T2的双栅节点B2与驱动模块101的控制端A之间的电位差几乎不变，且第一双栅晶体管T1的双栅节点B1与驱动模块101的第一端C的电位差几乎不变，从而减小漏流，维持驱动模块101的稳定，从而避免画面闪烁，提高显示面板的画面质量。
可选地，第一电容C1包括两个相对的第一极板；第二电容C2包括两个相对的第二极板；第一极板的面积小于第二极板的面积。
具体地，第一电容C1可以维持驱动模块101的控制端的电位；当第一初始化模块104关断时，第二电容C2可以维持第一双栅晶体管T1的双栅节点B1的电位，从而使得驱动模块101的控制端与第一双栅晶体管T1的双栅节点B1的电位差几乎无变化，从而维持驱动模块101的控制端的电位；而且，当驱动模块101产生驱动电流时，驱动模块101的第一端C的电位可能会发生变化，第二电容C2可以维持第一双栅晶体管T1的双栅节点B1的电位，使得第一双栅晶体管T1的双栅节点B1的电位不会因为驱动模块101的第一端C的电位变化而变化，从而维持驱动模块101的控制端的电位，所以可以增大第二电容C2的容量，使得第二电容C2可以在第一初始化模块104关断时和发光阶段更好的维持第一双栅晶体管T1的双栅节点B1的电位，从而更好的维持驱动模块101的控制端的电位，所以可以设置第一电容C1的第一极板的面积小于第二电容C2的第二基板的面积，可以更好的维持驱动模块101的控制端的电位，还可以减小版图空间，有利于减小显示面板的面积，使得即使设置两个电容，也不会使得显示面板的尺寸过大。
图3是本发明实施例提供的又一种像素驱动电路的结构示意图，可选地，参考图3，像素驱动电路还包括第二初始化模块108；第二初始化模块108的控制端接入第三扫描信号Scan3，第二初始化模块108的第一端接入初始化信号Vref，第二初始化模块108的第二端与发光模块107的第一端电连接，第二初始化模块108用于在第二初始化阶段初始化发光模块107。
具体地，第二初始化模块108可以将初始化信号Vref写入发光模块107的第一端，从而对发光模块107进行初始化，可以清除上一帧画面的残留电荷，使得发光模块107可以更准确的显示待显示亮度，从而提高显示面板的画面质量。在其它一些实施方式中，第二初始化模块108的控制端也可以接入第一扫描信号Scan1或第二扫描信号Scan2，使得第二初始化模块108可以在第一初始化阶段或阈值补偿阶段初始化发光模块107，可以减少扫描线的数量，达到简化版图的效果。
可选地，参考图3，像素驱动电路还包括第一发光控制模块109和第二发光控制模块110；第一发光控制模块109的控制端接入第一使能信号EM1，第一发光控制模块109的第一端接入第一电源信号VDD，第一发光控制模块109的第二端与驱动模块101的第二端电连接；驱动模块101的第一端通过第二发光控制模块110与发光模块107的第一端电连接，第二发光控制模块110的控制端接入第一使能信号EM1，第一发光控制模块109和第二发光控制模块110用于在发光阶段，控制发光模块107响应驱动电流发光。
具体地，在发光阶段，第一使能信号EM1控制第一发光控制模块109和第二发光控制模块110导通，使得发光模块107可以获取驱动模块101产生的驱动电流，使得发光模块107可以根据驱动电流发光，以显示待显示亮度。在发光阶段，第一使能信号EM1为了控制控制第一发光控制模块109和第二发光控制模块110导通，第一使能信号EM1会升高或降低，可能会引起驱动模块101的第一端C的电位变化，由于第二存储模块106可以维持第一双栅晶体管T1的双栅节点B1的电位，而且第一子晶体管T11的沟道宽长比较小，第一子晶体管T11的漏电流较小，所以驱动模块101的第一端C的电位变化不会引起第一双栅晶体管T1的双栅节点B1的电位变化，从而使得第一双栅晶体管T1的双栅节点B1与驱动模块101的控制端A的电位差几乎无变化，从而可以使得驱动模块101的控制端的电位保持稳定。
图4是本发明实施例提供的一种像素驱动电路的时序图，参考图3和图4，在第一初始化阶段t1，第二扫描信号Scan2为低电平，第一初始化模块104导通，第一初始化模块104初始化驱动模块101；在阈值补偿阶段t2，第一扫描信号Scan1为低电平，数据写入模块103和阈值补偿模块102导通，数据写入模块103将数据电压信号Vdata写入驱动模块101，阈值补偿模块102可以抓取驱动模块101的阈值电压至驱动模块101的控制端A，实现阈值电压的补偿；并且第一存储模块105可以维持驱动模块101的控制端A的电位，避免当第一初始化模块104关断时，驱动模块101的控制端A的电位被耦合而变化，并且第二存储模块106可以将第一电源信号VDD耦合至第一双栅晶体管T1的双栅节点B1及第二双栅晶体管T2的双栅节点B2，从而维持第一双栅晶体管T1的双栅节点B1及第二双栅晶体管T2的双栅节点B2的电位；在第二初始化阶段t3，第三扫描信号Scan3为低电平，第二初始化模块108导通，第二初始化模块108可以初始化发光模块107；在发光阶段t4，第一使能信号EM1为低电平，第一发光控制模块109和第二发光控制模块110导通，驱动模块101产生驱动电流，发光模块107响应驱动电流发光。
需要说明的是，图4中只示出了所有模块为低电平导通的情况，但并不进行限定，在其它一些实施方式中，各模块的导通电平类型也可与本实施例的电平相反。
图5是本发明实施例提供的又一种像素驱动电路的结构示意图，可选地，参考图5，像素驱动电路还包括第三初始化模块111；第三初始化模块111的控制端接入第三扫描信号Scan3，第三初始化模块111的第一端接入初始化信号Vref，第三初始化模块111的第二端与驱动模块101的第二端电连接，第三初始化模块111用于在第二初始化阶段初始化驱动模块101的第二端。
具体地，在第二初始化阶段，第三扫描信号Scan3控制第三初始化模块111导通，使得第三初始化模块111可以将初始化信号写入驱动模块101的第二端，从而对驱动模块101的第二端进行初始化，从而确保每一帧内，发光模块107发光前，驱动模块101的控制端与驱动模块101的第二端的电位相同，使得每一帧的显示亮度保持一致，从而提高显示面板的显示效果。
可选地，参考图5，像素驱动电路还包括第三发光控制模块112和第四发光控制模块113；第三发光控制模块112的控制端接入第二使能信号EM2，第三发光控制模块112的第一端接入第一电源信号VDD，第三发光控制模块112的第二端与驱动模块101的第二端电连接；驱动模块101的第一端通过第四发光控制模块113与发光模块107的第一端电连接，第四发光控制模块113的控制端接入第三使能信号EM3，第三发光控制模块112和第四发光控制模块113用于在发光阶段，控制发光模块107响应驱动电流发光，第二初始化模块108还用于在第二初始化阶段，通过第四发光控制模块113初始化驱动模块101的第一端。
具体地，在第二初始化阶段，第三扫描信号Scan3控制第二初始化模块108和第三初始化模块111导通，第二初始化模块108可以初始化发光模块107，第三初始化模块111可以初始化驱动模块101的第二端，同时第四发光控制模块113导通，使得第二初始化模块108可以通过第四发光控制模块113将初始化信号Vref写入驱动模块101的第一端，驱动模块101的控制端、驱动模块101的第一端和驱动模块101的第二端均为初始化信号Vref，从而确保每一帧内，在发光模块107发光前，驱动模块101的控制端、驱动模块101的第一端与驱动模块101的第二端的电位相同，使得每一帧的显示亮度保持一致，从而提高显示面板的显示效果。
图6是本发明实施例提供的又一种像素驱动电路的时序图，参考图5和图6，在低刷新频率时，例如刷新频率为f，则可以使数据刷新频率为f，显示频率为4f，即可以将像素驱动电路的驱动电路分为T1、T2、T3和T4四个阶段，在T1阶段中，第一初始化阶段t11，第二扫描信号Scan2为低电平，第一初始化模块104可以初始化驱动模块101的控制端；在阈值补偿阶段t12，第一扫描信号Scan1为低电平，数据写入模块103可以将数据电压信号写入驱动模块101，阈值补偿模块102可以抓取驱动模块101的阈值电压至驱动模块101的控制端，实现阈值补偿，并且第一存储模块105可以维持驱动模块101的控制端的电位，第二存储模块106可以将第一电源信号VDD耦合至第一双栅晶体管T1和第二双栅晶体管T2的双栅节点，可以进一步维持驱动模块101的控制端的电位；在第二初始化阶段t13，第三扫描信号Scan3为低电平，第二初始化模块108可以初始化发光模块107和驱动模块101的第一端，第三初始化模块111可以初始化驱动模块101的第二端；在发光阶段t14，驱动模块101产生驱动电流，发光模块107响应驱动电流发光；在T2阶段中，由于数据电压信号Vdata已写入驱动模块101，所以只需进行第二初始化阶段t23和发光阶段t24，对发光模块107进行初始化，并对驱动模块101的第一端和第二端进行初始化，使得在发光前，像素驱动电路中各节点电位保持一致，使得T2阶段的显示亮度与T1阶段的显示亮度一致；相应的，在T3阶段，只需进行第二初始化阶段t33和发光阶段t34，在T4阶段，只需进行第二初始化阶段t43和发光阶段t44，使得在发光模块107发光前，对发光模块107进行初始化，并对驱动模块101的第一端和第二端进行初始化，从而使得每次发光前，像素驱动电路中各节点电位保持一致，使得发光模块107每次发光时的显示亮度一致，从而实现低刷新频率下，显示面板可以正常显示，不会发生闪烁现象，从而提高了显示面板的显示效果。
需要说明的是，图6中只示出了所有模块为低电平导通的情况，但并不进行限定，在其它一些实施方式中，各模块的导通电平类型也可与本实施例的电平相反。
图7是本发明实施例提供的又一种像素驱动电路的结构示意图，可选地，参考图7，驱动模块101包括第三晶体管T3，第三晶体管T3的控制端为驱动模块101的控制端，第三晶体管T3的第一端为驱动模块101的第一端，第三晶体管T3的第二端为驱动模块101的第二端；数据写入模块103包括第四晶体管T4，第四晶体管T4的第一端为数据写入模块103的第一端，第四晶体管T4的第二端为数据写入模块103的第二端，第四晶体管T4的控制端为数据写入模块103的控制端；发光模块107包括有机发光二极管D1，有机发光二极管D1的第一端为发光模块107的第一端，有机发光二极管D2的第二端为发光模块107的第二端；第二初始化模块108包括第五晶体管T5，第五晶体管T5的控制端为第二初始化模块108的控制端，第五晶体管T5的第一端为第二初始化模块108的第一端，第五晶体管T5的第二端为第二初始化模块108的第二端；第一发光控制模块109包括第六晶体管T6，第六晶体管T6的控制端为第一发光控制模块109的控制端，第六晶体管T6的第一端为第一发光控制模块109的第一端，第六晶体管T6的第二端为第一发光控制模块109的第二端；第二发光控制模块110包括第七晶体管T7，第七晶体管T7的控制端为第二发光控制模块110的控制端，第七晶体管T7的第一端为第二发光控制模块110的第一端，第七晶体管T7的第二端为第二发光控制模块110的第二端。
图8是本发明实施例提供的又一种像素驱动电路的结构示意图，可选地，参考图8，第三初始化模块111包括第八晶体管T8，第八晶体管T8的控制端为第三初始化模块111的控制端，第八晶体管T8的第一端为第三初始化模块111的第一端，第八晶体管T8的第二端为第三初始化模块111的第二端；第三发光控制模块112包括第九晶体管T9，第九晶体管T9的控制端为第三发光控制模块112的控制端，第九晶体管T9的第一端为第三发光控制模块112的第一端，第九晶体管T9的第二端为第三发光控制模块112的第二端；第四发光控制模块113包括第十晶体管T10，第十晶体管T10的控制端为第四发光控制模块113的控制端，第十晶体管T10的第一端为第四发光控制模块113的第一端，第十晶体管T10的第二端为第四发光控制模块113的第二端。
图9为本发明实施例提供的一种显示面板的结构示意图，参考图9，显示面板包括多个本发明任意实施例提供的像素驱动电路PX，显示面板可包括多条纵横交错的扫描线(S1～Sk)与数据线(DL1～DLj)，像素驱动电路位于扫描线与数据线限定出的区域，扫描线例如可以包括第一扫描线、第二扫描线及第三扫描线，分别与像素驱动电路中的第一扫描信号端、第二扫描信号端及第三扫描信号端电连接，从而为像素驱动电路PX提供扫描信号。因其包括本发明任意实施例提供的像素驱动电路，因而也有相同的有益效果，在此不再赘述。
图10为本发明实施例提供的一种显示装置的结构示意图，参考图10，显示装置包括本发明任意实施例提供的显示面板，显示装置可为手机、平板、显示器、智能手表、MP3、MP4或其他可穿戴设备等，因其包含本发明任意实施例提供的显示面板，因而也具有相同的有益效果，在此不再赘述。
注意，上述仅为本发明的较佳实施例及所运用技术原理。本领域技术人员会理解，本发明不限于这里所述的特定实施例，对本领域技术人员来说能够进行各种明显的变化、重新调整和替代而不会脱离本发明的保护范围。因此，虽然通过以上实施例对本发明进行了较为详细的说明，但是本发明不仅仅限于以上实施例，在不脱离本发明构思的情况下，还可以包括更多其他等效实施例，而本发明的范围由所附的权利要求范围决定。

Claims (10)

1.一种像素驱动电路，其特征在于，包括：驱动模块、阈值补偿模块、数据写入模块、第一初始化模块、第一存储模块、第二存储模块和发光模块；
所述数据写入模块用于将数据电压信号写入所述驱动模块；
所述驱动模块用于产生驱动电流，所述发光模块用于响应所述驱动电流发光；
所述阈值补偿模块用于抓取所述驱动模块的阈值电压至所述驱动模块的控制端，所述阈值补偿模块包括第一双栅晶体管；
所述第一初始化模块用于初始化所述驱动模块，所述第一初始化模块包括第二双栅晶体管；
所述第一存储模块用于维持所述驱动模块的控制端的电位；
所述第二存储模块用于将第一电源信号耦合至所述第一双栅晶体管的双栅节点及所述第二双栅晶体管的双栅节点。
2.根据权利要求1所述的像素驱动电路，其特征在于，
所述第一双栅晶体管包括第一子晶体管和第二子晶体管，所述第一子晶体管的控制端和所述第二子晶体管的控制端均接入第一扫描信号，所述第一子晶体管的第一端与所述驱动模块的第一端电连接，所述第一子晶体管的第二端与所述第二子晶体管的第一端电连接，所述第二子晶体管的第二端与所述驱动模块的控制端电连接；
所述第二双栅晶体管包括第三子晶体管和第四子晶体管，所述第三子晶体管的控制端和所述第四子晶体管的控制端均接入第二扫描信号，所述第三子晶体管的第一端接入初始化信号，所述第三子晶体管的第二端与所述第四子晶体管的第一端电连接，所述第四子晶体管的第二端与所述驱动模块的控制端电连接；
所述第二存储模块的第一端接入所述第一电源信号，所述第二存储模块的第二端与所述第三子晶体管的第二端电连接，所述第二存储模块的第二端还与所述第一子晶体管的第二端电连接；
所述数据写入模块的第一端接入数据电压信号，所述数据写入模块的控制端接入所述第一扫描信号，所述数据写入模块的第二端与所述驱动模块的第二端电连接；
所述驱动模块的控制端与所述第一存储模块的第一端电连接，所述第一存储模块的第二端接入所述第一电源信号，所述驱动模块的第一端与所述发光模块的第一端电连接，所述发光模块的第二端接入第二电源信号。
3.根据权利要求2所述的像素驱动电路，其特征在于，
所述第一子晶体管的沟道宽长比小于等于0.45；
和/或，所述第三子晶体管的沟道宽长比小于等于0.45。
4.根据权利要求1所述的像素驱动电路，其特征在于，所述第一存储模块包括第一电容，所述第一电容的第一端为所述第一存储模块的第一端，所述第一电容的第二端为所述第一存储模块的第二端；
所述第二存储模块包括第二电容，所述第二电容的第一端为所述第二存储模块的第一端，所述第二电容的第二端为所述第二存储模块的第二端。
5.根据权利要求4所述的像素驱动电路，其特征在于，所述第一电容包括两个相对的第一极板；所述第二电容包括两个相对的第二极板；
所述第一极板的面积小于所述第二极板的面积。
6.根据权利要求2所述的像素驱动电路，其特征在于，还包括第二初始化模块；
所述第二初始化模块的控制端接入第三扫描信号，所述第二初始化模块的第一端接入所述初始化信号，所述第二初始化模块的第二端与所述发光模块的第一端电连接，所述第二初始化模块用于在第二初始化阶段初始化所述发光模块。
7.根据权利要求6所述的像素驱动电路，其特征在于，还包括第一发光控制模块和第二发光控制模块；
所述第一发光控制模块的控制端接入第一使能信号，所述第一发光控制模块的第一端接入所述第一电源信号，所述第一发光控制模块的第二端与所述驱动模块的第二端电连接；
所述驱动模块的第一端通过所述第二发光控制模块与所述发光模块的第一端电连接，所述第二发光控制模块的控制端接入所述第一使能信号，所述第一发光控制模块和所述第二发光控制模块用于在发光阶段，控制所述发光模块响应所述驱动电流发光。
8.根据权利要求6所述的像素驱动电路，其特征在于，还包括第三初始化模块；
所述第三初始化模块的控制端接入第三扫描信号，所述第三初始化模块的第一端接入所述初始化信号，所述第三初始化模块的第二端与所述驱动模块的第二端电连接，所述第三初始化模块用于在第二初始化阶段初始化所述驱动模块的第二端。
9.根据权利要求8所述的像素驱动电路，其特征在于，还包括第三发光控制模块和第四发光控制模块；
所述第三发光控制模块的控制端接入第二使能信号，所述第三发光控制模块的第一端接入所述第一电源信号，所述第三发光控制模块的第二端与所述驱动模块的第二端电连接；
所述驱动模块的第一端通过所述第四发光控制模块与所述发光模块的第一端电连接，所述第四发光控制模块的控制端接入第三使能信号，所述第三发光控制模块和所述第四发光控制模块用于在发光阶段，控制所述发光模块响应所述驱动电流发光，所述第二初始化模块还用于在所述第二初始化阶段，通过所述第四发光控制模块初始化所述驱动模块的第一端。
10.一种显示面板，其特征在于，包括权利要求1-9任一项所述的像素驱动电路。
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