CN112102782A - 像素驱动电路、显示面板和显示装置 - Google Patents

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Abstract

本发明公开了一种像素驱动电路、显示面板和显示装置。该像素驱动电路包括驱动晶体管、存储模块、数据写入模块、第一初始化模块、第二初始化模块和发光器件；第一初始化模块用于对驱动晶体管的栅极进行初始化；第二初始化模块的控制端和第一端与像素驱动电路的扫描信号输入端连接，用于对发光器件进行初始化；数据写入模块用于向驱动晶体管的栅极写入数据电压；存储模块用于存储驱动晶体管的栅极电压；驱动晶体管用于根据数据电压输出驱动电流，驱动发光器件发光。可以提高设置有像素驱动电路的显示面板的显示均一性，同时降低了显示面板的布线难度，有利于显示面板实现高刷新频率或高PPI。

Description

像素驱动电路、显示面板和显示装置
技术领域
本发明实施例涉及显示技术领域，尤其涉及一种像素驱动电路、显示面板和显示装置。
背景技术
在显示面板显示的过程中，像素驱动电路驱动发光二极管发光进行显示。当显示面板的刷新频率比较高或像素密度(Pixels Per Inch，PPI)比较高时，显示面板的远端和近端的像素驱动电路的充电率不同，导致显示面板的不同位置发光亮度不同，显示面板的显示均一性比较差。
发明内容
本发明提供一种像素驱动电路、显示面板和显示装置，以减少像素驱动电路的充电时间，提高显示面板的显示均一性。
第一方面，本发明实施例提供了一种像素驱动电路，包括驱动晶体管、存储模块、数据写入模块、第一初始化模块、第二初始化模块和发光器件；
所述第一初始化模块用于对所述驱动晶体管的栅极进行初始化；
所述第二初始化模块的控制端和第一端与像素驱动电路的扫描信号输入端连接，用于对所述发光器件进行初始化；
所述数据写入模块用于向所述驱动晶体管的栅极写入数据电压；所述存储模块用于存储所述驱动晶体管的栅极电压；所述驱动晶体管用于根据所述数据电压输出驱动电流，驱动所述发光器件发光。
可选地，所述像素驱动电路包括第一扫描信号输入端和第二扫描信号输入端；
所述第一扫描信号输入端与所述第一初始化模块的控制端连接，所述第二扫描信号输入端与所述数据写入模块的控制端连接；
所述第二初始化模块的控制端和第一端与所述第一扫描信号输入端或所述第二扫描信号输入端连接。
可选地，所述第二初始化模块包括第一晶体管；
所述第一晶体管的栅极作为所述第二初始化模块的控制端，所述第一晶体管的第一极作为所述第二初始化模块的第一端，所述第一晶体管的第二极与所述发光器件的阳极连接。
可选地，所述像素驱动电路包括第一扫描信号输入端和第二扫描信号输入端；所述第一初始化模块包括第二晶体管，所述数据写入模块包括第三晶体管；
所述第二晶体管的栅极与所述第一扫描信号输入端连接，所述第二晶体管的第一极与初始化信号输入端连接，所述第二晶体管的第二极与所述驱动晶体管的栅极连接；
所述第三晶体管的栅极与所述第二扫描信号输入端连接，所述第三晶体管的第一极与数据信号输入端连接，所述第三晶体管的第二极与所述驱动晶体管的第一极连接。
可选地，像素驱动电路还包括阈值补偿模块和发光控制模块；所述存储模块包括存储电容；
所述阈值补偿模块的控制端与所述第二扫描信号输入端连接，所述阈值补偿模块的第一端与所述驱动晶体管的栅极和所述存储电容的第一极连接，所述阈值补偿模块的第二端与所述驱动晶体管的第二极连接；所述发光控制模块的控制端与发光控制信号输入端连接，所述发光控制模块的第一端和所述存储电容的第二极与第一电源信号输入端连接，所述发光控制模块的第二端与所述驱动晶体管的第一极连接，所述发光控制模块的第三端与所述驱动晶体管的第二极连接，所述发光控制模块的第四端与所述发光器件的阳极连接，所述发光器件的阴极与第二电源信号输入端连接。
可选地，所述阈值补偿模块包括第四晶体管；
所述第四晶体管的栅极作为所述阈值补偿模块的控制端，所述第四晶体管的第一极作为所述阈值补偿模块的第一端，所述第四晶体管的第二极作为所述阈值补偿模块的第二端。
可选地，所述发光控制模块包括第五晶体管和第六晶体管；
所述第五晶体管的第一极作为所述发光控制模块的第一端，所述第五晶体管的第二极作为所述发光控制模块的第二端，所述第六晶体管的第一极作为所述发光控制模块的第三端，所述第六晶体管的第二极作为所述发光控制模块的第四端，所述第五晶体管的栅极和所述第六晶体管的栅极作为所述发光控制模块的控制端。
可选地，所述驱动晶体管为P型晶体管，所述第一电源信号输入端提供的第一电源信号和所述驱动晶体管的阈值电压之和为第一电压；所述初始化信号输入端提供的初始化信号的电压大于零，且小于所述第一电压。
第二方面，本发明实施例还提供了一种显示面板，包括本发明任意实施例提供的像素驱动电路。
第三方面，本发明实施例还提供了一种显示装置，包括本发明任意实施例提供的显示面板。
本发明实施例的技术方案，通过设置第一初始化模块的第一端与初始化信号输入端连接，第二初始化模块的控制端和第一端与扫描信号输入端连接，在对驱动晶体管的栅极和发光器件的阳极进行初始化时，可以通过初始化信号对驱动晶体管的栅极进行初始化，初始化信号可以根据像素驱动电路的数据写入阶段的时长适应性设置，避免初始化结束时驱动晶体管的栅极电位太低导致的数据电压写入不充分，同时可以避免不同的像素驱动电路的充电率不同导致的驱动电流不同，提高了设置有像素驱动电路的显示面板的显示均一性。而且，通过扫描信号对发光器件的阳极进行初始化，可以避免额外设置另一初始化信号输入端，从而可以避免额外设置一条初始化信号线，降低了显示面板的布线难度，有利于显示面板实现高刷新频率或高PPI。
附图说明
图1为现有的一种显示面板的结构示意图；
图2为本发明实施例提供的一种像素驱动电路的结构示意图；
图3为本发明实施例提供的另一种像素驱动电路的结构示意图；
图4为本发明实施例提供的另一种像素驱动电路的结构示意图；
图5为本发明实施例提供的另一种像素驱动电路的结构示意图；
图6为本发明实施例提供的另一种像素驱动电路的结构示意图；
图7为图6提供的像素驱动电路对应的一种时序图；
图8为本发明实施例提供的一种显示面板的结构示意图；
图9为本发明实施例提供的一种显示装置的结构示意图。
具体实施方式
下面结合附图和实施例对本发明作进一步的详细说明。可以理解的是，此处所描述的具体实施例仅仅用于解释本发明，而非对本发明的限定。另外还需要说明的是，为了便于描述，附图中仅示出了与本发明相关的部分而非全部结构。
图1为现有的一种显示面板的结构示意图。如图1所示，该显示面板包括信号线101和驱动芯片102，驱动芯片102设置于显示面板的第一端103，信号线101由显示面板的第一端103延伸至与第一端103对应设置的第二端104，驱动芯片101通过信号线101为显示面板中的像素驱动电路提供数据信号。例如，信号线101可以为数据线和电源信号线。当显示面板的刷新频率比较高或PPI比较高时，显示面板中的像素驱动电路的一帧时长比较短，使得像素驱动电路的数据写入阶段的时长比较短。而且，信号线101沿其延伸方向连接多个像素驱动电路，作为信号线101的负载，使得信号线101沿其延伸方向的阻抗越来越大，导致信号线101为不同位置的像素驱动电路充电时充电率不同。在像素驱动电路的数据写入阶段时长比较短时，信号线101为不同位置的像素驱动电路充电的充电率不同，使得信号线101为不同位置的像素驱动电路提供的信号电压不同，导致不同位置的像素驱动电路形成的驱动电流不同，进而使得显示面板的显示均一性比较差。示例性地，当信号线101为数据线时，沿着信号线101延伸的方向，像素驱动电路的充电率越来越小，使得像素驱动电路写入的数据电压越来越小，导致显示面板的发光亮度越来越亮，显示面板的显示均一性比较差。
针对上述技术问题，本发明实施例提供了一种像素驱动电路。图2为本发明实施例提供的一种像素驱动电路的结构示意图。如图2所示，该像素驱动电路包括驱动晶体管Tdr、存储模块10、数据写入模块20、第一初始化模块30、第二初始化模块40和发光器件D1；第一初始化模块30用于对驱动晶体管Tdr的栅极进行初始化；第二初始化模块40的控制端和第一端与像素驱动电路的扫描信号输入端SCAN连接，用于对发光器件D1进行初始化；数据写入模块20用于向驱动晶体管Tdr的栅极写入数据电压；存储模块10用于存储驱动晶体管Tdr的栅极电压；驱动晶体管Tdr用于根据数据电压输出驱动电流，驱动发光器件D1发光。
具体地，第一初始化模块30的第一端可以与像素驱动电路的初始化信号输入端VREF连接，第一初始化模块30的第二端可以与驱动晶体管Tdr的栅极连接。通过控制第一初始化模块30导通，使得初始化信号输入端VREF提供的初始化信号传输至驱动晶体管Tdr的栅极，可以对驱动晶体管Tdr的栅极进行初始化。第二初始化模块40的控制端和第一端与像素驱动电路的扫描信号输入端SCAN连接，第二初始化模块40的第二端与发光器件D1的阳极连接，通过控制第二初始化模块40导通，扫描信号输入端SCAN提供的扫描信号可以通过第二初始化模块40传输至发光器件D1的阳极，实现对发光器件D1的阳极初始化。在初始化后，通过数据写入模块20向驱动晶体管Tdr的栅极写入数据电压，并通过存储模块10存储驱动晶体管Tdr的栅极电压，驱动晶体管Tdr根据栅极电压形成驱动电流，驱动发光器件D1发光。
在对驱动晶体管Tdr的栅极初始化和发光器件D1的阳极初始化的过程中，通过初始化信号输入端VREF提供的初始化信号对驱动晶体管Tdr的栅极进行初始化，驱动晶体管Tdr的栅极电位为初始化信号。在像素驱动电路的数据写入阶段，将数据电压写入驱动晶体管Tdr的栅极所需的时间与初始化信号和充电率相关。初始化信号的电位越高，充电率越大，所需时间越短。当像素驱动电路的一帧工作时长比较短时，像素驱动电路的数据写入时间比较短，此时可以使初始化信号的电位比较高，实现在短时间内实现将数据电压写入驱动晶体管Tdr的栅极，避免了初始化结束时驱动晶体管Tdr的栅极电位太低导致的数据电压写入不充分，同时可以避免不同的像素驱动电路的充电率不同导致的驱动电流不同，提高了设置有像素驱动电路的显示面板的显示均一性。同时第二初始化模块40通过扫描信号输入端SCAN提供的扫描信号对发光器件D1的阳极进行初始化，避免额外设置另一初始化信号输入端，从而可以避免额外设置一条初始化信号线，降低了显示面板的布线难度，有利于显示面板实现高刷新频率或高PPI。
继续参考图2，像素驱动电路包括第一扫描信号输入端SCAN1和第二扫描信号输入端SCAN2；第一扫描信号输入端SCAN1与第一初始化模块30的控制端连接，第二扫描信号输入端SCAN2与数据写入模块20的控制端连接；第二初始化模块40的控制端和第一端与第一扫描信号输入端SCAN1或第二扫描信号输入端SCAN2连接。
具体地，图2示例性地示出了第二初始化模块40的控制端和第一端与第一扫描信号输入端SCAN1连接。在像素驱动电路的初始化阶段，第一扫描信号输入端SCAN1提供的第一扫描信号控制第一初始化模块30和第二初始化模块40导通，初始化信号输入端VREF提供的初始化信号通过第一初始化模块30传输至驱动晶体管Tdr的栅极，对驱动晶体管Tdr的栅极进行初始化。同时第二初始化模块40将第一扫描信号传输至发光器件D1的阳极，对发光器件D1的阳极进行初始化。由于驱动晶体管Tdr的栅极初始化后的电位为初始化信号的电位，发光器件D1的阳极初始化后的电位为第一扫描信号的电位，初始化信号的电位可以比较高，实现像素驱动电路在数据写入阶段，短时间内将数据电压写入驱动晶体管Tdr的栅极，提高显示面板的显示均一性。同时，第一扫描信号的电位可以为低电平，满足发光器件D1的阳极初始化要求。
图3为本发明实施例提供的另一种像素驱动电路的结构示意图。如图3所示，第二初始化模块40的控制端和第一端还可以与第二扫描信号输入端SCAN2连接。在像素驱动电路的初始化阶段，第一扫描信号输入端SCAN1提供的第一扫描信号控制第一初始化模块30导通，初始化信号输入端VREF提供的初始化信号通过第一初始化模块30传输至驱动晶体管Tdr的栅极，对驱动晶体管Tdr的栅极进行初始化。在数据写入阶段，第二扫描信号输入端SCAN2提供的第二扫描信号控制第二初始化模块40导通，第二扫描信号输入端SCAN2提供的第二扫描信号通过第二初始化模块40传输至发光器件D1的阳极，对发光器件D1的阳极进行初始化。
图4为本发明实施例提供的另一种像素驱动电路的结构示意图。如图4所示，第二初始化模块40包括第一晶体管T1；第一晶体管T1的栅极作为第二初始化模块40的控制端，第一晶体管T1的第一极作为第二初始化模块40的第一端，第一晶体管T1的第二极与发光器件D1的阳极连接。
具体地，图4中示例性地示出了第一晶体管T1为P型晶体管，且第一晶体管T1的栅极和第一极与第一扫描信号输入端SCAN1连接。在像素驱动电路的初始化阶段，第一扫描信号为低电平，控制第一晶体管T1导通，第一扫描信号通过第一晶体管T1传输至发光器件D1的阳极，对发光器件D1的阳极进行初始化。而且，第一扫描信号为低电平时，其电位小于零，可以满足发光器件D1的阳极初始化需求。
需要说明的是，在其他实施例中，第一晶体管T1的栅极和第一极还可以与第二扫描信号输入端SCAN2连接。在像素驱动电路的初始化阶段，第一扫描信号输入端SCAN1提供的第一扫描信号控制第一初始化模块30导通，对驱动晶体管Tdr的栅极进行初始化。在数据写入阶段，第二扫描信号输入端SCAN2提供的第二扫描信号为低电平，控制第一晶体管T1导通，第二扫描信号通过第一晶体管T1传输至发光器件D1的阳极，对发光器件D1的阳极进行初始化。同理，第二扫描信号为低电平时，其电位小于零，可以满足发光器件D1的阳极初始化需求。
图5为本发明实施例提供的另一种像素驱动电路的结构示意图。如图5所示，像素驱动电路包括第一扫描信号输入端SCAN1和第二扫描信号输入端SCAN2；第一初始化模块30包括第二晶体管T2，数据写入模块20包括第三晶体管T3；第二晶体管T2的栅极与第一扫描信号输入端SCAN1连接，第二晶体管T2的第一极与初始化信号输入端VREF连接，第二晶体管T2的第二极与驱动晶体管Tdr的栅极连接；第三晶体管T3的栅极与第二扫描信号输入端SCAN2连接，第三晶体管T3的第一极与数据信号输入端VDATA连接，第三晶体管T3的第二极与驱动晶体管Tdr的第一极连接。
具体地，图5中示例性地示出了第二晶体管T2和第三晶体管T3为P型晶体管。在像素驱动电路的初始化阶段，第一扫描信号为低电平，第二晶体管T2导通，初始化信号输入端VREF提供的初始化信号通过第二晶体管T2传输至驱动晶体管Tdr的栅极，对驱动晶体管Tdr的栅极进行初始化。在像素驱动电路的数据写入阶段，第二扫描信号为低电平，第三晶体管T3导通，数据信号输入端VDATA提供的数据信号通过第三晶体管T3传输至驱动晶体管Tdr的栅极，实现数据写入。然后驱动晶体管Tdr根据栅极电压形成驱动电流，驱动发光器件D1发光。
图6为本发明实施例提供的另一种像素驱动电路的结构示意图。如图6所示，像素驱动电路还包括阈值补偿模块50和发光控制模块60；存储模块10包括存储电容Cst；阈值补偿模块50的控制端与第二扫描信号输入端SCAN2连接，阈值补偿模块50的第一端与驱动晶体管Tdr的栅极和存储电容Cst的第一极连接，阈值补偿模块50的第二端与驱动晶体管Tdr的第二极连接；发光控制模块60的控制端与发光控制信号输入端EM连接，发光控制模块60的第一端和存储电容Cst的第二极与第一电源信号输入端VDD连接，发光控制模块60的第二端与驱动晶体管Tdr的第一极连接，发光控制模块60的第三端与驱动晶体管Tdr的第二极连接，发光控制模块60的第四端与发光器件D1的阳极连接，发光器件D1的阴极与第二电源信号输入端VSS连接。
具体地，阈值补偿模块50的控制端与第二扫描信号输入端SCAN2连接，用于在像素驱动电路的数据写入模块对驱动晶体管Tdr的阈值电压进行补偿。发光控制模块60的控制端与发光控制信号输入端EM连接，用于在像素驱动电路的发光阶段控制存储电容Cst耦合数据电压至驱动晶体管Tdr，使驱动晶体管Tdr根据数据信号形成驱动电流，驱动发光器件D1发光。
继续参考图6，阈值补偿模块50包括第四晶体管T4；第四晶体管T4的栅极作为阈值补偿模块50的控制端，第四晶体管T4的第一极作为阈值补偿模块50的第一端，第四晶体管T4的第二极作为阈值补偿模块50的第二端。
具体地，图6中示例性地示出了第四晶体管T4为P型晶体管。第四晶体管T4的栅极与第二扫描信号输入端SCAN2连接，第四晶体管T4的第一极与驱动晶体管Tdr的栅极连接，第四晶体管T4的第二极与驱动晶体管Tdr的第二极连接。在像素驱动电路的数据写入阶段，第二扫描信号输入端SCAN2提供的第二扫描信号为低电平，第三晶体管T3和第四晶体管T4导通，数据信号通过第三晶体管T3、驱动晶体管Tdr和第四晶体管T4写入至驱动晶体管Tdr的栅极，直至驱动晶体管Tdr的栅极电位为数据电压和驱动晶体管Tdr的阈值电压之和，驱动晶体管Tdr截止，实现了数据信号写入和驱动晶体管Tdr的阈值电压补偿。
继续参考图6，发光控制模块60包括第五晶体管T5和第六晶体管T6；第五晶体管T5的第一极作为发光控制模块60的第一端，第五晶体管T5的第二极作为发光控制模块60的第二端，第六晶体管T6的第一极作为发光控制模块60的第三端，第六晶体管T6的第二极作为发光控制模块60的第四端，第五晶体管T5的栅极和第六晶体管T6的栅极作为发光控制模块60的控制端。
具体地，图6中示例性地示出了第五晶体管T5和第六晶体管T6为P型晶体管。在像素驱动电路的发光阶段，发光控制信号输入端EM提供的发光控制信号为低电平，控制第五晶体管T5和第六晶体管T6导通，第一电源信号输入端VDD提供的第一电源信号传输至驱动晶体管Tdr的第一极，且驱动晶体管Tdr的栅极电位为数据信号和驱动晶体管Tdr的阈值电压之和，则驱动晶体管Tdr根据第一电源信号、数据信号和驱动晶体管Tdr的阈值电压形成驱动电流，并通过第六晶体管T6传输至发光器件D1，驱动发光器件D1发光。
图7为图6提供的像素驱动电路对应的一种时序图。其中，s1为第一扫描信号输入端SCAN1提供的第一扫描信号的时序图，s2为第二扫描信号输入端SCAN2提供的第二扫描信号的时序图，em为发光控制信号输入端EM提供的发光控制信号的时序图。以下结合图6和图7说明像素驱动电路的工作过程。
在初始化阶段t1，第一扫描信号s1为低电平，第二扫描信号s2为高电平，发光控制信号em为高电平，第一晶体管T1和第二晶体管T2导通，第一扫描信号通过第一晶体管T1传输至发光器件D1的阳极，对发光器件D1的阳极进行初始化，初始化信号输入端VREF提供的初始化信号通过第二晶体管T2传输至驱动晶体管Tdr的栅极，对驱动晶体管Tdr的栅极进行初始化。在初始化阶段t1结束后，驱动晶体管Tdr导通。
在数据写入阶段t2，第一扫描信号s1为高电平，第二扫描信号s2为低电平，发光控制信号em为高电平，第三晶体管T3和第四晶体管T4导通，数据信号输入端VDATA提供的数据信号通过第三晶体管T3、驱动晶体管Tdr和第四晶体管T4写入至驱动晶体管Tdr的栅极，直至驱动晶体管Tdr的栅极电位为数据电压vdata和驱动晶体管Tdr的阈值电压vth之和，即为vdata+vth，驱动晶体管Tdr截止，完成了数据信号vdata的写入以及驱动晶体管Tdr的阈值电压补偿，并通过存储电容Cst维持两极的电位不变。
在发光阶段t3，第一扫描信号s1为高电平，第二扫描信号s2为高电平，发光控制信号em为低电平，第五晶体管T5和第六晶体管T6导通。第一电源信号输入端VDD提供的第一电源信号vdd通过第五晶体管T5传输至驱动晶体管Tdr的第一极，使得驱动晶体管Tdr的第一极由数据信号vdata跳变为第一电源信号vdd，驱动晶体管Tdr导通。驱动晶体管Tdr根据栅极电位和第一极电压形成驱动电流，并通过第六晶体管T6传输至发光器件D1的阳极，驱动发光器件D1发光。其中，驱动电流为：
Figure BDA0002702074570000131
其中，μ为驱动晶体管Tdr的载流子迁移率，Cox为驱动晶体管Tdr的电容常数，w为驱动晶体管Tdr的沟道宽度，L为驱动晶体管Tdr的沟道长度。
由驱动电流公式可知，驱动电流与驱动晶体管Tdr的阈值电压无关，实现了驱动晶体管Tdr的阈值电压补偿。
需要说明的是，图6中示例性地示出了第一晶体管T1的栅极与第一扫描信号输入端SCAN1连接。在其他实施例中，第一晶体管T1的栅极还可以与第二扫描信号输入端SCAN2连接，此时第一晶体管T1在数据写入阶段导通，对发光器件D1的阳极进行初始化。
继续参考图6，驱动晶体管Tdr为P型晶体管，第一电源信号输入端VDD提供的第一电源信号vdd和驱动晶体管Tdr的阈值电压vth之和为第一电压；初始化信号输入端VREF提供的初始化信号的电压大于零，且小于第一电压。
具体地，当驱动晶体管Tdr为P型晶体管时，驱动晶体管Tdr的阈值电压vth为负值。驱动晶体管Tdr的栅源压差小于驱动晶体管Tdr的阈值电压vth时，驱动晶体管Tdr导通。在像素驱动电路的初始化阶段，驱动晶体管Tdr的栅极电位为初始化信号输入端VREF提供的初始化信号vref。在像素驱动电路的数据写入阶段，第三晶体管T3和第四晶体管T4导通，驱动晶体管Tdr的第一极电位为数据信号vdata，由于数据信号vdata的电位与像素驱动电路的显示灰阶相关，当像素驱动电路的显示灰阶为黑灰阶时，数据信号vdata的电位最大，此时数据信号vdata的电位可以为第一电压。在数据写入阶段，通过设置初始化信号vref小于第一电压，可以保证驱动晶体管Tdr的栅极电位和第一极电位的差值小于驱动晶体管Tdr的阈值电压，保证驱动晶体管Tdr导通。实现数据写入和驱动晶体管Tdr的阈值补偿。另外，初始化信号vref的电位大于零，可以保证初始化后驱动晶体管Tdr的栅极电位比较高，从而在数据写入阶段将驱动晶体管Tdr的栅极写至第一电压所需要的时间比较短，避免了初始化结束时驱动晶体管Tdr的栅极电位太低导致的数据电压写入不充分，同时可以避免不同的像素驱动电路的充电率不同导致的驱动电流不同，提高了设置有像素驱动电路的显示面板的显示均一性。
本发明实施例还提供一种显示面板。图8为本发明实施例提供的一种显示面板的结构示意图。如图8所示，该显示面板包括本发明任意实施例提供的像素驱动电路。
具体地，如图8所示，显示面板10包括多个像素驱动电路11，每个像素驱动电路11工作过程中驱动发光器件发光，从而实现显示面板10的显示。
本发明实施例还提供一种显示装置。图9为本发明实施例提供的一种显示装置的结构示意图。如图9所示，该显示装置20包括本发明任意实施例提供的显示面板21。
注意，上述仅为本发明的较佳实施例及所运用技术原理。本领域技术人员会理解，本发明不限于这里所述的特定实施例，对本领域技术人员来说能够进行各种明显的变化、重新调整和替代而不会脱离本发明的保护范围。因此，虽然通过以上实施例对本发明进行了较为详细的说明，但是本发明不仅仅限于以上实施例，在不脱离本发明构思的情况下，还可以包括更多其他等效实施例，而本发明的范围由所附的权利要求范围决定。

Claims (10)

1.一种像素驱动电路，其特征在于，包括驱动晶体管、存储模块、数据写入模块、第一初始化模块、第二初始化模块和发光器件；
所述第一初始化模块用于对所述驱动晶体管的栅极进行初始化；
所述第二初始化模块的控制端和第一端与像素驱动电路的扫描信号输入端连接，用于对所述发光器件进行初始化；
所述数据写入模块用于向所述驱动晶体管的栅极写入数据电压；所述存储模块用于存储所述驱动晶体管的栅极电压；所述驱动晶体管用于根据所述数据电压输出驱动电流，驱动所述发光器件发光。
2.根据权利要求1所述的像素驱动电路，其特征在于，所述像素驱动电路包括第一扫描信号输入端和第二扫描信号输入端；
所述第一扫描信号输入端与所述第一初始化模块的控制端连接，所述第二扫描信号输入端与所述数据写入模块的控制端连接；
所述第二初始化模块的控制端和第一端与所述第一扫描信号输入端或所述第二扫描信号输入端连接。
3.根据权利要求1所述的像素驱动电路，其特征在于，所述第二初始化模块包括第一晶体管；
所述第一晶体管的栅极作为所述第二初始化模块的控制端，所述第一晶体管的第一极作为所述第二初始化模块的第一端，所述第一晶体管的第二极与所述发光器件的阳极连接。
4.根据权利要求3所述的像素驱动电路，其特征在于，所述像素驱动电路包括第一扫描信号输入端和第二扫描信号输入端；所述第一初始化模块包括第二晶体管，所述数据写入模块包括第三晶体管；
所述第二晶体管的栅极与所述第一扫描信号输入端连接，所述第二晶体管的第一极与初始化信号输入端连接，所述第二晶体管的第二极与所述驱动晶体管的栅极连接；
所述第三晶体管的栅极与所述第二扫描信号输入端连接，所述第三晶体管的第一极与数据信号输入端连接，所述第三晶体管的第二极与所述驱动晶体管的第一极连接。
5.根据权利要求4所述的像素驱动电路，其特征在于，还包括阈值补偿模块和发光控制模块；所述存储模块包括存储电容；
所述阈值补偿模块的控制端与所述第二扫描信号输入端连接，所述阈值补偿模块的第一端与所述驱动晶体管的栅极和所述存储电容的第一极连接，所述阈值补偿模块的第二端与所述驱动晶体管的第二极连接；所述发光控制模块的控制端与发光控制信号输入端连接，所述发光控制模块的第一端和所述存储电容的第二极与第一电源信号输入端连接，所述发光控制模块的第二端与所述驱动晶体管的第一极连接，所述发光控制模块的第三端与所述驱动晶体管的第二极连接，所述发光控制模块的第四端与所述发光器件的阳极连接，所述发光器件的阴极与第二电源信号输入端连接。
6.根据权利要求5所述的像素驱动电路，其特征在于，所述阈值补偿模块包括第四晶体管；
所述第四晶体管的栅极作为所述阈值补偿模块的控制端，所述第四晶体管的第一极作为所述阈值补偿模块的第一端，所述第四晶体管的第二极作为所述阈值补偿模块的第二端。
7.根据权利要求6所述的像素驱动电路，其特征在于，所述发光控制模块包括第五晶体管和第六晶体管；
所述第五晶体管的第一极作为所述发光控制模块的第一端，所述第五晶体管的第二极作为所述发光控制模块的第二端，所述第六晶体管的第一极作为所述发光控制模块的第三端，所述第六晶体管的第二极作为所述发光控制模块的第四端，所述第五晶体管的栅极和所述第六晶体管的栅极作为所述发光控制模块的控制端。
8.根据权利要求5所述的像素驱动电路，其特征在于，所述驱动晶体管为P型晶体管，所述第一电源信号输入端提供的第一电源信号和所述驱动晶体管的阈值电压之和为第一电压；所述初始化信号输入端提供的初始化信号的电压大于零，且小于所述第一电压。
9.一种显示面板，其特征在于，包括权利要求1-8任一项所述的像素驱动电路。
10.一种显示装置，其特征在于，包括权利要求9所述的显示面板。
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