CN109887464B - 像素电路及其驱动方法、显示面板和显示设备 - Google Patents

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Abstract

一种像素电路及其驱动方法、显示面板和显示设备。像素电路包括：发光元件、驱动电路、第一复位偏置电路和第二复位偏置电路。驱动电路的控制端与数据信号端和第一复位偏置电路的第二端电连接，驱动电路的第一端与第二复位偏置电路的第二端电连接，驱动电路的第二端与发光元件电连接；第一复位偏置电路的控制端与第一控制端电连接，第一复位偏置电路的第一端与第一偏置电压端电连接；第二复位偏置电路的控制端与偏置控制端电连接，第二复位偏置电路的第一端与第二偏置电压端电连接；第一复位偏置电路和第二复位偏置电路被配置为在复位阶段控制驱动电路处于偏置状态。该像素电路可以改善因磁滞效应产生的短期残像问题，提高显示质量。

Description

像素电路及其驱动方法、显示面板和显示设备
技术领域
本公开的实施例涉及一种像素电路及其驱动方法、显示面板和显示设备。
背景技术
有机发光二极管(Organic Light Emitting Diode，OLED)显示面板具有自发光、对比度高、能耗低、视角广、响应速度快、可用于挠曲性面板、使用温度范围广、制造简单等特点，具有广阔的发展前景。作为新一代的显示方式，OLED显示面板可以被广泛应用于手机、显示器、笔记本电脑、数码相机、仪器仪表等具有显示功能的装置。
发明内容
本公开至少一实施例提供一种像素电路，包括：发光元件、驱动电路、第一复位偏置电路和第二复位偏置电路。所述驱动电路的控制端与数据信号端以及所述第一复位偏置电路的第二端电连接，所述驱动电路的第一端与所述第二复位偏置电路的第二端电连接，所述驱动电路的第二端与所述发光元件电连接；所述第一复位偏置电路的控制端与第一控制端电连接，所述第一复位偏置电路的第一端与第一偏置电压端电连接；所述第二复位偏置电路的控制端与偏置控制端电连接，所述第二复位偏置电路的第一端与第二偏置电压端电连接；所述第一复位偏置电路和所述第二复位偏置电路被配置为在复位阶段对所述驱动电路进行复位并控制所述驱动电路处于偏置状态。
例如，在本公开一实施例提供的像素电路中，所述驱动电路包括驱动晶体管，所述第一复位偏置电路包括第一偏置晶体管，所述第二复位偏置电路包括第二偏置晶体管，所述驱动电路的控制端为所述驱动晶体管的栅极，所述驱动电路的第一端为所述驱动晶体管的第一极，所述驱动电路的第二端为所述驱动晶体管的第二极，所述第一复位偏置电路的第一端为所述第一偏置晶体管的第一极，所述第一复位偏置电路的第二端为所述第一偏置晶体管的第二极，所述第一复位偏置电路的控制端为所述第一偏置晶体管的栅极，所述第二复位偏置电路的第一端为所述第二偏置晶体管的第一极，所述第二复位偏置电路的第二端为所述第二偏置晶体管的第二极，所述第二复位偏置电路的控制端为所述第二偏置晶体管的栅极。
例如，本公开一实施例提供的像素电路还包括：数据写入电路和存储电路。所述数据写入电路被配置为在数据写入阶段向所述驱动晶体管的栅极写入数据信号；所述存储电路被配置为存储所述数据信号并将其保持在所述驱动晶体管的栅极。
例如，本公开一实施例提供的像素电路还包括阈值补偿电路。所述阈值补偿电路被配置为在所述数据写入阶段向所述驱动晶体管的栅极写入阈值补偿信号。
例如，在本公开一实施例提供的像素电路中，所述阈值补偿电路包括阈值补偿晶体管，所述数据写入电路包括数据写入晶体管，所述存储电路包括存储电容，所述阈值补偿晶体管的第一极与所述数据写入晶体管的第二极电连接，所述阈值补偿晶体管的第二极和栅极彼此电连接，并电连接至所述驱动晶体管的栅极；所述数据写入晶体管的第一极与所述数据信号端电连接，所述数据写入晶体管的栅极与第二控制端电连接；所述存储电容的第一端电连接至所述驱动晶体管的第一极，所述存储电容的第二端电连接至所述驱动晶体管的栅极。
例如，本公开一实施例提供的像素电路还包括压降补偿电路。所述压降补偿电路被配置在所述数据写入阶段向所述驱动晶体管的第一极写入参考电压信号。
例如，在本公开一实施例提供的像素电路中，所述压降补偿电路包括压降补偿晶体管，所述存储电路包括存储电容，所述压降补偿晶体管的第一极与参考电源端电连接，所述压降补偿晶体管的第二极电连接至所述驱动晶体管的第一极，所述压降补偿晶体管的栅极与第二控制端电连接；所述存储电容的第一端电连接至所述驱动晶体管的第一极，所述存储电容的第二端电连接至所述驱动晶体管的栅极。
例如，本公开一实施例提供的像素电路还包括发光控制电路。所述发光控制电路被配置为控制所述驱动电路驱动所述发光元件发光。
例如，在本公开一实施例提供的像素电路中，所述发光控制电路包括第一控制晶体管和第二控制晶体管，所述第一控制晶体管的第一极电连接至所述驱动晶体管的第二极，所述第一控制晶体管的第二极电连接至所述发光元件，所述第一控制晶体管的栅极与第三控制端电连接；所述第二控制晶体管的第一极电连接至第一电源电压端，所述第二控制晶体管的第二极电连接至所述驱动晶体管的第一极，所述第二控制晶体管的栅极被配置接收发光控制信号。
例如，在本公开一实施例提供的像素电路中，所述第二控制晶体管的栅极电连接至所述第三控制端以接收所述发光控制信号，所述第二偏置晶体管的栅极与所述第一控制端电连接，所述第二偏置晶体管的第一极与复位电压端电连接，所述复位电压端为所述第二偏置电压端，所述第一控制端为所述偏置控制端。
例如，在本公开一实施例提供的像素电路中，所述第一偏置电压端输出的信号与所述第二偏置电压端输出的信号相同。
例如，在本公开一实施例提供的像素电路中，所述第二偏置晶体管复用为所述第二控制晶体管。
例如，在本公开一实施例提供的像素电路中，所述第二偏置晶体管为N型晶体管，所述第二偏置晶体管的栅极与所述第二控制端电连接，所述第一电源电压端为所述第二偏置电压端，所述第二控制端为所述偏置控制端。
本公开至少一实施例还提供一种显示面板，包括根据上述任一项所述的像素电路。
本公开至少一实施例还提供一种显示设备，包括上述任一项所述的显示面板。
本公开至少一实施例还提供一种上述任一项所述的像素电路的驱动方法，包括：在所述复位阶段，对所述驱动电路进行复位并控制所述驱动电路处于偏置状态；在数据写入阶段，向所述驱动电路写入数据信号；在发光阶段，驱动所述发光元件发光。
例如，在本公开一实施例提供的驱动方法中，所述驱动电路包括驱动晶体管，所述第一复位偏置电路包括第一偏置晶体管，所述第二复位偏置电路包括第二偏置晶体管；对所述驱动电路进行复位并控制所述驱动电路处于偏置状态包括：通过所述第一偏置晶体管向所述驱动晶体管的栅极写入第一偏置电压信号；以及通过所述第二偏置晶体管向所述驱动晶体管的第一极写入第二偏置电压信号。所述第一偏置电压信号和所述第二偏置电压信号之差控制所述驱动晶体管处于偏置状态。
例如，在本公开一实施例提供的驱动方法中，所述第一偏置电压信号和所述第二偏置电压信号相同。
例如，在本公开一实施例提供的驱动方法中，所述第二偏置晶体管的第一极电连接至第一电源电压端以接收第一电源电压信号，所述第一电源电压信号为所述第二偏置电压信号。
例如，本公开一实施例提供的驱动方法还包括：在所述数据写入阶段，通过阈值补偿电路向所述驱动晶体管的栅极写入阈值补偿信号。
例如，本公开一实施例提供的驱动方法还包括：在所述数据写入阶段，通过压降补偿电路向所述驱动晶体管的第一极写入参考电压信号。
本公开实施例提供一种像素电路及其驱动方法、显示面板和显示设备，其通过在复位阶段使驱动电路处于偏置状态，从而在显示画面时，驱动电路均由偏置状态改变为相应的显示状态，后一帧显示画面的数据电压不受前一帧显示画面的数据电压的影响，从而改善因磁滞效应产生的短期残像问题，提高显示面板的显示质量。另外，本公开实施例提供的像素电路的驱动方法还可以进行阈值补偿操作和压降补偿操作，从而补偿驱动晶体管的阈值电压漂移和显示面板的电源电压降(IR drop)，从而提高显示均匀性，有效改善显示面板的显示效果。
附图说明
为了更清楚地说明本公开实施例的技术方案，下面将对实施例的附图作简单地介绍，显而易见地，下面描述中的附图仅仅涉及本公开的一些实施例，而非对本公开的限制。
图1为本公开一实施例提供的一种像素电路的示意性框图；
图2为本公开一实施例提供的一种像素电路的结构示意图；
图3为本公开另一实施例提供的一种像素电路的结构示意图；
图4为本公开一实施例提供的一种显示面板的示意性框图；
图5为本公开一实施例提供的一种显示设备的示意性框图；
图6为本公开一实施例提供的一种像素电路的驱动方法的示意性流程图；
图7为本公开一实施例提供的一种像素电路的示意性时序图；
图8A为图2所示的像素电路的复位阶段的示意图；
图8B为图2所示的像素电路的数据写入阶段的示意图；
图8C为图2所示的像素电路的发光阶段的示意图；
图9A为图3所示的像素电路的复位阶段的示意图；
图9B为图3所示的像素电路的数据写入阶段的示意图；以及
图9C为图3所示的像素电路的发光阶段的示意图。
具体实施方式
为了使得本公开实施例的目的、技术方案和优点更加清楚，下面将结合本公开实施例的附图，对本公开实施例的技术方案进行清楚、完整地描述。显然，所描述的实施例是本公开的一部分实施例，而不是全部的实施例。基于所描述的本公开的实施例，本领域普通技术人员在无需创造性劳动的前提下所获得的所有其他实施例，都属于本公开保护的范围。
除非另外定义，本公开使用的技术术语或者科学术语应当为本公开所属领域内具有一般技能的人士所理解的通常意义。本公开中使用的“第一”、“第二”以及类似的词语并不表示任何顺序、数量或者重要性，而只是用来区分不同的组成部分。“包括”或者“包含”等类似的词语意指出现该词前面的元件或者物件涵盖出现在该词后面列举的元件或者物件及其等同，而不排除其他元件或者物件。“连接”或者“相连”等类似的词语并非限定于物理的或者机械的连接，而是可以包括电性的连接，不管是直接的还是间接的。“上”、“下”、“左”、“右”等仅用于表示相对位置关系，当被描述对象的绝对位置改变后，则该相对位置关系也可能相应地改变。
为了保持本公开实施例的以下说明清楚且简明，本公开省略了已知功能和已知部件的详细说明。
随着有机发光二极管(Organic Light Emitting Diode，OLED)显示面板的尺寸增大，OLED显示面板的电源电压降(IR drop)的问题越来越严重，从而导致OLED显示面板的显示亮度不均匀，影响OLED显示面板的显示效果。
OLED显示面板上的每个像素点由多个薄膜晶体管(TFT)驱动发光，采用TFT驱动技术可以提升显示速度、对比度和亮度、提高分辨率。但是，TFT存在磁滞效应现象，TFT的磁滞效应是在一定的偏压下，TFT电特性表现出来的一种不确定性，即流过TFT的电流不仅与当前的偏压有关，还与上一时刻TFT所处的状态。TFT的磁滞效应与TFT的栅介质、半导体材料以及两者之间的界面态陷阱有关，TFT的磁滞效应会造成短期残像，前一帧的图像往往会保留在后一帧的图像中，从而影响OLED显示面板的显示品质，甚至导致显示错误。
本公开至少一实施例提供一种像素电路及其驱动方法、显示面板和显示设备，其通过在复位阶段使驱动电路处于偏置状态，从而在显示画面时，驱动电路均由偏置状态改变为相应的显示状态，后一帧显示画面的数据电压不受前一帧显示画面的数据电压的影响，从而改善因磁滞效应产生的短期残像问题，提高显示面板的显示质量。另外，本公开实施例提供的像素电路的驱动方法还可以进行阈值补偿操作和压降补偿操作，从而补偿驱动晶体管的阈值电压漂移和显示面板的电源电压降(IR drop)，从而提高显示均匀性，有效改善显示面板的显示效果。
下面对本公开的一些实施例进行详细说明，但是本公开并不限于这些具体的实施例。
图1为本公开一实施例提供的一种像素电路的示意性框图。图2为本公开一实施例提供的一种像素电路的结构示意图。
例如，如图1所示，本公开实施例提供的像素电路100可以包括发光元件EL、驱动电路10、第一复位偏置电路21和第二复位偏置电路22。驱动电路10的控制端与数据信号端VD以及第一复位偏置电路21的第二端分别电连接，驱动电路10的第一端与第二复位偏置电路22的第二端电连接，驱动电路10的第二端与发光元件EL电连接。第一复位偏置电路21的控制端与第一控制端SC1电连接，第一复位偏置电路21的第一端与第一偏置电压端VB1电连接；第二复位偏置电路22的控制端与偏置控制端BS电连接，第二复位偏置电路22的第一端与第二偏置电压端VB2电连接；第一复位偏置电路21和第二复位偏置电路22被配置为在复位阶段对驱动电路10进行复位并控制驱动电路10处于偏置状态。
例如，本公开实施例提供的像素电路100可应用于显示面板，例如有源矩阵有机发光二极管(AMOLED)显示面板等。
例如，发光元件EL被配置为在施加电压或电流的情况下发光。发光元件EL可以为有机发光元件，有机发光元件例如可以为有机发光二极管，但本公开的实施例不限于此。发光元件EL例如可以采用不同的发光材料，以发出不同颜色的光，从而进行彩色发光。
例如，驱动电路10、第一复位偏置电路21和第二复位偏置电路22的具体结构可以根据实际应用需求进行设定，本公开的实施例对此不作具体限定。例如，本公开实施例提供的一种像素电路100可以实现为如图2所示的电路结构。
例如，如图2所示，在一个实施例中，驱动电路10包括驱动晶体管T1。驱动电路10的控制端a3为驱动晶体管T1的栅极，驱动电路10的第一端a1为驱动晶体管T1的第一极，驱动电路10的第二端a2为驱动晶体管T1的第二极。“驱动电路10处于偏置状态”可以表示驱动晶体管T1处于偏置状态，也就是说，第一复位偏置电路21和第二复位偏置电路22可以在复位阶段控制驱动晶体管T1处于偏置状态。
例如，驱动晶体管T1为P型晶体管。驱动晶体管T1的第一极可以为源极，驱动晶体管T1的第二极可以为漏极。在本公开的描述中，“驱动晶体管T1处于偏置状态”可以表示驱动晶体管T1的栅极和源极之间的电压差不大于最大灰阶(即255灰阶)对应的栅极和源极之间的电压差Vgs255，即驱动晶体管T1的Vgs小于等于Vgs255。“驱动晶体管T1处于偏置状态”还可以表示驱动晶体管T1的栅极和源极之间的电压差不小于驱动晶体管T1的阈值电压Vth1，即驱动晶体管T1的Vgs大于等于Vth1。
例如，第一复位偏置电路21被配置为在复位阶段向驱动晶体管T1的栅极写入第一偏置电压信号；第二复位偏置电路22被配置为在复位阶段向驱动晶体管T1的第一极写入第二偏置电压信号。第一偏置电压信号和第二偏置电压信号之差控制驱动晶体管T1处于偏置状态。在复位阶段，第一偏置电压信号和第二偏置电压信号分别为驱动晶体管T1的栅极电压和源极电压，从而第一偏置电压信号和第二偏置电压信号之差大于等于Vth1；或者，小于等于Vgs255。
例如，如图2所示，第一复位偏置电路21包括第一偏置晶体管T4。第一复位偏置电路21的第一端b1为第一偏置晶体管T4的第一极，第一复位偏置电路21的第二端b2为第一偏置晶体管T4的第二极，第一复位偏置电路21的控制端b3为第一偏置晶体管T4的栅极。第二复位偏置电路22包括第二偏置晶体管T8。第二复位偏置电路22的第一端c1为第二偏置晶体管T8的第一极，第二复位偏置电路22的第二端c2为第二偏置晶体管T8的第二极，第二复位偏置电路22的控制端c3为第二偏置晶体管T8的栅极。
例如，第一偏置电压端VB1被配置为输出第一偏置电压信号Vinit1，第二偏置电压端VB2被配置为输出第二偏置电压信号Vinit2。
例如，第一偏置晶体管T4的栅极与第一控制端SC1电连接以接收第一控制信号S1，第一偏置晶体管T4的第一极与第一偏置电压端VB1电连接以接收第一偏置电压信号Vinit1。第一偏置晶体管T4的第二极与驱动晶体管T1的栅极电连接，以在第一偏置晶体管T4导通时向驱动晶体管T1的栅极传输第一偏置电压信号Vinit1。
例如，如图2所示，第二偏置晶体管T8的栅极与第一控制端SC1电连接，第二偏置晶体管T8的第一极与复位电压端VR电连接，第二偏置晶体管T8的第二极与驱动晶体管T1的第一极电连接。第一控制端SC1即为偏置控制端BS，复位电压端VR为第二偏置电压端VB2。在复位阶段，第一控制端SC1可以输出第一控制信号S1，第一控制信号S1为偏置控制信号。复位电压端VR可以输出第二偏置电压信号Vinit2，第二偏置晶体管T8的第一极可以接收第二偏置电压信号Vinit2，从而第二偏置电压信号Vinit2可以在第二偏置晶体管T8导通时被传输至驱动晶体管T1的第一极。
例如，在图2所示的实施例中，第一偏置晶体管T4和第二偏置晶体管T8的类型相同。第一偏置晶体管T4和第二偏置晶体管T8例如均为P型晶体管，第一偏置晶体管T4的栅极和第二偏置晶体管T8的栅极均电连接到第一控制端SC1且由相同的第一控制信号S1控制，从而可以节省信号控制端的数量。第一偏置晶体管T4和第二偏置晶体管T8在第一控制信号S1的控制下同时工作。需要说明的是，第一偏置晶体管T4的栅极和第二偏置晶体管T8的栅极也可以分别电连接到不同的信号控制端，以接收不同的控制信号，只要保证第一偏置晶体管T4的栅极和第二偏置晶体管T8能在复位阶段同时工作即可。
需要说明的是，第一偏置晶体管T4和第二偏置晶体管T8的类型也可以不相同，本公开对此不作限制。
例如，第一偏置电压信号Vinit1与第二偏置电压信号Vinit2可以相等，由此第一偏置晶体管T4的第一极和第二偏置晶体管T8的第一极可以均电连接到同一个偏置电压端(例如，第一偏置电压端VB1或第二偏置电压端VB2)，也就是说，像素电路100可以仅包括一个偏置电压端，从而节省偏置电压端的数量，节省生产成本。但不限于此，第一偏置电压信号Vinit1与第二偏置电压信号Vinit2可以不相等，只要第一偏置电压信号Vinit1与第二偏置电压信号Vinit2之差大于等于Vth1；或者，小于等于Vgs255即可(即，Vinit1-Vinit2≤Vgs255，或Vinit1-Vinit2≥Vth1)。本公开对此不作具体限制。
例如，如图2所示，像素电路100还可以包括数据写入电路11和存储电路12。数据写入电路11被配置为在数据写入阶段向驱动晶体管T1的栅极写入数据信号；存储电路12被配置为存储数据信号并将其保持在驱动晶体管T1的栅极。
例如，存储电路12包括存储电容Cst。存储电容Cst的第一端电连接至驱动晶体管T1的第一极，存储电容Cst的第二端电连接至驱动晶体管T1的栅极。也就是说，第一偏置晶体管T4的第二极与存储电容Cst的第二端电连接，第二偏置晶体管T8的第二极与存储电容Cst的第一端电连接。从而，在复位阶段，存储电容Cst的第一端可以存储第二偏置电压信号Vinit2并将其保持在驱动晶体管T1的第一极，存储电容Cst的第二端可以存储第一偏置电压信号Vinit1并将其保持在驱动晶体管T1的栅极。
例如，根据实际应用需求，像素电路100还可以具备电学补偿功能。电学补偿功能可以通过电压补偿、电流补偿或混合补偿来实现。
例如，如图2所示，像素电路100还可以包括阈值补偿电路13。阈值补偿电路13被配置为在数据写入阶段向驱动晶体管T1的栅极写入阈值补偿信号，以补偿驱动晶体管T1的阈值电压Vth1漂移。从而，本公开实施例的像素电路100可以补偿驱动晶体管T1的阈值电压漂移，提高显示均匀性和显示效果。
例如，阈值补偿电路13可以包括阈值补偿晶体管T3，数据写入电路11可以包括数据写入晶体管T2。如图2所示，阈值补偿晶体管T3的第一极与数据写入晶体管T2的第二极电连接，阈值补偿晶体管T3的第二极和栅极彼此电连接，并电连接至驱动晶体管T1的栅极。数据写入晶体管T2的第一极与数据信号端VD电连接，数据写入晶体管T2的栅极与第二控制端SC2电连接。
例如，阈值补偿晶体管T3和驱动晶体管T1相同，也就是说，阈值补偿晶体管T3和驱动晶体管T1的类型、制备工艺等均相同，从而保证阈值补偿晶体管T3的阈值电压Vth2和驱动晶体管T1的阈值电压Vth1相同。阈值补偿晶体管T3例如也为P型晶体管。
例如，第一偏置电压信号Vinit1小于阈值补偿晶体管T3的阈值电压Vth2和数据信号Vdata之和。也就是说，第一偏置电压信号Vinit1需要满足以下公式：Vinit1<Vth2+Vdata。由于阈值补偿晶体管T3的阈值电压Vth2和驱动晶体管T1的阈值电压Vth1相同，即，Vinit1<Vth1+Vdata。
例如，在数据写入阶段，第二控制端SC2可以向数据写入晶体管T2的栅极提供第二控制信号S2，以使数据写入晶体管T2导通。数据信号端VD可以向数据写入晶体管T2的第一极提供数据信号Vdata。由于阈值补偿晶体管T3的第二极和栅极彼此电连接，阈值补偿晶体管T3导通。由此，数据信号端VD提供的数据信号Vdata可以经由数据写入晶体管T2和阈值补偿晶体管T3对存储电容Cst的第二端充电，以将数据信号Vdata和驱动晶体管T1的阈值电压Vth1存储在存储电容Cst的第二端，且该存储的数据信号Vdata和驱动晶体管T1的阈值电压Vth1可以控制驱动晶体管T1的导通程度，从而控制流过驱动晶体管T1的发光电流大小，该流过驱动晶体管T1的发光电流可以决定发光元件EL的发光的灰阶(即发光强度)。
例如，在图2所示的实施例中，阈值补偿电路13为内部补偿电路，但不限于此，阈值补偿电路13也可以为外部补偿电路，外部补偿电路例如可以包括感测电路部分以感测驱动晶体管T1的电学特性或发光元件EL的电学特性，具体构造可以参见常规设计，这里不再赘述。
例如，如图2所示，像素电路100还可以包括压降补偿电路14。压降补偿电路14被配置在数据写入阶段向驱动晶体管T1的第一极写入参考电压信号Vref，以补偿由于显示面板的电源电压降(IR drop)引起的发光元件EL的显示电压差异，提高显示画质、改善显示效果。
例如，压降补偿电路14可以包括压降补偿晶体管T6。压降补偿晶体管T6的第一极与参考电源端REF电连接。压降补偿晶体管T6的第二极电连接至驱动晶体管T1的第一极，即压降补偿晶体管T6的第二极也与存储电容Cst的第一端电连接。压降补偿晶体管T6的栅极与第二控制端SC2电连接。
例如，在数据写入阶段，第二控制端SC2可以向压降补偿晶体管T6的栅极提供第二控制信号S2，以使压降补偿晶体管T6导通。参考电源端REF可以向压降补偿晶体管T6的第一极提供参考电压信号Vref，从而参考电压信号Vref经由压降补偿晶体管T6对存储电容Cst的第一端充电，由此存储电容Cst的第一端的电压可以为参考电压信号Vref。
例如，如图2所示，像素电路100还可以包括发光控制电路15。发光控制电路15被配置为控制驱动电路10驱动发光元件EL发光。发光控制电路15可以包括第一发光控制子电路151和第二发光控制子电路152。第一发光控制子电路151设置在驱动电路10与发光元件EL之间，且被配置为控制将驱动电路10与发光元件EL导通或断开。第二发光控制子电路152设置在第一电源电压端V1和驱动电路10之间，且被配置为控制将第一电源电压端V1和驱动电路10导通或断开。
例如，第一发光控制子电路151可以包括第一控制晶体管T7，第二发光控制子电路152可以包括第二控制晶体管T5。第一控制晶体管T7的第一极电连接至驱动晶体管T1的第二极，第一控制晶体管T7的第二极电连接至发光元件EL的第一端(例如，发光元件EL的正极端)，第一控制晶体管T7的栅极与第三控制端SC3电连接；第二控制晶体管T5的第一极电连接至第一电源电压端V1，第二控制晶体管T5的第二极电连接至驱动晶体管T1的第一极，第二控制晶体管T5的栅极被配置接收发光控制信号。发光元件EL的第二端(例如，发光元件EL的负极端)电连接至第二电源电压端V2。
例如，在图2所示的实施例中，第三控制端SC3可以在发光阶段输出第三控制信号S3，第三控制信号S3即为发光控制信号，第二控制晶体管T5的栅极电连接至第三控制端SC3以接收该发光控制信号，也就是说，第一控制晶体管T7的栅极和第二控制晶体管T5的栅极可以均电连接到第三控制端SC3，且第三控制端SC3可以同时向第一控制晶体管T7的栅极和第二控制晶体管T5的栅极传输相同的发光控制信号。
需要说明的是，第一控制晶体管T7和第二控制晶体管T5也可以电连接至不同的控制端，而不同的控制端施加的发光控制信号同步。本公开实施例对此不作限制。
例如，在发光阶段，发光控制信号被同时施加到第一控制晶体管T7和第二控制晶体管T5的栅极，以使得第一控制晶体管T7和第二控制晶体管T5同时导通，从而第一电源电压端V1、第二控制晶体管T5、驱动晶体管T1、第一控制晶体管T7、发光元件EL和第二电源电压端V2可以形成回路，发光电流经由导通的第二控制晶体管T5、驱动晶体管T1和第一控制晶体管T7被传输至发光元件EL以驱动其发光。
例如，第一电源电压端V1为高压端，且可以输出第一电源电压信号Vdd，第二电源电压端V2为低压端，且可以输出第二电源电压信号Vss。高压端输出的电压信号大于低压端输出的电压信号，即第一电源电压信号Vdd可以大于第二电源电压信号Vss。但不限于此，在一些实施例中，第一电源电压端V1也可以为低压端，而第二电源电压端V2为高压端。例如，高压端可以电连接电源的正极。低压端可以电连接电源的负极。低压端还可以电连接至地端(GND)。
需要说明的是，数据写入电路11、存储电路12、阈值补偿电路13、压降补偿电路14和发光控制电路15等电路的具体结构可以根据实际应用需求进行设定，本公开的实施例对此不作具体限定。
图3为本公开另一实施例提供的一种像素电路的结构示意图。
例如，在另一个实施例中，图2所示的第二偏置晶体管可以复用为第二控制晶体管，由此该像素电路可以节省一个晶体管(省去图2的晶体管T5)，节约生产成本。如图3所示，第二偏置晶体管T8可以为N型晶体管，且被配置为在复位阶段向驱动晶体管T1的第一极写入第二偏置电压信号Vinit2。此处，第二偏置晶体管T8的栅极与第二控制端SC2电连接，第二偏置晶体管T8的第一极与第一电源电压端V1电连接，第二偏置晶体管T8的第二极与驱动晶体管T1的第一极电连接。第一电源电压端V1被配置为在复位阶段向第二偏置晶体管T8的第一极传输第一电源电压信号Vdd，此时，第二偏置电压信号Vinit2即为第一电源电压信号Vdd。
例如，在复位阶段，第一控制端SC1可以输出第一控制信号S1以控制第一偏置晶体管T4导通，第二控制端SC2可以输出第二控制信号S2以控制第二偏置晶体管T8导通；第一偏置电压端VB1被配置为输出第一偏置电压信号Vinit1，第一偏置电压信号Vinit1可以经由第一偏置晶体管T4传输至驱动晶体管T1的栅极，第一电源电压端V1可以输出第一电源电压信号Vdd，第一电源电压信号Vdd即为第二偏置电压信号Vinit2，第一电源电压信号Vdd可以经由第二偏置晶体管T8传输至驱动晶体管T1的第一极。在这种情形下，在复位阶段，第二控制端SC2为偏置控制端BS，第一电源电压端V1为第二偏置电压端VB2，第一控制信号S1和第二控制信号S2均为偏置控制信号。
例如，在发光阶段，第二控制端SC2输出第二控制信号S2，第三控制端输出第三控制信号S3，第二控制信号S2和第三控制信号S3用于控制第二偏置晶体管T8和第一控制晶体管T7同时导通，从而控制将发光电流传输至发光元件EL以驱动其发光。在这种情形下，在发光阶段，第二控制信号S2和第三控制信号S3均为发光控制信号。
需要说明的是，图3所示的实施例中其余电路(例如，第一复位偏置电路21、数据写入电路11、存储电路12、阈值补偿电路13和压降补偿电路14等)可以与图2所示的实施例中相应电路的结构和连接方式均相同，在此不再赘述。
例如，在图3所示的实施例中，第二偏置晶体管T8的栅极与数据写入晶体管T2的栅极、压降补偿晶体管T6的栅极均通过相同的第二控制信号S2控制，第二偏置晶体管T8与数据写入晶体管T2、压降补偿晶体管T6的类型可以不同。也就是说，若第二偏置晶体管T8为N型晶体管，则数据写入晶体管T2和压降补偿晶体管T6均为P型晶体管。但不限于此，第二偏置晶体管T8的栅极与数据写入晶体管T2的栅极、压降补偿晶体管T6的栅极也可以通过不同的控制信号控制，在此种情形下，第二偏置晶体管T8与数据写入晶体管T2、压降补偿晶体管T6的类型则没有限制，即第二偏置晶体管T8与数据写入晶体管T2、压降补偿晶体管T6的类型可以相同(例如均为P型晶体管)，也可以不相同。本公开对此不作限制。
值得注意的是，按照晶体管的特性，晶体管可以分为N型晶体管和P型晶体管，为了清楚起见，本公开的实施例以晶体管为P型晶体管为例详细阐述了本公开的技术方案。然而本公开的实施例的晶体管不限于P型晶体管，除了驱动晶体管T1和阈值补偿晶体管T3以外，本领域技术人员还可以根据实际需要利用N型晶体管实现本公开中的实施例中的一个或多个晶体管的功能。
在本公开的实施例中，晶体管的第一极可以为源极或漏极，相应地，晶体管的第二极为漏极或源极。所以本公开实施例中全部或部分晶体管的第一极和第二极根据需要是可以互换的。对于不同类型的晶体管，其栅极的控制信号也不相同。例如，对于N型晶体管，在控制信号为高电平信号时，该N型晶体管处于开启状态；而在控制信号为低电平信号时，N型晶体管处于截止状态。对于P型晶体管时，在控制信号为低电平信号时，该P型晶体管处于开启状态；而在控制信号为高电平信号时，P型晶体管处于截止状态。本公开实施例中的控制信号可以根据晶体管的类型而相应变化。
本公开实施例还提供一种显示面板。图4为本公开一实施例提供的一种显示面板的示意性框图。如图4所示，显示面板70包括多个像素单元110，多个像素单元110可以阵列排布，根据实际应用需求，显示面板70例如可以包括1440行、900列的像素单元110。每个像素单元110可以包括上述任一实施例所述的像素电路100。该像素电路100通过在复位阶段使驱动电路处于偏置状态，从而改善因磁滞效应产生的短期残像现象，提高显示面板的显示质量。
例如，显示面板70可以为矩形面板、圆形面板、椭圆形面板或多边形面板等。另外，显示面板70不仅可以为平面面板，也可以为曲面面板，甚至球面面板。
例如，显示面板70还可以具备触控功能，即显示面板70可以为触控显示面板。
本公开实施例还提供一种显示设备。图5为本公开一实施例提供的一种显示设备的示意性框图。如图5所示，显示设备80包括上述任一所述的显示面板70，显示面板70用于显示图像。显示面板70的每个像素单元包括上述任一实施例所述的像素电路。像素电路包括驱动电路、数据写入电路、存储电路、发光元件、第一复位偏置电路和第二复位偏置电路等。第一复位偏置电路和第二复位偏置电路被配置为在复位阶段控制驱动电路处于偏置状态，从而改善因磁滞效应产生的短期残像现象，提高显示设备的显示质量。
例如，显示设备80还可以包括栅极驱动器82。栅极驱动器82还被配置为通过多条栅线与数据写入电路电连接，以用于为数据写入电路提供第二控制信号。
例如，显示设备80还可以包括数据驱动器84。数据驱动器84被配置为向显示面板70提供数据信号。该数据信号可以为电压信号，用于控制相应像素单元的发光元件的发光强度。数据信号的电压越高则代表灰阶越大，由此使得发光元件的发光强度越大。
例如，栅极驱动器82和数据驱动器84可以分别由各自的专用集成电路芯片或者可以通过半导体制备工艺直接制备在显示面板70上来实现。
例如，显示设备80可以为手机、平板电脑、电视机、显示器、笔记本电脑、数码相框、导航仪等任何具有显示功能的产品或部件。
需要说明的是，对于显示设备80的其它组成部分(例如控制装置、图像数据编码/解码装置、时钟电路等)均为本领域的普通技术人员应该理解具有的，在此不做赘述，也不应作为对本公开的限制。
本公开实施例还提供一种像素电路的驱动方法，该驱动方法可以应用于上述任一项所述的像素电路。
图6为本公开一实施例提供的一种像素电路的驱动方法的示意性流程图。如图6所示，像素电路的驱动方法包括以下步骤：
步骤S101：在复位阶段，对驱动电路进行复位并控制驱动电路处于偏置状态；
步骤S102：在数据写入阶段，向驱动电路写入数据信号；
步骤S103：在发光阶段，驱动发光元件发光。
例如，以图2所示的像素电路为例，像素电路100可以包括发光元件EL、驱动电路10、第一复位偏置电路21和第二复位偏置电路22。驱动电路10包括驱动晶体管T1，第一复位偏置电路21包括第一偏置晶体管T4，第二复位偏置电路22包括第二偏置晶体管T8。由此，在步骤S101中，对驱动电路进行复位并控制驱动电路处于偏置状态可以包括：通过第一偏置晶体管向驱动晶体管的栅极写入第一偏置电压信号；以及通过第二偏置晶体管向驱动晶体管的第一极写入第二偏置电压信号。第一偏置电压信号和第二偏置电压信号之差控制驱动晶体管处于偏置状态。
例如，第一偏置电压信号和第二偏置电压信号可以相同。或者，第一偏置电压信号小于第二偏置电压信号。
例如，在图3所示的实施例中，第二偏置晶体管T8可以被分时复用为第二控制晶体管，第二偏置电压信号可以为第一电源电压信号。
例如，在一个示例中，本公开实施例提供的像素电路的驱动方法可以包括阈值补偿操作。在步骤S102中，驱动方法还可以包括：在数据写入阶段，通过阈值补偿电路向驱动晶体管的栅极写入阈值补偿信号。从而该像素电路可以补偿驱动晶体管的阈值电压。
例如，在一个示例中，本公开实施例提供的像素电路的驱动方法可以包括压降(IRdrop)补偿操作。在步骤S102中，驱动方法还可以包括：在数据写入阶段，通过压降补偿电路向驱动晶体管的第一极写入参考电压信号。从而该像素电路可以补偿第一电源电压端的IRdrop。
例如，像素电路的时序图可以根据实际需求进行设定，本公开的实施例对此不作具体限定。
例如，在一个示例中，图7是图2和图3所示的像素电路的驱动方法的示例性时序图。
例如，图8A至图8C是图2所示的像素电路的在各个工作阶段的示意图。下面结合图2、图7和图8A至图8C详细说明本公开实施例提供的一种像素电路的驱动方法的操作流程。
需要说明的是，在图8A至图8C中，在晶体管的位置处设置虚线方框表示该晶体管处于截止状态，在晶体管的位置处不设置符号则表示该晶体管处于开启状态。带箭头的实线表示信号流向。
例如，如图2、图7和图8A所示，在复位阶段RT，第一控制端SC1提供的第一控制信号S1为低电平信号，从而第一偏置晶体管T4和第二偏置晶体管T8导通。第二控制端SC2提供的第二控制信号S2为高电平信号，第三控制端SC3提供的第三控制信号S3(即发光控制信号)为高电平信号，从而数据写入晶体管T2、压降补偿晶体管T6、第一控制晶体管T7和第二控制晶体管T5均处于截止状态。第一偏置电压端VB1输出第一偏置电压信号Vinit1，且第一偏置电压信号Vinit1小于阈值补偿晶体管T3的阈值电压Vth2和数据信号Vdata之和，从而阈值补偿晶体管T3处于导通状态。第一偏置电压信号Vinit1经由第一偏置晶体管T4传输至驱动晶体管T1的栅极，从而驱动晶体管T1的栅极的电压被重置为第一偏置电压信号Vinit1。第二偏置电压端VB2(即复位电压端VR)可以输出第二偏置电压信号Vinit2，且第二偏置电压信号Vinit2经由第二偏置晶体管T8传输至驱动晶体管T1的第一极，从而驱动晶体管T1的第一极的电压被重置为第二偏置电压信号Vinit2。此时，驱动晶体管T1可以处于导通状态。
例如，在图8A所示的示例中，在复位阶段RT，驱动晶体管T1处于导通状态。但不限于此，在复位阶段RT，驱动晶体管T1也可以处于截止状态。第一偏置电压信号Vinit1和第二偏置电压信号Vinit2例如可以相同，在这种情况下，驱动晶体管T1处于截止状态。
例如，如图2、图7和图8B所示，在数据写入阶段DT，第一控制信号S1变为高电平信号，第二控制信号S2变为低电平信号，第三控制信号S3保持为高电平信号。此时，第一偏置晶体管T4、第二偏置晶体管T8、第一控制晶体管T7和第二控制晶体管T5均处于截止状态，驱动晶体管T1、数据写入晶体管T2、压降补偿晶体管T6和阈值补偿晶体管T3均导通。由此，数据信号Vdata经由数据写入晶体管T2和阈值补偿晶体管T3对存储电容Cst的第二端充电，一直充电至存储电容Cst的第二端的电压为Vdata+Vth2为止，Vth2为阈值补偿晶体管T3的阈值电压Vth2，阈值补偿晶体管T3的阈值电压Vth2与驱动晶体管T1的阈值电压Vth1相同，即存储电容Cst的第二端的电压可以为Vdata+Vth1。此时，驱动晶体管T1的栅极的电压变为Vdata+Vth1。参考电压信号Vref经由压降补偿晶体管T6对存储电容Cst的第一端进行充电，即存储电容Cst的第一端的电压可以为参考电压信号Vref，此时，驱动晶体管T1的第一极的电压变为Vref。
例如，如图2、图7和图8C所示，在发光阶段LT，第一控制信号S1保持高电平信号，第二控制信号S2变为高电平信号，第三控制信号S3变为低电平信号。此时，第一偏置晶体管T4、第二偏置晶体管T8、数据写入晶体管T2、压降补偿晶体管T6和阈值补偿晶体管T3均处于截止状态，而驱动晶体管T1、第一控制晶体管T7和第二控制晶体管T5均导通。由此，第一电源电压端V1输出的第一电源电压信号Vdd可以经由第二控制晶体管T5传输至驱动晶体管T1的第一极，驱动晶体管T1的第一极的电压变为第一电源电压信号Vdd，从而驱动晶体管T1的栅极的电压变为Vdata+Vth1+Vdd-Vref。
由上分析可知，在三个阶段(复位阶段、数据写入阶段和发光阶段)中，驱动晶体管T1的栅极和第一极的电压的对应关系可以如下表格1所示。
表格1
工作阶段 驱动晶体管T1的栅极 驱动晶体管T1的第一极
RT V<sub>init1</sub> V<sub>init2</sub>
DT V<sub>data</sub>+V<sub>th1</sub> V<sub>ref</sub>
LT V<sub>data</sub>+V<sub>th1</sub>+V<sub>dd</sub>-V<sub>ref</sub> V<sub>dd</sub>
例如，图9A至图9C是图3所示的像素电路的在各个工作阶段的示意图。下面结合图3、图7和图9A至图9C详细说明本公开实施例提供的另一种像素电路的驱动方法的操作流程。
需要说明的是，在图9A至图9C中，在晶体管的位置处设置虚线方框表示该晶体管处于截止状态，在晶体管的位置处不设置符号则表示该晶体管处于开启状态。带箭头的实线表示信号流向。
例如，如图3、图7和图9A所示，在复位阶段RT，第一控制端SC1提供的第一控制信号S1为低电平信号，从而第一偏置晶体管T4导通。第二控制端SC2提供的第二控制信号S2为高电平信号，从而第二偏置晶体管T8导通，而数据写入晶体管T2和压降补偿晶体管T6处于截止状态。第三控制端SC3提供的第三控制信号S3(即发光控制信号)为高电平信号，从而第一控制晶体管T7处于截止状态。第一偏置电压端VB1输出第一偏置电压信号Vinit1，且第一偏置电压信号Vinit1小于阈值补偿晶体管T3的阈值电压Vth2和数据信号Vdata之和，从而阈值补偿晶体管T3处于导通状态。第一偏置电压信号Vinit1经由第一偏置晶体管T4传输至驱动晶体管T1的栅极，从而驱动晶体管T1的栅极的电压被重置为第一偏置电压信号Vinit1。第一电源电压端V1(即第二偏置电压端VB2)可以输出第一电源电压信号Vdd，且第一电源电压信号Vdd经由第二偏置晶体管T8传输至驱动晶体管T1的第一极，从而驱动晶体管T1的第一极的电压被重置为第一电源电压信号Vdd。此时，驱动晶体管T1可以处于导通状态。
例如，第一电源电压信号Vdd可以大于第一偏置电压信号Vinit1，且第一偏置电压信号Vinit1与第一电源电压信号Vdd之差不大于Vgs255(最大灰阶对应的驱动晶体管T1的栅源电压差)，即Vinit1-Vdd小于等于Vgs255。
例如，在图9A所示的示例中，在复位阶段RT，驱动晶体管T1处于导通状态。但不限于此，在复位阶段RT，驱动晶体管T1也可以处于截止状态。例如，若在复位阶段RT，Vinit1-Vdd大于驱动晶体管T1的阈值电压Vth1，此时，驱动晶体管T1处于截止状态。
例如，如图3、图7和图9B所示，在数据写入阶段DT，第一控制信号S1变为高电平信号，第二控制信号S2变为低电平信号，第三控制信号S3保持为高电平信号。此时，第一偏置晶体管T4、第二偏置晶体管T8和第一控制晶体管T7均处于截止状态，驱动晶体管T1、数据写入晶体管T2、压降补偿晶体管T6和阈值补偿晶体管T3均导通。由此，数据信号Vdata经由数据写入晶体管T2和阈值补偿晶体管T3对存储电容Cst的第二端充电，一直充电至存储电容Cst的第二端的电压为Vdata+Vth2为止，Vth2为阈值补偿晶体管T3的阈值电压Vth2，阈值补偿晶体管T3的阈值电压Vth2与驱动晶体管T1的阈值电压Vth1相同，即存储电容Cst的第二端的电压可以为Vdata+Vth1。此时，驱动晶体管T1的栅极的电压变为Vdata+Vth1。参考电压信号Vref经由压降补偿晶体管T6对存储电容Cst的第一端进行充电，即存储电容Cst的第一端的电压可以为参考电压信号Vref，此时，驱动晶体管T1的第一极的电压变为Vref。
例如，如图3、图7和图9C所示，在发光阶段LT，第一控制信号S1保持高电平信号，第二控制信号S2变为高电平信号，第三控制信号S3变为低电平信号。此时，第一偏置晶体管T4、数据写入晶体管T2、压降补偿晶体管T6和阈值补偿晶体管T3均处于截止状态，而驱动晶体管T1、第一控制晶体管T7和第二偏置晶体管T8均导通。由此，第一电源电压端V1输出的第一电源电压信号Vdd可以经由第二偏置晶体管T8传输至驱动晶体管T1的第一极，驱动晶体管T1的第一极的电压变为第一电源电压信号Vdd，从而驱动晶体管T1的栅极的电压变为Vdata+Vth1+Vdd-Vref。
由上分析可知，在三个阶段(复位阶段、数据写入阶段和发光阶段)中，驱动晶体管T1的栅极和第一极的电压的对应关系可以如下表格2所示。
表格2
工作阶段 驱动晶体管T1的栅极 驱动晶体管T1的第一极
RT V<sub>init1</sub> V<sub>dd</sub>
DT V<sub>data</sub>+V<sub>th1</sub> V<sub>ref</sub>
LT V<sub>data</sub>+V<sub>th1</sub>+V<sub>dd</sub>-V<sub>ref</sub> V<sub>dd</sub>
参考表格1和表格2，基于驱动晶体管T1的饱和电流公式，可以得到流经驱动晶体管T1的发光电流IOLED可以表示为：
IOLED＝K(VGS–Vth1)2
＝K[(Vdata+Vth1+Vdd-Vref)–Vdd–Vth1]2
＝K(Vdata-Vref)2
上述公式中VGS为驱动晶体管T1的栅极和源极之间的电压差，Vdd为第一电源电压端V1输出的第一电源电压信号，Vth1是驱动晶体管T1的阈值电压。由上式中可以看到，发光电流IOLED已经不受驱动晶体管T1的阈值电压Vth1和第一电源电压端V1的第一电源电压信号的影响，而只与参考电源端REF输出的参考电压信号Vref和数据信号Vdata有关。数据信号Vdata由数据信号端VD直接传输，其与驱动晶体管T1的阈值电压Vth无关，这样就可以解决驱动晶体管T1由于工艺制程及长时间的操作造成阈值电压漂移的问题。参考电压信号Vref由参考电源端REF提供，其与第一电源电压端V1的IR drop无关，从而可以解决显示面板的IR drop的问题。综上所述，像素电路可以保证发光电流IOLED的准确性，消除驱动晶体管T1的阈值电压和IRdrop对发光电流IOLED的影响，保证发光元件EL正常工作，提高显示画面的均匀性，提升显示效果。
例如，上述公式中K为常数，且K可以表示为：
K＝0.5μnCox(W/L)
其中，μn为驱动晶体管T1的电子迁移率，Cox为驱动晶体管T1的栅极单位电容量，W为驱动晶体管T1的沟道宽，L为驱动晶体管T1的沟道长。
需要说明的是，复位阶段、数据写入阶段和发光阶段的设置方式可以根据实际应用需求进行设定，本公开的实施例对此不作具体限定。
由此，本公开实施例提供的像素电路的驱动方法通过在复位阶段使驱动晶体管处于偏置状态，从而改善因磁滞效应产生的短期残像问题，提高显示均匀性和显示质量。另外，本公开实施例提供的像素电路的驱动方法还可以进行阈值补偿操作和压降补偿操作，从而补偿驱动晶体管的阈值电压漂移和显示面板的IR drop，有效改善显示面板的显示效果，提高显示质量。
对于本公开，还有以下几点需要说明：
(1)本公开实施例附图只涉及到与本公开实施例涉及到的结构，其他结构可参考通常设计。
(2)在不冲突的情况下，本公开的实施例及实施例中的特征可以相互组合以得到新的实施例。
以上所述仅为本公开的具体实施方式，但本公开的保护范围并不局限于此，本公开的保护范围应以所述权利要求的保护范围为准。

Claims (19)

1.一种像素电路，包括：发光元件、驱动电路、数据写入电路、压降补偿电路、第一复位偏置电路和第二复位偏置电路，其中，
所述驱动电路的控制端与所述数据写入电路以及所述第一复位偏置电路的第二端电连接，所述驱动电路的第一端与所述压降补偿电路以及所述第二复位偏置电路的第二端电连接，所述驱动电路的第二端与所述发光元件电连接；
所述第一复位偏置电路的控制端与第一控制端电连接，所述第一复位偏置电路的第一端与第一偏置电压端电连接；
所述第二复位偏置电路的控制端与偏置控制端电连接，所述第二复位偏置电路的第一端与第二偏置电压端电连接；
所述驱动电路包括驱动晶体管，所述第一复位偏置电路和所述第二复位偏置电路被配置为在复位阶段对所述驱动电路进行复位并控制所述驱动晶体管处于偏置状态，所述偏置状态可以表示所述驱动晶体管的栅极和第一极之间的电压差不大于最大灰阶对应的栅极和第一极之间的电压差，或者，所述偏置状态表示所述驱动晶体管的栅极和第一极之间的电压差不小于所述驱动晶体管的阈值电压，
所述数据写入电路与数据信号端和第二控制端连接，且被配置为在数据写入阶段在所述第二控制端提供的第二控制信号的控制下向所述驱动电路的控制端写入所述数据信号端提供的数据信号；
所述压降补偿电路与参考电源端和所述第二控制端连接，且被配置在所述数据写入阶段在所述第二控制端提供的所述第二控制信号的控制下向所述驱动电路的第一端写入所述参考电源端提供的参考电压信号；
所述偏置控制端为所述第一控制端或所述第二控制端。
2.根据权利要求1所述的像素电路，其中，所述第一复位偏置电路包括第一偏置晶体管，所述第二复位偏置电路包括第二偏置晶体管，
所述驱动电路的控制端为所述驱动晶体管的栅极，所述驱动电路的第一端为所述驱动晶体管的第一极，所述驱动电路的第二端为所述驱动晶体管的第二极，
所述第一复位偏置电路的第一端为所述第一偏置晶体管的第一极，所述第一复位偏置电路的第二端为所述第一偏置晶体管的第二极，所述第一复位偏置电路的控制端为所述第一偏置晶体管的栅极，
所述第二复位偏置电路的第一端为所述第二偏置晶体管的第一极，所述第二复位偏置电路的第二端为所述第二偏置晶体管的第二极，所述第二复位偏置电路的控制端为所述第二偏置晶体管的栅极。
3.根据权利要求2所述的像素电路，还包括：存储电路，
其中，所述存储电路被配置为存储所述数据信号并将其保持在所述驱动晶体管的栅极。
4.根据权利要求3所述的像素电路，还包括阈值补偿电路，
其中，所述阈值补偿电路被配置为在所述数据写入阶段向所述驱动晶体管的栅极写入阈值补偿信号。
5.根据权利要求4所述的像素电路，其中，所述阈值补偿电路包括阈值补偿晶体管，所述数据写入电路包括数据写入晶体管，所述存储电路包括存储电容，
所述阈值补偿晶体管的第一极与所述数据写入晶体管的第二极电连接，所述阈值补偿晶体管的第二极和栅极彼此电连接，并电连接至所述驱动晶体管的栅极；
所述数据写入晶体管的第一极与所述数据信号端电连接，所述数据写入晶体管的栅极与所述第二控制端电连接；
所述存储电容的第一端电连接至所述驱动晶体管的第一极，所述存储电容的第二端电连接至所述驱动晶体管的栅极。
6.根据权利要求3所述的像素电路，其中，所述压降补偿电路包括压降补偿晶体管，所述存储电路包括存储电容，
所述压降补偿晶体管的第一极与所述参考电源端电连接，所述压降补偿晶体管的第二极电连接至所述驱动晶体管的第一极，所述压降补偿晶体管的栅极与所述第二控制端电连接；
所述存储电容的第一端电连接至所述驱动晶体管的第一极，所述存储电容的第二端电连接至所述驱动晶体管的栅极。
7.根据权利要求6所述的像素电路，还包括发光控制电路，
其中，所述发光控制电路被配置为控制所述驱动电路驱动所述发光元件发光。
8.根据权利要求7所述的像素电路，其中，所述发光控制电路包括第一控制晶体管和第二控制晶体管，
所述第一控制晶体管的第一极电连接至所述驱动晶体管的第二极，所述第一控制晶体管的第二极电连接至所述发光元件，所述第一控制晶体管的栅极与第三控制端电连接；
所述第二控制晶体管的第一极电连接至第一电源电压端，所述第二控制晶体管的第二极电连接至所述驱动晶体管的第一极，所述第二控制晶体管的栅极被配置接收发光控制信号。
9.根据权利要求8所述的像素电路，其中，所述第二控制晶体管的栅极电连接至所述第三控制端以接收所述发光控制信号，
在所述偏置控制端为所述第一控制端的情况下，所述第二偏置晶体管的栅极与所述第一控制端电连接，所述第二偏置晶体管的第一极与复位电压端电连接，所述复位电压端为所述第二偏置电压端。
10.根据权利要求9所述的像素电路，其中，所述第一偏置电压端输出的信号与所述第二偏置电压端输出的信号相同。
11.根据权利要求8所述的像素电路，其中，所述第二偏置晶体管复用为所述第二控制晶体管。
12.根据权利要求11所述的像素电路，其中，所述第二偏置晶体管为N型晶体管，所述偏置控制端为所述第二控制端，所述第二偏置晶体管的栅极与所述第二控制端电连接，所述第一电源电压端为所述第二偏置电压端。
13.一种显示面板，包括根据权利要求1-12任一所述的像素电路。
14.一种显示设备，包括如权利要求13所述的显示面板。
15.一种如权利要求1-12任一项所述的像素电路的驱动方法，包括：
在所述复位阶段，对所述驱动电路进行复位并控制所述驱动晶体管处于偏置状态；
在数据写入阶段，通过所述数据写入电路向所述驱动电路的控制端写入所述数据信号和通过所述压降补偿电路向所述驱动电路的第一端写入所述参考电压信号；
在发光阶段，驱动所述发光元件发光。
16.根据权利要求15所述的驱动方法，其中，所述第一复位偏置电路包括第一偏置晶体管，所述第二复位偏置电路包括第二偏置晶体管；
对所述驱动电路进行复位并控制所述驱动电路处于偏置状态包括：
通过所述第一偏置晶体管向所述驱动晶体管的栅极写入第一偏置电压信号；以及
通过所述第二偏置晶体管向所述驱动晶体管的第一极写入第二偏置电压信号，
其中，所述第一偏置电压信号和所述第二偏置电压信号之差控制所述驱动晶体管处于偏置状态。
17.根据权利要求16所述的驱动方法，其中，所述第一偏置电压信号和所述第二偏置电压信号相同。
18.根据权利要求16所述的驱动方法，其中，所述第二偏置晶体管的第一极电连接至第一电源电压端以接收第一电源电压信号，所述第一电源电压信号为所述第二偏置电压信号。
19.根据权利要求15所述的驱动方法，还包括：
在所述数据写入阶段，通过阈值补偿电路向所述驱动晶体管的栅极写入阈值补偿信号。
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