CN107204944A - 发送序列产生装置、训练序列同步装置、信道间隔估计装置、方法和*** - Google Patents

发送序列产生装置、训练序列同步装置、信道间隔估计装置、方法和*** Download PDF

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Abstract

本发明实施例提供一种发送序列产生装置、训练序列同步装置、信道间隔估计装置、方法和***，该训练序列的同步装置包括：延时相关处理单元，其对包含周期性训练序列的接收序列并行地进行不同延时量的自相关操作，得到多个并行的相关序列；叠加处理单元，其对所述多个并行的相关序列进行叠加操作，得到同步相关序列；同步提取单元，其对所述同步相关序列进行同步位置提取，得到训练序列的同步位置。通过本发明实施例，能够增强训练序列的抗噪声性能。

Description

发送序列产生装置、训练序列同步装置、信道间隔估计装置、方法和 ***
技术领域
本发明涉及通信技术领域，尤其涉及一种发送序列产生装置、训练序列同步装置、信道间隔估计装置、方法和***。
背景技术
目前，训练序列在高速光纤通信***中起重要作用。首先，由于光纤信道不理想，常需要引入训练序列来协助接收机进行信道均衡；其次，训练序列还可以用于协助进行性能检测、频差估计等。而基于训练序列的处理都是以训练序列的提取(同步)为前提的，鉴于训练序列同步处理的重要作用，有效的训练序列设计及同步方法成为提高传输***性能的关键。
在非理想条件下，***噪声是影响训练序列同步性能的关键因素，有效的训练序列设计和处理方法可以增强训练序列的抗噪声特性，抗噪声特性的提高不仅有利于同步位置的提取，还可以带来训练序列若干功能的强化，从而使整个***具有良好的通信性能。
应该注意，上面对技术背景的介绍只是为了方便对本发明的技术方案进行清楚、完整的说明，并方便本领域技术人员的理解而阐述的。不能仅仅因为这些方案在本发明的背景技术部分进行了阐述而认为上述技术方案为本领域技术人员所公知。
发明内容
发明人发现，解决训练序列的抗噪声问题是设计和训练序列同步的基础，也是进一步优化光纤通信***的有效手段。在实现训练序列同步抗噪声强化的过程中，不希望引入额外硬件开销，所以在光接收机进行有效数字信号信号处理，在不引入过大复杂度的情况下增强训练序列抗噪声特性，改善训练序列在用于同步方面的性能，是本申请的出发点。
本发明实施例提供了一种发送序列生成装置、训练序列同步装置、信道间隔估计装置、方法和***，该训练序列同步装置利用光接收机的信息，对具有周期性的训练序列进行提取，并利用多周期重复的性质来增强训练序列的抗噪声性能，由此，显著改善了训练序列的抗噪声性能。
根据本发明实施例的第一方面，提供了一种发送序列产生装置，其中，该装置包括：
产生单元，其将周期性训练序列***到发送数据中，得到发送序列，其中，所述周期性训练序列包括多个重复的子序列，各子序列之间首尾相接构成所述周期性训练序列。
根据本发明实施例的第二方面，提供了一种训练序列同步装置，其中，该装置包括：
延时相关处理单元，其对包含周期性训练序列的接收序列并行地进行不同延时量的自相关操作，得到多个并行的相关序列；
叠加处理单元，其对所述多个并行的相关序列进行叠加操作，得到同步相关序列；
同步提取单元，其对所述同步相关序列进行同步位置提取，得到训练序列的同步位置。
根据本发明实施例的第三方面，提供了一种信道间隔估计装置，其中，所述装置包括：
同步单元，其对包含周期性训练序列的中心信道的接收序列并行地进行不同延时量的自相关操作，得到多个并行的相关序列，对所述多个并行的相关序列进行叠加操作，得到同步相关序列，对所述同步相关序列进行同步位置提取，得到中心信道的训练序列的同步位置；对包含周期性训练序列的邻道的接收序列并行地进行不同延时量的自相关操作，得到多个并行的相关序列，对所述多个并行的相关序列进行叠加操作，得到同步相关序列，对所述同步相关序列进行同步位置提取，得到邻道的训练序列的同步位置；
第一估计单元，其利用中心信道的训练序列的同步位置估计中心信道的频偏，并第二估计单元，其利用邻道的训练序列的位置估计邻道的频偏；
第二估计单元，利用中心信道的频偏和邻道的频偏估计信道间隔。
根据本发明实施例的第四方面，提供了一种发射机，其中，所述发射机包括前述第一方面所述的装置。
根据本发明实施例的第五方面，提供了一种接收机，其中，所述接收机包括前述第二方面或第三方面所述的装置。
根据本发明实施例的第六方面，提供了一种通信***，其中，所述通信***包括前述第四方面所述的发射机和前述第五方面所述的接收机。
根据本发明实施例的第七方面，提供了一种发送序列产生方法，其中，该方法包括：
将周期性训练序列***到发送数据中，得到发送序列，其中，所述周期性训练序列包括多个重复的子序列，各子序列之间首尾相接构成所述周期性训练序列。
根据本发明实施例的第八方面，提供了一种训练序列同步方法，其中，所述方法包括：
对包含周期性训练序列的接收序列并行地进行不同延时量的自相关操作，得到多个并行的相关序列；
对所述多个并行的相关序列进行叠加操作，得到同步相关序列；
对所述同步相关序列进行同步位置提取，得到训练序列的同步位置。
根据本发明实施例的第九方面，提供了一种信道间隔估计方法，其中，所述方法包括：
对包含周期性训练序列的中心信道的接收序列并行地进行不同延时量的自相关操作，得到多个并行的相关序列，对所述多个并行的相关序列进行叠加操作，得到同步相关序列，对所述同步相关序列进行同步位置提取，得到中心信道的训练序列的同步位置；
对包含周期性训练序列的邻道的接收序列并行地进行不同延时量的自相关操作，得到多个并行的相关序列，对所述多个并行的相关序列进行叠加操作，得到同步相关序列，对所述同步相关序列进行同步位置提取，得到邻道的训练序列的同步位置；
利用中心信道的训练序列的同步位置估计中心信道的频偏；
利用邻道的训练序列的位置估计邻道的频偏；
利用中心信道的频偏和邻道的频偏估计信道间隔。
本发明的有益效果在于：通过本发明实施例，利用多周期重复的训练序列增强了训练序列抗噪声性能，这种有效的处理有利于光接收机传输性能的提升，为光接收机模块的产品化提供指导。
参照后文的说明和附图，详细公开了本发明的特定实施方式，指明了本发明的原理可以被采用的方式。应该理解，本发明的实施方式在范围上并不因而受到限制。在所附权利要求的精神和条款的范围内，本发明的实施方式包括许多改变、修改和等同。
针对一种实施方式描述和/或示出的特征可以以相同或类似的方式在一个或更多个其它实施方式中使用，与其它实施方式中的特征相组合，或替代其它实施方式中的特征。
应该强调，术语“包括/包含”在本文使用时指特征、整件、步骤或组件的存在，但并不排除一个或更多个其它特征、整件、步骤或组件的存在或附加。
附图说明
所包括的附图用来提供对本发明实施例的进一步的理解，其构成了说明书的一部分，用于例示本发明的实施方式，并与文字描述一起来阐释本发明的原理。显而易见地，下面描述中的附图仅仅是本发明的一些实施例，对于本领域普通技术人员来讲，在不付出创造性劳动性的前提下，还可以根据这些附图获得其他的附图。在附图中：
图1是实施例1的发送序列产生装置的示意图；
图2是周期性的训练序列的结构的示意图；
图3是实施例2的训练序列同步装置的示意图；
图4是接收训练的结构的示意图；
图5是预处理单元的一个实施方式的示意图；
图6是预处理单元的另一个实施方式的示意图；
图7是实施例3的信道间隔估计装置的示意图；
图8是中心信道和邻道的滤波示意图；
图9是实施例4的发射机的示意图；
图10是实施例4的发射机的***构成示意图；
图11是实施例5的接收机的示意图；
图12是实施例5的接收机的***构成示意图；
图13是实施例6的通信***的示意图；
图14是实施例7的发送序列产生方法的示意图；
图15是实施例8的训练序列同步方法的示意图；
图16是实施例9的信道间隔估计方法的示意图。
具体实施方式
参照附图，通过下面的说明书，本发明的前述以及其它特征将变得明显。在说明书和附图中，具体公开了本发明的特定实施方式，其表明了其中可以采用本发明的原则的部分实施方式，应了解的是，本发明不限于所描述的实施方式，相反，本发明包括落入所附权利要求的范围内的全部修改、变型以及等同物。
下面结合附图和具体实施方式对本发明实施例进行说明。
实施例1
本发明实施例提供了一种发送序列产生装置，该装置配置于通信***的发射机中，用于产生包含周期性训练序列的发送序列，以提高训练序列的抗噪声性能。
图1是该发送序列产生装置100的示意图，请参照图1，该装置100包括：产生单元101，其将周期性训练序列***到发送数据中，得到发送序列，在本实施例中，该周期性训练序列包括多个重复的子序列，各子序列之间首尾相接构成该周期性训练序列。
图2是该周期性训练序列的一个实施方式的结构示意图，如图2所示，在本实施方式中，该训练序列包含N个重复的子序列，子序列之间首尾相接构成周期性的训练序列，每段子序列中包含m个数据符号。本实施例对N不做限制，可以等于1，优选大于10。并且，本实施例对m也不做限制。由此，构成了周期为m的周期性的训练序列。
在本实施方式中，各子序列之间可以***数据，也可以没有数据，如果***数据，需要保证子序列的周期性，也即，***的数据也需要具有周期性。此外，本实施例对各子序列的结构也不作限制，其可以是传统的序列结构，也可以独立进行设计。
在本实施方式中，该周期性的训练序列可以是所有训练序列的全部，也可以是所有训练序列的一部分，如果该周期性的训练序列是所有训练序列的一部分，则本实施例对其它位置的训练序列的结构不作限制，例如，该其他位置的训练序列可以是周期性的，也可以是非周期性的。
通过本实施例的装置产生了发送序列之后，发射机即可按照常规的方法对该发送序列进行发送，由此，接收机接收到的接收序列中即包含了该周期性的训练序列，通过对该周期性的训练序列的提取，可以用于后续的信道间隔估计、信道均衡等处理。
通过本实施例对***到发送数据中的训练序列的设计，利用周期性重复的特性，提高了训练序列的抗噪声性能。并且只引入了周期性重复这一种约束，对训练序列(子序列)的结构还保留很大的设计自由度，可以便于实现其它功能。所以，从灵活应用的角度考虑，这种结构的训练序列保留了较充分的设计自由度。
实施例2
本发明实施例提供了一种训练序列同步装置，该装置配置于接收机中，利用接收机的信息对具有周期性的训练序列进行提取，并利用多周期重复的性质来增强训练序列的抗噪声性能。
图3是该训练序列同步装置300的示意图，请参照图3，该装置300包括：延时相关处理单元301、叠加处理单元302、以及同步提取单元303。该延时相关处理单元301用于对包含周期性训练序列的接收序列并行地进行不同延时量的自相关操作，得到多个并行的相关序列。该叠加处理单元302用于对该多个并行的相关序列进行叠加操作，得到不同相关序列，该同步提取单元303用于对该同步相关序列进行同步位置提取，得到该训练序列的同步位置。
在本实施例中，接收机接收到的信号(简称为接收序列)如图4所示，其中，训练序列占接收序列的一小部分，由于训练序列位置是未知的，因此本发明实施例的装置针对接收机的整段接收序列进行处理。在本实施例中，该整段接收序列包含有实施例1所述的周期性地训练序列，其训练序列的结构被合并于此，此处不再赘述。
在本实施例中，如图3所示，可选的，该装置300还可以包括预处理单元304，在图3中用虚框示出。该预处理单元304用于对包含该周期性训练序列的接收序列进行预处理，以得到预处理后的接收序列提供给该延时相关处理单元301。在本实施例中，在得到整段接收序列后，可以先通过该预处理单元304对该接收序列进行预处理，以便有选择性的进行去除噪声、解复用、预均衡等处理。
在本实施例中，对接收序列的预处理可以考虑已有的IQ不平衡消除、偏振解复用、滤除带外噪声与预均衡等操作，本实施例对此不做限制，下面通过两个例子对该预处理单元304的预处理方法进行说明。
图5是该预处理单元304的一个实施方式的示意图，如图5所示，接收机的接收信号为H、V两路信号，由于同步信息可以只由一路信号提取，所以可弃掉H、V之中一路。保留的一路信号通过滤除带外噪声和IQ不平衡消除处理，作为该预处理单元304的输出。
图6是该预处理单元304的另一个实施方式的示意图，如图6所示，接收机的接收信号为H、V两路信号，在接收机中可陆续进行滤除带外噪声、IQ不平衡消除、偏振解复用及预均衡处理，之后弃掉H、V之中一路。保留的一路信号作为该预处理单元304的输出。
以上仅通过两个例子对该预处理单元304做了简单说明，本实施例不排除其他对接收序列进行预处理的方法。并且，在本实施例中，该预处理单元304是可选的，在具体实施过程中，也可以不对接收序列进行预处理，直接对该接收序列进行上述自相关操作。
在本实施例中，该延时相关处理单元301可以对该接收序列进行不同延时量的自相关操作，延时量可以分别取该周期性的训练序列的周期m的整数倍。如图3所示，该延时相关处理单元301分别对接收序列进行1周期、2周期、…k周期的延时自相关。
在本实施例中，如果接收信号用表示，则其k个周期的延时自相关序列可以表示为：
其中，T为符号周期，<·>表示计算平均值，(·)*表示复共轭，k为延时周期数，由于总周期数为N，故k可在[1，N-1]区间内任意取值，本实施例对k的取值不作限制。
通过上式并行计算出的k个延时相关序列在数据符号部分彼此之间没有相关性，但在训练序列部分都会出现较大的峰值，利用这种特性，用k个相关序列计算出的相关峰值比只利用1个相关序列计算出的相关峰值具有更高的信噪比，从而抗噪声性能更好。
通过该延时相关处理单元301对接收序列并行地进行不同延时量的自相关操作，最大程度地利用了训练序列多周期重复的性质，从而带来了抗噪声性能的改善。
在本实施例中，在多周期的延时相关操作后，并行的相关序列输入到叠加处理单元302，该叠加处理单元302可以对这些相关序列进行叠加，叠加输出的序列称为同步相关序列，由于同步相关序列可以明确指示出训练序列的位置，故可作为提取同步位置的重要参考。
在本实施例中，该叠加处理单元302的作用是综合k个相关序列的信息，计算出用于提取同步位置的单一序列。
在一个实施方式中，该叠加处理单元302可以使用幅度叠加法实现上述叠加。在本实施方式中，该叠加处理单元302可以将上述多个并行的相关序列的幅度相加，得到的单一序列作为该同步相关序列。
例如，把上述k个相关序列的幅度直接进行相加，得到单一序列，表达为：
由于k个相关序列的幅度在同步位置都会出现极大值，这种幅度叠加法可以增加同步位置的信噪比。
在另一个实施方式中，该叠加处理单元302可以将上述多个并行的相关序列中相邻两个相关序列进行复数共轭相乘，再将所有值相加，得到的单一序列作为该同步相关序列。
本实施方式是利用理论上与间相位差恒定的原理来进行复数的同相叠加，表达为：
这种同相叠加的方法也可以保持相关序列在同步位置处的极大值，从而提高信噪比，加强同步的抗噪声性能。
在本实施例中，基于叠加处理单元302输出的同步相关序列，输入到同步提取单元303，即可得到训练序列同步位置，由此得到训练序列。在本实施例中，该同步提取单元303是基于叠加处理单元302输出的单一序列来判断同步位置，而由于同步位置在单一序列上反映为极大值，因此，在一个实施方式中，该同步提取单元303可以直接定位序列最大值作为同步位置，也即，将上述同步相关序列的最大值作为该训练序列的同步位置；在另一个实施方式中，该同步提取单元303可以在序列最大值附近寻找若干次大值重心作为同步位置，也即，将上述同步相关序列的最大值的预定范围内的所有值的重心作为该训练序列的同步位置。
通过本实施例的装置，利用周期性训练序列，显著改善了训练序列的抗噪声性能，既保证了训练序列的同步性能，又减小了非理性因素对估计值产生的影响。
实施例3
本发明实施例提供了一种信道间隔估计装置。
在一个接收机的带宽范围内，除了需要解调的中心信道，还包括同时接收的左右部分邻道信息。由于接收的带宽有限，故左右两邻道信息只有部分信息被接收。由于邻道频谱不完整，故不能直接判断两信道中心波长的间隔，也即信道间隔。本实施例利用中心信道和邻道的训练序列的信息，可以对两信道的频率偏移分别进行估计，从而由两信道的频率偏移的差值估计出信道间隔。
图7是该信道间隔估计装置700的示意图，如图7所示，该装置包括：同步单元701、第一估计单元702、以及第二估计单元703。
该同步单元701用于对接收机的带宽范围内的中心信道的训练序列进行同步，得到中心信道的训练序列的同步位置，并对接收机的带宽范围内的邻道的训练序列进行同步，得到邻道的训练序列的同步位置。在本实施例中，该同步单元701可以通过实施例2的训练序列同步装置300来实现。
例如，对于该中心信道的训练序列的同步，该同步单元701可以对包含周期性训练序列的中心信道的接收序列并行地进行不同延时量的自相关操作，得到多个并行的相关序列，对所述多个并行的相关序列进行叠加操作，得到同步相关序列，对所述同步相关序列进行同步位置提取，得到中心信道的训练序列的同步位置。
再例如，对于该邻道的训练序列的同步，该同步单元701可以对包含周期性训练序列的邻道的接收序列并行地进行不同延时量的自相关操作，得到多个并行的相关序列，对所述多个并行的相关序列进行叠加操作，得到同步相关序列，对所述同步相关序列进行同步位置提取，得到邻道的训练序列的同步位置。
由于在实施例2中，已经对该训练序列同步装置300做了详细说明，其内容被合并于此，此处不再赘述。
在本实施例中，基于该同步单元701所使用的同步方法，如图8所示，可以在预处理单元304分别对中心信道及邻道进行滤波操作来去除带外噪声，得到中心信道的接收序列和邻道的接收序列，之后分别对中心信道的训练序列和邻道的训练序列进行同步处理，得到中心信道的训练序列的同步位置和邻道的训练序列的同步位置。由于本实施例提出的同步方法具有更强的抗噪声性能，对于信号功率更小的邻道，本实施例提出的同步方法相对于传统的同步方法会表现出更好的噪声容忍度，从而使邻道的训练序列处理受益，这是本实施例提出的同步方法具有增强抗噪声性能的应用实例之一。
在本实施例中，该第一估计单元702可以利用通过同步单元701得到的中心信道的训练序列的同步位置估计中心信道的频偏，再利用通过同步单元701得到的邻道的训练序列估计邻道的频偏。本实施例对具体的估计方法不作限制，任何可实施的方法都可以应用于该第一估计单元702。
在本实施例中，该第二估计单元703可以利用上述中心信道的频偏和上述邻道的频偏估计信道间隔。例如，将两者相减得到该中心信道和该邻道之间的信道间隔。
通过本实施例的装置，利用周期性训练序列，显著改善了训练序列的抗噪声性能，既保证了训练序列的同步性能，又减小了非理性因素对估计值产生的影响。
实施例4
本实施例提供了一种发射机。图9是该发射机的示意图，如图9所示，该发射机900包括实施例1所述的发送序列产生装置。由于在实施例1中，已经对该发送序列的产生装置做了详细说明，其内容被合并于此，此处不再赘述。
图10是该发射机的***构成的示意框图。如图10所示，该发射机1000包括信号生成器1001、信号设置单元1002、数模转换单元1003、以及调制器单元1004。
信号生成器1001根据发送数据生成数字信号；信号设置单元1002在生成的数字信号中叠加周期性的训练序列；数模转换单元1003对该数字信号进行数模转换；调制器单元1004以该数模转换单元1003转换后的信号作为调制信号进行调制。
在本实施例中，该信号设置单元1002可以通过实施例1的发送训练产生装置100来实现，关于上述周期性的训练序列，已经在实施例1中做了详细说明，其内容被合并于此，此处不再赘述。
图10所示的该发射机的***构成只是举例说明，在具体实施过程中，可以根据需要增加或减少某些部件。
通过本实施例的发射机，将周期性的训练序列***到发送数据中，显著改善了训练序列的抗噪声性能，既保证了训练序列的同步性能，又减小了非理性因素对估计值产生的影响。
实施例5
本实施例还提供了一种接收机。图11是该接收机的示意图，如图11所示，该接收机1100包括实施例2所述的训练序列同步装置和/或包括实施例3所述的信道间隔估计装置。由于在实施例2和实施例3中，已经对该训练序列同步装置300和该信道间隔估计装置700做了详细说明，其内容被合并于此，此处不再赘述。
图12是本发明实施例的接收机的***构成的示意框图。如图17所示，接收机1200包括：
前端，其作用是将输入的光信号转换为两个偏振态上的基带信号，在本发明实施例中，该两个偏振态可包括H偏振态和V偏振态。
如图12所示，该前端包括：本振激光器1210、光混频器(Optical 90deg hybrid)1201、光电检测器(O/E)1202、1204、1206和1208、数模转换器(ADC)1203、1205、1207和1209、色散补偿器1211、均衡器1212以及训练序列同步装置1213和/或信道间隔估计装置1214，其中，训练序列同步装置1213和信道间隔估计装置1214的结构与功能与实施例2和实施例3中的记载相同，此处不再赘述；本振激光器1210用于提供本地光源，光信号经光混频器(Optical 90deg hybrid)1201、光电检测器(O/E)1202和1204、数模转换器(ADC)1203和1205转换为一个偏振态上的基带信号；该光信号经光混频器(Optical 90deg hybrid)1201、光电检测器(O/E)1206和1208、数模转换器(ADC)1207和1209转换为另一个偏振态上的基带信号；其具体过程与现有技术类似，此处不再赘述。
此外，如果频差和相位噪声对OSNR的估计有影响，接收机1200中也可以包括频差补偿器和相位噪声补偿器(图中未示出)。
通过本实施例的接收机，利用周期性的训练序列的特性，显著改善了训练序列的抗噪声性能，既保证了训练序列的同步性能，又减小了非理性因素对估计值产生的影响。
实施例6
本发明实施例还提供了一种通信***，图13是本实施例的通信***的结构示意图，如图13所示，通信***1300包括发射机1301、传输链路1302以及接收机1303，其中，发射机1301的结构与功能与实施例5中的记载相同，接收机1303的结构与功能与实施例6中的记载相同，此处不再赘述。传输链路1302可具有现有的传输链路的结构与功能，本发明实施例不对传输链路的结构和功能进行限制。
通过本发明实施例提供的通信***，利用周期性的训练序列的特性，显著改善了训练序列的抗噪声性能，既保证了训练序列的同步性能，又减小了非理性因素对估计值产生的影响。
实施例7
本发明实施例还提供了一种发送序列产生方法，该方法应用于通信***的发射机中，由于该方法解决问题的原理与实施例1的装置类似，因此其具体的实施可以参照实施例1的装置的实施，内容相同之处不再重复说明。
图14是本实施例的发送序列产生方法的流程图，请参照图14，该方法包括：
步骤1401：将周期性训练序列***到发送数据中，得到发送序列，其中，所述周期性训练序列包括多个重复的子序列，各子序列之间首尾相接构成所述周期性训练序列。
在本实施例中，该周期性的训练序列可以是整个训练序列的一部分，也可以是整个训练序列的全部，只要保证训练序列中包含周期性的几段子序列即可。
在本实施例中，***到发送数据中的训练序列包含了周期性的训练序列，由此，显著改善了训练序列的抗噪声性能，既保证了训练序列的同步性能，又减小了非理性因素对估计值产生的影响。
实施例8
本发明实施例还提供了一种训练序列同步方法，该方法应用于通信***的接收机中，由于该方法解决问题的原理与实施例2的装置类似，因此其具体的实施可以参照实施例2的装置的实施，内容相同之处不再重复说明。
图15是本实施例的训练序列同步方法的流程图，请参照图15，该方法包括：
步骤1501：对包含周期性训练序列的接收序列并行地进行不同延时量的自相关操作，得到多个并行的相关序列；
步骤1502：对所述多个并行的相关序列进行叠加操作，得到同步相关序列；
步骤1503：对所述同步相关序列进行同步位置提取，得到训练序列的同步位置。
在步骤1501中，上述不同延时量分别为上述训练序列的周期的整数倍。
在步骤1502中，可以将所述多个并行的相关序列的幅度相加，得到的单一序列作为所述同步相关序列，也可以将所述多个并行的相关序列中相邻两个相关序列进行复数共轭相乘，再将所有值相加，得到的单一序列作为所述同步相关序列。
在步骤1503中，可以将所述同步相关序列的最大值作为所述训练序列的同步位置，也可以将所述同步相关序列的最大值的预定范围内的所有值的重心作为所述训练序列的同步位置。
在本实施例中，在步骤1501之前，该方法还可以包括：
步骤1500：对包含所述周期性训练序列的接收序列进行预处理，得到预处理的接收序列。
通过本实施例的方法，利用周期性的训练序列的特性，显著改善了训练序列的抗噪声性能，既保证了训练序列的同步性能，又减小了非理性因素对估计值产生的影响。
实施例9
本发明实施例还提供了一种信道间隔估计方法，该方法应用于通信***的接收机中，由于该方法解决问题的原理与实施例3的装置类似，因此其具体的实施可以参照实施例3的装置的实施，内容相同之处不再重复说明。
图16是本实施例的信道间隔估计方法的流程图，请参照图16，该方法包括：
步骤1601：对接收机的带宽范围内的中心信道的训练序列进行同步，得到中心信道的训练序列的同步位置，并对接收机的带宽范围内的邻道的训练序列进行同步，得到邻道的训练序列的同步位置；
步骤1602：利用中心信道的训练序列的同步位置估计中心信道的频偏，并利用邻道的训练序列的位置估计邻道的频偏；
步骤1603：利用中心信道的频偏和邻道的频偏估计信道间隔。
在本实施例中，步骤1601可以通过实施例8的方法来实现，其内容被合并于此，此处不再赘述。
通过本实施例的方法，利用周期性的训练序列的特性，显著改善了训练序列的抗噪声性能，既保证了训练序列的同步性能，又减小了非理性因素对估计值产生的影响。
本发明实施例还提供一种计算机可读程序，其中当在发射机中执行所述程序时，所述程序使得计算机在所述发射机中执行实施例7所述的方法。
本发明实施例还提供一种存储有计算机可读程序的存储介质，其中所述计算机可读程序使得计算机在发射机中执行实施例7所述的方法。
本发明实施例还提供一种计算机可读程序，其中当在接收机中执行所述程序时，所述程序使得计算机在所述接收机中执行实施例8或实施例9所述的方法。
本发明实施例还提供一种存储有计算机可读程序的存储介质，其中所述计算机可读程序使得计算机在接收机中执行实施例8或实施例9所述的方法。
本发明以上的装置和方法可以由硬件实现，也可以由硬件结合软件实现。本发明涉及这样的计算机可读程序，当该程序被逻辑部件所执行时，能够使该逻辑部件实现上文所述的装置或构成部件，或使该逻辑部件实现上文所述的各种方法或步骤。本发明还涉及用于存储以上程序的存储介质，如硬盘、磁盘、光盘、DVD、flash存储器等。
以上结合具体的实施方式对本发明进行了描述，但本领域技术人员应该清楚，这些描述都是示例性的，并不是对本发明保护范围的限制。本领域技术人员可以根据本发明的精神和原理对本发明做出各种变型和修改，这些变型和修改也在本发明的范围内。

Claims (10)

1.一种发送序列产生装置，其中，该装置包括：
产生单元，其将周期性训练序列***到发送数据中，得到发送序列，其中，所述周期性训练序列包括多个重复的子序列，各子序列之间首尾相接构成所述周期性训练序列。
2.根据权利要求1所述的装置，其中，所述周期性训练序列是整个训练序列的一部分或者全部。
3.一种训练序列同步装置，其中，该装置包括：
延时相关处理单元，其对包含周期性训练序列的接收序列并行地进行不同延时量的自相关操作，得到多个并行的相关序列；
叠加处理单元，其对所述多个并行的相关序列进行叠加操作，得到同步相关序列；
同步提取单元，其对所述同步相关序列进行同步位置提取，得到训练序列的同步位置。
4.根据权利要求3所述的装置，其中，所述不同延时量分别为所述训练序列的周期的整数倍。
5.根据权利要求3所述的装置，其中，所述叠加处理单元将所述多个并行的相关序列的幅度相加，得到的单一序列作为所述同步相关序列。
6.根据权利要求3所述的装置，其中，所述叠加处理单元将所述多个并行的相关序列中相邻两个相关序列进行复数共轭相乘，再将所有值相加，得到的单一序列作为所述同步相关序列。
7.根据权利要求3所述的装置，其中，所述同步提取单元将所述同步相关序列的最大值作为所述训练序列的同步位置。
8.根据权利要求3所述的装置，其中，所述同步提取单元将所述同步相关序列的最大值的预定范围内的所有值的重心作为所述训练序列的同步位置。
9.根据权利要求3所述的装置，其中，所述装置还包括：
预处理单元，其对包含所述周期性训练序列的接收序列进行预处理，得到预处理的接收序列提供给所述延时相关处理单元。
10.一种信道间隔估计装置，其中，该装置包括：
同步单元，其对包含周期性训练序列的中心信道的接收序列并行地进行不同延时量的自相关操作，得到多个并行的相关序列，对所述多个并行的相关序列进行叠加操作，得到同步相关序列，对所述同步相关序列进行同步位置提取，得到中心信道的训练序列的同步位置；对包含周期性训练序列的邻道的接收序列并行地进行不同延时量的自相关操作，得到多个并行的相关序列，对所述多个并行的相关序列进行叠加操作，得到同步相关序列，对所述同步相关序列进行同步位置提取，得到邻道的训练序列的同步位置；
第一估计单元，其利用中心信道的训练序列的同步位置估计中心信道的频偏，并利用邻道的训练序列的位置估计邻道的频偏；
第二估计单元，利用中心信道的频偏和邻道的频偏估计信道间隔。
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