JP2009278338A - 光伝送システム - Google Patents
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Abstract
【解決手段】本発明は、送信出力信号の半分のビットレートを有する2系統の変調信号を合成して出力する送信器において、出力信号の変調フォーマットに対応した複数個のプリコード回路を設けたパラレルプリコード回路部を2系統備え、2系統の変調フォーマットへのパラレル信号の振り分けを行う順序変更手段と、パラレル信号をそれぞれ変調信号に纏め上げるパラレル−シリアル変換手段とを有し、送信器で合成された2系統の変調信号をそれぞれの系統に分離し、受信する受信器において、光学的に復調された2系統の受信信号を送信器の送信信号と一致させるように低速パラレル信号において信号変換を行う並列順序処理手段を備える。
【選択図】図1
Description
送信出力信号の半分のビットレートを有する2系統の変調信号が合成されて出力される送信器100と、
送信器100で合成された2系統の変調信号をそれぞれの系統に分離し、受信する受信器200と、を有し、
送信器100は、
出力信号の変調フォーマットに対応した複数個のプリコード回路を設けたパラレルプリコード回路部を2系統備え、2系統の変調フォーマットへのパラレル信号の振り分けを行う順序変更手段と1、
パラレル信号をそれぞれ変調信号に纏め上げるパラレル−シリアル変換手段2と、
を備え、
受信器200は、
光学的に復調された2系統の受信信号を送信器100の送信信号と一致させるように低速パラレル信号において信号変換を行う並列順序処理手段8を備える。
受信器200は、
2系統の遅延干渉計によるDQSPK信号復調回路6と、
DQSPK信号復調回路6の出力を低速のパラレル信号に変換するシリアル−パラレル変換手段7と、を有し、
並列順序処理手段8は、
シリアル−パラレル変換手段7によりパラレル化された信号を所望の受信状態となるように、論理符号反転、ビット遅延処理、ビットスワップ処理、信号順序変換を行う手段を含む。
送信器100は、
2系統の並列DQPSKプリコード回路が配置され、該2系統の並列プリコード回路への入出力において、最終的な送信器の出力信号が所望の信号となるように、パラレル信号の順番を変更する順序変更回路を備え、
受信器200は、
2系統の遅延干渉計によるDQSPK信号復調回路6と、
DQPSK信号復調回路6の出力を低速のパラレル信号に変換するシリアル−パラレル変換手段7と、
シリアル−パラレル変換手段7によりパラレル化された信号を所望の受信状態となるように、系列遅延量調整処理、論理符号反転、ビット遅延処理、ビットスワップ処理、信号順序変換を行う並列順序処理手段を備え、
並列順序処理手段の系列遅延量調整処理により、2つの系列間の遅延差がなくなるように系列毎に異なる遅延量を与える。
受信器200は、
2系統のコヒーレント受信によるQPSK信号復調回路と、
QPSK信号復調回路の出力を低速のパラレル信号に変換するシリアル−パラレル変換手段と、を有し、
並列順序処理手段8は、
シリアル−パラレル変換手段によりパラレル化された信号を所望の受信状態となるように、論理符号反転、ビット遅延処理、ビットスワップ処理、信号順序変換、受信パターンに応じた任意のパターン変換を行う任意パターン変換を行う手段を含む。
受信器200は、
2系統の遅延干渉計によるDSPK信号復調回路と、
DSPK信号復調回路の出力を低速のパラレル信号に変換するシリアル−パラレル変換手段と、を有し、
並列順序処理手段8は、
シリアル−パラレル変換手段によりパラレル化された信号を所望の受信状態となるように、論理符号反転、ビット遅延処理、信号順序変換を行う手段を含む。
送信器100は、
2系統の並列DPSKプリコード回路が配置され、該2系統の並列プリコード回路への入出力において、最終的な送信器出力信号が所望の信号となるように、パラレル信号の順番を変更する順序変更回路を備え、
受信器200は、
2系統の遅延干渉計によるDSPK信号復調回路と、
DPSK信号復調回路の出力を低速のパラレル信号に変換するシリアル−パラレル変換手段と、
シリアル−パラレル変換手段によりパラレル化された信号を所望の受信状態となるように、系列間遅延調整処理、論理符号反転、ビット遅延処理、信号順序変換を行う並列順序処理手段を備え、
並列順序処理手段の系列間遅延調整処理により、2つの系列間の遅延差がなくなるように系列毎に異なる遅延量を与える。
受信器200は、
2系統のコヒーレント受信によるPSK信号復調回路と、
PSK信号復調回路の出力を低速のパラレル信号に変換するシリアル−パラレル変換手段と、を有し、
並列順序処理手段8は、
シリアル−パラレル変換手段によりパラレル化された信号を所望の受信状態となるように、論理符号反転、ビット遅延処理、信号順序変換を行う手段を含む。
送信器100は、
2系統の並列PSKプリコード回路が配置され、該2系統の並列プリコード回路への入出力において、最終的な該送信器の出力信号が所望の信号となるように、パラレル信号の順番を変更する順序変更回路を備え、
受信器200は、
2系統のコヒーレント受信によるPSK信号復調回路と、
PSK信号復調回路の出力を低速のパラレル信号に変換するシリアル−パラレル変化手段と、
シリアル−パラレル変換手段によりパラレル化された信号を所望の受信状態となるように、系列間遅延調整処理、論理符号反転、ビット遅延処理、信号順序変換を行う並列順序処理手段を備え、
並列順序処理手段の系列間遅延調整処理により、2つの系列間の遅延差がなくなるように系列毎に異なる遅延量を与える。
受信器200は、
2系統のOptical duobinary信号復調回路と、
optical duobinary信号復調回路の出力を低速パラレル信号に変換するシリアル−パラレル変換手段と、を有し、
並列順序処理手段8は、
シリアル−パラレル変換手段によりパラレル化された信号を所望の受信状態となるように、ビット遅延処理、信号順序変換を行う手段を含む。
送信器100は、
2系統の並列Optical duobiaryプリコード回路が配置され、該2系列の並列プリコード回路への入出力において、最終的な該送信器の出力信号が所望の信号となるように、パラレル信号の順番を変更する順序変更回路を備え、
受信器200は、
2系統のOptical duobinary信号復調回路と、
Optical duobinary信号復調回路の出力を低速のパラレル信号に変換するシリアル−パラレル変換手段と、
シリアル−パラレル変換手段によりパラレル化された信号を所望の受信状態となるように、系列間遅延調整処理、ビット遅延処理、信号順序変換を行う並列順序処理手段を備え、
並列順序処理手段の系列間遅延調整処理により、2つの系列間の遅延差がなくなるように系列毎に異なる遅延量を与える。
それぞれのサブキャリアがDQPSK変調されている、
または、
それぞれのサブキャリアがQPSK変調されている、
または、
それぞれのサブキャリアがDPSK変調されている、
または、
それぞれのサブキャリアがPSK変調されている、
または、
それぞれのサブキャリアがOptical duobinary変調されている。
送受信フレーム処理手段と送信器100の順序変更手段、及び、受信器200の並列順序処理手段を一体化した構成とする。
図2は、本発明の第1の実施の形態における光伝送システムの構成を示す。
図11は、本発明の第2の実施の形態における光伝送システムの構成図(その1)である。
図14は、本発明の第3の実施の形態における光伝送システムの構成を示す。
図15は、本発明の第4の実施の形態における光伝送システムの構成を示す。
上記の第3の実施の形態の、2系統の(D)QPSKプリコードを用いる代わりに、Optical duobinaryを用い、OFDM信号の各キャリアにOptical duobainary変調を行う構成としてもよい。
2 パラレル−シリアル変換手段
3 変調手段
4 合成手段
5 分離手段
6 復調手段
7 シリアル−パラレル変換手段
8 並列順序処理手段
10 送信器
20 受信器
100 送信器
101,102,201,202 40G OR VSR
103,203 フレーマLSI部
104,204 順序変更処理回路・並列プリコーダ部(D)QPSK
105,205 並列順序処理回路部(D)QPSK
106,206 パラレル−シリアル変換部
107,207 シリアル−パラレル変換部
108,109,208,209 20G OS (D) QPSK変調部
110,111,210,211 20G OS (D) QPSK復調部
112,212 合成部
113,213 分離部
281 奇数反転部
282 偶数反転部
283 1ビットシフト部
284 奇数偶数入れ替え部(SWAP回路)
285 パターン任意変換部
291,292 接続順序変更処理回路
293 遅延量調整部
295 シフト部
381 反転部
382 1ビットシフト部
391,392 接続順序変更処理回路
396 遅延量調整部
401,402 並列プリコード回路(precoder)
403,404 順序変更処理回路
405 シフト
406 制御部
501 1:4DES
511 1:2 Demux
601,602 順序変更処理回路
603,604 プリコード回路(Precoder)
605 シフト
610 SWAP回路
701,702,705,706 20G OS (D) PSK変調部
703,704,707,708 20G OS (D) PSK復調部
709,711 順序変更処理回路・並列プリコーダ部(D)PSK
710,712 並列順序処理回路部(D)PSK
801,802,805,806 20G OS OFDM (D)QPSK変調部
803,804,807,808 20G OS OFDM (D)QPSK復調部
901,902,805,906 20G OS OFDM (D)PSK変調部
903,904,907,908 20G OS OFDM (D) PSK復調部
Claims (13)
- 光伝送システムであって、
送信出力信号の半分のビットレートを有する2系統の変調信号が合成されて出力される送信器と、
前記送信器で合成された前記2系統の変調信号をそれぞれの系統に分離し、受信する受信器と、を有し、
前記送信器は、
出力信号の変調フォーマットに対応した複数個のプリコード回路を設けたパラレルプリコード回路部を2系統備え、2系統の変調フォーマットへのパラレル信号の振り分けを行う順序変更手段と、
前記パラレル信号をそれぞれ変調信号に纏め上げるパラレル−シリアル変換手段と、
を備え、
前記受信器は、
光学的に復調された2系統の受信信号を前記送信器の送信信号と一致させるように低速パラレル信号において信号変換を行う並列順序処理手段を備える
ことを特徴とする光伝送システム。 - 前記2系統の変調フォーマットは、DQPSK(Differential Quadratutre Phase Shift Keying)符号であり、
前記受信器は、
2系統の遅延干渉計によるDQSPK信号復調回路と、
前記DQSPK信号復調回路の出力を低速のパラレル信号に変換するシリアル−パラレル変換手段と、を有し、
前記並列順序処理手段は、
前記シリアル−パラレル変換手段によりパラレル化された信号を所望の受信状態となるように、論理符号反転、ビット遅延処理、ビットスワップ処理、信号順序変換を行う手段を含む
請求項1記載の光伝送システム。 - 前記2系統の変調フォーマットがDQPSK符号であり
前記送信器は、
2系統の並列DQPSKプリコード回路が配置され、該2系統の並列プリコード回路への入出力において、最終的な送信器の出力信号が所望の信号となるように、パラレル信号の順番を変更する順序変更回路を備え、
前記受信器は、
2系統の遅延干渉計によるDQSPK信号復調回路と、
前記DQPSK信号復調回路出力を低速のパラレル信号に変換するシリアル−パラレル変換手段と、
前記シリアル−パラレル変換手段によりパラレル化された信号を所望の受信状態となるように、系列遅延量調整処理、論理符号反転、ビット遅延処理、ビットスワップ処理、信号順序変換を行う並列順序処理手段を備え、
前記並列順序処理手段の前記系列遅延量調整処理により、2つの系列間の遅延差がなくなるように系列毎に異なる遅延量を与える
請求項1記載の光伝送システム。 - 前記2系統の変調フォーマットがQPSK(Quadratutre Phase Shift Keying)符号であり、
前記受信器は、
2系統のコヒーレント受信によるQPSK信号復調回路と、
前記QPSK信号復調回路の出力を低速のパラレル信号に変換するシリアル−パラレル変換手段と、を有し、
前記並列順序処理手段は、
前記シリアル−パラレル変換手段によりパラレル化された信号を所望の受信状態となるように、論理符号反転、ビット遅延処理、ビットスワップ処理、信号順序変換、受信パターンに応じた任意のパターン変換を行う任意パターン変換を行う手段を含む
請求項1記載の光伝送システム。 - 前記2系統の変調フォーマットがDPSK(Differential Phase Shift Keying)符号であり、
前記受信器は、
2系統の遅延干渉計によるDSPK信号復調回路と、
前記DSPK信号復調回路の出力を低速のパラレル信号に変換するシリアル−パラレル変換手段と、を有し、
前記並列順序処理手段は、
前記シリアル−パラレル変換手段によりパラレル化された信号を所望の受信状態となるように、論理符号反転、ビット遅延処理、信号順序変換を行う手段を含む
請求項1記載の光伝送システム。 - 前記2系統の変調フォーマットがDPSK符号であり、
前記送信器は、
2系統の並列DPSKプリコード回路が配置され、該2系統の並列プリコード回路への入出力において、最終的な送信器出力信号が所望の信号となるように、パラレル信号の順番を変更する順序変更回路を備え、
前記受信器は、
2系統の遅延干渉計によるDSPK信号復調回路と、
前記DPSK信号復調回路の出力を低速のパラレル信号に変換するシリアル−パラレル変換手段と、
前記シリアル−パラレル変換手段によりパラレル化された信号を所望の受信状態となるように、系列間遅延調整処理、論理符号反転、ビット遅延処理、信号順序変換を行う並列順序処理手段を備え、
前記並列順序処理手段の前記系列間遅延調整処理により、2つの系列間の遅延差がなくなるように系列毎に異なる遅延量を与える
請求項1記載の光伝送システム。 - 前記2系統の変調フォーマットがPSK(Phase Shift Keying)符号であり、
前記受信器は、
2系統のコヒーレント受信によるPSK信号復調回路と、
前記PSK信号復調回路の出力を低速のパラレル信号に変換するシリアル−パラレル変換手段と、を有し、
前記並列順序処理手段は、
前記シリアル−パラレル変換手段によりパラレル化された信号を所望の受信状態となるように、論理符号反転、ビット遅延処理、信号順序変換を行う手段を含む
請求項1記載の光伝送システム。 - 前記2系統の変調フォーマットがPSK符号であり、
前記送信器は、
2系統の並列PSKプリコード回路が配置され、該2系統の並列プリコード回路への入出力において、最終的な該送信器の出力信号が所望の信号となるように、パラレル信号の順番を変更する順序変更回路を備え、
前記受信器は、
2系統のコヒーレント受信によるPSK信号復調回路と、
前記PSK信号復調回路の出力を低速のパラレル信号に変換するシリアル−パラレル変化手段と、
前記シリアル−パラレル変換手段によりパラレル化された信号を所望の受信状態となるように、系列間遅延調整処理、論理符号反転、ビット遅延処理、信号順序変換を行う並列順序処理手段を備え、
前記並列順序処理手段の前記系列間遅延調整処理により、2つの系列間の遅延差がなくなるように系列毎に異なる遅延量を与える
請求項1記載の光伝送システム。 - 前記2系統の変調フォーマットがOptical duobinary符号であり、
前記受信器は、
2系統のOptical duobinary信号復調回路と、
前記optical duobinary信号復調回路の出力を低速パラレル信号に変換するシリアル−パラレル変換手段と、を有し、
前記並列順序処理手段は、
前記シリアル−パラレル変換手段によりパラレル化された信号を所望の受信状態となるように、ビット遅延処理、信号順序変換を行う手段を含む
請求項1記載の光伝送システム。 - 前記2系統の変調フォーマットがOptical duobinary符号であり、
前記送信器は、
2系統の並列Optical duobiaryプリコード回路が配置され、該2系列の並列プリコード回路への入出力において、最終的な該送信器の出力信号が所望の信号となるように、パラレル信号の順番を変更する順序変更回路を備え、
前記受信器は、
2系統のOptical duobinary信号復調回路と、
前記Optical duobinary信号復調回路の出力を低速のパラレル信号に変換するシリアル−パラレル変換手段と、
前記シリアル−パラレル変換手段によりパラレル化された信号を所望の受信状態となるように、系列間遅延調整処理、ビット遅延処理、信号順序変換を行う並列順序処理手段を備え、
前記並列順序処理手段の前記系列間遅延調整処理により、2つの系列間の遅延差がなくなるように系列毎に異なる遅延量を与える
請求項1記載の光伝送システム。 - 前記2系統の変調信号を、OFDM(Orthogonal Frequency Division Multiplexing)信号とし、
それぞれのサブキャリアがDQPSK変調されている、
または、
それぞれのサブキャリアがQPSK変調されている、
または、
それぞれのサブキャリアがDPSK変調されている、
または、
それぞれのサブキャリアがPSK変調されている、
または、
それぞれのサブキャリアがOptical duobinary変調されている
請求項1記載の光伝送システム。 - 前記送信器の前記順序変更処理回路、前記パラレル−シリアル変換手段、及び、前記受信器の前記並列順序回路、前記シリアル−パラレル変換手段を一体化した構成とする
請求項1乃至11のいずれか1項記載の光伝送システム。 - 前記送信器及び前記受信器に送受信フレーム処理手段を備え、
前記送受信フレーム処理手段と前記送信器の前記順序変更手段、及び、前記受信器の前記並列順序処理手段を一体化した構成とする
請求項1乃至11のいずれか1項記載の光伝送システム。
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