CN104778928B - 一种移位寄存器、栅极驱动电路、显示面板及显示装置 - Google Patents

一种移位寄存器、栅极驱动电路、显示面板及显示装置 Download PDF

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Abstract

本发明公开了一种移位寄存器、栅极驱动电路、显示面板及显示装置，该移位寄存器包括输入模块、第一节点下拉模块、第二节点上拉模块、第二节点下拉模块、输出控制模块，以及输出降噪模块；输入模块用于拉高第一节点的电位；第一节点下拉模块用于拉低第一节点的电位；第二节点上拉模块用于拉高第二节点的电位；第二节点下拉模块用于拉低第二节点的电位；输出控制模块用于控制扫描信号输出端选择输出第二时钟信号端的信号或低电平信号端的信号，输出降噪模块将第一节点的信号进行滤波降噪，且将滤波降噪后的信号传输到第三节点，从而输出控制模块可以在第三节点的控制下输出低噪声扫描信号。

Description

一种移位寄存器、栅极驱动电路、显示面板及显示装置
技术领域
本发明涉及显示技术领域，尤其涉及一种移位寄存器、栅极驱动电路、显示面板及显示装置。
背景技术
目前，随着液晶显示技术的发展，液晶面板业竞争越来越激烈，降低液晶显示面板的生产成本成为面板商提高竞争力的首选方案，而为了降低显示面板的生产成本，一般地，相关技术领域的技术人员利用显示面板的边缘搭建栅极驱动电路，栅极驱动电路包括多个移位寄存器，每个移位寄存器对应一条栅线，多个移位寄存器采用串联设置，相邻两个移位寄存器之间有逐级传递的触发信号，每个移位寄存器接收到触发信号后，向对应栅线输出栅线扫描信号，并把触发信号输送给下一级单元电路以实现栅极驱动的功能，这样的设计可以省去在显示面板的边框区域单独设置栅极驱动芯片，有利于实现显示面板的窄边框设计，同时降低了相关产品的生产成本，提高了显示产品的市场竞争力。
一般地，现有的移位寄存器的电路结构，如图1所示，其对应的输入输出时序图，如图2所示，从图2可以看出，移位寄存器在正常开启工作时，第一节点PU的电位在第一时间段被拉高，在第二阶段被继续拉高，进而控制开关晶体管T7开启，使得扫描信号输出端对应输出扫描信号，然而由于第一节点PU输出的电压信号有噪声(如图2中标注的区域A所示)，且第一节点PU在第一次被拉高时产生的信号的电位较高，通过电容C1的充放电过程，易造成扫描信号输出端输出的扫描信号有较大噪声(如图2中标注的区域B所示)，进而造成移位寄存器电路功耗较大，降低了显示面板的良率。
因此，如何降低移位寄存器输出的扫描信号的噪声，降低功耗，从而提高显示面板的良率，是本领域技术人员亟需解决的技术问题。
发明内容
本发明实施例提供一种移位寄存器，栅极驱动电路、显示面板及显示装置，用以解决现有技术中存在的移位寄存器输出的扫描信号的噪声较大，功耗较大的问题。
本发明实施例提供了一种移位寄存器，包括：输入模块、第一节点下拉模块、第二节点上拉模块、第二节点下拉模块、输出控制模块，以及输出降噪模块；其中，
所述输入模块的第一输入端与第一信号输入端相连，第二输入端与第二信号输入端相连，第一控制端与第一参考信号端相连，第二控制端与第二参考信号端相连，输出端与第一节点相连，所述输入模块用于在所述第一参考信号端和所述第二参考信号端的控制下拉高所述第一节点的电位；
所述第一节点下拉模块的输入端与低电平信号端相连，控制端与第二节点相连，输出端与所述第一节点相连，所述第一节点下拉模块用于在所述第二节点的控制下拉低所述第一节点的电位；
所述第二节点上拉模块的输入端与高电平信号端相连，控制端与第一时钟信号端相连，输出端与所述第二节点相连，所述第二节点上拉模块用于在所述第一时钟信号端的控制下拉高所述第二节点的电位；
所述第二节点下拉模块的第一输入端和第二输入端分别与所述低电平信号端相连，第一控制端与所述第一节点相连，第二控制端与扫描信号输出端相连，输出端与所述第二节点相连，所述第二节点下拉模块用于在所述第一节点或所述扫描信号输出端的控制下拉低所述第二节点的电位；
所述输出控制模块的第一输入端与所述低电平信号端相连，第二输入端与第二时钟信号端相连，第一控制端与第三节点相连，第二控制端与所述第二节点相连，输出端与所述扫描信号输出端相连，所述输出控制模块用于在所述第三节点或所述第二节点的控制下，控制所述扫描信号输出端选择输出所述第二时钟信号端的信号或所述低电平信号端的信号；
所述输出降噪模块的输入端与所述第一节点相连，控制端与所述高电平信号端相连，输出端与所述第三节点相连，所述输出降噪模块用于将所述第一节点的信号进行滤波降噪后输出到到所述第三节点。
在一种可能的实施方式中，本发明实施例提供的上述移位寄存器中，所述输出降噪模块，具体包括：第一开关晶体管；
所述第一开关晶体管的栅极与所述高电平信号端相连，源极与所述第一节点相连，漏极与所述第三节点相连。
在一种可能的实施方式中，本发明实施例提供的上述移位寄存器中，还包括：第一节点降噪模块；
所述第一节点降噪模块连接于所述第一节点、所述高电平信号端和所述第一开关晶体管的源极之间，所述第一节点降噪模块用于对所述第一节点的信号进行进一步滤波降噪后输出到所述第一开关晶体管的源极。
在一种可能的实施方式中，本发明实施例提供的上述移位寄存器中，所述第一节点降噪模块，具体包括：第二开关晶体管和第开关三晶体管；其中，
所述第二开关晶体管的栅极与所述第一节点相连，源极与所述第三开关晶体管的漏极相连，漏极与所述第一开关晶体管的源极相连；
所述第三开关晶体管的栅极和源极分别与所述高电平信号端相连。
在一种可能的实施方式中，本发明实施例提供的上述移位寄存器中，还包括：第二节点降噪模块；
所述第二节点降噪模块连接于所述高电平信号端、所述第二节点上拉模块的输出端和所述第二节点之间，所述第二节点降噪模块用于对所述第二节点上拉模块输出端输出的信号进行滤波降噪后输出到所述第二节点。
在一种可能的实施方式中，本发明实施例提供的上述移位寄存器中，所述第二节点降噪模块，具体包括：第四开关晶体管；
所述第四开关晶体管的栅极与所述高电平信号端相连，源极与所述第二节点上拉模块的输出端相连，漏极与所述第二节点相连。
在一种可能的实施方式中，本发明实施例提供的上述移位寄存器中，所述第二节点上拉模块，具体包括：第五开关晶体管；
所述第五开关晶体管的栅极与所述第一时钟信号端相连，源极与所述高电平信号端相连，漏极与所述第四开关晶体管的源极相连。
在一种可能的实施方式中，本发明实施例提供的上述移位寄存器中，还包括：保护模块；
所述保护模块连接于所述第一信号输入端、所述第二信号输入端、所述高电平信号端和所述第二节点上拉模块的输出端之间，所述保护模块用于在所述第一信号输入端或所述第二信号输入端输入异常电流信号时，对异常电流信号进行分流。
在一种可能的实施方式中，本发明实施例提供的上述移位寄存器中，所述保护模块，具体包括：第六开关晶体管和第七开关晶体管；其中，
所述第六开关晶体管的栅极与所述第一信号输入端相连，源极与所述高电平信号端相连，漏极与所述第七开关晶体管的源极相连；
所述第七开关晶体管的栅极与所述第二信号输入端相连，漏极与所述第二节点上拉模块的输出端相连。
在一种可能的实施方式中，本发明实施例提供的上述移位寄存器中，还包括：维持模块；
所述维持模块的输入端与所述高电平信号端相连，控制端和输出端分别与所述扫描信号输出端相连，所述维持模块用于在所述扫描信号输出端输出扫描信号时，维持所述扫描信号输出端的电位。
在一种可能的实施方式中，本发明实施例提供的上述移位寄存器中，所述维持模块，具体包括：第八开关晶体管；
所述第八开关晶体管的栅极和漏极分别与所述扫描信号输出端相连，源极与所述高电平信号端相连。
在一种可能的实施方式中，本发明实施例提供的上述移位寄存器中，所述输出控制模块，具体包括：第一输出控制模块和第二输出控制模块；其中，
所述第一输出控制模块连接于所述第三节点、所述第二时钟信号端，以及所述扫描信号输出端之间，所述第一输出控制模块用于在所述第三节点的控制下，控制所述扫描信号输出端输出所述第二时钟信号端的信号；
所述第二输出控制模块连接于所述低电平信号端、所述第二节点，以及所述扫描信号输出端之间，所述第二输出控制模块用于在所述第二节点的控制下，控制所述扫描信号输出端输出所述低电平信号端的信号。
在一种可能的实施方式中，本发明实施例提供的上述移位寄存器中，所述第一输出控制模块，具体包括：第九开关晶体管和第一电容；其中，
所述第九开关晶体管的栅极与所述第三节点相连，源极与所述第二时钟信号端相连，漏极与所述扫描信号输出端相连；
所述第一电容连接于所述第三节点与所述扫描信号输出端之间。
在一种可能的实施方式中，本发明实施例提供的上述移位寄存器中，所述第二输出控制模块，具体包括：第十开关晶体管；
所述第十开关晶体管的栅极与所述第二节点相连，源极与所述低电平信号端相连，漏极与所述扫描信号输出端相连。
在一种可能的实施方式中，本发明实施例提供的上述移位寄存器中，所述第二输出控制模块，还包括：第二电容；
所述第二电容连接于所述第二节点和所述低电平信号端之间。
在一种可能的实施方式中，本发明实施例提供的上述移位寄存器中，所述第二节点下拉模块，具体包括：第一下拉模块和第二下拉模块；其中，
所述第一下拉模块的输入端与所述低电平信号端相连，控制端与所述第一节点相连，输出端与所述第二节点相连，所述第一下拉模块用于在所述第一节点的控制下拉低所述第二节点的电位；
所述第二下拉模块的输入端与所述低电平信号端相连，控制端与所述扫描信号输出端相连，输出端与所述第二节点相连，所述第二下拉模块用于在所述扫描信号输出端输出扫描信号时进一步拉低所述第二节点的电位。
在一种可能的实施方式中，本发明实施例提供的上述移位寄存器中，所述第一下拉模块，具体包括：第十一开关晶体管；
所述第十一开关晶体管的栅极与所述第一节点相连，源极与所述低电平信号端相连，漏极与所述第二节点相连。
在一种可能的实施方式中，本发明实施例提供的上述移位寄存器中，所述第二下拉模块，具体包括：第十二开关晶体管；
所述第十二开关晶体管的栅极与所述扫描信号输出端相连，源极与所述低电平信号端相连，漏极与所述第二节点相连。
在一种可能的实施方式中，本发明实施例提供的上述移位寄存器中，所述输入模块，具体包括：第十三开关晶体管和第十四开关晶体管；
所述第十三开关晶体管的栅极与所述第一参考信号端相连，源极与所述第一信号输入端相连，漏极分别与所述第十四开关晶体管的源极和所述第一节点相连；
所述第十四开关晶体管的栅极与所述第二参考信号端相连，源极与所述第二信号输入端相连。
在一种可能的实施方式中，本发明实施例提供的上述移位寄存器中，所述第一节点下拉模块，具体包括：第十五开关晶体管；
所述第十五开关晶体管的栅极与所述第二节点上拉模块的输出端相连，源极与所述低电平信号端相连，漏极与所述输出降噪模块的输入端相连。
本发明实施例提供了一种栅极驱动电路，包括级联的多个本发明实施例提供的上述移位寄存器，除最后一个移位寄存器之外，其余每个移位寄存器的扫描信号输出端均向与其相邻的下一个移位寄存器的信号输入端输入触发信号。
本发明实施例提供了一种显示面板，包括本发明实施例提供的上述栅极驱动电路。
本发明实施例提供了一种显示装置，包括本发明实施例提供的上述显示面板。
本发明实施例的有益效果包括：
本发明实施例提供了一种移位寄存器、栅极驱动电路、显示面板及显示装置，该移位寄存器包括输入模块、第一节点下拉模块、第二节点上拉模块、第二节点下拉模块、输出控制模块，以及输出降噪模块；其中，输入模块用于在第一参考信号端或第二参考信号端的控制下拉高第一节点的电位；第一节点下拉模块用于在第二节点的控制下拉低第一节点的电位；第二节点上拉模块用于在第一时钟信号端的控制下拉高第二节点的电位；第二节点下拉模块用于在第一节点和扫描信号输出端的控制下拉低第二节点的电位；输出控制模块用于在第三节点和第二节点的控制下，控制扫描信号输出端选择输出第二时钟信号端的信号或低电平信号端的信号，这样实现了移位寄存器在对应时间段输出扫描信号的功能，同时，输出降噪模块用于将第一节点的信号进行滤波降噪，且将滤波降噪后的信号传输到第三节点，从而输出控制模块在第三节点的控制下输出低噪声扫描信号，并且可以避免第一电容在较大的噪声信号的影响下使扫描信号输出端输出噪声信号，提高信号的无损耗传输，降低功耗，进而提高显示面板的良率。
附图说明
图1为现有技术中移位寄存器的结构示意图；
图2为现有的移位寄存器的输入输出时序图；
图3为本发明实施例提供的移位寄存器的结构示意图；
图4-图7分别为本发明实施例提供的移位寄存器的具体结构示意图；
图8为本发明实施例提供的移位寄存器的输入输出时序图；
图9为本发明实施例提供的栅极驱动电路的结构示意图。
具体实施方式
下面结合附图，对本发明实施例提供的移位寄存器，栅极驱动电路、显示面板及显示装置的具体实施方式进行详细地说明。
本发明实施例提供了一种移位寄存器，如图3所示，可以包括：输入模块01、第一节点下拉模块02、第二节点上拉模块03、第二节点下拉模块04、输出控制模块05，以及输出降噪模块06；其中，
输入模块01的第一输入端与第一信号输入端Input1相连，第二输入端与第二信号输入端Input2相连，第一控制端与第一参考信号端CN相连，第二控制端与第二参考信号端CNB相连，输出端与第一节点P1相连，输入模块01用于在第一参考信号端CN和第二参考信号端CNB的控制下拉高第一节点P1的电位；
第一节点下拉模块02的输入端与低电平信号端VGL相连，控制端与第二节点P2相连，输出端与第一节点P1相连，第一节点下拉模块02用于在第二节点P2的控制下拉低第一节点P2的电位；
第二节点上拉模块03的输入端与高电平信号端VGH相连，控制端与第一时钟信号端CLK相连，输出端与第二节点P2相连，第二节点上拉模块03用于在第一时钟信号端CLK的控制下拉高第二节点P2的电位；
第二节点下拉模块04的第一输入端和第二输入端分别与低电平信号端VGL相连，第一控制端与第一节点P1相连，第二控制端与扫描信号输出端Out相连，输出端与第二节点P2相连，第二节点下拉模块04用于在第一节点P1或扫描信号输出端Out的控制下拉低第二节点P2的电位；
输出控制模块05的第一输入端与低电平信号端VGL相连，第二输入端与第二时钟信号端CLKB相连，第一控制端与第三节点P3相连，第二控制端与第二节点P2相连，输出端与扫描信号输出端Out相连，输出控制模块05用于在第三节点P3或第二节点P2的控制下，控制扫描信号输出端Out选择输出第二时钟信号端CLKB的信号或低电平信号端VGL的信号；
输出降噪模块06的输入端与第一节点P1相连，控制端与高电平信号端VGH相连，输出端与第三节点P3相连，输出降噪模块06用于将第一节点P1的信号进行滤波降噪后输出到第三节点P3。
本发明实施例提供的上述移位寄存器中，包括输入模块01、第一节点下拉模块02、第二节点上拉模块03、第二节点下拉模块04，输出控制模块05，以及输出降噪模块06；其中，输入模块01用于拉高第一节点P1的电位；第一节点下拉模块02用于拉低第一节点P1的电位；第二节点上拉模块03用于拉高第二节点P2的电位；第二节点下拉模块04用于拉低第二节点P2的电位；输出控制模块05用于控制扫描信号输出端Out选择输出第二时钟信号端CLKB的信号或低电平信号端VGL的信号，这样实现了移位寄存器输出扫描信号的功能，同时，输出降噪模块用于将第一节点的信号进行滤波降噪，且将滤波降噪后的信号传输到第三节点，从而输出控制模块在第三节点的控制下输出低噪声扫描信号，并且可以避免第一电容在较大的噪声信号的影响下使扫描信号输出端输出噪声信号，提高信号的无损耗传输，降低功耗，进而提高显示面板的良率。
在具体实施时，本发明实施例提供的上述移位寄存器中，如图4所示，输出降噪模块06，可以具体包括：第一开关晶体管T1；第一开关晶体管T1的栅极与高电平信号端VGH相连，源极与第一节点P1相连，漏极与第三节点P3相连。
具体地，由于第一开关晶体管T1的栅极与高电平信号端VGH相连，因此第一开关晶体管T1处于常开状态，作为单管传输门工作，因此第一开关晶体管T1可以对第一节点P1的信号进行滤波降噪，并将滤波降噪后的信号传输到第三节点P3。
在具体实施时，本发明实施例提供的上述移位寄存器中，如图5所示，还可以包括：第一节点降噪模块07；第一节点降噪模块07连接于第一节点P1、高电平信号端VGH和第一开关晶体管T1的源极之间，第一节点降噪模块07用于在第一节点P1的控制下将高电平信号端VGH与第一开关晶体管T1的源极导通。
具体地，第一节点降噪模块07在第一节点的电位被拉高时，将高电平信号端VGH与第一开关晶体管T1的源极导通，即可以对第一节点P1的信号进行直流拉高，从而进一步滤波降噪，降低第一节点P1的信号噪声，进而将第一节点P1降噪后的信号输出到第一开关晶体管T1的源极，通过第一开关晶体管T1对信号再进行滤波降噪，进一步降低信号的噪声，提高信号的无损耗传输，从而降低功耗。
在具体实施时，本发明实施例提供的上述移位寄存器中，如图5所示，第一节点降噪模块07，可以具体包括：第二开关晶体管T2和第三开关晶体管T3；其中，第二开关晶体管T2的栅极与第一节点P1相连，源极与第三开关晶体管T3的漏极相连，漏极与第一开关晶体管T1的源极相连；第三开关晶体管T3的栅极和源极分别与高电平信号端VGH相连。
具体地，当第一节点P1的电位被拉高时，第二开关晶体管T2处于导通状态，而由于第三开关晶体管T3的栅极和源极分别与高电平信号端VGH相连，因此第三开关晶体管T3处于常开状态，作为单管传输门工作，因此在第一节点P1的电位被拉高时，高电平信号端VGH的信号通过第三开关晶体管T3和导通的第二开关晶体管T2输出到第一开关晶体管T1的源极，对第一开关晶体管T1的源极的信号进行直流拉高，进一步降低信号噪声，而不是将第一节点P1未经降噪的信号输出到第一开关晶体管T1的源极，这样可以降低第一开关晶体管T1的源极的信号的噪声。
在具体实施时，本发明实施例提供的上述移位寄存器中，如图6和图7所示，还可以包括：第二节点降噪模块08；第二节点降噪模块08连接于高电平信号端VGH、第二节点上拉模块03的输出端和第二节点P2之间，第二节点降噪模块08用于对第二节点上拉模块03的输出端的信号进行滤波降噪，将滤波降噪后的信号输出到第二节点P2，进一步降低第二节点P2的信号噪声。
具体地，第二节点降噪模块08在高电平信号端VGH的控制下处于常开状态，作为传输门工作，对第二节点上拉模块03的输出端的信号进行滤波降噪，并将滤波降噪后的信号输出到第二节点P2，进一步降低第二节点P2的信号噪声。
在具体实施时，本发明实施例提供的上述移位寄存器中，如图6和图7所示，第二节点降噪模块08，可以具体包括：第四开关晶体管T4；第四开关晶体管T4的栅极与高电平信号端VGH相连，源极与第二节点上拉模块03的输出端相连，漏极与第二节点P2相连。
具体地，由于第四开关晶体管T4的栅极与高电平信号端VGH相连，因此第四开关晶体管T4处于常开状态，作为单管传输门工作，对第二节点上拉模块03的输出端的信号进行滤波降噪，且将滤波降噪后的信号输出到第二节点P2，进一步降低第二节点P2的信号噪声。
在具体实施时，本发明实施例提供的上述移位寄存器中，如图6和图7所示，第二节点上拉模块03，可以具体包括：第五开关晶体管T5；第五开关晶体管T5的栅极与第一时钟信号端CLK相连，源极与高电平信号端VGH相连，漏极与第四开关晶体管T4的源极相连。
具体地，第二节点上拉模块03在第一时钟信号端CLK输入高电平信号时，第五开关晶体管T5处于导通状态，导通的第五开关晶体管T5将高电平信号端VGH与第四开关晶体管T4的源极导通，拉高第四开关晶体管T4的源极的电位，由于第四开关晶体管T4处于常开状态，因此可以拉高第二节点P2的电位。
在具体实施时，本发明实施例提供的上述移位寄存器中，如图6和图7所示，还可以包括：保护模块09；保护模块09连接于第一输入信号端Input1、第二信号输入端Input2、高电平信号端VGH和第二节点上拉模块03的输出端之间，保护模块09用于在第一信号输入端Input1或第二信号输入端Input2输入异常电流信号时，对异常电流信号进行分流。
具体地，保护模块09在移位寄存器正常工作时处于关闭状态，在第一信号输入端Input1或第二信号输入端Input2输入异常电流信号时，其中异常电流信号为高于正常电流信号的大电流信号，例如信号输入端正常输入信号为1V的信号，当信号输入端输入的信号为10V信号时，则信号输入端输入了异常信号，此时，输入的大电流信号可能损坏移位寄存器中的晶体管，因此保护模块09此时可以对异常电流信号进行分流，起保护作用，避免移位寄存器由于异常电流信号的输入而损坏。
在具体实施时，本发明实施例提供的上述移位寄存器中，如图6和图7所示，保护模块09，可以具体包括：第六开关晶体管T6和第七开关晶体管T7；其中，第六开关晶体管T6的栅极与第一信号输入端Input1相连，源极与高电平信号端VGH相连，漏极与第七开关晶体管T7的源极相连；
第七开关晶体管T7的栅极与第二信号输入端Input2相连，漏极与第二节点上拉模块03的输出端相连。
具体地，在移位寄存器正常工作时处于关闭状态，第六开关晶体管T6和第七开关晶体管T7均处于截止状态，在第一信号输入端Input1或第二信号输入端Input2输入大电流信号时，对应第六开关晶体管T6或第七开关晶体管T7处于导通状态，对输入的异常电流信号进行分流缓冲，对移位寄存器起保护作用，避免移位寄存器由于异常电流信号的输入而损坏。
在具体实施时，本发明实施例提供的上述移位寄存器中，如图6和图7所示，还可以包括：维持模块10；维持模块10的输入端与高电平信号端VGH相连，控制端和输出端分别与扫描信号输出端Out相连，维持模块10用于在扫描信号输出端Out输出扫描信号时，维持扫描信号输出端Out的电位。
具体地，当扫描信号输出端Out输出扫描信号时，维持模块10处于开启状态，将高电平信号端VGH与扫描信号输出端Out导通，进而将高电平信号输出到扫描信号输出端Out，进一步维持扫描信号输出端Out的电位。
在具体实施时，本发明实施例提供的上述移位寄存器中，如图6和图7所示，维持模10，可以具体包括：第八开关晶体管T8；第八开关晶体管T8的栅极和漏极分别与扫描信号输出端Out相连，源极与高电平信号端VGH相连。
具体地，当扫描信号输出端Out输出扫描信号时，第八开关晶体管T8处于导通状态，导通的第八开关晶体管T8将高电平信号端VGH与扫描信号输出端Out导通，进一步维持扫描信号输出端Out的电位。
在具体实施时，本发明实施例提供的上述移位寄存器中，如图6和图7所示，输出控制模块05，可以具体包括：第一输出控制模块051和第二输出控制模块052；其中，
第一输出控制模块051连接于第三节点P3、第二时钟信号端CLKB，以及扫描信号输出端Out之间，第一输出控制模块051用于在第三节点P3的控制下，控制扫描信号输出端Out输出第二时钟信号端CLKB的信号；
第二输出控制模块052连接于低电平信号端VGL、第二节点P2，以及扫描信号输出端Out之间，第二输出控制模块052用于在第二节点P2的控制下，控制扫描信号输出端Out输出低电平信号端VGL的信号。
具体地，第一输出控制模块051和第二输出控制模块052分别在第三节点P3和第二节点P2的控制下对应输出第二时钟信号端CLKB的信号和低电平信号端VGL的信号，实现移位寄存器在对应时间段向对应栅线输出扫描信号，驱动显示面板实现逐行扫描。
在具体实施时，本发明实施例提供的上述移位寄存器中，如图6和图7所示，第一输出控制模块051，可以具体包括：第九开关晶体管T9和第一电容C1；其中，第九开关晶体管T9的栅极与第三节点P3相连，源极与第二时钟信号端CLKB相连，漏极与扫描信号输出端Out相连；第一电容C1连接于第三节点P3与扫描信号输出端Out之间。
具体地，当第三节点P3的电位被拉高时，第九开关晶体管T9处于导通状态，导通的第九开关晶体管T9将第二时钟信号端CLKB与扫描信号输出端Out导通，同时第一电容C1对第三节点P3的电位起到自举作用，进一步保持第三节点P3的电位。
在具体实施时，本发明实施例提供的上述移位寄存器中，如图6所示，第二输出控制模块052，可以具体包括：第十开关晶体管T10；第十开关晶体管T10的栅极与第二节点P2相连，源极与低电平信号端VGL相连，漏极与扫描信号输出端Out相连。
具体地，当第二节点P2的电位被拉高时，第十开关晶体管T10处于导通状态，导通的第十开关晶体管T10将低电平信号端VGL与扫描信号输出端Out导通，同时通过第十开关晶体管T10的寄生电容也可以维持第二节点P2的电位。
在具体实施时，本发明实施例提供的上述移位寄存器中，如图7所示，第二输出控制模块052，还可以包括：第二电容C2；第二电容C2连接于第二节点P2和低电平信号端VGL之间。
具体地，当第二节点P2的电位被拉高时，第十开关晶体管T10处于导通状态，导通的第十开关晶体管T10将低电平信号端VGL与扫描信号输出端Out导通，同时第二电容C2可以进一步保持第二节点P2的电位，降低第二节点P2的电压信号的噪声。
在具体实施时，本发明实施例提供的上述移位寄存器中，如图6和图7所示，第二节点下拉模块04，可以具体包括：第一下拉模块041和第二下拉模块042；其中，第一下拉模块041的输入端与低电平信号端VGL相连，控制端与第一节点P1相连，输出端与第二节点P2相连，第一下拉模块041用于在第一节点P1的控制下拉低第二节点P2的电位；第二下拉模块042的输入端与低电平信号端VGL相连，控制端与扫描信号输出端Out相连，输出端与第二节点P2相连，第二下拉模块042用于在扫描信号输出端Out输出扫描信号时进一步拉低第二节点P2的电位。
具体地，第一下拉模块041和第二下拉模块042分别在第一节点P1的电位被拉高时和扫描信号输出端Out输出扫描信号时，拉低第二节点P2的电位，降低第二节点P2的信号噪声。
在具体实施时，本发明实施例提供的上述移位寄存器中，如图6和图7所示，第一下拉模块041，可以具体包括：第十一开关晶体管T11；第十一开关晶体管T11的栅极与第一节点P1相连，源极与低电平信号端VGL相连，漏极与第二节点P2相连。
具体地，在第一节点P1的电位被拉高时，第十一开关晶体管T11处于导通状态，导通的第十一开关晶体管T11将低电平信号端VGL与第二节点P2导通，拉低第二节点P2的电位，降低第二节点P2的信号的噪声。
在具体实施时，本发明实施例提供的上述移位寄存器中，如图6和图7所示，第二下拉模块042，可以具体包括：第十二开关晶体管T12；第十二开关晶体管T12的栅极与扫描信号输出端Out相连，源极与低电平信号端VGL相连，漏极与第二节点P2相连。
具体地，在扫描信号输出端Out输出扫描信号时，第十二开关晶体管T12处于导通状态，导通的第十二开关晶体管T12将低电平信号端VGL与第二节点P2导通，拉低第二节点P2的电位，降低第二节点P2的信号的噪声。
在具体实施时，本发明实施例提供的上述移位寄存器中，如图6和图7所示，输入模块01，可以具体包括：第十三开关晶体管T13和第十四开关晶体管T14；第十三开关晶体管T13的栅极与第一参考信号端CN相连，源极与第一信号输入端Input1相连，漏极分别与第十四开关晶体管T14的源极和第一节点P1相连；第十四开关晶体管T14的栅极与第二参考信号端CNB相连，源极与第二信号输入端Input2相连。
具体地，由于第十三开关晶体管T13和第十四开关晶体管T14的栅极分别与第一参考信号端CN和第二参考信号端CNB相连，因此正向扫描时第十三开关晶体管T13处于导通状态，当第一信号输入端Input1输入信号时，对应的处于导通状态第十三开关晶体管T13将第一信号输入端Input1与第一节点P1导通，进而将第一信号输入端Input1的信号输出到第一节点P1；反向扫描时第十四开关晶体管T14处于导通状态，当第二信号输入端Input2输入信号时，对应的处于导通状态第十四开关晶体管T14将第二信号输入端Input2与第一节点P1导通，进而将第二信号输入端Input2的信号输出到第一节点P1。
在具体实施时，本发明实施例提供的上述移位寄存器中，如图6和图7所示，第一节点下拉模块02，可以具体包括：第十五开关晶体管T15；第十五开关晶体管T15的栅极与第二节点上拉模块03的输出端相连，源极与低电平信号端VGL相连，漏极与输出降噪模块06的输入端相连。
具体地，在第二节点P2的电位被拉高时，即第二节点上拉模块03的输出端输出高电平信号时，第十五开关晶体管T15也处于导通状态，导通的第十五开关晶体管T15将低电平信号端VGL与输出降噪模块06的输入端导通，进而拉低输出降噪模块06的输入端的电位，由于输出降噪模块06处于常开状态，因此也拉低了第三节点P3的电位。
需要说明的是本发明上述实施例中提到的开关晶体管可以是薄膜晶体管(TFT，Thin Film Transistor)，也可以是金属氧化物半导体场效应管(MOS，Metal OxideScmiconductor)，在此不做限定。在具体实施中，这些晶体管的源极和漏极可以互换，不做具体区分。在描述具体实施例时以薄膜晶体管为例进行说明。
进一步地，由于在本发明实施例提供的上述移位寄存器中第一信号输入端Input1和第二信号输入端Input2为对称设计，可以实现功能互换，因此本发明实施例提供的上述移位寄存器可以实现双向扫描。
一般地，在启动正向扫描时，第一参考信号端CN提供高电平信号，第二参考信号端CNB提供低电平信号。一般地，在反向扫描时，第一参考信号端CN提供低电平信号，第二参考信号端CNB提供高电平信号。
下面结合图7所示的移位寄存器以及图8所示的图7的输入输出时序图，以正向扫描为例对本发明实施例提供的移位寄存器的工作过程作以描述。具体地，选取如图8所示的输入输出时序图中的t1～t3三个阶段。下述描述中以1表示高电平信号，0表示低电平信号。
在t1阶段，Input1＝1，CLKB＝0，CLK＝0，CN＝1，CNB＝0。由于CN＝1，因此第十三开关晶体管T13导通，导通的第十三开关晶体管T13将第一信号输入端Input1与第二开关晶体管T2的栅极导通，因此第二开关晶体管T2导通，而第三开关晶体管T3处于常开状态，因此高电平信号端VGH的信号通过第三开关晶体管T3和导通的第二开关晶体管T2输出到第一开关晶体管T1的源极，由于第一开关晶体管T1处于常开状态，因此第一节点P1的信号经过第一开关晶体管T1的滤波降噪后输出到第三节点P3，第三节点P3的电位被拉高，同时对第一电容C1充电，此时第九开关晶体管T9处于导通状态，导通的第九开关晶体管T9将第二时钟信号端CLKB与扫描信号输出端Out导通，由于此时CLKB＝0，因此扫描信号输出端Out输出低电平信号。t1阶段为充电阶段。
在t2阶段，Input1＝0，CLKB＝1，CLK＝0，CN＝1，CNB＝0。由于第一电容C1的自举作用，第三节点P3的电位进一步升高，因此第九开关晶体管T9仍处于导通状态，而此时CLKB＝1，因此，扫描信号输出端Out输出高电平信号。t2阶段为扫描信号输出阶段。
在t3阶段，Input1＝0，CLKB＝0，CLK＝1，CN＝1，CNB＝0。由于CLK＝1，因此第五开关晶体管T5导通，导通的第五开关晶体管T5将高电平信号端VGH与第四开关晶体管T4的源极导通，而第四开关晶体管T4处于常开状态，因此，高电平信号端VGH的信号经过滤波降噪后输出到第二节点P2，第二节点P2的电位被拉高，此时，第十开关晶体管T10处于导通状态，导通的第十开关晶体管T10将低电平信号端VGL与扫描信号输出端Out导通，因此扫描信号输出端Out输出低电平信号，同时由于第四开关晶体管T4的源极的电位被拉高，因此第十五开关晶体管T15处于导通状态，导通的第十五开关晶体管T15将第一开关晶体管T1的源极与低电平信号端VGL导通，因此第一开关晶体管T1的源极的电位被拉低，而第一开关晶体管T1处于常开状态，因此第三节点P3的电位被拉低，第九开关晶体管T9处于截止状态。t3阶段为非扫描信号输出阶段。
在后续时间段，扫描信号输出端Out将一直输出低电平信号，直到某个时间段第一信号输入端Input1再次输入高电平信号时，则该移位寄存器将重复上述工作工程。
基于同一发明构思，本发明实施例提供了一种栅极驱动电路，包括级联的多个本发明实施例提供的上述移位寄存器，除最后一个移位寄存器之外，其余每个移位寄存器的扫描信号输出端均向与其相邻的下一个移位寄存器的信号输入端输入触发信号。
为了方便说明，图9中仅示出了八个移位寄存器，分别为第1级移位寄存器、第2级移位寄存器、第3级移位寄存器、第4级移位寄存器、第N-3级移位寄存器、第N-2级移位寄存器、第N-1级移位寄存器、第N级移位寄存器。其中，除第N级移位寄存器外，其余每个移位寄存器的扫描信号输出端Out不仅向与其连接的栅线输出栅开启信号，还向与其相邻的下一级移位寄存器输出触发信号。
具体地，上述栅极驱动电路中的每个移位寄存器与本发明提供的上述移位寄存器在功能和结构上均相同，重复之处不再赘述。
基于同一发明构思，本发明实施例提供了一种显示面板，包括本发明实施例提供的上述栅极驱动电路。由于该显示面板解决问题的原理与栅极驱动电路相似，因此该显示面板的实施可以参见上述栅极驱动电路的实施，重复之处不再赘述。
基于同一发明构思，本发明实施例提供了一种显示装置，包括本发明实施例提供的上述显示面板。该显示装置可以应用于手机、平板电脑、电视机、显示器、笔记本电脑、数码相框、导航仪等任何具有显示功能的产品或部件。由于该显示装置解决问题的原理与显示面板相似，因此该显示装置的实施可以参见上述显示面板的实施，重复之处不再赘述。
本发明实施例提供了一种移位寄存器、栅极驱动电路、显示面板及显示装置，该移位寄存器包括输入模块、第一节点下拉模块、第二节点上拉模块、第二节点下拉模块、输出控制模块，以及输出降噪模块；其中，输入模块用于在信号输入端的控制下拉高第一节点的电位；第一节点下拉模块用于在第二节点的控制下拉低第一节点的电位；第二节点上拉模块用于在第一时钟信号端的控制下拉高第二节点的电位；第二下拉模块用于在第一节点和扫描信号输出端的控制下拉低第二节点的电位；输出控制模块用于在第三节点和第二节点的控制下，控制扫描信号输出端选择输出第二时钟信号端的信号或低电平信号端的信号，这样实现了移位寄存器在对应时间段输出扫描信号的功能，同时，输出降噪模块用于将第一节点的信号进行滤波降噪，且将滤波降噪后的信号传输到第三节点，从而输出控制模块在第三节点的控制下输出低噪声扫描信号，并且可以避免第一电容在较大的噪声信号的影响下使扫描信号输出端输出噪声信号，提高信号的无损耗传输，降低功耗，进而提高显示面板的良率。
显然，本领域的技术人员可以对本发明进行各种改动和变型而不脱离本发明的精神和范围。这样，倘若本发明的这些修改和变型属于本发明权利要求及其等同技术的范围之内，则本发明也意图包含这些改动和变型在内。

Claims (21)

1.一种移位寄存器，其特征在于，包括：输入模块、第一节点下拉模块、第二节点上拉模块、第二节点下拉模块、输出控制模块，以及输出降噪模块；其中，
所述输入模块的第一输入端与第一信号输入端相连，第二输入端与第二信号输入端相连，第一控制端与第一参考信号端相连，第二控制端与第二参考信号端相连，输出端与第一节点相连，所述输入模块用于在所述第一参考信号端或所述第二参考信号端的控制下拉高所述第一节点的电位；
所述第一节点下拉模块的输入端与低电平信号端相连，控制端与第二节点相连，输出端与所述第一节点相连，所述第一节点下拉模块用于在所述第二节点的控制下拉低所述第一节点的电位；
所述第二节点上拉模块的输入端与高电平信号端相连，控制端与第一时钟信号端相连，输出端与所述第二节点相连，所述第二节点上拉模块用于在所述第一时钟信号端的控制下拉高所述第二节点的电位；
所述第二节点下拉模块的第一输入端和第二输入端分别与所述低电平信号端相连，第一控制端与所述第一节点相连，第二控制端与扫描信号输出端相连，输出端与所述第二节点相连，所述第二节点下拉模块用于在所述第一节点和所述扫描信号输出端的控制下拉低所述第二节点的电位；
所述输出控制模块的第一输入端与所述低电平信号端相连，第二输入端与第二时钟信号端相连，第一控制端与第三节点相连，第二控制端与所述第二节点相连，输出端与所述扫描信号输出端相连，所述输出控制模块用于在所述第三节点或所述第二节点的控制下，控制所述扫描信号输出端选择输出所述第二时钟信号端的信号或所述低电平信号端的信号；
所述输出降噪模块的输入端与所述第一节点相连，控制端与所述高电平信号端相连，输出端与所述第三节点相连，所述输出降噪模块用于将所述第一节点的信号进行滤波降噪后输出到所述第三节点；
所述输出降噪模块，具体包括：第一开关晶体管；
所述第一开关晶体管的栅极与所述高电平信号端相连，源极与所述第一节点相连，漏极与所述第三节点相连；
所述移位寄存器还包括：第一节点降噪模块；
所述第一节点降噪模块连接于所述第一节点、所述高电平信号端和所述第一开关晶体管的源极之间，所述第一节点降噪模块用于对所述第一节点的信号进行进一步的滤波降噪后输出到所述第一开关晶体管的源极。
2.如权利要求1所述的移位寄存器，其特征在于，所述第一节点降噪模块，具体包括：第二开关晶体管和第三开关晶体管；其中，
所述第二开关晶体管的栅极与所述第一节点相连，源极与所述第三开关晶体管的漏极相连，漏极与所述第一开关晶体管的源极相连；
所述第三开关晶体管的栅极和源极分别与所述高电平信号端相连。
3.如权利要求1所述的移位寄存器，其特征在于，还包括：第二节点降噪模块；
所述第二节点降噪模块连接于所述高电平信号端、所述第二节点上拉模块的输出端和所述第二节点之间，所述第二节点降噪模块用于对所述第二节点上拉模块输出端输出的信号进行滤波降噪后输出到所述第二节点。
4.如权利要求3所述的移位寄存器，其特征在于，所述第二节点降噪模块，具体包括：第四开关晶体管；
所述第四开关晶体管的栅极与所述高电平信号端相连，源极与所述第二节点上拉模块的输出端相连，漏极与所述第二节点相连。
5.如权利要求4所述的移位寄存器，其特征在于，所述第二节点上拉模块，具体包括：第五开关晶体管；
所述第五开关晶体管的栅极与所述第一时钟信号端相连，源极与所述高电平信号端相连，漏极与所述第四开关晶体管的源极相连。
6.如权利要求1所述的移位寄存器，其特征在于，还包括：保护模块；
所述保护模块连接于所述第一信号输入端、所述第二信号输入端、所述高电平信号端和所述第二节点上拉模块的输出端之间，所述保护模块用于在所述第一信号输入端或所述第二信号输入端输入异常电流信号时，对异常电流信号进行分流。
7.如权利要求6所述的移位寄存器，其特征在于，所述保护模块，具体包括：第六开关晶体管和第七开关晶体管；其中，
所述第六开关晶体管的栅极与所述第一信号输入端相连，源极与所述高电平信号端相连，漏极与所述第七开关晶体管的源极相连；
所述第七开关晶体管的栅极与所述第二信号输入端相连，漏极与所述第二节点上拉模块的输出端相连。
8.如权利要求1所述的移位寄存器，其特征在于，还包括：维持模块；
所述维持模块的输入端与所述高电平信号端相连，控制端和输出端分别与所述扫描信号输出端相连，所述维持模块用于在所述扫描信号输出端输出扫描信号时，维持所述扫描信号输出端的电位。
9.如权利要求8所述的移位寄存器，其特征在于，所述维持模块，具体包括：第八开关晶体管；
所述第八开关晶体管的栅极和漏极分别与所述扫描信号输出端相连，源极与所述高电平信号端相连。
10.如权利要求1-9任一项所述的移位寄存器，其特征在于，所述输出控制模块，具体包括：第一输出控制模块和第二输出控制模块；其中，
所述第一输出控制模块连接于所述第三节点、所述第二时钟信号端，以及所述扫描信号输出端之间，所述第一输出控制模块用于在所述第三节点的控制下，控制所述扫描信号输出端输出所述第二时钟信号端的信号；
所述第二输出控制模块连接于所述低电平信号端、所述第二节点，以及所述扫描信号输出端之间，所述第二输出控制模块用于在所述第二节点的控制下，控制所述扫描信号输出端输出所述低电平信号端的信号。
11.如权利要求10所述的移位寄存器，其特征在于，所述第一输出控制模块，具体包括：第九开关晶体管和第一电容；其中，
所述第九开关晶体管的栅极与所述第三节点相连，源极与所述第二时钟信号端相连，漏极与所述扫描信号输出端相连；
所述第一电容连接于所述第三节点与所述扫描信号输出端之间。
12.如权利要求10所述的移位寄存器，其特征在于，所述第二输出控制模块，具体包括：第十开关晶体管；
所述第十开关晶体管的栅极与所述第二节点相连，源极与所述低电平信号端相连，漏极与所述扫描信号输出端相连。
13.如权利要求12所述的移位寄存器，其特征在于，所述第二输出控制模块，还包括：第二电容；
所述第二电容连接于所述第二节点和所述低电平信号端之间。
14.如权利要求1-9任一项所述的移位寄存器，其特征在于，所述第二节点下拉模块，具体包括：第一下拉模块和第二下拉模块；其中，
所述第一下拉模块的输入端与所述低电平信号端相连，控制端与所述第一节点相连，输出端与所述第二节点相连，所述第一下拉模块用于在所述第一节点的控制下拉低所述第二节点的电位；
所述第二下拉模块的输入端与所述低电平信号端相连，控制端与所述扫描信号输出端相连，输出端与所述第二节点相连，所述第二下拉模块用于在所述扫描信号输出端输出扫描信号时进一步拉低所述第二节点的电位。
15.如权利要求14所述的移位寄存器，其特征在于，所述第一下拉模块，具体包括：第十一开关晶体管；
所述第十一开关晶体管的栅极与所述第一节点相连，源极与所述低电平信号端相连，漏极与所述第二节点相连。
16.如权利要求14所述的移位寄存器，其特征在于，所述第二下拉模块，具体包括：第十二开关晶体管；
所述第十二开关晶体管的栅极与所述扫描信号输出端相连，源极与所述低电平信号端相连，漏极与所述第二节点相连。
17.如权利要求1-9任一项所述的移位寄存器，其特征在于，所述输入模块，具体包括：第十三开关晶体管和第十四开关晶体管；
所述第十三开关晶体管的栅极与所述第一参考信号端相连，源极与所述第一信号输入端相连，漏极分别与所述第十四开关晶体管的源极和所述第一节点相连；
所述第十四开关晶体管的栅极与所述第二参考信号端相连，源极与所述第二信号输入端相连。
18.如权利要求1-9任一项所述的移位寄存器，其特征在于，所述第一节点下拉模块，具体包括：第十五开关晶体管；
所述第十五开关晶体管的栅极与所述第二节点上拉模块的输出端相连，源极与所述低电平信号端相连，漏极与所述输出降噪模块的输入端相连。
19.一种栅极驱动电路，其特征在于，包括级联的多个如权利要求1-18任一项所述的移位寄存器，除最后一个移位寄存器之外，其余每个移位寄存器的扫描信号输出端均向与其相邻的下一个移位寄存器的信号输入端输入触发信号。
20.一种显示面板，其特征在于，包括如权利要求19所述的栅极驱动电路。
21.一种显示装置，其特征在于，包括如权利要求20所述的显示面板。
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